KR950015826A - 반도체 장치의 접촉부 형성방법 - Google Patents
반도체 장치의 접촉부 형성방법 Download PDFInfo
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Abstract
본 발명은 반도체 장치의 접촉부 형성방법에 관한것으로, 특히 스태틱램(RAM)을 구성하는 MOS트랜지스터에 연결되는 접촉부의 특성개선을 위한 오버에치(OVER ETCH)에 의한 접촉영역의 단절등을 개선하도록 오버에치후에 불순물 확산으로 접촉부의 특성을 보강하도록 한 반도체 장치의 접촉부 형성방법에 관한 것으로, 본 공정은 반도체 장치의 매립 접촉부 형성공정에 있어서, 접촉될 영역을 갖는 반도체층상에 절연층을 형성하고 상기 접촉영역에 대응하는 부분의 상가 절연층을 식각하여 접촉창을 형성하는 단계 ; 도전층을 데포지션하고 분술문도핑을 실시하여 접촉영역을 형성하는 단계, 상기 도전층을 사진식각방법으로 식각하여 도전저극을 패턴닝함과 아울러 상기 접촉창을 노출시켜서 접촉창부분을 오버에치하는 단계 ; 오버에치된 접촉부의 불순물 영역을 보강하도록 포클을 사용하여 열확산에 의해 불순물 영역을 보강하도록 하는 단계를 포함하는 것을 특징으로 한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도(a) 내지 (e)는 본 발명에 따른 반도체 장치의 접촉부 형성방법을 나타낸 공정도이다.
Claims (3)
- 반도체 장치의 매립 접촉부 형성공정에 있어서, 접촉될 영역을 갖는 반도체층상에 절연층을 형성하고 상기 접촉영역에 대응하는 부분의 상기 절연층을 식각하여 접촉창을 형성하는 단계; 도전층을 데포지션하고 불순물도핑을 실시하여 접촉영역을 형성하는 단계; 상기 도전층을 사진식각방법으로 식각하여 도전전극에 패턴닝함과 아울러 상기 접촉창을 노출시켜 접촉창부분을 오버에치하는 단계; 오버에치된 접촉부의 불순물 영역을 보강하도록 포클을 사용하여 열확산에 의해 불순물 영역을 보강하도록 하는 단계를 포함하는 것을 특징으로 하는 반도체 장치의 매립접촉부 형성방법.
- 제1항에 있어서, 상기 반도체 장치는 스태틱 RAM을 구성하는 MOS 트랜지스터이며 상기 도전층은 이에 연결되는 도전라인인 것을 특징으로 하는 반도체 장치의 매립접촉부 형성방법.
- 제1항에 있어서, 상기 접촉부의 접촉영역에서의 불순물영역은 포클에 의한 열확산공정으로 형성됨을 특징으로 하는 반도체 장치의 매립접촉부 형성방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
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KR93025434A KR970003744B1 (en) | 1993-11-26 | 1993-11-26 | Semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR93025434A KR970003744B1 (en) | 1993-11-26 | 1993-11-26 | Semiconductor device |
Publications (2)
Publication Number | Publication Date |
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KR950015826A true KR950015826A (ko) | 1995-06-17 |
KR970003744B1 KR970003744B1 (en) | 1997-03-21 |
Family
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Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR93025434A KR970003744B1 (en) | 1993-11-26 | 1993-11-26 | Semiconductor device |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR970003744B1 (ko) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
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JP3773773B2 (ja) | 1999-10-27 | 2006-05-10 | 三洋電機株式会社 | 画像信号処理装置及び画素欠陥の検出方法 |
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1993
- 1993-11-26 KR KR93025434A patent/KR970003744B1/ko not_active IP Right Cessation
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KR970003744B1 (en) | 1997-03-21 |
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