KR950013018A - 교차 결합 트랜지스터를 가진 차동 증폭기를 구성하는 주파수 보상 회로 - Google Patents

교차 결합 트랜지스터를 가진 차동 증폭기를 구성하는 주파수 보상 회로 Download PDF

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Abstract

본 발명은 차동 증폭기를 디링톤 차동 트랜지스터 쌍(T1/T3, T2/T4)및 상기 트랜지스터(T1/T3, T2/T4)의 상호 콘덕턴스를 증가시키는 교차 결합 트랜지스터 쌍(T5,T6)을 포함하며, 교차 결합 차동 트랜지스터 쌍이 설치되므로써 차동 증폭기의 부의 입력 임피던스가 고주파에서 보상되며, 차동 증폭기의 이득이 교차 결합 차동 트랜지스터 쌍(T5,T6)의 제어 전극 사이의 캐패시터(30) 및 상기 제어 전극과 직렬인 저항(26,28)을 가지는 보상 회로에 의해 감소된다.

Description

교차 결합 트랜지스터를 가진 차동 증폭기를 구성하는 주파수 보상 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 본 발명에 따른 차동 증폭기의 제1 실시예를 도시한 도면,
제5도는 본 발명에 따른 차동 증폭기의 제2 실시예를 도시한 도면.

Claims (5)

  1. 입력 신호를 출력 신호로 증폭하는 차동 증폭기로서, 입력 신호를 수신하는 제1 입력단자(2) 및 제2 입력단자(4), 출력 신호를 공급하는 제1 출력단자(14) 및 제2 출력단자(18), 제1 주전극, 제2 주전극 및 제어전극을 각각 가지는데, 상기 제어 전극이 제1 입력단자(2)에 접속된 제1 트랜지스터(T1), 제2 입력단자에 접속된 제2 트랜지스터(T2), 각기 제1 주전극, 제2 주전극 및 제어 전극을 가지는 제3 트랜지스터(T3) 및 제4 트랜지스터(T4)로서, 제3 트랜지스터의 제어 전극이 제1 트랜지스터의 제1 주전극에 접속되며, 제4 트랜지스터의 제어 전극이 제2 트랜지스터의 주전극에 접속되며, 제3 트랜지스터의 제1 주전극 및 제4 트랜지스터의 제1 주전극이 바이어스 전류를 수신하도록 제 1노드에 접속되며, 제3 트랜지스터의 제2 주전극은 제1 출력단자(14)에 결합되며, 제4 트랜지스터의 제2주전극이 제2 출력단자(18)에 결합되게한 제3 및 트랜지스터(T3)및 제4 트랜지스터(T4), 각기 제1주전극, 제2주전극 및 제어 전극을 가지는 제5 트랜지스터(T5) 및 제6트랜지스터(T6)로서 제5 트랜지스터의 제어전극이 제1 트랜지스터의 제1 주전극에 접속되며, 제6트랜지스터의 제어 전극이 제2 트렌지스터의 제1 주전극에 접속되며, 제5트랜지스터 제1 주전국 및 제6트랜지스터의 제1 주전극이 바이어스 전류를 수신하도록 제2 노드(22)에 접속되며, 제5트랜지스터 제2주전극이 제2 트랜지스터의 제1주전극에 접속되며, 제6트랜지스터의 제2주전극이 제1트랜지스터의 제1주전극에 접속되게한 제5트랜지스터(T5) 및 제6트랜지스터(T6)를 포함하는 차동 증폭기에 있어서, 제5트랜지스터(T5)의 제어전극과 제1 트랜지스터의 제1주전극 사이에 접속된 제1 저항(26), 제6트랜지스터 제어전극과 제2 트랜지스터의 제1주전극 사이에 접속된 제2저항(28), 및 제5트랜지스터의 제어 전극과 제6트랜지스터의 제어 전극 사이에 접속된 캐패시터(30)를 추가로 포함하는 것을 특징으로 하는 차동 증폭기.
  2. 제1항에 있어서, 상기 제1 노드(8)는 제1 전류원(10)에 접속되며, 제2 노드(22)는 제2전류원(24)에 접속되는 것을 특징으로 하는 차동 증폭기.
  3. 제1항에 있어서, 제1 노드(8) 및 제2 노드(22)는 공통 전류원(36)에 접속되며, 제3 트랜지스터(T3)및 제4 트랜지스터(T4)의 치수는 제5트랜지스터(T5)와 제6트랜지스터(T6)의 치수와 같거나 큰 것을 특징으로 하는 차동 증폭기.
  4. 제1항에 있어서, 제1 노드(8)가 전류원(36)에 결합되며, 제2 노드(22)가 제 3저항을 통해 전류원(36)에 결합되는 것을 특징으로 하는 차동 증폭기.
  5. 제4항에 있어서, 제1노드(8)가 제4저항(40)을 통해 전류원(36)에 결합되는 것을 특징으로 하는 차동 증폭기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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