KR950006858A - 반도체 기억회로 - Google Patents
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Abstract
비트선쌍이 충분히 활성화 되는 것을 감지하여 Y 데토더를 활성화 시키므로서 고속 액세스를 가능케 하고, 또한 셀정보의 파괴를 일으키는 일이 없는 반도체 기억회로를 제공한다.
비트선쌍 BLm,-BLm와 이 비트선상의 전위차를 검지하고 증폭하는 센스앰프(50)과, 소정의 비트선쌍을 선택하는 Y 데코더(ADY)와를 갖는 반도체 기억 회로에 있어서, 상기 센스앰프(50)의 활성화 신호 ΦA, ΦB에 의해 기동하고, 상기 비트선쌍의 전위차가 소정의 크기로 됐을 때 검지신호 P1을 출력하는 비트선쌍 전위차 감지회로(150)을 상기 비크선쌍 BLm,-BLm간에 각각 설치하고, 상기 검지신호 P1에 의해 상기 Y 데코더(ADY)의 선택동작을 제어하는 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도의 (a) 본 발명의 일실시예의 메모리셀 어레이와 그 관련회로의 개략 구성도, (b) Y 데코더와 회로열을 표시하는 도면.
제2도는 비트선상 전위차 감지회로의 회로도.
Claims (1)
- 비트선쌍과, 이 비트선쌍의 전위차를 검지하고 증폭하는 센스앰프와, 소정의 비트선쌍을 선택하는 Y 데코더와를 가지는 반도체 기억회로에 있어서, 상기 센스앰프의 활성화 신호에 의해 기동하고, 상기 비트선쌍의 전위차가 소정의 크기로 됐을 때 검지신호를 출력하는 비트선상 전위차 감지회로를 상기 비트선쌍간에 각각 설치하고, 상기 검지신호에 의해 Y 데코더의 선택동작을 제어하는 것을 특징으로 하는 반도체 기억회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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