KR950004277A - 데이타 출력 장치 - Google Patents
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- G11C7/1057—Data output buffers, e.g. comprising level conversion circuits, circuits for adapting load
Abstract
본 발명은 다비트 데이타 출력 버터를 갖는 반도체 기억소자에서, 동시에 두개 이상의 데이타 출력 버퍼로 리드 데이타를 출력하는 경우에 발생하는 전원선의 노이즈를 감소시키기 위하여, 출력되는 리드 데이타를 검색하여 리드 데이타가 동일한 경우에는 작은 크기의 출력 드라이버를 이용하고, 리드 데이타가 다른 경우에는 큰 크기의 출력 드라이버를 이용하여 데이타를 출력하도록 데이타 출력 버퍼를 구현한 데이타 출력 장치에 관한 기술이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 데이타 검색회로와 데이타 출력 버퍼의 실시예를 도시한 회로도, 제4A도 내지 제4B도는 본 발명의 데이타 출력 버퍼가 동작할 때에 발생하는 전원선의 노이즈 시뮬레이션도.
Claims (7)
- 반도체 기억소자의 다비트 데이타 출력 장치에 있어서, 출력하고자 하는 데이타를 검색하는 데이타 검색회로와, 상기 데이타 검색회로의 출력을 입력으로 하는 각각의 데이타 출력 버퍼에서 풀-업 드라이버는 서로 다른 신호에 의해 게이트가제어되는 두개의 트랜지스터로 이루어져 있으며, 두개의 트랜지스터는 리드되는 다비트 출력 데이타가 서로 동일한 경우에는 하나만 동작을 하고, 다비트 출력 데이타가 서로 다른 경우에는 두개의 트랜지스터가 모두 동작하도록 구현한 두개이상의 데이타 출력 버퍼로 이루어진 것을 특징으로 하는 데이타 출력 장치.
- 제1항에 있어서, 상기 데이타 검색회로는 데이타 출력 버퍼로 출력하고자 하는 리드 데이타(D31,D32)를 입력으로 하여 제1출력(AA)를 출력하는 낸드 게이트(NAND Gate)와, 데이타 출력 버퍼로 출력하고자 하는 리드 데이타(D31,D32)를 입력으로하여 제2출력(BB)을 출력하는 노아 게이트(NOR Gate)로 구성된 것을 특징으로 하는 데이타 출력 장치.
- 제1항에 있어서, 상기 데이타 출력 버퍼의 풀-업 드라이버는, 리드 데이타(D31)에 의해 출력된 풀-업 리드 데이타(D31a)가 반전된 신호에 의해 게이트가 제어되는 제1PMOS 트랜지스터(T1)와, 상기 풀-업 리드 데이타(D31a)와 데이타 검색회로의 제1출력(AA)을 입력으로 한 게이트(G2)의 출력에 의해 제어되는 제2PMOS 트랜지스터(T2)로 이루어지는 것을 특징으로하는 데이타 출력 장치.
- 반도체 기억소자의 다비트 데이타 출력 장치에 있어서, 출력하고자 하는 데이타를 검색하는 데이타 검색회로와, 상기 데이타 검색회로의 출력을 입력으로 하는 각각의 데이타 출력 버퍼에서 풀-다운 드라이버는 서로 다른 신호에 의해 게이트가 제어되는 두개의 트랜지스터로 이루어져 있으며, 두개의 트랜지스터는 리드되는 다비트 출력 데이타가 서로 동일한 경우에는 하나만 동작을 하고, 다비트 출력 데이타가 서로 다른 경우에는 두개의 트랜지스터가 모두 동작하도록 구현한 두개 이상의 데이타 출력 버퍼로 이루어진 것을 특징으로 하는 데이타 출력 장치.
- 제4항에 있어서, 상기 데이타 검색회로는 데이타 출력 버퍼로 출력하고자 하는 리드 데이타(D31,D32)를 입력으로 하여 제1출력(AA)을 출력하는 낸드 게이트(NAND Gate)와, 데이타 출력 버퍼로 출력하고자 하는 리드 데이타(D31,D32)를 입력으로하여 제2출력(BB)을 출력하는 노아 게이트(NOR Gate)로 구성된 것을 특징으로 하는 데이타 출력 장치.
- 제4항에 있어서, 상기 데이타 출력 버퍼의 풀-다운 드라이버는, 리드 데이타(D31)에 의해 출력된 풀-다운 리드 데이타(D31b)가 반전된 신호에 의해 게이트가 제어되는 제1NMOS 트랜지스터(T3)와, 상기 풀-다운 리드 데이타(D31b)와 데이타검색회로의 제2출력(BB)을 입력으로 한 게이트(G4)의 출력에 의해 제어되는 제2NMOS 트랜지스터(T4)로 이루어지는 것을특징으로 하는 데이타 출력 장치.
- 반도체 기억소자의 데이타 출력 장치에 있어서, 출력하고자 하는 데이타를 검색하는 데이타 검색회로와, 상기 데이타 검색회로의 출력을 입력으로 하는 각각의 데이타 출력 버퍼에서 풀-업 드라이버는 서로 다른 신호에 의해 게이트가 제어되는 두개의 트랜지스터로 이루어져 있으며, 두개의 트랜지스터는 리드되는 다비트 출력 데이타가 서로 동일한 경우에는 하나만 동작을 하고, 다비트 출력 데이타가 서로 다른 경우에는 두개의 트랜지스터가 모두 동작하도록 구현하고, 풀-다운드라이버는 서로 다른 신호에 의해 게이트가 제어되는 두개의 트랜지스터로 이루어져 있으며, 두개의 트랜지스터는 리드되는 다비트 출력 데이타가 서로 동일한 경우에는 하나만 동작을 하고, 다비트 출력 데이타가 서로 다른 경우에는 두개의트랜지스터가 모두 동작하도록 구현한 두개 이상의 데이타 출력 버퍼로 이루어진 것을 특징으로 하는 데이타 출력 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019930014016A KR950010626B1 (ko) | 1993-07-23 | 1993-07-23 | 데이타 출력 장치 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019930014016A KR950010626B1 (ko) | 1993-07-23 | 1993-07-23 | 데이타 출력 장치 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR950004277A true KR950004277A (ko) | 1995-02-17 |
KR950010626B1 KR950010626B1 (ko) | 1995-09-20 |
Family
ID=19359893
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019930014016A KR950010626B1 (ko) | 1993-07-23 | 1993-07-23 | 데이타 출력 장치 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR950010626B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100684896B1 (ko) * | 2005-04-20 | 2007-02-20 | 삼성전자주식회사 | 반도체 메모리 장치의 출력버퍼회로 |
-
1993
- 1993-07-23 KR KR1019930014016A patent/KR950010626B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100684896B1 (ko) * | 2005-04-20 | 2007-02-20 | 삼성전자주식회사 | 반도체 메모리 장치의 출력버퍼회로 |
Also Published As
Publication number | Publication date |
---|---|
KR950010626B1 (ko) | 1995-09-20 |
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