KR950003974A - 정보 처리 장치 - Google Patents
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- 238000000034 method Methods 0.000 claims 1
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- 238000010586 diagram Methods 0.000 description 2
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Abstract
본 발명의 목적은 인터럽트를 이용하지 안혹 타이머의 출력신호에 동기하여 처리가능한 파이프라인 처리 방식의 정보처리 장치를 제공함에 있다.
파이프라인의 실행을 일시 정지하는 일시 정지명령을 명령 세트에 갖고, 동시에 파이프라인의 실행 및 정지를 제어하는 파이프라인 제어수단을 구비하고, 파이프라인 제어수단이 일시 정지 명령의 실행에 의해 출력되는 일시 정지 신호에 기초하여 파이프라인의 각 스테이지를 정지상태로 설정함과 동시에, 일시 정지 명령에 의해 지정된 파이프라인 실행 재개수단이 출력하는 펄스 신호에 기초하여 정지상태에 있는 파이프라인의 각 스테이지를 실행 상태로 설정한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 정보 처리장치의 제1실시예의 블럭도, 제2도는 제1실시예의 동작을 도시한 타이밍챠트, 제5도는 본 발명의 제3실시예의 블럭도.
Claims (8)
- 명령 실행 과정을 복수 스테이지로 분할하여 파이프라인 처리하는 정보 처리 장치에 있어서, 상기 정보 처리장치가 파이프라인의 실행을 일시 정지하는 일시 정지 명령을 명령 세트에 갖고, 또한 파이프라인의 실행 및 정지를 제어하는 파이프라인 제어수단을 구비하고, 상기 파이프라인 제어 수단이 상기 일시 정지 명령의 실행에 의해 출력되는 일시 정지 신호에 기초하여 파이프라인의 각 스테이지를 정지 상태로 설정함과 동시에, 상기 일시 정지 명령에 의해 지정된 파이프라인 실행 재개 수단의 출력 신호에 기초하여 정지 상태에 있는 상기 파이프 라인의 각 스테이지를 실행 상태로 설정하는 것을 특징으로 하는 정보 처리 장치.
- 제1항에 있어서, 상기 일시 정지 명령이 오퍼랜드부에서 상기 파이프라인 실행 재개수단을 지정하는 것을 특징으로 하는 정보 처리 장치.
- 제1항 또는 제 2항에 있어서, 상기 파이프라인 제어 수단이 파이프라인의 일시 정지의 설정 및 해제를 기억하기 위한 기억 수단을 구비하고, 파이프라인의 명령 디코드 스테이지로부터 출력되는 상기 일시 정지 명령의 디코드 신호가 상기 기억 수단의 세트 단자에 입력되어 이 기억 수단의 출력 신호에 따라 파이프 라인의 각 스테이지 레지스터의 기록을 금지함과 동시에, 상기 일시 정지 명령에 의해 지정된 상기 파이프라인 재개 수단의 출력 신호가 상기 기억 수단의 리셋 단자에 입력되어 이 기억 수단의 출력 신호에 의해 파이프라인의 각 스테이지 레지스터의 기록을 허가하는 것을 특징으로 하는 정보 처리장치.
- 제1항 또는 제2항에 있어서, 상기 파이프라인 제어 수단이 파이프라인의 일시 정지의 설정 및 해제를 기억하기 위한 기억 수단과 게이트 수단을 구비하고, 파이프라인의 명령 디코드 스테이지로부터 출력되는 상기 일시 정지 명령의 디코드 신호가 상기 기억수단의 세트 단자에 입력되어 이 기억 수단의 출력 신호에 따라 파이프라인의 각 스테이지 레이스터의 기록을 금지함과 동시에, 상기 일시 정지 명령에 의해 지정된 상기 파이프라인 재개 수단의 출력신호가 상기 기억수단의 리셋단자 및 상기 게이트 수단에 입력되어 이 게이트 수단의 출력 신호에 의해 파이프 라인의 각 스테이지 레지스터의 기록을 허가하는 것을 특징으로 하는 정보 처리 장치.
- 제1항 또는 제2항에 있어서, 상기 파이프라인 제어 수단이 파이프라인의 일시 정지의 설정 및 해제 하기 위한 게이트 수단을 구비하고, 파이프라인의 실행 스테이지로부터 출력되는 상기 일시 정지 명령의 디코드 신호가 상기 게이트 수단에 입력되어 이 게이트 수단의 출력에 기초하여 파이프라인의 각 스테이지 레지스터의 기록을 금지함과 동시에, 상기 일시 정지 명령에 의해 지정된 상기 파이프라인 재게 수단의 출력신호가 상기 게이트 수단으로 입력되어 이 게이트 수단의 출력에 기초하여 파이프 라인의 각 스테이지 레지스터의 기록을 허가하는 것을 특징으로 하는 정보 처리 장치.
- 재1항 또는 제2항에 있어서, 상기 파이프라인 제어 수단이 상기 일시 정지 명령의 오퍼랜드에서 지정된 상기 파이프라인 실행 재개 수단을 선택하기 위한 선택 수단을 구비한 것을 특징으로 하는 정보 처리 장치.
- 제1항 또는 제2항에 있어서, 상기 일시 정지 명령의 파이프라인의 실행 제2스테이지로의 전송시, 후단의 명령이 일시 정지 명령이 아닐 때에 상기 파이프라인 실행 재개 수단의 지정이 리셋되는 것을 특징으로 하는 정보 처리장치.
- 제1항 또는 제2항에 있어서, 상기 파이프라인 실행 재개 수단이 소정 주기 의 펄스 신호를 발생하는 1 또는 복수의 타이머 수단으로 이루어지는 것을 특징으로 하는 정보 처리 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5165612A JP2748822B2 (ja) | 1993-07-05 | 1993-07-05 | 情報処理装置 |
JP93-165612 | 1993-07-05 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR950003974A true KR950003974A (ko) | 1995-02-17 |
KR0136019B1 KR0136019B1 (ko) | 1998-06-15 |
Family
ID=15815675
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940015894A KR0136019B1 (ko) | 1993-07-05 | 1994-07-04 | 정보 처리 장치 |
Country Status (5)
Country | Link |
---|---|
US (1) | US5579498A (ko) |
EP (1) | EP0633522B1 (ko) |
JP (1) | JP2748822B2 (ko) |
KR (1) | KR0136019B1 (ko) |
DE (1) | DE69424092T2 (ko) |
Families Citing this family (21)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
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KR100237642B1 (ko) * | 1996-12-30 | 2000-01-15 | 구자홍 | 파이프라인 정지회로를 구비한 프로세서 |
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---|---|---|---|---|
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-
1993
- 1993-07-05 JP JP5165612A patent/JP2748822B2/ja not_active Expired - Lifetime
-
1994
- 1994-07-04 KR KR1019940015894A patent/KR0136019B1/ko not_active IP Right Cessation
- 1994-07-05 EP EP94110435A patent/EP0633522B1/en not_active Expired - Lifetime
- 1994-07-05 DE DE69424092T patent/DE69424092T2/de not_active Expired - Fee Related
-
1996
- 1996-03-18 US US08/617,427 patent/US5579498A/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
JP2748822B2 (ja) | 1998-05-13 |
KR0136019B1 (ko) | 1998-06-15 |
US5579498A (en) | 1996-11-26 |
JPH0721021A (ja) | 1995-01-24 |
DE69424092D1 (de) | 2000-05-31 |
EP0633522A1 (en) | 1995-01-11 |
EP0633522B1 (en) | 2000-04-26 |
DE69424092T2 (de) | 2001-02-01 |
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