KR940017887A - 동화상 복호 장치 - Google Patents
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- H01L2924/1435—Random access memory [RAM]
- H01L2924/1436—Dynamic random-access memory [DRAM]
Abstract
화상 이미지 상의 수평 어드레스(X)를 하위측(LSB)에, 수직 어드레스(Y)를 상위측(MSB)에 배열하고, 동기형 DRAM의 하위측의 컬럼 어드레스(C) 및 상위측의 로우 어드레스(R)에 대해 상기 수평 어드레스(X) 및 수직 어드레스(Y)를 할당할 때, 뱅크 전환 어드레스(BS)를 상기 수평 어드레스(X)의 최상위 비트와 로우 어드레스(R)의 최하위 비트와의 사이의 BS 할당 범위 내에 위치시킨다.
데이타의 연속 독출이 가능해지고, 고속 억세스를 달성할 수 있으며, 또 데이타 버스의 사용 효율을 향상시킬 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 관한 동화상(動畵像) 복호 장치의 구성을 도시한 블럭 회로도, 제2도는 동기형(Synchronous) DRAM의 화상 이미지를 도시한 도면, 제3도는 화상 이미지 상의 좌표에서 8×8크기의 데이타 블럭을 도시한 도면, 제4도는 SDRAM의 기본적인 기능을 설명하기 위한 타이밍챠트, 제5도는 본 실시예에 적용되는 SDRAM의 어드레스 할당을 도시한 도면, 제6도는 제5도에 도시한 어드레스 할당의 구체적인 예를 도시한 도면, 제7도는 제6도에 도시한 어드레스 할당을 사용한 SDRAM의 타이밍챠트, 제8도는 제6도에 도시한 어드레스 할당의 구체예에 의한 데이타 출력을 설명하기 위한 도면, 제9도는 제5도에 도시한 어드레스 할당의 구체예를 도시한 도면.
Claims (4)
- 화상 메모리에 대해 화상 데이타의 기입/독출을 행하여 동화상의 복호 처리를 행하는 동화상 복호 장치에 있어서, 상기 화상 메모리로서, 복수의 탱크를 가지고 이들 복수의 각 뱅크에 대해 공통의 열 어드레스 및 행 어드레스에 의해 억세스되어 각 뱅크가 뱅크 전환 어드레스에 의해 지정되는 동기형 DRAM을 사용하는 것을 특징으로 하는 동화상 복호 장치.
- 제1항에 있어서, 화상 이미지 상의 수평 어드레스를 하위측에, 수직 어드레스를 상위측에 배열하며, 상기 화상 메모리로서 사용되는 상기 동기형 DRAM의 하위측에 열 어드레스 및 상위측의 행 어드레스에 대해 상기 수평 어드레스 및 수직 어드레스를 할당할 때, 상기 뱅크 전환 어드레스 비트를 상기 수평 어드레스의 최상위 비트와 상기 행 어드레스의 최하위 비트 사이에 할당하는 것을 특징으로 하는 동화상 복호 장치.
- 제1항에 있어서, 화상 이미지 상의 수평 어드레스를 하위측에, 수직 어드레스를 상위측에 배열하여, 상기 화상 메모리로서 사용되는 상기 동기형 DRAM의 하위측의 열 어드레스 및 상위측의 행 어드레스에 대해 상기 수평 어드레스 및 수직 어드레스를 할당할 때, 상기 뱅크 전환 어드레스 비트를 상기 열 어드레스와 상기 행 어드레스 사이에 할당하는 것을 특징으로 하는 동화상 복호 장치.
- 제1항에 있어서, 화상 이미지 상의 수평 어드레스를 하위측에, 수직 어드레스를 상위측에 배열하여, 상기 화상 메모리로서 사용되는 상기 동기형 DRAM의 하위측의 열 어드레스 및 상위측의 행 어드레스에 대해 상기 수평 어드레스 및 수직 어드레스를 할당할 때, 상기 뱅크 전환 어드레스 비트를 상기 수직 어드레스의 최하위 비트에 할당하는 것을 특징으로 하는 동화상 복호 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP92-334768 | 1992-12-01 | ||
JP33476892A JPH06189292A (ja) | 1992-12-15 | 1992-12-15 | 動画像復号装置 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR940017887A true KR940017887A (ko) | 1994-07-27 |
Family
ID=18281019
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019930027779A KR940017887A (ko) | 1992-12-01 | 1993-12-15 | 동화상 복호 장치 |
Country Status (5)
Country | Link |
---|---|
US (1) | US6008850A (ko) |
EP (1) | EP0602588A3 (ko) |
JP (1) | JPH06189292A (ko) |
KR (1) | KR940017887A (ko) |
CN (1) | CN1091884A (ko) |
Families Citing this family (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100203243B1 (ko) * | 1995-07-31 | 1999-06-15 | 윤종용 | 에스디알에이엠에 프레임의 영상신호를 기록하는 방법 |
JP3686155B2 (ja) * | 1996-03-21 | 2005-08-24 | 株式会社ルネサステクノロジ | 画像復号装置 |
US6307588B1 (en) * | 1997-12-30 | 2001-10-23 | Cognex Corporation | Method and apparatus for address expansion in a parallel image processing memory |
KR100282389B1 (ko) * | 1997-12-31 | 2001-02-15 | 구자홍 | 에이치디티브이 비디오 디코더의 메모리 제어 방법 |
JP5147102B2 (ja) * | 2005-05-30 | 2013-02-20 | 株式会社メガチップス | メモリアクセス方法 |
KR101136900B1 (ko) * | 2005-06-28 | 2012-04-20 | 엘지디스플레이 주식회사 | 오버 드라이빙 구동장치 및 구동방법 |
JP5700228B2 (ja) * | 2013-03-13 | 2015-04-15 | コニカミノルタ株式会社 | メモリ制御装置および画像形成装置 |
TWI806641B (zh) * | 2022-01-11 | 2023-06-21 | 旺宏電子股份有限公司 | 記憶體裝置及其操作方法 |
Family Cites Families (9)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2555141B2 (ja) * | 1988-04-15 | 1996-11-20 | 株式会社日立製作所 | 画像処理装置 |
US5195182A (en) * | 1989-04-03 | 1993-03-16 | Eastman Kodak Company | Frame buffer architecture for storing sequential data in alternating memory banks |
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US5353063A (en) * | 1990-04-04 | 1994-10-04 | Canon Kabushiki Kaisha | Method and apparatus for processing and/or displaying image data based on control data received with the image data |
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US5247355A (en) * | 1992-06-11 | 1993-09-21 | Northwest Starscan Limited Partnership | Gridlocked method and system for video motion compensation |
-
1992
- 1992-12-15 JP JP33476892A patent/JPH06189292A/ja not_active Withdrawn
-
1993
- 1993-12-14 US US08/168,087 patent/US6008850A/en not_active Expired - Fee Related
- 1993-12-14 EP EP19930120123 patent/EP0602588A3/en not_active Withdrawn
- 1993-12-15 KR KR1019930027779A patent/KR940017887A/ko not_active Application Discontinuation
- 1993-12-15 CN CN93121128A patent/CN1091884A/zh active Pending
Also Published As
Publication number | Publication date |
---|---|
EP0602588A2 (en) | 1994-06-22 |
JPH06189292A (ja) | 1994-07-08 |
US6008850A (en) | 1999-12-28 |
CN1091884A (zh) | 1994-09-07 |
EP0602588A3 (en) | 1994-12-07 |
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Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E601 | Decision to refuse application |