KR930018543A - 비디오 신호 자동이득 제어(agc)회로 - Google Patents

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Abstract

비디오 신호 AGC 회로는 입력 아나로그 비디오 신호의 레벨을 조정하는 아나로그 이득 제어 증폭기와, 상기 아나로그 제어 증폭기의 출력을 디지탈 비디오 신호로 변환하는 A-D변환기와, 상기 A-D 변환기로부터 출력되는 상기 디지탈 비디오 신호의 레벨을 조정하는 디지탈 이득 제어 증폭기와, 동기 레벨 검출기의 출력에 근거하여 상기 아나로그 이득 제어 증폭기의 이득을 조정하기 위해 제1제어 신호를 발생시키는 제1제어 신호 발생기및 상기 동기 레벨 검출기의 출력에 근거하여 상기 디지탈 이득 제어 증폭기의 이득을 조정하기 위한 제2제어 신호를 발생시키는 제2제어신호 발생기를 구비한다. 이 AGC회로에서, 상기 동기 레벨 검출기는 상기 A-D변환기의 출력의 동깅 신호를 검출하는 수단과, 상기 동기 신호에 근거하여 페데스탈(pedestal)레벨에 대응하는 페데스탈 데이타를 검출하는 수단 및, 상기 동기 신호에 기초하여 동기 팁 레벨(sync tip level)에 대응하는 동기팁 데이타를 검출하는 수단을 포함한다.

Description

비디오 신호 자동이득 제어(AGC)회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 비디오 AGC 회로를 나타내는 제1실시예의 블럭도, 제2도는 제1도의 제1실시예에서 사용된 마이크로 컴퓨터의 동작을 도시한 흐름도, 제3도는 본 발명의 비디오 레벨 제어회로를 나타내는 제2실시예의 블럭도, 제4도는 제3도의 제2실시예에서 사용된 마이크로 컴퓨터의 동작을 도시한 흐름도.

Claims (21)

  1. 비디오 신호 AGC(자동 이득 제어)회로에 있어서, 입력 아나로그 비디오 신호 레벨을 조정하기 위한 아나로그 이득 제어 증폭기와: 상기 아나로그 이득 제어 증폭기의 출력을 디지탈 비디오 신호로 변환키 위한 A-D변환기와: 상기 A-D변환기로부터 출력된 디지탈 비디오 신호의 동기 레벨을 검출키 위한 동기 신호 검출기와: 상기 A-D변환기로부터 출력된 디지탈 비디오 신호의 레벨을 조정하기 위한 디지탈 이득 제어 증폭기와: 상기 아나로그 이득 제어 증폭기 이득을 조정하기 위해, 상기 동기 레벨 검출기 출력에 근거하여, 제1제어 신호를 발생키 위한 제1제어 신호 발생기 및: 상기 디지탈 이득 제어 증폭기 이득을 조정하기 위해, 상기 동기 레벨 검출기 출력에 근거하여, 제2제어 신호를 발생키 위한 제2제어 신호 발생기를 구비하는 비디오 신호 AGC회로.
  2. 제1항에 있어서, 상기 동기 레벨 검출기가 상기 A-D 변환기 출력중 동기 신호를 검출하기 위한 수단과, 상기 동기 신호에 근거하여, 페데스탈 레벨에 대응한 페데스타를 검출키 위한 수단 및, 상기 동기 신호에 근거하여, 동기 팁 레벨에 대응한 동기 팁 데이타를 검출키 위한 수단을 구비하는 비디오 신호 AGC 회로.
  3. 제2항에 있어서, 상기 페데스탈 데이타와 상기 동기 팁 데이타 간의 차에 근거하여 디지탈 동기 레벨을 검출키 위한 수단과, 소정의 동기 레벨을 기억하기 위한 메모리를 더 구비하며, 여기서 상기 제1및 제2제어 신호들이 검출된 디지탈 동기 레벨과 소정의 동기 레벨 간의 차에 근거하여 발생되는 비디오 신호 AGC 회로.
  4. 제3항에 있어서, 상기 제1제어 신호 발생기, 제2제어 신호 발생기, 디지탈 동기 레벨을 검출하기 위한 수단 및 상기 메모리가 마이크로 컴퓨터로 구성되는 비디오 신호 AGC 회로.
  5. 제4항에 있어서, 상기 제2제어 신호가 상기 제1제어 신호의 제어 정확도 보다 더 높은 제어 정확도를 보유하도록 형성된 비디오 신호 AGC 회로.
  6. 제4항에 있어서, 단주기 동안, 상기 제1또는 제2제어 신호에서 어떤 급속한 변화가 발생할 경우, 이전에 사용된 데이타가 대신 사용되는 비디오 신호 AGC 회로.
  7. 제4항에 있어서, 상기 디지탈 이득 제어 증폭기가 멀티플라이어로 구성되는 비디오 신호 AGC 회로.
  8. 제4항에 있어서, 상기 아나로그 제어 증폭기의 시정수와 상기 디지탈 이득 제어 증폭기의 시정수가 서로 다르게 설정되는 비디오 신호 AGC 회로.
  9. 제8항에 있어서, 상기 아나로그 제어 증폭기의 시정수는 상기 디지탈 이득 제어 증폭기의 시정수보다 더 크게 설정되는 비디오 신호 AGC 회로.
  10. 비디오 신호 레벨 제어 회로에 있어서, 입력 아나로그 비디오 신호를 디지탈 비디오 신호로 변환키 위한 A-D변환기와, 디지탈 비디오 신호의 동기 팁 레벨을 검출키 위한 동기 팁 검출기와, 상기 동기 팁 검출기의 출력에 근거하여 클램프 데이타를 발생키 위한 클램프 데이타 발생기 및, 상기 디지탈 비디오 신호의 동기 팁을, 상기 클램프 데이타 발생기 출력에 근거하여, 소정 레벨로 클램핑하기 위해 디지탈 클램퍼를 구비하는 비디오 신호 레벨 제어 회로.
  11. 제10항에 있어서, 상기 디지탈 클램퍼가 감산기로 이루어지는 비디오 신호 레벨 제어 회로.
  12. 제11항에 있어서, 상기 클램프 데이타 발생기가 마이크로 컴퓨터로 이루어지는 비디오 신호 레벨 제어 회로.
  13. 제12항에 있어서, 상기 마이크로 컴퓨터가 검출된 동기팁 데이타와 소정의 클램프 레벨간의 차를 계산하며, 0에 근접하는 소정의 차값과 일치하는 완만한 변화 클램프 데이타 또는 0과는 상이한 소정의 차값과 일치하는 급속한 변화 클램프 데이타를 발생하는 비디오 신호 레벨 제어 회로.
  14. 제12항에 있어서, 단주기동안, 검출동기 팁 데이타내에서 어떤 급속한 변화가 발생할 경우, 상기 마이크로 컴퓨터는 이전의 클램프 데이타를 사용하는 비디오 신호 레벨 제어 회로.
  15. 제12항에 있어서, 상기 마이크로 컴퓨터가 소정의 시간간격의 주기로 상기 클램프 데이타를 출력하는 비디오 신호 레벨 제어 회로.
  16. 비디오 신호 레벨 제어 회로에 있어서, 입력 아나로그 비디오 신호를 디지탈 비디오 신호에 변환키 위한 A-D 변환기와, 상기 디지탈 비디오 신호의 동기 팁 레벨을 검출하기 위한 동기 팁 검출기와, 상기 디지탈 비디오 신호의 페데스탈 레벨을 검출하기 위한 페데스탈 검출기와, 상기 동기 팁 검출기와 상기 페데스탈 검출기 각각의 출력에 근거하여 클램핑 데이타와 이득 제어 데이타를 발생키 위한 레벨 제어 데이타 발생기와, 상기 레벨 제어 데이타 발생기로부터 출력된 클램프 데이타에 근거하여 소정의 레벨로 디지탈 비디오 신호의 동기 팁을 클램프하기 위한 디지탈 클램프 및, 상기 레벨 제어 데이타 발생기로부터 출력된 이득 제어 데이타에 근거하여 소정 레벨로 상기 디지탈 클램퍼의 출력 디지탈 비디오의 동기 레벨을 조정키 위해, 디지탈 이득 제어 증폭기를 구비하는 비디오 신호레벨 제어 회로.
  17. 제16항에 있어서, 페데스탈 데이타 및 동기 팁 데이타 둘다에 근거하여 비디오 신호의 동기 레벨을 검출하기 위한 동기 레벨 검출기 및, 소정의 동기 레벨을 기억하기 위한 메모리를 구비하며, 상기 이득 제어 데이타는 소정의 동기 레벨로 상기 검출된 동기 레벨의 비에 근거하여 발생되는 비디오 신호 레벨 제어 회로.
  18. 제17항에 있어서, 상기 레벨 제어 데이타 발생기가 마이크로 컴퓨터로 이루어지는 비디오 신호 레벨 제어 회로.
  19. 제18항에 있어서, 상기 마이크로 컴퓨터는 소정의 동기 레벨로 상기 검출된 동기 레벨비가 대략 1일때는 완만한 변화 이득 제어 데이타를 발생하며, 그러한 비가 1과는 매우 상이할때는 급속한 변화 이득 제어 데이타를 발생하는 비디오 신호 레벨 제어 회로.
  20. 제18항에 있어서, 단주기동안, 어떤 급속한 변화가 상기 소정의 동기 레벨대 검출동기 레벨의 비로 발생할 경우, 상기 마이크로 컴퓨터는 이전의 이득 제어 데이타를 사용하는 비디오 신호 레벨 제어 회로.
  21. 제18항에 있어서, 상기 마이크로 컴퓨터가 소정의 시간 간격의 주기로 이득 제어 데이타를 발생하는 비디오 신호 레벨 베어 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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