KR930011494A - Fifo 메모리 테스트 방법 - Google Patents

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KR930011494A
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윤희선
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정용문
삼성전자 주식회사
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    • G01MEASURING; TESTING
    • G01RMEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
    • G01R31/00Arrangements for testing electric properties; Arrangements for locating electric faults; Arrangements for electrical testing characterised by what is being tested not provided for elsewhere
    • G01R31/28Testing of electronic circuits, e.g. by signal tracer
    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14Handling requests for interconnection or transfer
    • G06F13/20Handling requests for interconnection or transfer for access to input/output bus
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Abstract

FIFO 메모리를 이용하여 시스템간의 통신을 수행할 경우 상기 FIFO 메모리를 테스트하는 방법에 관한 것이다. 온 라인 서비스 전과 온라인 서비스도중 FIFO 메모리의 상태를 정확히 확인하여 데이타 송수신시의 신뢰성을 높이고, 상태 래지스터 플래그 불량으로 인해 무한 루프에 빠질 우려를 해소한다.

Description

FIFO 메모리 테스트 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명이 적용되는 시스템 블럭도.
제2도는 본 발명에 따른 시스템 서비스 전 처리 흐름도.
제3도는 본 발명에 따른 온 라인 서비스시의 테스트 흐름도.
제4도는 본 발명에 따른 플래그 비트 구성도.

Claims (2)

  1. 상호 통신을 위산 송수신용 FIFO 메모리를 구비한 마스터 시스템과 슬레이브 시스템의 FIFO 메모리 테스트방법에 있어서, 상기 FIFO 메모리의 상태 플래그 래지스터를 초기화 하는 제1과정과, 상기 초기화 후 수신측 FIFO메모리에 동기 및 데이타를 기록하는 제2과정과, 상기 동기 및 데이타 기록후 풀플래그 세트시 까지 테스트 데이타를 기록하는 제3과정과, 상기 기록된 데이타를 검사하여 비정상일시 버퍼내의 데이타를 모두 읽어 지우는 제3과정으로 이루어짐을 특징으로 하는 사용전의 FIFO 메모리 테스트 방법.
  2. 상호 통신을 위산 송수신용 FIFO 메모리를 구비한 마스터 시스템과 슬레이브 시스템의 FIFO 메모리 테스트방법에 있어서, 상기 마스터 시스템과 슬레이브 시스템간의 사건 발생 가능한 최소시간을 계산하여 그값이 만큼 데이타 송수신 시의 상태를 체크하는 제1과정과, 상기 상태 체크 결과 정상 상태이고 데이타가 있으면 메세지 포멧의 헤드부분에서 특정 코드를 검출하는 제2과정과, 상기 특정 코드가 검출될 경우 서비스 하고 검출되지 않을 경우 메세지 재전송을 요구하는 제3과정으로 이루어짐을 특징으로 하는 온라인 서비스 중의 FIFO 메모리테스트 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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