KR930005367A - 잡음제거회로 - Google Patents

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Publication number
KR930005367A
KR930005367A KR1019920014806A KR920014806A KR930005367A KR 930005367 A KR930005367 A KR 930005367A KR 1019920014806 A KR1019920014806 A KR 1019920014806A KR 920014806 A KR920014806 A KR 920014806A KR 930005367 A KR930005367 A KR 930005367A
Authority
KR
South Korea
Prior art keywords
circuit
switch
switch circuit
logic
signal
Prior art date
Application number
KR1019920014806A
Other languages
English (en)
Inventor
오사무 우다가와
신이치 스미
Original Assignee
사토 후미오
가부시키가이샤 도시바
오카모토 세이시
도시바 마이크로 일렉트로닉스 가부시키가이샤
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 사토 후미오, 가부시키가이샤 도시바, 오카모토 세이시, 도시바 마이크로 일렉트로닉스 가부시키가이샤 filed Critical 사토 후미오
Publication of KR930005367A publication Critical patent/KR930005367A/ko

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Classifications

    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits

Landscapes

  • Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Computing Systems (AREA)
  • General Engineering & Computer Science (AREA)
  • Mathematical Physics (AREA)
  • Manipulation Of Pulses (AREA)
  • Logic Circuits (AREA)

Abstract

내용 없음.

Description

잡음제거회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 잡음 제거회로의 기본 구성을 나타낸 블럭도,
제2도는 제1도에 도시된 잡음 제거회로의 제1실시예를 나타낸 회로도,
제3도는 제2도에 도시된 잡음 제거회로의 잡음제거동작의 일예를 나타낸 파형도,
제4도는 제1도에 도시된 잡음제거회로의 제2실시예를 나타낸 회로도.

Claims (4)

  1. 입력신호를 소정시간 지연시켜서 지연신호를 출력하는 지연회로(10)와, 상기 입력신호 및 상기 징련신호를 입력받아 소정의 논리처리를 행하는 논리회로(11,12), 제1전원노드와 출력노드간에 접속되는 상기 논리회로(11,12)의 제1출력신호에 의해 스위치제어되는 제1스위치회로(14) 및, 상기 출력노드와 제2전원노드간에 접속되어 상기 논리회로(11,12)의 제2출력신호에 의해 스위치제어되는 제2스위치회로(15)를 구비하여 이루어진 것을 특징으로 하는 잡음제거회로.
  2. 제1항에 있어서, 상기 논리회로(11,12)는, 상기 입력신호 및 상기 지연신호의 논리레벨이 동일한 때에는 상기 제1스위치회로(14) 및 상기 제2스위치회로(15)를 상보적으로 스위치제어하고, 상기 입력신호 및 상기 지연신호의 논리레벨이 서로 다른때에는 상기 제1스위치회로(14) 및 상기 제2스위치회로(15)를 각각 오프상태로 제어 하는 것을 특징으로 하는 잡음제거회로.
  3. 제1항 또는 제2항에 있어서, 상기 논리회로(11,12)는 상기 제1스위치회로(14)를 스위치제어하는 낸드회로(21) 및 상기 제2스위치회로(15)를 스위치제어하는 노아회로(22)를 갖추고 있고, 상기 제1스위치회로(14)은 P챈널 MOS 트랜지스터이며, 상기 제2스위치 회로(15)는 N챈널 MOS트랜지스터인 것을 특징으로 하는 잡음제거회로.
  4. 제1항 또는 제2항에 있어서, 상기 논리회로(11,12,)는 상기 제1스위치회로(14)를 스위치제어하는 오아회로(41) 및 상기 제2스위치회로(15)를 스위치제어하는 앤드회로(42)를 갖추고 있고, 상기 제1스위치회로(14)은 P챈널 MOS 트랜지스터이며, 상기 제2스위치 회로(15)는 N챈널 MOS트랜지스터인 것을 특징으로 하는 잡음제거회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920014806A 1991-08-19 1992-08-18 잡음제거회로 KR930005367A (ko)

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Application Number Priority Date Filing Date Title
JP91-206767 1991-08-19
JP3206767A JPH0548410A (ja) 1991-08-19 1991-08-19 雑音除去回路

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ID=16528754

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Families Citing this family (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5682496A (en) 1995-02-10 1997-10-28 Micron Quantum Devices, Inc. Filtered serial event controlled command port for memory
US6108237A (en) 1997-07-17 2000-08-22 Micron Technology, Inc. Fast-sensing amplifier for flash memory
JP4573401B2 (ja) * 2000-06-20 2010-11-04 三洋電機株式会社 Ｆｇ信号のチャタリング防止回路
JP3980431B2 (ja) 2002-07-19 2007-09-26 Ｎｅｃエレクトロニクス株式会社 バッファ回路とバッファツリー及び半導体装置

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JPH0548410A (ja) 1993-02-26

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