KR920702094A - D/a 변환기 - Google Patents

D/a 변환기

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KR920702094A
KR920702094A KR1019910700394A KR910700394A KR920702094A KR 920702094 A KR920702094 A KR 920702094A KR 1019910700394 A KR1019910700394 A KR 1019910700394A KR 910700394 A KR910700394 A KR 910700394A KR 920702094 A KR920702094 A KR 920702094A
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노리유끼 고꾸히로
Original Assignee
세끼사와 요시
후지쓰 가부시끼가이샤
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M1/00Analogue/digital conversion; Digital/analogue conversion
    • H03M1/66Digital/analogue converters
    • H03M1/70Automatic control for modifying converter range
    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M1/00Analogue/digital conversion; Digital/analogue conversion
    • H03M1/66Digital/analogue converters
    • H03M1/74Simultaneous conversion
    • H03M1/80Simultaneous conversion using weighted impedances
    • H03M1/808Simultaneous conversion using weighted impedances using resistors

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Analogue/Digital Conversion (AREA)

Abstract

내용 없음

Description

D/A 변환기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 종래의 D/A 변환기를 나타낸 블럭도, 제2도는 본 발명의 제1실시예에 따른 D/A 변환기의 원리를 설명하는 블럭도, 제3도는 제2도를 상세히 나타낸 D/A 변환기를 설명하는 블럭도.

Claims (17)

  1. 소정의 비트수를 갖는 디지탈 입력신호에 의존하는 저항을 제공하기 위한 입력저항망 수단; 상기 입력저항망 수단에 연결된 제1입력단과 기준전위를 받기 위해 연결가능한 제2입력단을 구비하며, 상기 제1입력단에서 얻은 신호와 상기 기준 전위를 가산하기 위하고, 상기 디지탈 입력신호에 대응하는 아날로그 신호를 나타내는 가산동작의 상기 결과가 출력되는 출력단을 갖는 가산수단; 상기 가산수단의 상기 제1입력단과 상기 출력단사이에 제공되며, 상기 디지탈 입력신호의 크기를 지시하는 제어신호에 의존하는 귀환 저항을 제공하는 귀한 저항망; 및 상기 디지탈 입력신호로 부터 상기 디지탈 입력신호의 크기를 지시하는 상기 제어신호를 발생하기 위한 귀환 저항망 제어수단으로 이루어진 가중 저항을 사용한 전류 부가형 D/A 변환기.
  2. 제1항에 있어서, 상기 입력저항망 수단이 상기 디지탈 입력신호의 상기 소정의 비트수 보다 작은수의 저항을 포함하는 D/A 변환기.
  3. 제2항에 있어서, 상기 입력저항망 수단이 상기 디지탈 입력신호의 가장 중요한 비트로 부터 시작되는 처음시간 동안 나타나는 비트 "I"을 포함하고, 상기 비트 "I" 차후의 비트를 포함하는 상기 디지탈 입력신호의 비트에 따른 상기 저항을 선택하기 위한 수단을 포함하는 D/A 변환기.
  4. 제1항에 있어서, 상기 귀환 저항망 제어수단이 상기 디지탈 입력신호의 가장 중요한 비트로 부터 순차적으로 얻어진 2진수 0을 근거로 하여 상기 입력신호의 크기를 지시하는 상기 제어신호를 발생하기 위한 수단을 포함하는 D/A 변환기.
  5. 제1항에 있어서, 상기 귀환 저항망이 저항 및 스위치를 각각 갖는 소정의 수의 직렬회로와 기준저항을 포함하며; 각 상기 직렬회로의 제1단이 상기 가산수단의 상기 제1입력단에 연결되고, 제2단은 상기 가산수단의 상기 출려단에 연결되며, 그리고 상기 기준저항은 상기 가산수단의 상기 제1입력단 및 상기 출력단에 연결되는 D/A 변환기.
  6. 제5항에 있어서, 각각의 상기 직렬회로가 상기 제어신호를 수신하는 제어단을 포함하며; 그리고 각각의 상기 직렬회로의 상기 저항이 상기 제어신호에 의해 상기 스위치가 ON이 될때 상기 가산수단의 상기 제1입력단에 연결되는 D/A 변환기.
  7. 제6항에 있어서, 상기 제어신호가 상기 직렬회로와 같은 수의 비트를 가지며; 상기 제어신호의 각 비트가 상기 직렬회로의 대응하는 하나의 제어단에 인가되며; 그리고 상기 제어신호의 모든 비트들 사이의 비트가 상기 디지탈 입력신호의 가장 중요한 비트로 부터 순차적으로 얻어진 0을 근거로 하여 모든 직렬회로들 사이의 직렬회로에 각각 대응하는 상기 스위치를 ON이 되게 하는 비트값으로 설정되는 D/A 변환기.
  8. 제6항에 있어서, 상기 귀환 저항망 수단이 가장 중요한 비트로 부터 시작되어 상기 디지탈 입력신호의 연속적인 0중의 하나가 입력되는 각시간 동안 상기 스위치를 ON이 되게 하는 비트값을 발생하기 위한 쉬프트 레지스터 수단; 및 상기 디지탈 입력신호의 상기 가장 중요한 비트가 입력된 후에 상기 쉬프트 레지스터 수단에 저장된 상기 비트값으로 상기 직렬회로중의 대응하는 하나의 상기 스위치의 제어단을 공급하기 위한 래치수단을 포함하는 D/A 변환기.
  9. 제5항에 있어서, 상기 가장 중요한 비트에 대응하는 상기 직렬회로중의 하나의 저항이 상기 기준 저항과 같은 D/A 변환기.
  10. 제1항에 있어서, 상기 디지탈 입력신호가 직렬로 배열된 상기 비트를 갖는 신호인 D/A 변환기.
  11. 제1항에 있어서, 상기 입력저항망 수단이 상기 디지탈 입력신호의 가장 중요한 비트로 부터 시작되는 처음시간 동안 나타나는 비트 "1"을 포함하고 상기 비트 "1"차후의 비트를 포함하는 상기 디지탈 입력 신호의 비트를 순차적으로 쉬프트하기 위한 쉬프트 레지스터 수단 및, 상기 쉬프트 레지스터 수단에서의 비트를 상기 입력저항망 수단으로 전송하기 위한 래치수단을 포함하며; 상기 입력저항망 수단이 상기 래치수단으로 부터 전송된 상기 비트를 근거로 하여 선택되는 소정의 수의 저항을 포함하며; 상기 귀환 저항망 제어수단이 저항및 스위치를 갖는 소정의 수의 직렬회로와 기준저항을 포함하며; 각각의 상기 직렬회로의 제1단이 상기 가산수단의 상기 제1입력단에 연결되며; 각각의 상기 직렬회로의 제2단이 각각의 상기 직렬회로의 상기 출력단에 연결되며; 상기 기준저항이 상기 제1입력단과 상기 가산수단의 상기 출력단 사이의 직접 연결되며; 그리고 상기 귀환 저항망제어 수단이 가장 중요한 비트로 부터 시작하여 상기 디지탈 입력신호의 연속적인 0중의 하나가 입력되는 시간동안 상기 스위치를 ON이 되게 하는 비트값을 발생하기 위한 쉬프트 레지스터 수단과, 상기 디지탈 입력신호의 상기 가장 중요한 비트가 입력된 후에 상기 쉬트프 레지스터 수단에 상기 비트값으로 대응하는 상기 직렬회로중의 하나의 상기 스위치의 제어단을 공급하기 위한 래치수단을 포함하는 D/A 변환기.
  12. 제11항에 있어서, 상기 D/A 변환기가 상기 디지탈 입력신호의 0이 가장 중요한 비트로 부터 시작되어 입력될때 그시간 동안 제1클럭신호를 발생하기 위하고, 상기 디지탈 입력신호의 비트 "1"이 처음으로 나타난 후에 제2클럭신호를 발생하기 위한 타이밍 제어수단을 더 포함하며; 상기 귀환 저항망 제어수단이 상기 쉬프트 레지스터 수단은 상기 제1클럭신호로 동기화되어 동작되며; 그리고 상기 입력저항망의 상기 쉬프트 레지스터 수단이 상기 제2클럭신호로 동기화되어 동작되는 D/A 변환기.
  13. 제12항에 있어서, 상기 타이밍 제어기 수단이 상기 입력 디지탈 신호와 상기 디지탈 입력신호의 전송시간을 지시하는 클럭펄스로 부터 상기 제1클럭 및 상기 제2클럭신호를 발생하는 D/A 변환기.
  14. 제1항에 있어서, 상기 가산수단이 연산증폭기를 포함하는 D/A 변환기.
  15. 소정의 비트수를 갖는 디지탈 입력신호에 의존한 저항을 제공하기 위한 입력저항망 수단; 상기 입력저항망 수단에 연결된 제1입력단과 기준전위를 받기 위해 연결가능한 제2입력단을 가지며, 상기 제1입력단에서 얻어진 신호와 상기 기준전위를 가산하기 위하며, 상기 디지탈 입력신호에 대응하는 아날로그 신호를 나타내는 가산동작의 결과가 출력되는 출력단을 갖는 가산수단; 상기 디지탈 입력신호의 상기 소정의 비트수 보다 적은 수의 저항을 포함하는 입력저항망 수단; 및 상기 디지탈 입력신호의 크기에 의존하는 전압을 각각의 상기 저항의 한단에 인가하기 위한 제어수단을 포함하는 가중저항을 갖는 전류 부가형 D/A 변환기.
  16. 제15항에 있어서, 상기 제어수단이 상기 디지탈 입력신호의 가장 중요한 비트로 부터 시작되어 순차적으로 얻어진 상기 디지탈 입력신호의 0을 유지하기 위한 제1수단; 및 순차적으로 얻어진 상기 0의 수를 근거로 하여 각각의 상기 저항의 상기 한 단에 인가된 전압을 변화시키기 위한 제2수단을 포함하는 D/A 변환기.
  17. 제16항에 있어서, 상기 제2수단이 상기 디지탈 입력신호의 가장 중요한 비트로 부터 시작되어 처음시간 동안 나타나는 비트 "1"을 포함하고 상기 비트 "1"차후의 비트를 포함하는 상기 디지탈 입력신호의 비트를 유지하기 위한 쉬프트 레지스터 수단; 및 상기 쉬프트 레지스터 수단에 저장된 비트와 대응하는 상기 입력저항망 수단의 모든 저항으로 부터 저항을 선택하기 위하여, 선택된 저항 각각의 한단에 전압을 인가되는 래치수단을 포함하는 D/A 변환기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910700394A 1989-08-21 1990-08-20 전류 가산형 d/a 변환기 KR940007545B1 (ko)

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