KR920006826A - 프로그램 가능 컨트롤러 및 그 제조방법 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
Claims (5)
- 주기적으로 주행하는 프로그램을 갖는 축적 프로그램 방식의 프로그램 가능 콘트롤러에 있어서, 오퍼레이팅 시스템 및 사용자 프로그램을 처리하는 제1 제2의 CPU(101, 102), 상기 사용자 프로그램을 저장하는 사용자 메모리(107, 108, 701), 제어 대상에 접속되는 입출력회로부의 입출력 정보를 이미지정보로서 사상하는 데이타 RAM(109, 110, 702) 및 상기 제1의 CPU(101)과, 제2의 CPU(102)의 동기수단을 포함하고, 상기 제1의 CPU의 상기 입출력회로부(113)으로의 액세스와 상기 제2의 CPU의 상기 입출력회로부의 액세스는 시분할로 실행하는 프로그램 가능 콘트롤러.
- 제1의 CPU가 처리하는 사용자 프로그램과 제2의 CPU가 처리하는 사용자 프로그램은 동일하고, 상기 제1, 제2의 각 CPU는 입출력회로부의 입력정보를 데이타 RAM에 일시 저장하는 입력재생단계, 상기 데이타 RAM에 저장되어 있는 이미지정보에 의해서 연산을 실행하는 연산처리단계 및 상기 연산처리 단계에서의 연산결과를 상기 입출력회로부로 출력하는 출력재생단계를 갖는 주기적 처리를 실행하고, 상기 제1의 CPU의 입력재생처리와 출력재생처리는 상기 제2의 CPU의 연산처리시에 실행되고, 상기 제2의 CPU의 입력 재생처리와 출력재생처리는 상기 제1의 CPU의 연산처리에 실행되는 입출력회로의 재어방법.
- 특허청구의 범위 제1항에 있어서, 상기 동기 수단은 상기 제1의 CPU에 의해 설정되는 제1의 설정값 레지스터 및 상기 제1의 설정값 레지스터의 내용과 제1의 사용자 메모리의 어드레스를 비교하는 제1의 비교수단을 갖고, 상기 제1의 비교수단에 의해 출력되는 일치신호를 제2의 CPU의 주기적처리 개시의 동기신호로 하고, 상기 제2의 CPU에 의해 설정되는 제2의 설정레지스터 및 상기 제2의 설정레지스터의 내용과 제2의 사용자 메모리의 어드레스를 비교하는 제2의 비교수단을 갖고, 상기 제2의 비교수단에서 출력되는 일치신호를 상기 제1의 CPU의 주기적 처리개시의 동기신호를 2CPU동기회로를 마련한 프로그램 가능 콘트롤러.
- 전원투입시에 제1의 비교수단을 이네이블로 하고, 제2의 비교수단을 디스에이블로하는 초기설정단계, 상기 제1의 비교수단의 일치신호를 제2의 CPU로의 동기신호로하는 제1의 주기적 동기단계, 제1의 CPU가 이상으로 되었을때 상기 제1의 비교수단은 디스에이블로 함과 동시에 상기 제2의 CPU에 이상을 알리는 이상시처리단계, 상기 제2의 CPU에 의해서 상기 제2의 비교수단이 이네이블로 되는 비교수단 변경처리단계 및 상기 제2의 비교수단의 일치신호를 상기 제1의 CPU로의 동기신호로하는 제2의 주기적 동기단계에 의해 처리되는 2CPU동기에 관한 제어방법.
- 특허청구의 범위 제1항에 있어서, 또, 상기 제1, 제2의 CPU의 이상을 검출하는 이상검출 수단, 상기 이상검출 수단에 의해 이상을 검출해서 연산처리를 정지하는 연산정지수단, 상기 연산정지수단에 의한 다른 CPU의 연산정지 상태를 검출하는 연산정지 검출수단 및 상기 연산정지 검출수단에 의해 검출된 정지상태에 있는 다른 CPU의 연산처리를 재개시키는 연산재개수단을 마련한 프로그램 가능 콘트롤러.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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