KR910014803A - 싱글칩 마이크로 컴퓨터의 스택킹 시스템 - Google Patents

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KR910014803A
KR910014803A KR1019910000206A KR910000206A KR910014803A KR 910014803 A KR910014803 A KR 910014803A KR 1019910000206 A KR1019910000206 A KR 1019910000206A KR 910000206 A KR910000206 A KR 910000206A KR 910014803 A KR910014803 A KR 910014803A
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KR
South Korea
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stacking system
data
chip microcomputers
ram
executing
Prior art date
Application number
KR1019910000206A
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English (en)
Inventor
아끼라 오오하라
Original Assignee
하라 레이노스께
세비꼬 덴시고교 가부시끼가이샤
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Publication date
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    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/44Arrangements for executing specific programs
    • G06F9/448Execution paradigms, e.g. implementations of programming paradigms
    • G06F9/4482Procedural
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Abstract

내용 없음

Description

싱글칩 마이크로 컴퓨터의 스택킹 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제5도는 본 발명의 일실시예에 의한 싱글칩 마이크로 컴퓨터의 스택킹 시스템을 도시한 구조도, 제6도는 스택 RAM의 제어회로에 관한 상세한 회로도, 제7도는 RAM의 상세한 회로구조도.

Claims (1)

  1. 콜명령을 수행시에 사용하기 위한 복귀어드레스 데이타 및 푸시명령을 수행시에 사용하기 위한 복수개의 레지스터 데이타중 어느하나를 선택적으로 저장하도록 각각 작동할 수 있는 어드레스 위치를 가진 RAM과, 상기 RAM내의 데이타를 판독 및 기록을 행하기 위해 각 어드레스 위치내에 저장된 상기 모든 데이타를 억세싱하는 싱글명령에 응하는 수단으로 구성된 것을 특징으로 하는 싱글칩 마이크로 컴퓨터의 스텍 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910000206A 1990-01-09 1991-01-09 싱글칩 마이크로 컴퓨터의 스택킹 시스템 KR910014803A (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JP2001939A JPH03206525A (ja) 1990-01-09 1990-01-09 シングルチップマイコンのスタック方式
JP2-1939 1990-01-09

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Publication Number Publication Date
KR910014803A true KR910014803A (ko) 1991-08-31

Family

ID=11515582

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019910000206A KR910014803A (ko) 1990-01-09 1991-01-09 싱글칩 마이크로 컴퓨터의 스택킹 시스템

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EP (1) EP0437235A3 (ko)
JP (1) JPH03206525A (ko)
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Publication number Publication date
JPH03206525A (ja) 1991-09-09
EP0437235A3 (en) 1993-03-31
EP0437235A2 (en) 1991-07-17

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