KR910007282A - 회로 테스트용 카운터회로 - Google Patents

회로 테스트용 카운터회로 Download PDF

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KR910007282A
KR910007282A KR1019890013325A KR890013325A KR910007282A KR 910007282 A KR910007282 A KR 910007282A KR 1019890013325 A KR1019890013325 A KR 1019890013325A KR 890013325 A KR890013325 A KR 890013325A KR 910007282 A KR910007282 A KR 910007282A
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KR
South Korea
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circuit
terminal
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sel1
test
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KR1019890013325A
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Inventor
조영수
Original Assignee
정용문
삼성전자 주식회사
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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K23/00Pulse counters comprising counting chains; Frequency dividers comprising counting chains

Landscapes

  • Prepayment Telephone Systems (AREA)
  • Tests Of Electronic Circuits (AREA)

Abstract

내용 없음.

Description

회로 테스트용 카운터회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 따른 회로도.

Claims (1)

  1. 제1-n논리조합회로(L1-Ln)에서 논리조합 신호를 발생하고 제1-n플립플롭(F/F1-F/In)을 통해 칩 테스트 카운팅신호를 출력하도록 구성된 카운터 회로에 있어서, 상기 제1-n논리조합회로(L1-Ln)의 출력단을 제1-n선택기(SEL1-SELn)의 제2입력단(B)에 연결하고, 선택신호단(22)을 상기 제1-n선택기(SEL1-SELn)의 선택단(S)을 연결하며, 상기 시험데이타단(21)을 제1-n선택기(SEL1)의 제1입력단(A)에 연결하고, 상기 제1플립플롭(F/F1)의 출력단(Q0)을 상기 제2선택기(SEL1)의 제1입력단(A)에 연결하고, 상기 방식으로 이전 플립플롭의 출력단을 다음 선택기의 제1입력단(A)에 연결되도록 함을 특징으로 하는 회로 테스트용 카운터회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890013325A 1989-09-12 1989-09-12 회로 테스트용 카운터회로 KR920000362B1 (ko)

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KR920000362B1 KR920000362B1 (ko) 1992-01-11

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100302849B1 (ko) * 1999-09-02 2001-11-05 윤덕용 모든 카운터의 출력이 한 단의 플립플롭 지연 시간을 갖는 동기 카운터

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KR100302849B1 (ko) * 1999-09-02 2001-11-05 윤덕용 모든 카운터의 출력이 한 단의 플립플롭 지연 시간을 갖는 동기 카운터

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