KR910005567A - 계단파 발생회로 - Google Patents

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KR910005567A
KR910005567A KR1019890011608A KR890011608A KR910005567A KR 910005567 A KR910005567 A KR 910005567A KR 1019890011608 A KR1019890011608 A KR 1019890011608A KR 890011608 A KR890011608 A KR 890011608A KR 910005567 A KR910005567 A KR 910005567A
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박종석
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문정환
금성 일렉트론 주식회사
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K4/00Generating pulses having essentially a finite slope or stepped portions
    • H03K4/02Generating pulses having essentially a finite slope or stepped portions having stepped portions, e.g. staircase waveform
    • H03K4/026Generating pulses having essentially a finite slope or stepped portions having stepped portions, e.g. staircase waveform using digital techniques

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  • Logic Circuits (AREA)
  • Transmitters (AREA)

Abstract

내용 없음

Description

계단파 발생회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 입력데이타를 발생하기 위한 카운터의 예시도.
제4도의 (가)내지 (마)는 제3도의 출력파형도.
제5도는 제3도 카운터의 입력파형 선택 회로도.
제6도는 본 발명의 계단파 발생 회로도.

Claims (1)

  1. 직렬 접속한 플립플롭(FF1-FF4)에서 출력되는데이타출력데이타(Q3)는 직접 인버터(16)를 통해 데이타(X3)로 출력되게 하고, 나머지는 8분주된 클럭펄스(CK8)가 직접 또는 인버터(11)를 통해 게이트에 인가되는 전송게이트(T1,T2),(T3,T4),(T5,T6),(T7,T8)를 각기 통하여 데이타(X1,X2,X4,X5)로 출력되게 하며, 이 데이타(X1-X4)에 의해 변화되는 N형 전류미러(N1-N4)의 공통 출력단자와 저항(RN)의 접속점 전압을 상기 입력데이타(X5)의 반주기 동안 온되는 엔모스(NM5)를 통해 통해 버퍼(B1)의 입력단자에 인가하고, 입력데이타의해 변화되는 P형 전류미러(P1-P4)의 공통 출력단자와 저항(Rp)의 접속점 전압을 상기 입력데이타(X5)의 반주기 동안 온되는 엔모스(NM4)를 통해 상기 버퍼(B1)의 입력단자에 인가하도록 구성된 것을 특징으로 하는 계단파 발생회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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