KR870001707A - 회로의 응답과 이득을 독립적으로 제어 할 수 있는 연산증폭기 - Google Patents
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Abstract
내용 없음.
Description
제1도는 종래의 차동입력증 폭기의 회로도.
제2도는 본 발명에 따른 연산증폭기의 회로도.
Claims (11)
- 비반전 입력단자와, 반전입력단자와, 출력단자 및 상기의 반전입력단자와 출력단자사이에 연결시킨 궤환 저항을 구비한 제1 및 제2연산증폭기를 종속적으로 연결시켜서 회로이득과 대역폭을 독립적으로 제어하는 증폭기회로의 작동 방법에 있어서, 두개의 증폭기의 반전단자와 궤환 저항을 전류 궤환 작동을 하도록 공통노드에 연결시키고, 제1회로 입력단자를 제1증폭기의 비반전 입력단자에 연결시키며, 제2회로 입력단자를 직렬 입력저항을 통해서 공통노드에 연결시키고, 제2증폭기의 궤화저항에 대한 직렬입력저항의 비를 선택적으로 설정하여 회로의 이득을 조절토록 함을 특징으로 하는 증폭기회로의 작동방법.
- 제1항에 이어서, 제2증폭기의 궤환저항에 대한 제1증폭기의 궤환저항의 비를 선택적으로 설정하여 회로의 대역폭을 결정함을 특징으로 하는 증폭기 회로의 작동방법.
- 제1항 또는 제2항에 있어서, 제2증폭기의 궤환 저항을 고정치로 설정하고, 회로이득을 제어하기 위해서 직렬 입력 저항의 값을 독립적으로 설정하고, 회로대역 폭을 제어하기 위해서 제1증폭기의 궤환저항의 값을 자유로히 설정함으로써 회로이득과 대역폭을 상호 독립적으로 결정함의 특징으로 하는 증폭기회로의 작동방법.
- 비반전 입력단자 및 반전 입력단자(44,46;34,36)와, 출력단자(Vx,38), 및 상기의 출력단자와 반전입력 단자(36) 사이에 연결된 궤환임프던스(42,40)를 구비한 제1 및 제2연산증폭기(OA1,OA2)와, 상기의 증폭기들을 제1증폭기의 출력단자(Vx)에 연결된 제2증폭기의 비반 전입력단자(34)와 종속적으로 연결시키기 위한 수단으로 구성된 증폭기회로에 있어서, 상기회로의 전류 궤환작동을 하도록 하기 위해서, 각각의 증폭기의 반전 단자 및 궤환 임피던스를 공통점(V1)에 연결시킴을 특징으로 하는 증폭기회로.
- 제4항에 있어서, 제1입력 단자(Vni)의 형태인 입력 신호 인가 수단을 제1증폭기(OA1)의 비반전 입력단자에 연결시키고, 제2입력단자(Vin)를 회로 입력 임피던스(48)와 직렬로 공통점(V1)에서 연결시킴을 특징으로 하는 증폭기 회로.
- 제5항에 있어서, 제1입력 단자(44)가 전회로의 비반전 입력 단자(Vni)이고, 제2입력 단자(46)가 전회로의 반전 입력 단자(Vin)이며, 제2증폭기의 출력 단자(38)가 전회로의 출력단자(Vo)임을 특징으로 하는 증폭기 회로.
- 각각의 연산증폭기의 이득이 매우큰 제6항에 따른 증폭기회로에 있어서, 비반전 입력 단자(Vni)에서의 신호진폭에 대한 회로 출력 단자(Vo)에서의 신호진폭의 비임을 특징으로 하는 증폭기 회로.
- 각각의 연산증폭기의 이득이 매우큰 제6항에 따른 증폭기회로에 있어서, 반전입력단자(Vim)에서의 신호 진폭에 대한 회로출력단자(Vo)에서의 신호진폭의 비임을 특징으로 하는 증폭기 회로.
- 연산증폭기의 궤환임피던스(40,42)와 회로 입력임피던스(48)가 저항인 제6항에 따른 증폭기회로에 있어서, 증폭기회로의 이득이 제2증폭기의 궤환저항(40) 대입력저항(48)의 비에서의 변화에 따라 변함을 특징으로 하는 증폭기 회로.
- 두개의 궤환저항(40,42)의 비가 변할수 이는 제9항에 따른 증폭기회로에 있어서, 회로의 대역폭이 두개의 궤환저항(40,42)의 비에 의해 결정됨을 특징으로 하는 증폭기 회로.
- 제2증폭기 스테이지의 궤환저항(40)이 고정된 제10항에 따른 증폭기 회로에 있어서, 회로이득 및 대역폭이 직렬입력저항(48)과 제1증폭기의 궤환저항을 조절하므로써 독립적으로 제어될 수 있음을 특징으로 하는 증폭기 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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