KR860007584A - 비디오 변환기장치 - Google Patents

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Abstract

내용 없음

Description

비디오 변환기장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 1 도는 본 발명을 구체화시킨 장치의 전체적인 블록도.
제 2 도는 제 1 도의 장치의 콘트롤 논리회로의 특정된 실시예의 회로도.
* 도면의 주요부분에 대한 부호의 설명
10 : 컴퓨터 데이터 버스 11 : 콘트롤러 데이터 버스 12 : 기억장치
14 : 메모리 16 : 버퍼 20 : 디스플레이 콘트롤러
A~A7: 제 1 어드레스 라인 A8~A11: 제 2 어드레스 라인

Claims (10)

  1. 컴퓨터에서 디스플레이 콘트롤러(2)를 콘트롤하기 위하여 사용되는 데이터를 제 1 형태의 디스플레이와 사용되는 제 1 셋트의 파라미터에 해당하는 제 1 의 값을 갖는 것으로부터 제 2 형태의 디스플레이와 사용되는 제 2 셋트의 파라미터에 해당하는 제 2 값을 갖는 것으로 변환하고, 컴퓨터 데이터 버스(10)와 콘트롤러 내의 어드래스를 선정하는 제 1 그룹의 데이터 및 그 어드레스와 관련된 파라미터를 콘트롤 하는 제 2 그룹의 데이터를 콘트롤러(20)로 통과시키는 콘크롤러 데이터 버스(11) 사이에 연결되는 장치에 있어서, 상기 제 1 그룹의 데이터를 기록하기 위하여 컴퓨터 데이터 버스(10)에 연결되는 기억장치(12)와 컴퓨터 데이터 버스(10)와 콘트롤러 데이터 버스(11)를 선택적으로 분리 및 연결시키도록 상기 버스를 사이에 배치되는 버스(11) 및 제1(A8~A11) 및 제2(A0~A1)의 복수개의 어드레스 라인들을 갖는 메모리(14)를 특징으로 하며, 제 1 의 복수개의 어드레스 라인들(A8~A11)은 기억장치(12)에 기록된 데이터를 수신하고 제 2 의 복수개의 어드레스 라인들(A0~A1)은 컴퓨터 데이터 버스(10)에 연결되며, 메모리(14)는 콘트롤러 데이터 버스(11)로 제 2 그룹의 데이터를 공급하는 상기 장치.
  2. 제 1 항에 있어서, 버퍼(16) 및 메모리(14)를 선택적으로 인에이블되게 하도록 버퍼와 메모리에 연결되는 콘트롤 논리회로(50)를 특징으로 하는 상기 장치.
  3. 제 2 항에 있어서, 제 1 그룹의 데이터와 제 2 그룹와 데이터가 순차적으로 콘트롤터로 인가되는 것을 특징으로 하는 상기 장치.
  4. 제 3 항에 있어서, 제 1 그룹의 데이터가 기억장치(12)에 의해 로드되고 메모리(14)로 인가되도록 기억장치 내에 기록되어 있는 반면에 제 4 그룹의 데이터가 메모리에 의해 수신되고, 메모리(14)는 한 그룹의 데이블로 조직되는 데이터 및 테이블 내의 데이터 라인들을 포함하며 상기 테이블은 기억장치(12)로부터 수신 되는제 1 그룹의 데이터에 의하여 선정되고 테이블 내의 라인들은 컴퓨터 데이터 버스(10)로부터 수신되는 제 2 그룹의 데이터에 의하여 선정되는 것을 특징으로 하는 상기 장치.
  5. 제 4 항에 있어서, 디스플레이 콘트롤러(20)는 컴퓨터 데이터 버스(10)에서 제 1 그룹의 데이터가 수신 될 때 콘트롤러의 디스플레이 파라미터를 콘트롤하기 위한 레지스터를 선정하는 논리 0 신호이고, 컴퓨터 데이터 버스(10)에서 제 2 그룹의 데이터가 수신될 때는 제 1 의 복수개의 데이터에 따라 선정된 레지스터에 데이터를 입력하는 논리 1 신호로 되는 레지스터 선택 신호(AO)에 응답하는 CRT 콘트롤러인 것을 특징으로 하는 상기 장치.
  6. 제 5 항에 있어서, 기억장치는 레지스터 선택 신호(AO)가 논리 0과 같을 때 하나의 값을 기록하는 상기 장치.
  7. 제 5 항 또는 6항에 있어서, 콘트롤 논리회로(50)가 기록신호(W) 및 레지스터 선택신호(AO)를 수신하고 제 1 출력단(51)이 버퍼(16)에 연결되며 제 2 출력단(53)이 메모리(14)에 연결되고, 상기 논리회로는 기록 신호(W)가 제 1 상태이고 레지스터 선택신호(AO)가 제 1 상태일 때 버퍼(16)는 인에이블되고 메모리 (14)는 디스에이블되며, 기록신호(W)가 제 1 상태이고 레지스터 선택신호(AO)가 제 2 상태일 때는 버퍼(16)는 디스에이블되고 메모리(14)는 인에이블되도록 되어지는 것을 특징으로 하는 상기 장치.
  8. 제 7 항에 있어서, 콘트롤 논리회로(50)가 고정된 논리 0 및 고정된 논리 1 신호에 연결되는 복수개의 입력단들(1CO~2C3)과 메모리(14) 및 버퍼(16)에 연결되는 출력단들(51,53)을 가지는 멀티플렉서(60)를 포함하고, 상기 멀티플렉서는 버퍼와 메모리를 디스에이블 및 인에이블 되게 하기 위하여 버퍼와 메모리에 인가될 신호들을 멀티플렉서 입력들에서 선택하는 것을 특징으로 하는 상기 장치.
  9. 전기한 어느 한 항에 있어서, 버퍼(16)는 CRT 콘트롤러(20)로부터 컴퓨터 데이터 버스(10)로 선택적으로 데이터가 유통되게 하며 컴퓨터 데이터 버스(10)로부터 CRT 콘트롤러 데이터 버스(11)로 데이터가 유통되게 하는 양방향성 버퍼인 것을 특징으로 하는 상기 장치.
  10. 제 7 항에 또는 제 9 항에 있어서, 양 방향성 버퍼(16)가 기록신호(W)에 의하여 콘트롤되는 것을 특징으로 하는 상기 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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