KR830008210A - 발진기 이득제어가 있는 시계회로 - Google Patents

발진기 이득제어가 있는 시계회로 Download PDF

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KR830008210A
KR830008210A KR1019810005180A KR810005180A KR830008210A KR 830008210 A KR830008210 A KR 830008210A KR 1019810005180 A KR1019810005180 A KR 1019810005180A KR 810005180 A KR810005180 A KR 810005180A KR 830008210 A KR830008210 A KR 830008210A
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에드워드 질베르그 제임스
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글렌 에이치. 브르스틀
알 씨 에이 코포레이션
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Abstract

내용 없음

Description

발진기 이득제어가 있는 시계회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 시계회로를 도시한 도면.

Claims (10)

  1. 발진기(10)와 표시작동전압(VEE)를 제공하기 위하여 상기 발진기에 응답하는 표시전압발생기(20)을 포함하는 시계회로에 있어서, 상기 표시전압이 선정된 레벨이하일때, 제1이득 레벨을 갖도록 그리고 상기 표시전압이 상기 선정레벨이 상일때 상기 제1이득레벨보다 낮은 제2이득레벨을 갖도록 상기 발진기를 조절하기 위하여 상기 표시전압에 응답하는 수단(22,P2,N2,34)를 포함하는 것을 특징으로 하는 발진기 이득제어가 있는 시계회로.
  2. 제1항에 의한 시계회로에 있어서, 상기 수단이 상기표시전압이 상기 선정된 레벨 이하일때 2진 신호의 제1레벨을 그리고 상기 표시전압이 상기 선정된 레벨이상일대 2진 제어신호의 제2레벨을 제공하도록 표시전압에 응답하는 임계 검출기 수단과, 상기 제1이득 레벨을 갖도록 상기 발진기를 조절하기 위하여 2진 제어신호의 제1레벨에 응답하며 그리고 상기 비교적 낮은 제2이득레벨을 갖도록 상기 발진기를 조절하기 위하여 2진 제어신호의 상기 제2레벨에 응답하는 발진기 이득 제어수단(22,P2,N2,34)를 포함하는 것을 특징으로 하는 발진기 이득제어가 있는 시계회로.
  3. 제2항에 의한 시계회로에 있어서, 상기 임계검출기가 표시전압을 수신하는 소오스와, 제1트랜지스터와 같이 동일한 도전형의 제2전계효과 트랜지스터(N3)의 소오스에 공통적으로 접속된 게이트 및 트레인을 갖는 제1전계효과 트랜지스터(N4)와 작동전위(VDD)를 수신하도록 임피던스 수단(P3,C3)을 통하여 접속되는 제2트랜지스터의 드레인과, 상기 선정된 전압이 연관된 기준전위(VSS)를 수신하도록 연결되는 제2트랜지스터의 게이트와, 상기 2진 제어신호를 이득제어수단에 제공하도록 발진기 이득제어수단에 제2트랜지스터의 드레인을 접속하는 수단(37)을 포함하는 것을 특징으로 하는 발진기 이득제어가 있는 시계회로.
  4. 제3항에 의한 회로에 있어서, 연결수단이 상기 2진 제어신호를 제공하기 위하여 로직 발전기를 포함하는 것을 특징으로 하는발진기 이득제어가 있는 시계회로.
  5. 제4항에 의한 시계회로에 있어서, 상기 임피던스 수단이 상기 제1 및 제2트랜지스터들과 같이 반대도 전형이며 상기 작동전위를 수신하도록 연결된 소오스와, 상기 2진 레벨을 수신하도록 접속된 게이트와 상기 제2트랜지스터의 드레인에 접속된 드레인을 갖는 제3FET 트랜지스터(P3)를 포함하는 것을 특징으로 하는 발진기 이득제어가 있는 시계회로.
  6. 제5항에 의한 시계회로에 있어서, 또한 상기 임피던스 수단이 제3트랜지스터의 소오스와 드레인 사이에 접속된 콘덴서(C3)를 포함하는 발진기 이득제어가 있는 시계회로.
  7. 제2항 내지 제6항에 따른 시계회로에 있어서, 발진기(10)가 동시에 접속된 트랜지스터들의 드레인과 동시에 접속된 트랜지스터들의 게이트를 갖으며 상반도전형의 제1및 제2전계효과 트랜지스터들(R1N1)과, 발진을 제공하도록 상기 드레인에 상기 게이트를 접속하는 궤환수단들과, 제1 및 제2트랜지스터들의 소오스가 작동전위를 수신하도록 제각기 접속된 제1 및 제2저항기들(R2R3)을 포함하는 발진기 이득제어가 있는 시계회로.
  8. 제7항에 의한 회로에 있어서, 이득제어수단이 상기 제1 및 제2전항기(R2R3)중 하나에 제각기 접속되는 소오스-드레인 통로르 갖으며 그리고 상기 제2레벨에 응답하는 제2의 비교적 높은 임피던스와 상기 제1레벨에 응답하는 제1임피던스를 갖으며 또한 저항기들과 연관하도록 제공된 상기 2진 제어신호에 응답하는 제3 및 제4전계효과 트랜지스터들(R2,N2)를 포함하는 발진기 이득제어가 있는 시계회로.
  9. 제8항에 의한 회로에 있어서, 제1저항기(R2)와 연관된 제3트랜지스터(P2)가 발진기의 제1트랜지스터(P1)과 같이 동일도전형이며 제2저항기(R3)와 연관된 트랜지스터(N2)가 발진기의 제2트랜지스터(N1)와 같이 동일 도전형이며 그리고 제3 및 제4트랜지스터들중 하나의 게이트가 2진 제어신호를 수신하도록 접속되며 다른 게이트가 변환기(34)에 의하여 변환된 2진 제어신호를 수신하도록 접속되므로서 상기 제1 및 제2이득 레벨의 제공이 제1 및 제2 2진레벨에 응답하는 것을 특징으로 하는 발진기 이득제어가 있는 시계회로.
  10. 축전지, 축전지에 의하여 구동되는 발진기, 시간에 대응하는 출력신호 표시를 제공하기 위하여 상기에 발진기에 응답하는 시간보지회로, 상기 시간을 표시하기 위하여 상기 시간보지회로의 상기 출력신호표시에 응답하는 표시 및 표시작동전압을 제공하기 위하여 상기 발진기에 응답하는 표시전압 발생기를 포함하는 시계회로에 있어서, 상기 표시전압이 선정된 레벨이하일때 제1 이득레벨을 그리고 상기 표시 전압이 선정된 레벨이상일때 상기 제1 이득레벨보다 낮은 제2이득레벨을 갖도록 발진기를 조절하기 위하여 상기 표시 작동전압이 응답하는 수단을 특징으로 하는 발진기 이득제어가 있는 시계회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019810005180A 1980-12-24 1981-12-24 발진기 이득제어가 있는 시계회로 KR880001722B1 (ko)

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