KR20210071258A - 터치 표시장치 및 그의 제조방법 - Google Patents

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이휘득
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Abstract

본 발명의 실시예들에 의하면, 디스플레이 영역과 라우팅영역 상에 배치되는 인캡슐레이션층, 인캡슐레이션층 상에 배치되며, 라우팅영역 중 기판의 폴딩영역과 중첩되는 제1영역과 폴딩영역과 중첩되지 않는 제2영역 중 제1영역에 배치된 복수의 홈을 포함하는 터치절연막, 터치절연막의 상부에 배치되는 터치커버, 적어도 일부가 인캡슐레이션층과 터치절연막의 사이 또는 터치절연막과 터치커버의 사이에서 액티브영역과 중첩된 위치에 배치되는 복수의 터치전극 및 라우팅영역에 배치되며, 제1영역에서 복수의 홈 또는 복수의 홈 사이에 각각 배치되며, 제2방향으로 연장되는 복수의 터치신호라인을 포함하는 표시장치 및 그의 제조방법을 제공할 수 있다.

Description

터치 표시장치 및 그의 제조방법{TOUCH DISPLAY DEVICE AND MAUNUFACTURING METHOD FOR THE SAME}
본 발명의 실시예들은 터치표시장치 및 그의 제조방법에 관한 것이다.
정보화 사회가 발전함에 따라 화상을 표시하기 위한 표시장치에 대한 요구가 다양한 형태로 증가하고 있으며, 액정표시장치(LCD: Liquid Crystal Display Device), 플라즈마표시장치(Plasma Display Device), 유기발광표시장치(OLED: Organic Light Emitting Display Device) 등과 같은 여러 가지 타입의 표시장치가 활용되고 있다.
이러한 표시장치는 스마트폰과 태블릿 PC와 같은 모바일 기기뿐만 아니라 TV(Television), 자동차 디스플레이, 웨어러블(wearable) 기기 등 다양한 분야에 적용되고 있다.
또한, 표시장치는 터치패널을 포함하고, 터치패널을 이용하여 화면을 터치하여 직관적이고 편리하게 사용자의 명령을 입력할 있다. 터치패널을 포함하는 표시장치를 터치표시장치라고 칭할 수 있다.
모바일 기기는 휴대가 간편하도록 하기 위해, 접힌 상태로 휴대가 가능하고, 사용시에 펼쳐진 상태로 영상을 표시하는 폴더블 표시장치에 관한 연구가 활발히 진행되고 있다.
한편, 폴더블 표시장치는 접힘과 펼침이 반복됨에 따라, 접힘과 펼침시 압축력과 수축력을 받게 되는 접힌 영역에 손상이 발생하게 되어 터치감도가 저하되는 문제가 발생할 수 있다. 따라서, 접힘과 펼침 시에 표시장치에 손상이 발생되는 것을 억제할 필요가 있다.
본 발명의 실시예들의 목적은 접을 수 있는 터치 표시장치 및 그의 제조방법을 제공하는 것이다.
본 발명의 실시예들의 다른 목적은 터치감도의 저하를 방지할 수 있는 터치 표시장치 및 그의 제조방법을 제공하는 것이다.
일측면에서, 본 발명의 실시예들은, 제1방향으로 연장되는 게이트라인과 제2방향으로 연장되는 데이터라인과 게이트라인과 상기 데이터라인에 연결되는 화소가 배치되는 디스플레이 영역과, 디스플레이 영역의 테두리에 배치되는 라우팅영역을 포함하는 기판, 디스플레이 영역과 라우팅영역 상에 배치되는 인캡슐레이션층, 인캡슐레이션층 상에 배치되며, 라우팅영역 중 기판의 폴딩영역과 중첩되는 제1영역과 폴딩영역과 중첩되지 않는 제2영역 중 제1영역에 배치된 복수의 홈을 포함하는 터치절연막, 터치절연막의 상부에 배치되는 터치커버, 적어도 일부가 인캡슐레이션층과 터치절연막의 사이 또는 터치절연막과 터치커버의 사이에서 액티브영역과 중첩된 위치에 배치되는 복수의 터치전극 및 라우팅영역에 배치되며, 제1영역에서 복수의 홈 또는 복수의 홈 사이에 각각 배치되며, 제2방향으로 연장되는 복수의 터치신호라인을 포함하는 표시장치를 제공하는 것이다.
다른 일측면에서, 본 발명의 실시예들은, 기판의 디스플레이 영역과 라우팅 영역 상에 배치되는 인캡슐레이션층 상에서 상기 라우팅 영역과 중첩되는 위치에 복수의 터치신호라인을 배치하는 단계, 복수의 터치신호라인이 배치된 상기 인캡슐레이션층 상에 복수의 홈을 포함하는 절연막을 배치하되, 상기 복수의 홈에 상기 복수의 터치신호라인이 각각 대등되도록 배치되는 단계 및 터치 절연막 상에 터치커버를 배치하는 단계를 포함하는 표시장치의 제조방법을 제공하는 것이다.
다른 일측면에, 본 발명의 실시예들은 인캡슐레이션층 상에 복수의 홈을 포함하는 터치절연막을 배치하는 단계, 터치절연막 상에 배치되고, 복수의 홈 사이에 배치되도록 복수의 터치신호라인을 배치하는 단계 및 복수의 타치신호라인이 배치된 상기 터치절연막 상에 터치커버를 배치하는 단계를 포함하는 표시장치의 제조방법을 제공하는 것이다.
본 발명의 실시예들에 의하면, 접힐 수 있는 터치 표시장치 및 그의 제조방법을 제공할 수 있다.
본 발명의 실시예들에 의하면, 터치감도 저하를 방지할 수 있는 터치 표시장치 및 그의 제조방법을 제공할 수 있다.
도 1은 본 발명의 실시예들에 따른 터치 표시장치를 나타내는 구조도이다.
도 2는 본 발명의 실시예들에 따른 화소를 나타내는 회로도이다.
도 3은 본 실시예에 따른 표시장치의 일 실시예를 나타내는 평면도이다.
도 4는 본 발명에 따른 표시장치가 졉혀 있는 상태를 나타내는 도면이다.
도 5와 도 6은 본 발명의 실시예들에 따른 표시장치의 단면을 나타내는 단면도이다.
도 6은 도 1에 도시된 표시장치에 채용된 라우팅영역의 일 실시예를 나타내는 평면도이다.
도 7a는 본 발명의 실시예들에 따른 표시장치에서 라우팅영역의 일부를 나타내는 평면도이다.
도 7b는 도 7a에 도시된 라우팅영역에 배치된 터치절연막을 나타내는 평면도이다.
도 8은 도 7a에서 A-A'의 단면을 나타내는 단면도이다.
도 9는 도 7a에서 B-B'의 단면을 나타내는 단면도이다.
도 10은 도 7a에서 C-C'의 단면을 나타내는 단면도이다.
도 11은 도 7a에서 B-B'의 단면을 나타내는 단면도이다.
도 12는 도 7a에서 C-C'의 단면을 나타내는 단면도이다.
도 13은 본 발명의 실시예들에 따른 표시장치에서 라우팅영역의 일부를 나타내는 평면도이다.
도 14는 도 13에서 A-A'의 단면을 나타내는 단면도이다.
도 15은 도 14에서 B-B'의 단면을 나타내는 단면도이다.
도 16은 도 13에서 C-C'의 단면을 나타내는 단면도이다.
도 17은 도 13에서 B-B'의 단면을 나타내는 단면도이다.
도 18은 도 13에서 C-C'의 단면을 나타내는 단면도이다.
도 19는 도 7a에서 A-A`의 단면을 나타내는 단면도이다.
도 20은 도 7a에서 B-B`의 단면을 나타내는 단면도이다.
도 21은 도 7a에서 C-C`의 단면을 나타내는 단면도이다.
도 22는 도 7a에서 B-B'의 단면을 나타내는 단면도이다.
도 23는 도 7a에서 C-C'의 단면을 나타내는 단면도이다.
도 24는 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이다.
도 25 및 도 26은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 27은 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이다.
도 28은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 29는 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이다.
도 30 및 도 31은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 32는 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이다.
도 33 및 도 34은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 35는 본 발명의 실시예들에 따른 표시장치의 제조방법을 나타내는 순서도이다.
이하, 본 발명의 일부 실시예들을 예시적인 도면을 참조하여 상세하게 설명한다. 각 도면의 구성요소들에 참조부호를 부가함에 있어서, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가질 수 있다. 또한, 본 발명을 설명함에 있어, 관련된 공지 구성 또는 기능에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략할 수 있다.
또한, 본 발명의 구성 요소를 설명하는 데 있어서, 제 1, 제 2, A, B, (a), (b) 등의 용어를 사용할 수 있다. 이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질, 차례, 순서 또는 개수 등이 한정되지 않는다. 어떤 구성 요소가 다른 구성요소에 "연결", "결합" 또는 "접속"된다고 기재된 경우, 그 구성 요소는 그 다른 구성요소에 직접적으로 연결되거나 또는 접속될 수 있지만, 각 구성 요소 사이에 다른 구성 요소가 "개재"되거나, 각 구성 요소가 다른 구성 요소를 통해 "연결", "결합" 또는 "접속"될 수도 있다고 이해되어야 할 것이다.
도 1은 본 발명의 실시예들에 따른 터치 표시장치를 나타내는 구조도이다.
도 1을 참조하면, 터치 표시장치(100)는 디스플레이 패널(110), 데이터드라이버(120), 게이트드라이버(130), 타이밍컨트롤러(140), 터치센서(150) 및 터치회로(160)를 포함할 수 있다.
디스플레이 패널(110)은 영상을 표시할 수 있다. 디스플레이 패널(110)은 제1방향(F1)으로 연장되는 복수의 게이트라인(GL1 내지 GLn)과 제2방향(F2)으로 배치되는 복수의 데이터라인(DL1 내지 DLm)이 배치될 수 있다. 여기서, 제1방향(F1)과 제2방향(F2)은 직교하는 것으로 도시되어 있지만, 이에 한정되는 것은 아니다. 그리고, 복수의 게이트 라인(GL1 내지 GLn)과 복수의 데이터라인(DL1 내지 DLm)과 연결되는 복수의 화소(101)를 포함할 수 있다. 복수의 화소(101)는 발광다이오드와, 발광다이오드에 구동전류를 공급하는 화소회로를 포함할 수 있다. 하지만, 이에 한정되는 것은 아니다.
화소회로는 게이트라인(GL1 내지 GLn)과 데이터라인(DL1 내지 DLm)에 연결되어 발광다이오드에 구동전류를 공급할 수 있다. 여기서, 디스플레이 패널(110)에 배치되는 배선은 복수의 게이트라인(GL1 내지 GLn)과 복수의 데이터라인(DL1 내지 DLm)에 한정되는 것은 아니다.
데이터드라이버(120)는 영상신호를 공급받아 데이터신호를 생성하여 복수의 데이터라인(DL1 내지 DLm)에 인가할 수 있다. 데이터신호는 계조에 대응할 수 있고, 대응하는 계조에 따라 데이터신호의 전압레벨이 결정될 수 있다. 데이터신호의 전압을 데이터전압이라 칭할 수 있다.
여기서, 데이터드라이버(120)의 수는 한 개인 것으로 도시되어 있지만, 이에 한정되는 것은 아니며 디스플레이 패널(110)의 크기, 해상도에 대응하여 두 개 이상일 수 있다. 또한, 데이터드라이버(120)는 집적회로(Integrated circuit)로 구현될 수 있다.
게이트드라이버(130)는 게이트신호를 복수의 게이트라인(GL1 내지 GLn)에 인가할 수 있다. 게이트신호가 인가된 복수의 게이트라인(GL1 내지 GLn)에 대응하는 화소(101)는 데이터신호를 전달받을 수 있다. 여기서, 게이트드라이버(130)의 수는 한 개인 것으로 도시되어 있지만, 이에 한정되는 것은 아니며, 적어도 두 개일 수 있다. 게이트드라이버(130)에서 출력되는 신호는 게이트신호에 한정되는 것은 아니다.
또한, 게이트드라이버(130)는 디스플레이 패널(110)의 양측에 배치되고 하나의 게이트드라이버(130)는 복수의 게이트라인(GL1 내지 GLn) 중 홀수번째 게이트라인에 연결되고 다른 하나의 게이트드라이버(130)는 복수의 게이트라인(GL1 내지 GLn) 중 짝수번째 게이트라인에 연결될 수 있다. 또한, 게이트드라이버(140)는 게이트신호생성회로와 게이트신호생성회로에 신호 및/또는 전압을 인가하는 레벨쉬프터를 포함할 수 있다. 그리고, 게이트신호생성회로는 디스플레이 패널(110) 내에 배치될 수 있다.
타이밍컨트롤러(140)는 데이터드라이버(120)와 게이트드라이버(130)를 제어할 수 있다. 또한, 타이밍컨트롤러(140)는 데이터신호에 대응하는 영상신호를 데이터드라이버(120)로 전달할 수 있다. 영상신호는 디지털신호일 수 있다. 타이밍컨트롤러(140)는 영상신호를 보정하여 데이터드라이버(120)에 전달할 수 있다. 타이밍컨트롤러(140)의 동작은 이에 한정되는 것은 아니다. 타이밍컨트롤러(140)는 집적회로로 구현될 수 있다.
터치센서(150)는 디스플레이 패널(110)과 대응하는 위치에 배치될 수 있다. 터치센서(120)는 디스플레이 패널(110) 상에서 손, 펜 등이 터치된 터치지점에 대응하여 터치센싱신호를 출력할 수 있다. 터치센서(120)에서 검출되는 터치는 터치표시장치(100)의 디스플레이 패널(110)의 일 지점을 직접 터치하는 것일 수 있다. 하지만, 이에 한정되는 것은 아니며, 터치는 터치객체가 디스플레이 패널(110)과 소정거리 이격된 상태에서 터치센서(150)가 정전용량의 변화가 발생되도록 하는 것을 포함할 수 있다.
터치회로(160)는 터치센서(150)에 터치구동신호를 공급할 수 있다. 또한, 터치회로(160)는 터치센서(150)에서 전달되는 터치센싱신호를 전달받아 터치지점에 대한 위치를 산출할 수 있다. 터치회로(160)는 터치센서(150)에 터치구동신호를 전달할 수 있다. 터치회로(160)는 산출된 터치지점에 대한 위치정보를 세트(200)로 전달할 수 있다. 세트(200)는 어플리케이션 프로세서(Application processor)을 포함할 수 있다. 하지만, 이에 한정되는 것은 아니다.
도 2는 본 발명의 실시예들에 따른 화소를 나타내는 회로도이다.
도 2를 참조하면, 화소(101)는 발광다이오드(LED)와, 발광다이오드(LED)를 구동하는 화소회로(101P)를 포함할 수 있다. 화소회로(101P)는 제1트랜지스터(M1), 제2트랜지스터(M2), 제3트랜지스터(M3) 및 캐패시터(Cst)를 포함할 수 있다.
제1트랜지스터(M1)는 제1전원(EVDD)이 전달되는 제1전원라인(VL)에 제1전극이 연결되고 제1노드(N1)에 게이트전극이 연결되며 제2노드(N2)에 제2전극이 연결될 수 있다. 제1트랜지스터(M1)는 제1노드(N1)에 전달되는 전압에 대응하여 제2노드(N2)에 전류가 흐르도록 할 수 있다. 제1트랜지스터(M1)의 제1전극은 드레인전극이고, 제2전극은 소스전극일 수 있다. 하지만, 이에 한정되는 것은 아니다.
제2노드(N2)로 흐르는 전류는 하기의 수학식 1에 대응할 수 있다.
Figure pat00001
여기서, Id는 제2노드(N2)에 흐르는 전류의 양을 의미하고, k는 트랜지스터의 전자이동도를 의미하며, VGS는 제1트랜지스터(M1)의 게이트전극과 소스전극의 전압차이를 의미하며, Vth는 제1트랜지스터(M1)의 문턱전압을 의미한다.
제2트랜지스터(M2)는 데이터라인(DL)에 제1전극이 연결되고 게이트라인(GL)에 게이트전극이 연결되며 제1노드(N1)에 제2전극이 연결될 수 있다. 따라서, 제2트랜지스터(M2)는 게이트라인(GL)을 통해 전달되는 게이트신호(GATE)에 대응하여 제1노드(N1)에 데이터신호에 대응하는 데이터전압(Vdata)이 전달되게 할 수 있다. 제2트랜지스터(M2)의 제1전극은 드레인전극이고, 제2전극은 소스전극일 수 있다. 하지만, 이에 한정되는 것은 아니다.
캐패시터(Cst)는 제1노드(N1)와 제2노드(N2) 사이에 연결될 수 있다. 캐패시터(Cst)는 제1트랜지스터(M1)의 게이트전극의 전압과 소스전극의 전압을 일정하게 유지할 수 있다.
발광다이오드(LED)는 애노드전극, 캐소드전극 및 애노드전극과 캐소드전극 사이에 배치되고, 구동전류에 대응하여 광을 발광하는 발광층을 포함할 수 있다. 발광층은 복수의 막을 포함할 수 있다. 발광층은 유기막, 무기막 중 적어도 하나의 막을 포함할 수 있다 발광다이오드(LED)는 애노드전극이 제2노드(N2)에 연결되고 캐소드전극이 제2전원(EVSS)에 연결될 수 있다. 여기서, 제2전원(EVSS)은 제1전원(EVDD)의 전압레벨보다 낮은 전압을 공급할 수 있다. 제2전원(EVSS)는 접지일 수 있다. 하지만, 이에 한정되는 것은 아니다.
발광다이오드(LED)는 애노드 전극에서 캐소드전극으로 흐르는 구동전류의 양에 대응하여 광량이 결정될 수 있다. 발광다이오드(LED)는 적색, 녹색, 청색, 백색 중 어느 하나의 색을 발광할 수 있다. 하지만, 이에 한정되는 것은 아니다.
도 3은 본 실시예에 따른 표시장치의 일 실시예를 나타내는 평면도이다.
도 3을 참조하면, 표시장치(100)는 제1방향(F1)으로 연장되는 복수의 게이트라인(GL)과 제2방향(F2)으로 연장되는 복수의 데이터라인(DL)과 복수의 게이트라인(GL)과 복수의 데이터라인(DL)에 연결되는 복수의 화소가 배치되는 디스플레이 영역(111a)과, 디스플레이 영역(111a)의 테두리에 배치되는 라우팅영역(111b)을 포함하는 기판(111)을 포함할 수 있다.
기판(111)에는 디스플레이 영역(111a)의 일부와 라우팅영역(111b)의 일부를 포함하는 폴딩영역(111p)을 포함할 수 있다. 라우팅영역(111b)은 폴딩영역(111p)과 중첩되는 제1영역(X)과 폴딩영역(111p)과 중첩되지 않는 제2영역(Y)을 포함할 수 있다.
또한, 라우팅영역(111b)에는 복수의 전원선과 신호선이 배치될 수 있다. 또한, 기판(111)의 하부에는 드라이버 IC(111d)가 배치되는 회로영역(111c)이 배치될 수 있다. 회로영역(111c)에 배치되는 드라이버 IC(111d)는 도 1에 도시된 데이터드라이버(120)일 수 있다. 하지만, 이에 한정되는 것은 아니다.
회로영역(111c)과 디스플레이 영역(111a) 사이에는 링크영역(111e)이 배치될 수 있고, 링크영역(111e)에는 드라이버 IC(111d)의 복수의 출력단과 디스플레이 영역(111a)에 배치되어 있는 복수의 데이터라인(DL)을 연결하는 복수의 링크라인(RK)이 배치될 수 있다. 디스플레이 영역(111a)의 좌우에는 게이트신호발생회로가 배치될 수 있고, 복수의 링크라인(RL) 중 일부는 게이트신호발생회로에 클럭신호를 공급하여 게이트신호발생회로에서 게이트신호를 발생시켜 복수의 게이트라인(GL)으로 공급되게 할 수 있다. 기판(111)은 링크영역(111e)에서 휘어질 수 있다.
도 4는 본 발명에 따른 표시장치가 졉혀 있는 상태를 나타내는 도면이다.
도 4를 참조하면, 사용자는 휴대 시에는 표시장치(100)가 접혀진 상태로 소지할 수 있고, 사용자는 표시장치(100)가 펼쳐진 상태에서 디스플레이 영역(111a)에 표시되는 영상을 볼 수 있다. 표시장치(100)는 도시된 것과 같이 폴딩영역(111p)을 축으로 접힐 수 있다. 폴딩영역(111p)이 접힐 때 폴딩영역(111p)은 일정한 곡률을 갖게 돌 수 있다. 여기서는 표시장치(100)이 접히는 경우 디스플레이 영역(111a)가 서로 맞닿는 것으로 도시되어 있지만 이에 한정되는 것은 아니다.
도 5와 도 6은 본 발명의 실시예들에 따른 디스플레이 패널의 나타내는 단면도이다.
도 5 및 도 6을 참조하면, 디스플레이 패널(110)은 기판(111)상에 멀티버퍼층(1111)이 형성되고, 멀티버퍼층(1111) 상에 액티브버퍼층(1112)이 형성될 수 있다. 멀티버퍼층(1111)과 액티브버퍼층(1112)을 통칭해서 버퍼층이라고 칭할 수 있다. 기판(111)은 폴리아미드(polyamide: PI)를 포함할 수 있다. 하지만, 이에 한정되는 것은 아니다. 또한, 기판(111)은 플렉서블할 수 있다. 여기서, 플렉서블한 기판(111)은 접히거나 휘어질 수 있다.
액티브버퍼층(1112) 상에 액티브층(1121)이 패터닝되어 배치될 수 있다. 멀티버퍼층(1111)과 액티브버퍼층(1112)은 디스플레이 기판(111)에 존재하는 이물질이 액티브층(112a)으로 침투하는 것을 방지할 수 있다. 멀티버퍼층(1111)은 복수의 무기막을 포함하며, 각 무기막은 이산화규소(SiO2)와 질화규소(SiNx)를 포함할 수 있다. 그리고, 액티브버퍼층(1112)은 무기막을 포함하며 무기막은 이산화규소(SiO2)를 포함할 수 있다.
액티브층(1121) 상에 게이트절연막(1122)이 배치될 수 있다. 그리고, 게이트절연막(1122) 상에 게이트메탈이 패터딩되어 형성되는 게이트전극(1123)이 배치될 수 있다. 게이트절연막(1122)은 이산화규소(SiO2)를 포함할 수 있다. 게이트전극(1123) 상에는 순차적으로 적층된 제1층간절연막(1124)과 제2층간절연막(1125)이 배치될 수 있다. 제1층간절연막(1124)은 이산화규소(SiO2)와 질화규소(SiNx)를 포함할 수 있고 제2층간절연막(1125)은 이산화규소(SiO2)와 질화규소(SiNx)를 포함할 수 있다.제2층간절연막(1125)의 상부에는 소스드레인메탈이 패터닝되어 드레인전극(1126a)과 소스전극(1126b)이 배치될 수 있다. 드레인전극(1126a)과 소스전극(1126b) 상에는 평탄화막(1127)이 배치될 수 있다.
그리고, 평탄화막(1127) 상에는 애노드전극(1131)이 배치될 수 있다.또한, 평탄화막(1127)에는 컨텍홀이 형성되고 애노드전극(1131)은 컨텍홀을 통해 소스전극(1126b)에 연결될 수 있다. 그리고,평탄화막(1127) 상에 뱅크(1132)가 형성되고 뱅크(1132)에는 캐버티가 형성되고 캐버티에 발광막(1133)이 형성될 수 있다. 여기서, 발광막(1133)은 하나의 막인 것으로 도시되어 있지만, 이에 한정되는 것은 아니며, 복수의 발광막을 포함할 수 있다. 발광막(1113) 상에는 캐소드전극(1134)이 형성될 수 있다. 캐소드전극(1134)은 공통전극일 수 있다.
캐소드전극(1134) 상에는 인캡슐레이션층(114)이 배치될 수 있다. 인캡슐레이션층(114)은 제1무기막(1141)과, 제2무기막(1143)과, 제1무기막(1141)과 제2무기막(1143) 사이에 배치되는 유기막(1142)을 포함할 수 있다. 유기막(1142)의 두께는 제1무기막(1141)과 제2무기막(1143)의 두께보다 두껍게 배치되어 이물이 인캡슐레이션층(114)을 통과하여 발광막(1133)에 침투하는 것을 방지할 수 있다.
기판(111) 상에 유기막(1142)이 외부로 배출되는 것을 방지하기 위해 2중의 댐(1132a)이 형성될 수 있고 제1무기막(1141)은 댐(1132a)의 상부를 덮을 수 있다. 그리고, 제2무기막(1143)은 일단이 제1무기막(1141)과 댐(1132a)에서 만날 수 있다. 댐(1132a)은 뱅크(1132)와 동일한 물질을 포함할 수 있다. 여기서, 댐(1132a)의 수는 두 개 인 것으로 도시되어 있지만, 이에 한정되는 것은 아니다. 또한, 댐(1132a)의 높이 역시 다를 수 있다.
그리고, 인캡슐레이션층(114) 상에 터치센서(150)가 배치될 수 있다. 터치센서(150)는 복수의 터치전극(150a,150b)을 포함할 수 있다. 또한, 디스플레이 패널(110)은 인캡슐레이션층(114) 상에 배치되는 터치버퍼층(114a)이 더 포함할 수 있다. 복수의 터치전극(150a)은 도전층이 패터닝되어 형성될 수 있는데, 인캡슐레이션층(114) 상에서 도전층을 패터닝하게 되면, 인캡슐레이션층(114)에 데미지가 가해질 수 있다. 이를 방지하기 위해, 인캡슐레이션층(114) 상에 터치버퍼층(114a)이 배치된 후 터치버퍼층(114a)상에 터치전극(150a,150b)을 포함하는 터치센서(150)를 배치할 수 있다. 복수의 터치전극(150a,150b)은 제1터치전극(150a)와 제2터치전극(150b)를 포함할 수 있다. 또한, 제1터치전극(150a)와 제2터치전극(150b) 사이에는 터치절연막(115)이 배치될 수 있다.
터치센서(150)는 터치버퍼층(114a) 상에 제1터치신호라인(150a)을 패터닝하여 형성한 후, 제1터치신호라인(150a) 상에 터치절연막(115)을 배치하고 터치절연막(115)의 상부에 제2터치신호라인(150b)이 배치됨으로써 표시장치(100)에 포함될 수 있다. 제2터치신호라인(150b)은 터치절연막(115)에 컨텍홀을 형성하고, 컨텍홀을 통해 제2터치신호라인(150b)과 제1터치신호라인(150a)는 서로 연결될 수 있다.
또한, 터치버퍼층(114a) 상에 제1터치신호라인(TSLa) 및/또는 제2터치신호라인(TSLb)이 배치될 수 있다. 제1터치신호라인(TSLa)은 도 5에 도시되어 있는 것과 같이 터치버퍼층(114a) 상에 배치될 수 있다. 그리고, 제1터치신호라인(TSLa) 상부에 터치절연막(115)이 배치될 수 있다. 또한, 제2터치신호라인(TSLb)은 도 6에 도시되어 있는 것과 같이 터치절연막(115) 상에 배치될 수 있다. 제2터치신호라인(TSLb) 상에는 터치커버(151)가 배치될 수 있다. 터치커버(151)는 유기막 또는 무기막일 수 있다.
도 3에 도시된 디스플레이 영역(111a)은 인캡슐레이션층 (1141,1142,1143)의 수평면(PL)에 대응하고, 라우팅영역(111b)은 인캡슐레이션층 (1141,1142,1143)의 경사면(SL)에 대응할 수 있다. 그리고, 제1터치신호라인(TSLa) 및/또는 제2터치신호라인(TSLb)은 인캡슐레이션층(1141,1142,1143)의 경사면(SL)에 배치될 수 있다.
도 7a는 본 발명의 실시예들에 따른 표시장치에서 라우팅영역의 일부를 나타내는 평면도이고, 도 7b는 도 7a에 도시된 라우팅영역에 배치된 터치절연막을 나타내는 평면도이다.
도 7a 및 도 7b을 참조하면, 기판(111)의 라우팅영역에 폴딩영역(111p) 중첩되는 제1영역(X)과 폴딩영역(111p)과 중첩되지 않는 제2영역(Y)이 배치될 수 있다. 제2영역(Y)은 제1영역(X)의 상부와 하부에 각각 배치될 수 있다. 제1영역(X)과 제2영역(Y)에는 터치절연막(115)이 배치되는데, 제1영역(X)에 배치된 터치절연막(115)은 복수의 홀(115h)을 포함할 수 있다.
그리고, 제1영역(X)과 제2영역(Y)에는 제2방향(F2)으로 연장되는 복수의 제1터치신호라인(TSLa)이 배치될 수 있다.
제1영역(X)에서는 복수의 홀(115h)은 각각 제1터치신호라인(TSLa)과 중첩되게 배치될 수 있다. 제1터치신호라인(TSLa)이 홀(115h)과 중첩되게 배치되면, 제1영역(X)에서 제1터치신호라인(TSLa) 상에 터치절연막(115)이 배치되지 않게 된다.
제2영역(Y)에서는 제1터치신호라인(TSLa)의 상부에 터치절연막(115)이 배치될 수 있다. 여기서, 제1영역(X) 상에 배치된 제1터치신호라인(TSLa)의 상부에는 터치절연막(115)이 배치되지 않고 제2영역(Y) 상에 배치된 제1터치신호라인(TSLa)은 절연막(115)에 덮히게 될 수 있다. 제2영역(Y) 상에 배치된 제1터치신호라인(TSLa)이 터치절연막(115)에 덮혀있는 것을 나타내기 위해 제2영역(Y)에는 복수의 제1터치신호라인(TSLa)의 테두리를 점선으로 표시하였다.
또한, 제1영역(X)에서 복수의 홀(115h) 사이의 영역과 중첩되는 위치에 각각의 제1터치신호라인(TSLa)이 배치될 수 있다. 복수의 홀(115h) 사이의 영역과 중첩되는 위치에 제1터치신호라인(TSLa)이 배치되면, 제1터치신호라인(TSLa) 상에서 제1터치신호라인(TSLa)과 중첩되는 위치에 터치 절연막(115)이 배치될 수 있다.
제1영역(X)에 배치되어 있는 제1터치신호라인(TSLa)는 상부와 하부에 터치절연막(115)가 배치되어 있지 않기 때문에 폴딩영역을 접을 때, 제1영역(X)은 터치절연막(115)에 의해 힘이 가해지지 않고, 제1터치신호라인(TSLa)이 터치절연막(115)보다 연성이 더 뛰어나기 때문에 휘어지더라도 제1터치신호라인(TSLa)이 손상되는 것을 억제할 수 있다. 따라서, 폴딩영역에서 기판(111)이 접히는 부분에서 손상에 의한 터치감도 저하를 방지할 수 있다.
도 8은 도 7a에서 A-A'의 단면을 나타내는 단면도이고, 도 9는 도 7a에서 B-B'의 단면을 나타내는 단면도이다. 또한, 도 10은 도 7a에서 C-C'의 단면을 나타내는 단면도이다. 여기서, 제1터치신호라인(TSLa) 및/또는 제2터치신호라인(TSLb)은 복수의 홀(115h)에 각각 중첩되도록 배치되어 있는 경우를 나타낸다.
도 8 내지 도 10을 참조하면, 제1무기막(1141), 유기막(1142), 제2무기막(1143)을 포함하는 인캡슐레이션층(1141,1142,1143) 상에 터치버퍼층(114a)이 배치될 수 있다. 그리고, 터치버퍼층(114a) 상에 제1터치신호라인(TLSa)이 배치되고, 제1터치신호라인(TLSa) 상에 터치절연막(115)이 배치될 수 있다. 터치절연막(115)은 무기막 또는 유기막일 수 있다. 터치절연막(115) 상에 터치커버(151)가 배치될 수 있다. 터치커버(151)는 무기막 또는 유기막일 수 있다.
제2영역(Y)에서는 터치절연막(115)이 제1터치신호라인(TSLa)의 상부와 터치버퍼층(114a)의 상부를 덮을 수 있다. 반면, 제1영역(X)에서는 터치절연막(115)에 복수의 홀(115h)이 형성되어 있고 복수의 홀(115h)에 각각 제1터치신호라인(TSLa)이 중첩되게 배치될 수 있어 터치절연막(115)의 홀(115h) 내에 제1터치신호라인(TSLa)이 배치될 수 있다. 그리고, 제1터치신호라인(TSLa)의 상부에 터치절연막(115)이 배치되지 않게 될 수 있다. 또한, 제1영역(X)과 제2영역(Y)에서 터치절연막(115) 상에 터치커버(151)가 배치되는데, 터치커버(151)는 제1영역(X)의 복수의 홀(115h)에 일부가 배치될 수 있다. 터치커버(151)는 무기막 또는 유기막일 수 있다.
터치커버(151)는 도 9의 (a)에 도시되어 있는 것과 같이 제1터치신호라인(TSLa)이 배치되어 있는 홀(115h)의 상부에 배치될 수 있다. 그리고, 제1터치신호라인(TSLa)은 터치절연막(115)에 포함된 홀(115h) 내에 배치될 수 있다. 또한, 터치커버(151)는 도 9의 (b)에 도시되어 있는 것과 같이 일부가 홀(115h)에 삽입되어 제1터치신호라인(TSLa)의 좌측과 우측을 통해 터치버퍼층(114a)에 접촉하게 될 수 있다. 터치버퍼층(114a)에 터치커버(151)의 일부가 접촉하게 될 때, 터치버퍼층(114a)에는 홈(114h)이 형성되어 있을 수 있다. 또한, 도 9의 (c)에 도시되어 있는 것과 같이, 터치절연막(115)이 제1터치신호라인(TSLa)의 테두리와 일부 중첩되게 배치될 수 있다. 따라서, 제1터치신호라인(TSLa)의 중심부는 터치절연막(115)에 의해 가려지지 않게 될 수 있다.
또한, 도 10에 도시되어 있는 것과 같이 터치절연막(115)은 제1영역(X)과 제2영역(Y)에 배치되되, 복수의 홀(115h)은 제1영역(X)내에서 제1영역(X)과 제2영역(Y)의 경계까지 연장되어 있어 터치절연막(115)은 제2영역(Y)에만 배치되고 홀(115h)에 대응되는 제1영역(X)에는 터치절연막(115)이 배치되지 않게 될 수 있다. 또한, 제1영역(X)에 터치절연막(115)이 배치되어 있지 않은 대신, 터치커버(151)의 일부가 배치될 수 있다.
도 11은 도 7a에서 B-B'의 단면을 나타내는 단면도이고, 도 12는 도 7a에서 C-C'의 단면을 나타내는 단면도이다. 여기서, 제1터치신호라인(TSLa)은 터치절연막(115)에 포함된 복수의 홀(115h) 사이의 영역에 각각 중첩되도록 배치되어 있는 경우를 나타낸다.
도 11 및 도 12를 참조하면, 제1무기막(1141), 유기막(1142), 제2무기막(1143)을 포함하는 인캡슐레이션층(1141,1142,1143) 상에 터치버퍼층(114a)이 배치될 수 있다. 그리고, 터치버퍼층(114a) 상에 제1터치신호라인(TSLa)이 배치되고, 제1터치신호라인(TSLa) 상에 터치절연막(115)이 배치될 수 있다. 터치절연막(115)은 무기막 또는 유기막일 수 있다.
제2영역(Y)에서는 터치절연막(115)이 제1터치신호라인(TSLa)의 상부와 터치버퍼층(114a)의 상부를 덮을 수 있다. 반면, 제1영역(X)에서는 터치절연막(115)에 복수의 홀(115h)이 형성되어 있고 복수의 홀(115h) 사이에 각각 제1터치신호라인(TSLa)이 배치될 수 있어 터치절연막(115)은 제1터치신호라인(TSLa) 상부에 배치될 수 있다. 그리고, 제1영역(X)과 제2영역(Y)에서 터치절연막(115) 상에 터치커버(151)가 배치되는데, 터치커버(151)는 제1영역(X)의 복수의 홀(115h)에 일부가 삽입될 수 있다.
또한, 터치커버(151)는 터치절연막(115)의 홀(115h) 사이의 영역과 대응되는 위치에 홈(151g)이 형성되고 홈(151g)에 제1터치신호라인(TSLa)과 터치절연막(115)이 중첩되어 배치될 수 있다. 이때, 터치버퍼층(114a)의 일부가 터치커버(151)에 형성된 홈(151g)에 삽입될 수 있다.
터치커버(151)에 형성된 홈(151g)에 도 11의 (a)에 도시되어 있는 것과 같이 폭이 동일한 제1터치신호라인(TSLa)과 터치절연막(115)이 삽입될 수 있다. 또한, 터치커버(151)에 형성된 홈(151g)에 도 11의 (b)에 도시되어 있는 것과 같이 제1터치신호라인(TSLa)과 제1터치신호라인(TSLa)의 폭보다 더 넓은 폭을 갖는 터치절연막(115)이 삽입될 수 있다. 또한, 터치커버(151)에 형성된 홈(151g)에 도 11의 (c)에 도시되어 있는 것과 같이 제1터치신호라인(TSLa)과 제1터치신호라인(TSLa)의 폭보다 더 좁은 폭을 갖는 터치절연막(115)이 삽입될 수 있다. 여기서, 터치커버(151)에 형성된 홈(151g)의 폭은 제1터치신호라인(TSLa)의 폭보다 더 넓을 수 있다.
도 13은 본 발명의 실시예들에 따른 표시장치에서 라우팅영역의 일부를 나타내는 평면도이다.
도 13을 참조하면, 기판(111)의 라우팅영역에 폴딩영역(111p) 중첩되는 제1영역(X)과 폴딩영역(111p)과 중첩되지 않는 제2영역(Y)이 배치될 수 있다. 제2영역(Y)은 제1영역(X)의 상부와 하부에 각각 배치될 수 있다. 제1영역(X)과 제2영역(Y)에는 터치절연막(115)이 배치되는데, 도 7b에 도시되어 있는 것과 같이 터치절연막(115)은 제1영역(X)에서 복수의 홀(115h)을 포함할 수 있다.
그리고, 제1영역(X)과 제2영역(Y)에는 제2방향(F2)으로 연장되는 복수의 제2터치신호라인(TSLb)이 배치될 수 있다.
제1영역(X)에서는 터치버퍼층(114a) 상에 터치절연막(115)이 배치되고, 터치절연막(115)의 상부에 제2터치신호라인(TSLb)가 배치될 수 있다. 제2터치신호라인(TSLb)는 복수의 홀(115h)과 중첩되게 배치될 수 있다. 각 제2터치신호라인(TSLb)이 홀(115h)과 중첩되게 배치되게 되면, 제2터치신호라인(TSLb)은 홀(115h)에 삽입될 수 있어 제2터치신호라인(TSLb)의 상부와 하부에서 제2터치신호라인(TSLb)과 중첩되는 위치에는 터치절연막(115)이 배치되지 않게 될 수 있다. 제2영역(Y)에서는 터치절연막(115)의 상부에 복수의 제2터치신호라인(TSLb)이 배치될 수 있다.
또한, 제1영역(X)에서 복수의 홀(115h) 사이의 영역과 중첩되는 위치에 각 제2터치신호라인(TSLb)이 배치될 수 있다. 복수의 홀(115h) 사이의 영역과 중첩되는 위치에 제2터치신호라인(TSLb)이 배치되면, 제2터치신호라인(TSLb) 상에 터치절연막(115)이 배치될 수 있다.
도 14는 도 13에서 A-A'의 단면을 나타내는 단면도이고, 도 15은 도 14에서 B-B'의 단면을 나타내는 단면도이다. 또한, 도 16은 도 13에서 C-C'의 단면을 나타내는 단면도이다. 여기서, 제2터치신호라인(TSLb)은 복수의 홀(115h)에 각각 중첩되도록 배치되어 있는 경우를 나타낸다.
도 14 내지 도 18을 참조하면, 제1무기막(1141), 유기막(1142), 제2무기막(1143)을 포함하는 인캡슐레이션층(1141,1142,1143) 상에 터치버퍼층(114a)이 배치될 수 있다. 그리고, 터치버퍼층(114a) 상에 터치절연막(115)이 배치되고, 터치절연막(115)의 상부에 제2터치신호라인(TSLb)가 배치될 수 있다. 그리고, 제2터치신호라인(TSLb)이 배치된 터치절연막(115)의 상부에 터치커버(151)가 배치될 수 있다. 터치절연막(115)과 터치커버(151)는 무기막 또는 유기막일 수 있다.
제2영역(Y)에서는 터치절연막(115)이 터치버퍼층(114a)의 상부를 덮고 터치버퍼층(114a)의 상부에 제2터치신호라인(TSLb)이 배치될 수 있다. 반면, 제1영역(X)에서는 터치절연막(115)에 복수의 홀(115h)이 형성되어 있고 복수의 홀(115h)과 중첩되는 위치에 제2터치신호라인(TSLb)이 배치될 수 있어 제2터치신호라인(TSLb)이 홀(115h)에 삽입될 수 있다. 따라서, 제1영역(X)에서 터치절연막(115)은 제2터치신호라인(TSLb) 상부와 하부에 중첩되지 않게 배치될 수 있다.
터치커버(151)는 제1영역(X)과 제2영역(Y)에서 터치절연막(115) 상에 배치되는데, 터치커버(151)의 일부가 제1영역(X)의 복수의 홀(115h)에 배치될 수 있다. 터치커버(151)는 무기막 또는 유기막일 수 있다. 터치커버(151)는 도 15의 (a)에 도시되어 있는 것과 같이 제2터치신호라인(TSLb)이 배치되어 있는 홀(115h)의 상부에 배치될 수 있다. 또한, 터치커버(151)는 도 15의 (b)에 도시되어 있는 것과 같이 일부가 홀(115h)에 삽입되어 제2터치신호라인(TSLb)의 좌측과 우측을 통해 터치버퍼층(114a)에 접촉하게 될 수 있다. 터치버퍼층(114a)에 터치커버(151)의 일부가 접촉하게 될 때, 터치버퍼층(114a)에는 홈(114h)이 형성되어 있을 수 있다. 또한, 도 15의 (c)에 도시되어 있는 것과 같이 터치버퍼층(114a)에 홈이 형성되고 터치신호라인(TSLb)가 터치버퍼층(114a)의 홈에 삽입되고, 터치절연막(115)과 일부 중첩되게 배치될 수 있다.
또한, 도 16에 도시되어 있는 것과 같이 터치절연막(115)은 제1영역(X)과 제2영역(Y)에 배치되되, 복수의 홈(115h)은 제1영역(X)내에서 제1영역(X)과 제2영역(Y)의 경계까지 연장되어 있어 터치절연막(115)은 제2영역(Y)에만 배치되고 홀(115h)에 대응되는 제1영역(X)에는 터치절연막(115)이 배치되지 않게 될 수 있다. 그리고, 제1영역(X)에 배치된 제2터치신호라인(TSLb)는 홀(115h)에 삽입되기 때문에 제2영역(Y)에 배치된 제2터치신호라인(TSLb) 보다 낮은 위치에 배치될 수 있다.
도 17은 도 13에서 B-B'의 단면을 나타내는 단면도이고, 도 18은 도 13에서 C-C'의 단면을 나타내는 단면도이다. 여기서, 제2터치신호라인(TSLb)은 복수의 홈 사이에 각각 배치되어 있는 경우를 나타낸다.
도 17 및 도 18을 참조하면, 제1무기막(1141), 유기막(1142), 제2무기막(1143)을 포함하는 인캡슐레이션층(1141,1142,1143) 상에 터치버퍼층(114a)이 배치될 수 있다. 그리고, 터치버퍼층(114a) 상에 터치절연막(115)이 배치되고, 터치절연막(115) 상에 제2터치신호라인(TSLb)이 배치될 수 있다. 터치절연막(115)은 무기막 또는 유기막일 수 있다.
제2영역(Y)에서는 터치절연막(115)이 제1터치신호라인(TSLa)과 터치버퍼층(114a)를 덮을 수 있고, 터치절연막(115) 상부에 제1터치신호라인(TSLa)과 중첩되는 위치에 제2터치신호라인(TSLb)이 배치될 수 있다. 제2터치신호라인(TSLb)의 상부에 터치커버(151)가 배치될 수 있다. 터치커버(151)는 무기막 또는 유기막일 수 있다.
제2영역(Y)에서는 제2터치신호라인(TSLb)의 하부에 터치절연막(115)과 터치버퍼층(114a)이 배치될 수 있다. 제1영역(X)에서는 터치절연막(115)에 복수의 홀(115h)이 형성되어 있고 복수의 홀(115h) 사이에 각각 제2터치신호라인(TSLb)이 배치될 수 있다. 따라서, 제2터치신호라인(TSLb)의 하부에 터치절연막(115)이 배치될 수 있다.
그리고, 제1영역(X)과 제2영역(Y)에서 터치절연막(115) 상에 터치커버(151)가 배치되는데, 터치커버(151)는 터치절연막(115)의 홀(115h) 사이의 영역과 대응되는 위치에 홈(151g)이 형성되고 홈(151g)에 터치절연막(115) 제2터치신호라인(TSLb)가 중첩되어 배치될 수 있다. 이때, 터치버퍼층(114a)의 일부가 터치커버(151)에 형성된 홈(151g)에 삽입될 수 있다.
터치커버(151)에 형성된 홈(151g)에 도 17의 (a)에 도시되어 있는 것과 같이 폭이 동일한 터치절연막(115), 제2터치신호라인(TSLb)이 삽입될 수 있다. 또한, 터치커버(151)에 형성된 홈(151g)에 도 17의 (b)에 도시되어 있는 것과 같이 제2터치신호라인(TSLb)의 폭보다 더 넓은 폭을 갖는 터치절연막(115)과 제2터치신호라인(TSLa)이 삽입될 수 있다. 또한, 터치커버(151)에 형성된 홈(151g)에 도 17의 (c)에 도시되어 있는 것과 같이 제2터치신호라인(TSLb)의 폭보다 더 좁은 폭을 갖는 터치절연막(115)과 제2터치신호라인(TSLb)가 삽입될 수 있다. 제2터치신호라인(TSLb)은 터치절연막(115)의 상부와 측면을 덮을 수 있다. 이때, 제2터치신호라인(TSLb)은 터치절연막(115)에 형성된 홀(115h)에 일부가 삽입될 수 있다.
또한, 터치커버(151)의 하부에 배치되어 있는 터치버퍼층(114a)의 일부가 터치커버(151)에 형성된 홈(151g)에 삽입될 수 있다.
도 19는 도 7a에서 A-A`의 단면을 나타내는 단면도이고, 도 20은 도 7a에서 B-B`의 단면을 나타내는 단면도이다. 또한, 도 21은 도 7a에서 C-C`의 단면을 나타내는 단면도이다. 도 7a에 제2터치신호라인(TSLb)은 도시되어 있지 않지만, 제1터치신호라인(TSLb)과 중첩되게 배치되어 있어, 제1터치신호라인(TSLb)과 제2터치신호라인(TSLb)은 터치절연막(115)에 포함된 복수의 홀(115h)에 각각 중첩되도록 배치되어 있는 경우를 나타낸다.
도 19 내지 도 21을 참조하면, 제1무기막(1141), 유기막(1142), 제2무기막(1143)을 포함하는 인캡슐레이션층(1141.1142,1143) 상에 터치버퍼층(114a)이 배치될 수 있다. 그리고, 터치버퍼층(114a) 상에 제1터치신호라인(TSLa)이 배치되고, 제1터치신호라인(TSLa)이 배치된 터치버퍼층(114a) 상에 터치절연막(115)이 배치될 수 있다. 터치절연막(115)은 무기막 또는 유기막일 수 있다. 터치절연막(115) 상에 제1터치신호라인(TSLa)과 중첩되는 위치에 제2터치신호라인(TSLb)이 배치될 수 있다. 그리고, 제2터치신호라인(TSLb)이 배치된 터치절연막(115) 상에 터치커버(151)가 배치될 수 있다. 터치커버(151)는 무기막 또는 유기막일 수 있다.
제2영역(Y)에서는 터치절연막(115)이 제1터치신호라인(TSLa)의 상부와 터치버퍼층(114a)의 상부를 덮을 수 있다. 반면, 제1영역(X)에서는 터치절연막(115)에 복수의 홀(115h)이 형성되어 있고 복수의 홀(115h)에 각각 제1터치신호라인(TSLa)이 중첩되게 배치될 수 있어 터치절연막(115)의 홀(115h) 내에 제1터치신호라인(TSLa)이 배치될 수 있다. 그리고, 제2터치신호라인(TSLb)은 제1터치신호라인(TSLa)과 중첩되게 배치되어 있어서 터치절연막(115)의 홀(115h)과 중첩되는 위치에 제2터치신호라인(TSLb)이 배치될 수 있다. 따라서, 제1영역(X)에서 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)은 서로 접촉할 수 있다. 그리고, 제1영역(X)에서 제2터치신호라인(TSLb)의 상부에 터치절연막(115)이 배치되지 않게 될 수 있다. 또한, 제1영역(X)과 제2영역(Y)에서 터치절연막(115) 상에 터치커버(151)가 배치되는데, 터치커버(151)는 제1영역(X)의 복수의 홀(115h)에 일부가 배치될 수 있다. 터치커버(151)는 무기막 또는 유기막일 수 있다.
터치커버(151)는 도 20의 (a)에 도시되어 있는 것과 같이 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)이 중첩되어 배치되어 있는 홀(115h)의 상부에 배치될 수 있다. 또한, 터치커버(151)는 도 20의 (b)에 도시되어 있는 것과 같이 일부가 홀(115h)에 삽입되어 중첩되어 배치되어 있는 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)의 좌측과 우측을 통해 터치버퍼층(114a)에 접촉하게 될 수 있다. 터치버퍼층(114a)에 터치커버(151)의 일부가 접촉하게 될 때, 터치버퍼층(114a)에는 홈(114h)이 형성되어 있을 수 있다. 그리고, 제2터치신호라인(TSLb)의 폭이 제1터치신호라인(TSLa)의 폭보다 더 넓을 수 있다. 또한, 도 20의 (c)에 도시되어 있는 것과 같이, 터치절연막(115)이 제1터치신호라인(TSLa)의 테두리와 일부 중첩되게 배치되고 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)과 접촉하고 터치절연막(115)의 일부와 중첩되게 배치될 수 있다.
또한, 도 21에 도시되어 있는 것과 같이 터치절연막(115)은 제1영역(X)과 제2영역(Y)에 배치되되, 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)이 중첩되어 있는 영역에는 배치되지 않을 수 있다.
도 22는 도 7a에서 B-B'의 단면을 나타내는 단면도이고, 도 23는 도 7a에서 C-C'의 단면을 나타내는 단면도이다. 도 7a에 제2터치신호라인(TSLb)은 도시되어 있지 않지만, 제1터치신호라인(TSLb)과 중첩되게 배치되어 있어, 제1터치신호라인(TSLb)과 제2터치신호라인(TSLb)은 터치절연막(115)에 포함된 복수의 홀(115h) 사이의 영역에 각각 중첩되도록 배치되어 있는 경우를 나타낸다.
도 22 및 도 23을 참조하면, 제1무기막(1141), 유기막(1142), 제2무기막(1143)을 포함하는 인캡슐레이션층(1141,1142,1143) 상에 터치버퍼층(114a)이 배치될 수 있다. 그리고, 터치버퍼층(114a) 상에 제1터치신호라인(TSLa)이 배치되고, 제1터치신호라인(TSLa) 상에 터치절연막(115)이 배치될 수 있다. 터치절연막(115)은 무기막 또는 유기막일 수 있다. 그리고, 터치절연막(115) 상에 제2터치신호라인(TSLb)이 배치될 수 있다.
제2영역(Y)에서는 터치절연막(115)이 제1터치신호라인(TSLa)의 상부와 터치버퍼층(114a)의 상부를 덮을 수 있고, 터치절연막(115) 상부에 제1터치신호라인(TSLa)과 중첩되는 위치에 제2터치신호라인(TSLb)이 배치될 수 있다. 반면, 제1영역(X)에서는 터치절연막(115)에 복수의 홀(115h)이 형성되어 있고 복수의 홀(115h)과 홀(115h) 사이의 영역에 각각 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)이 배치될 수 있어 터치절연막(115)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb) 사이에 배치될 수 있다. 그리고, 제1영역(X)과 제2영역(Y)에서 터치절연막(115) 상에 터치커버(151)가 배치될 수 있다.
터치커버(151)는 터치절연막(115)의 홀(115h) 사이의 영역과 대응되는 위치에 홈(151g)이 형성되고 홈(151g)에 제1터치신호라인(TSLa), 터치절연막(115) 제2터치신호라인(TSLb)가 중첩되어 배치될 수 있다. 이때, 터치버퍼층(114a)의 일부가 터치커버(151)에 형성된 홈(151g)에 삽입될 수 있다.
터치커버(151)에 형성된 홈(151g)에 도 22의 (a)에 도시되어 있는 것과 같이 폭이 동일한 제1터치신호라인(TSLa), 터치절연막(115), 제2터치신호라인(TSLb)이 삽입될 수 있다. 또한, 터치커버(151)에 형성된 홈(151g)에 도 22의 (b)에 도시되어 있는 것과 같이 제1터치신호라인(TSLa)과 제1터치신호라인(TSLa)의 폭보다 더 넓은 폭을 갖는 터치절연막(115)과 제2터치신호라인(TSLa)이 삽입될 수 있다. 터치절연막(115)은 제1터치신호라인(TSLa)의 상부와 측면을 덮을 수 있다. 또한, 터치커버(151)에 형성된 홈(151g)에 도 22의 (c)에 도시되어 있는 것과 같이 제1터치신호라인(TSLa)과 제1터치신호라인(TSLa)의 폭보다 더 좁은 폭을 갖는 터치절연막(115)과 제2터치신호라인(TSLb)가 삽입될 수 있다. 제2터치신호라인(TSLb)은 터치절연막(115)의 상부와 측면을 덮을 수 있다.
또한, 도 23에 도시되어 있는 것과 같이 터치절연막(115)은 제1영역(X)과 제2영역(Y)에 배치될 수 있다.
도 24는 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이고, 도 25 및 도 26은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 24 내지 도 26을 참조하면, 제1영역(X)에는 제2방향(F2)으로 연장되는 터치신호라인(TSLa, TSLb)이 배치될 수 있다. 터치신호라인(TSLa, TSLb)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)을 포함하며, 제2터치신호라인(TSLb)의 하부에 제1터치신호라인(TSLa)이 배치되어 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa)은 중첩될 수 있다.
그리고, 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb) 사이에 터치절연막(115)이 배치될 수 있다. 터치절연막(115)에는 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)과 중첩되는 위치에서 복수의 홈이 제2방향(F2)으로 배열되고, 복수의 홈을 통해 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)에 접촉할 수 있다. 따라서, 도 25에 도시되어 있는 것과 같이 B-B`의 단면을 보면 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)이 접촉하고 있고, D-D`의 단면을 보면 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)은 접촉하지 않고 있다. 또한, 도 26에 도시되어 있는 것과 같이 C-C` 단면을 보면, 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)과 일부 접촉하고 있는 것이 나타나 있다.
그리고, 제2터치신호라인(TLSb) 상에 터치커버(151)가 배치될 수 있다.
도 27은 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이고, 도 28은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 27 및 도 28를 참조하면, 제1영역(X)에는 제2방향(F2)으로 연장되는 터치신호라인(TSLa, TSLb)이 배치될 수 있다. 터치신호라인(TSLa, TSLb)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)을 포함하며, 제2터치신호라인(TSLb)의 하부에 제1터치신호라인(TSLa)이 배치되어 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa)은 중첩될 수 있다.
그리고, 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb) 사이에 터치절연막(115)이 배치될 수 있다. 또한, 터치절연막(115)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)이 서로 중첩되는 위치에서 제2방향(F2)으로 배치될 수 있다. 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)은 터치절연막(115)이 배치되어 있지 않은 부분에서 서로 접촉할 수 있다.
따라서, 도 28에 도시되어 있는 것과 같이 B-B`의 단면을 보면 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa) 사이에 터치절연막(115)가 배치되어 있어 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa)은 접촉하고 있지 않지만, D-D`의 단면을 보면 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa) 사이에 터치절연막(115)이 배치되어 있지 않기 때문에 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa)은 서로 접촉한다.
그리고, 제2터치신호라인(TLSb) 상에 터치커버(151)가 배치될 수 있다. 터치커버(155)에는 홈(151g)이 형성되어 있고, 도 28에 도시되어 있는 것과 같이 B-B` 단면에는 홈(151g)에 제1터치신호라인(TSLa), 터치절연막(115), 제2터치신호라인(TLSb)이 적층되어 있고, D-D` 단면에 제1터치신호라인(TSLa), 제2터치신호라인(TLSb)이 적층되어 있다. 홈(151g) 중 터치절연막(115)가 삽입되어 있는 홈의 깊이가 더 깊을 수 있다.
도 29는 도 3에 도시된 제1영역을 나타내는 평면도이고, 도 30 및 도 31은 도 3에 도시된 제1영역을 나타내는 단면도이다.
도 29 내지 도 31을 참조하면, 제1영역(X)에는 제2방향(F2)으로 연장되는 터치신호라인(TSLa, TSLb)이 배치될 수 있다. 터치신호라인(TSLa, TSLb)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)을 포함하며, 제2터치신호라인(TSLb)의 하부에 제1터치신호라인(TSLa)이 배치되어 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa)은 중첩될 수 있다.
그리고, 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb) 사이에 터치절연막(115)가 배치될 수 있다. 터치절연막(115)에는 복수의 홈이 제2방향(F2)으로 배열되고, 복수의 홈을 통해 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)에 접촉할 수 있다. 그리고, 제2터치신호라인(TLSb) 상에 터치커버(151)가 배치될 수 있다. 따라서, 도 30과 도 31에 도시되어 있는 것과 같이 B-B`의 단면과 E-E`의 단면을 보면 터치커버(151)의 일부는 터치절연막(115)를 관통하여 터치버퍼층(114a)에 접촉할 수 있다. 터치커버(151)의 일부가 터치퍼버층(114a)에 접촉하는 부분에는 홈(114h)이 형성될 수 있다.
도 32는 도 3에 도시된 표시장치의 제1영역을 나타내는 평면도이고, 도 33 및 도 34은 도 3에 도시된 표시장치의 제1영역을 나타내는 단면도이다.
도 32 내지 도 34를 참조하면, 제1영역(X)에는 제2방향(F2)으로 연장되는 터치신호라인(TSLa, TSLb)이 배치될 수 있다. 터치신호라인(TSLa, TSLb)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)을 포함하며, 제2터치신호라인(TSLb)의 하부에 제1터치신호라인(TSLa)이 배치되어 제2터치신호라인(TSLb)과 제1터치신호라인(TSLa)은 중첩될 수 있다.
그리고, 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb) 사이에 터치절연막(115)가 배치될 수 있다. 터치절연막(115)은 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb) 사이에서 소정의 간격으로 배치될 수 있다. 제1터치신호라인(TSLa)과 제2터치신호라인(TSLb)은 터치절연막(115)이 배치되어 있지 않은 부분에서 서로 접촉할 수 있다. 그리고, 터치신호라인(TSLa, TSLb) 사이에 터치버퍼층(114a)가 일부 돌출되어 있을 수 있다.
도 33과 도 34에 도시되어 있는 것과 같이 B-B`의 단면과 E-E`의 단면을 보면 제2터치신호라인(TSLb)이 제1터치신호라인(TSLa)이 적층되어 있는 부분의 좌우에 터치버퍼층(114a)이 돌출되어 있는 부분(114b)가 배치되어 있다.
그리고, 터치커버(151)이 배치되어 있는데, 터치커버(151)에는 홈(151g)가 형성되어 있다. 홈(151g) 중 제1터치신호라인(TSLa)와 제2터치신호라인(TSLb)가 삽입되어 있는 홈(151g)의 깊이가 크고 제1터치신호라인(TSLa)와 제2터치신호라인(TSLb)이 삽입되어 있지 않은 홈의 깊이는 낮을 수 있다.
도 35는 본 발명의 실시예들에 따른 표시장치의 제조방법을 나타내는 순서도이다.
도 35를 참조하면, 표시장치의 제조방법은 표시장치에 인캡슐레이션층을 형성할 수 있다.(S3500) 인캡슐레이션층은 제1무기막, 유기막, 제2무기막이 적층될 수 있다. 표시장치는 디스플레이 영역과 라우팅영역으로 구분되며, 라우팅영역에는 댐이 배치되어 댐에 의해 인캡슐레이션층의 유기막이 라우팅영역으로 넘어가는 것을 방지할 수 있다. 디스플레이 영역에는 복수의 화소를 포함하며, 각 화소는 발광다이오드와 발광다이오드에 구동전류를 공급하는 화소회로로 구분될 수 있고, 인캡슐레이션층은 발광다이오드에 이물 또는 수분이 침투하는 것을 방지할 수 있다.
인캡슐레이션층 상에 복수의 터치신호라인을 형성할 수 있다.(S3510) 복수의 터치신호라인은 터치센서로 터치구동신호를 공급하고 터치센서로부터 터치감지신호를 전달받을 수 있다. 복수의 터치신호라인이 형성될 때, 인캡슐레이션층에 터치센서가 배치될 수 있다. 복수의 터치신호라인은 라우팅영역과 중첩되는 위치에 배치될 수 있다.
그리고, 복수의 터치신호라인이 배치된 인캡슐레이션층 상의 제1영역에 복수의 홈을 포함하는 터치절연막이 배치될 수 있다. 터치절연막은 유기막 또는 무기막을 포함할 수 있다. 인캡슐레이션층 상에는 터치절연막이 배치될 수 있는데, 인캡슐레이션층 상의 제1영역에 배치된 터치절연막에 복수의 홈이 배치될 수 있다. 제1영역은 기판의 폴딩영역과 일부 중첩될 수 있다.
그리고, 터치절연막에 형성된 복수의 홈에 복수의 터치신호라인이 각각 배치될 수 있다. 또한, 터치절연막에 형성된 복수의 홈 사이에 복수의 터치신호라인이 각각 배치될 수 있다.
또한, 인캡슐레이션층 상에 터치신호라인을 배치하기 전에, 인캡슐레이션층의 제1영역에 복수의 홈을 포함하는 터치절연막을 배치할 수 있다. 그리고, 복수의 홈에 각각 복수의 터치신호라인을 배치할 수 있다. 또한, 복수의 홈 사이에 각각 복수의 터치신혼라인을 배치할 수 있다.
터치신호라인은 적층된 제1터치신호라인과 제2터치신호라인을 포함할 수 있다. 제1영역의 적어도 일부에서 제1터치신호라인과 제2터치신호라인은 서로 접촉할 수 있다.
또한, 터치신호라인과 터치센서에 의해 인캡슐레이션층이 손상되는 것을 방지하기 위해, 인캡슐레이션층 상에 터치버퍼층을 형성한 후 터치신호라인과 터치센서를 형성할 수 있다.
그리고, 터치신호라인이 형성된 인캡슐레이션층 상에 터치커버를 형성할 수 있다.(S3520) 터치커버는 터치신호라인과 터치센서를 보호할 수 있다. 터치커버는 유기막 또는 무기막을 포함할 수 있다.
이상에서의 설명 및 첨부된 도면은 본 발명의 기술 사상을 예시적으로 나타낸 것에 불과한 것으로서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 구성의 결합, 분리, 치환 및 변경 등의 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
100: 표시장치
101: 화소
111: 기판
110: 디스플레이 패널
120: 데이터 드라이버
130: 게이트 드라이버
140: 타이밍 컨트롤러

Claims (19)

  1. 제1방향으로 연장되는 게이트라인과 제2방향으로 연장되는 데이터라인과 상기 게이트라인과 상기 데이터라인에 연결되는 화소가 배치되는 디스플레이 영역과, 상기 디스플레이 영역의 테두리에 배치되는 라우팅영역을 포함하는 기판;
    상기 디스플레이 영역과 상기 라우팅영역 상에 배치되는 인캡슐레이션층;
    상기 인캡슐레이션층 상에 배치되며, 상기 라우팅영역 중 상기 기판의 폴딩영역과 중첩되는 제1영역과 상기 폴딩영역과 중첩되지 않는 제2영역 중 상기 제1영역에 배치된 복수의 홈을 포함하는 터치 절연막;
    상기 터치 절연막의 상부에 배치되는 터치커버;
    적어도 일부가 상기 인캡슐레이션층과 상기 터치 절연막의 사이 또는 상기 터치 절연막과 상기 터치커버의 사이에서 상기 액티브영역과 중첩된 위치에 배치되는 복수의 터치전극; 및
    상기 라우팅영역에 배치되며, 상기 제1영역에서 상기 복수의 홈 또는 상기 복수의 홈 사이에 각각 배치되며, 상기 제2방향으로 연장되는 복수의 터치신호라인을 포함하는 표시장치.
  2. 제1항에 있어서,
    상기 복수의 터치신호라인은 상기 제2영역에서 상기 인캡슐레이션층과 상기 터치절연막 사이에 배치되는 표시장치.
  3. 제1항에 있어서,
    상기 복수의 터치신호라인은 상기 제2영역에서 상기 터치커버와 상기 터치절연막 사이에 배치되는 표시장치.
  4. 제1항에 있어서,
    상기 복수의 터치신호라인 각각은 중첩된 제1터치신호라인과 제2터치신호라인을 포함하며,
    상기 제2영역에서 상기 제1터치신호라인과 상기 제2터치신호라인 사이에 상기 터치절연막이 배치되는 표시장치.
  5. 제4항에 있어서,
    상기 제1영역에서 상기 제2터치신호라인은 적어도 일부가 상기 제1터치신호라인에 접촉되어 있는 표시장치.
  6. 제4항에 있어서,
    상기 제1영역에서 상기 제1터치신호라인과 상기 제2터치신호라인 사이에 상기 터치 절연막이 배치되는 표시장치.
  7. 제1항에 있어서,
    상기 터치커버의 일부가 상기 복수의 홈에 삽입되고, 상기 터치커버의 일부는 상기 터치신호라인 사이에 배치되는 표시장치.
  8. 제2항에 있어서,
    상기 터치 절연막은 상기 제1영역에서 상기 터치신호라인의 일부를 덮는 표시장치.
  9. 제3항에 있어서,
    상기 복수의 터치신호라인은 상기 제1영역에서 상기 터치 절연막의 적어도 일부를 덮는 표시장치.
  10. 제4항에 있어서,
    상기 제1영역에서 상기 제1터치신호라인의 상부에 상기 터치절연막이 배치되고, 상기 제2터치신호라인의 적어도 일부가 상기 터치절연막과 상기 제1터치신호라인에 접촉되어 있는 표시장치.
  11. 제1항에 있어서,
    상기 복수의 터치신호라인이 상기 복수의 홈 사이에 배치된 경우, 상기 터치버퍼층의 일부가 상기 홈에 삽입되어 있는 표시장치.
  12. 제1항에 있어서,
    상기 기판과 상기 인캡슐레이션층 사이에 발광층과 상기 발광층에 전류를 공급하는 트랜지스터가 배치되어 있는 표시장치.
  13. 제1항에 있어서,
    상기 인캡슐레이션층의 경사진 면에 상기 라우팅영역의 적어도 일부가 대응되는 표시장치.
  14. 제13항에 있어서,
    상기 터치신호라인은 상기 라우팅영역에서 상기 인캡슐레이션층의 기울기에 대응하여 배치되는 표시장치.
  15. 제1항에 있어서,
    상기 인캡슐레이션층 상에 배치되는 터치버퍼층을 더 포함하는 표시장치.
  16. 기판의 디스플레이 영역과 라우팅 영역 상에 배치되는 인캡슐레이션층 상에서 상기 라우팅 영역과 중첩되는 위치에 복수의 터치신호라인을 배치하는 단계;
    상기 복수의 터치신호라인이 배치된 상기 인캡슐레이션층 상의 제1영역에 복수의 홈을 포함하는 터치절연막을 배치하되, 상기 복수의 홈에 상기 복수의 터치신호라인이 각각 배치되는 단계; 및
    상기 터치절연막 상에 터치커버를 배치하는 단계를 포함하는 표시장치의 제조방법.
  17. 제16항에 있어서,
    상기 복수의 터치신호라인은 상기 제1영역에서 적어도 일부가 중첩된 각각 제1터치신호라인과 제2터치신호라인을 포함하는 표시장치의 제조방법.
  18. 인캡슐레이션층 상의 제1영역에 복수의 홈을 포함하는 터치절연막을 배치하는 단계;
    상기 터치절연막 상에 배치되며, 상기 복수의 홈 사이에 배치되도록 복수의 터치신호라인을 배치하는 단계; 및
    상기 복수의 타치신호라인이 배치된 상기 터치절연막 상에 터치커버를 배치하는 단계를 포함하는 표시장치의 제조방법.
  19. 제18항에 있어서,
    상기 복수의 터치신호라인은 상기 제1영역에서 적어도 일부가 중첩된 각각 제1터치신호라인과 제2터치신호라인을 포함하는 표시장치의 제조방법.
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