KR20090059748A - 적층형 칩 커패시터 및 회로 기판 장치 - Google Patents
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Abstract
Description
Claims (5)
- 내부 전극이 실장면에 수직으로 배치되는 적층형 칩 커패시터에 있어서,복수의 유전체층의 적층에 의해 형성되며, 실장면인 하면을 갖는 커패시터 본체;상기 커패시터 본체 내에서, 유전체층을 사이에 두고 서로 대향하도록 배치되고, 각각 상기 하면으로 인출된 단 1개의 리드와 상기 하면과 마주보는 상면으로 인출된 단 1개의 리드를 갖는 복수의 내부 전극; 및상기 하면 및 상면에 형성되어 상기 리드를 통해 해당 내부 전극과 연결된 복수의 외부 전극을 포함하고,상기 내부 전극은 상기 하면에 수직으로 배치되고, 적층방향으로 인접한 서로 다른 극성의 내부 전극의 리드는 항상 수평 방향으로 서로 인접하도록 배치되고, 동일 극성을 갖는 내부 전극들은 상기 외부 전극들에 의해 상기 커패시터 내에서 모두 전기적으로 연결된 것을 특징으로 하는 적층형 칩 커패시터.
- 제1항에 있어서,상기 하면 및 상면의 각 면에 형성된 외부 전극들은 이종 극성끼리 서로 교대로 배치되고, 상기 하면 및 상면의 각 면에 인출되는 리드들은 적층방향으로 따라 지그재그 형태로 배치된 것을 특징으로 하는 적층형 칩 커패시터.
- 제2항에 있어서,상기 상면에 형성된 외부 전극과 하면에 형성된 외부 전극은 동수이고, 상기 상면 및 하면에서 이종 극성의 외부 전극이 서로 대향하도록 배치되고,각각의 내부 전극에 있어서, 상기 하면으로 인출된 리드는 상기 상면으로 인출된 리드에 대해서 1칸 옆의 외부 전극 위치만큼 오프셋된 것을 특징으로 하는 적층형 칩 커패시터.
- 제1항에 있어서,상기 적층형 칩 커패시터는 상기 하면에 배치된 4개의 외부 전극과 상기 상면에 배치된 4개의 외부 전극을 갖는 8단자 커패시터이고, 상기 적층방향으로 순차적으로 연속 배치된 제1 내지 제6 내부 전극이 하나의 블록을 이루고 이 블록이 반복 적층된 것을 특징으로 하는 적층형 칩 커패시터.
- 제4항에 있어서,상기 하면에는 제1 내지 제4 외부 전극이 순차적으로 배치되고, 상기 상면에는 제5 내지 제8 외부 전극이 순차적으로 배치되고,상기 제1 내지 제6 내부 전극 각각은 하면으로 인출된 리드 1개와 상면으로 인출된 리드 1개를 갖고,상기 하면으로 인출된 제1 내지 제4 내부 전극의 리드는 제1 내지 제4 외부 전극에 각각 접속되도록 배치되고, 상기 하면에 인출된 제5 내부 전극의 리드는 제 3 외부 전극에 접속되도록 배치되고, 상기 하면에 인출된 제6 내부 전극의 리드는 제2 외부 전극에 접속되도록 배치되고,상기 상면으로 인출된 리드들은 상면에서 보았을 때 상기 제5 외부 전극과 제8 외부 전극 사이에서 지그재그 형태로 배치되고, 동일 내부 전극으로부터 하면으로 인출된 대응 리드에 대해서 1칸 옆의 외부 전극 위치만큼 오프셋된 것을 특징으로 하는 적층형 칩 커패시터.
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