KR20050035522A - 다수의 다른 유형의 장치들중 임의의 하나를 인식하기위한 식별 시스템 및 방법 - Google Patents

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Abstract

정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나의 장치를 인식하기 위한 식별 시스템 및 방법은 검사 모드에서 하나의 장치에 검사 신호를 공급하는 단계; 상기 검사 모드에서 장치에 인가된 검사 신호에 응답하여 장치의 전기적 특성을 측정하는 단계; 및 다수의 다른 유형의 장치들중 하나로서 터미널에 접속된 장치를 인식하기 위해 다수의 장치들의 전기적 특성의 표현과 상기 장치의 전기적 특성의 표현을 매칭하는 단계

Description

다수의 다른 유형의 장치들중 임의의 하나를 인식하기 위한 식별 시스템 및 방법{IDENTIFICATION SYSTEM AND METHOD FOR RECOGNIZING ANY ONE OF A NUMBER OF DIFFERENT TYPES OF DEVICES}
본 출원은 2002년 6월 24일 출원된 미국 임시 출원번호 60/391,119의 우선권을 주장한다.
본 발명은 정보 처리 시스템의 터미널에서 다수의 다른 유형의 장치들중 임의의 하나를 인식하기 위한 식별 시스템, 및 추가로 상기 식별 장치를 사용하기 위하여 터미널을 재구성하기 위한 능력에 관한 것이다.
오디오 처리는 퍼스널 컴퓨터들의 분야에서 중요한 기능이 되었다. 컴퓨터들은 외부 오디오 트랜스듀서들 및 장치들에 연결하는 오디오 코덱들이라 일반적으로 불리는 전용 오디오 처리 장치들을 포함한다. 오디오 코덱의 주요 기능들중 하나는 입력 및 출력 오디오 신호들을 컴퓨터의 내부 디지탈 포맷들로 그리고 내부 디지탈 포맷들로부터 전환하는 것이고, 통상적으로 외부 장치들의 아날로그 포맷으로 전환하고 상기 아날로그 포맷으로부터 전환하는 것이다.
컴퓨터에 외부 오디오 장치들을 접속하는 한가지 방법은 3.5mm 또는 유사한 스테레오 오디오 잭을 사용하는 것이다. 각각의 컴퓨터는 스피커들, 마이크로폰 입력 및 라인 입력용 스테레오 라인 같은 각각 하나의 기능에 전용으로 통상적으로 사용되었던 몇몇 잭들을 포함한다. 오늘날 이용할 수 있는 다중매체 포맷들의 증가로 인해, 컴퓨터가 시스템의 비용을 증가시키는 컴퓨터상 잭들의 현재 수를 증가시키지 않고 서포트할 수 있는 입력 및 출력 오디오 장치들의 수를 증가시키기 위한 필요성이 있다. 또한, 외부 장치들을 잘못된 잭들에 올바르지 않게 접속하는 컴퓨터 사용자의 가능성은 값비싼 서포트 호출들을 크게 증가시킨다.
외부 장치들로부터의 입력 또는 외부 장치들로의 출력을 수용하기 위하여 외부 장치들 및 게다가 내부 구성의 식별은 셀 폰들 및 PDA들 같은 보다 작은 휴대용 장치들에 관련하여 보다 중요하고, 여기서 종종 단지 하나의 접속 또는 잭이 플러그를 수용하기 위하여 제공될 수 있다. 비디오뿐 아니라 오디오 입력들/출력들이 풍부하기 때문에 문제가 더 발생된다. 종래 잭 감지는 잭에서 플러그 인 및 플러그 아웃 이벤트들을 검출하는 것을 이용하였다. 그리고, 상기 이벤트들의 검출은 다른 액션들을 자동으로 수행하기 위하여 사용되었고, 예를들어 이어폰 플러그를 잭에 진입시키는 것은 스피커들의 소리를 자동으로 줄이고, 디지탈 또는 아날로그 스피커의 인식은 스피커들에 대한 출력을 아날로그 또는 디지탈 신호의 적당한 선택으로 전환한다. 미국특허 6,185,627는 여기에 참조로써 통합된다.
도 1은 본 발명에 따른 식별 및 재구성 회로들을 가진 정보 처리 시스템의 개략적인 블록도.
도 2는 플러그 이벤트 검출 회로와 함께 식별 회로의 보다 상세한 개략적인 블록 다이어그램.
도 3은 종래 오디오 잭 및 플러그의 개략적인 단면도.
도 4는 응답 분석기 회로, 여기 회로, 식별 회로, 재구성 회로, 및 도 1 및 도 2의 서포트 구성요소들의 보다 상세한 개략도.
도 5는 하드웨어 및/또는 소프트웨어에서 실행될 수 있는 판정 트리 논리의 개략적인 다이어그램.
도 6은 도 4의 여기 회로에서 프로그램 가능 회로 소스를 동작시키기 위하여 도 4의 데이타 분석 논리 회로에서 제어 논리의 개략적인 다이어그램.
도 7은 다수의 터미널들 또는 잭들과 여기 및 응답 분석기 회로들을 증가시키기 위한 스위칭 회로들을 도시하는 개략도.
도 8은 스펙트랄 시그네이쳐들을 매칭시키는 응답 분석기 회로의 개략 블록도.
도 9는 응답 분석기 회로, 여기 회로, 식별 회로, 재구성 회로, 및 도 1 및 2의 서포트 구성요소들의 다른 실행의 보다 상세한 개략도.
도 10은 본 발명에 따라 장치를 식별하기 위한 저장된 룩업 테이블의 흐름도.
도 11은 소프트웨어 실행을 가진 본 발명에 따른 방법/시스템의 개략적인 흐름도.
도 12는 소프트웨어 실행을 가진 본 발명에 따른 사용자 인터페이스의 개략적인 흐름도.
도 13은 소프트웨어 실행을 가진 본 발명에 따른 미들웨어 애플리케이션의 개략적인 흐름도.
도 14는 소프트웨어 실행을 가진 본 발명에 따른 코덱 드라이버의 개략적인 흐름도.
도 15는 시스템 시작 동작의 개략적인 흐름도.
도 16은 절연된 스위치들에 사용하기에 적당한 본 발명에 다른 이벤트 검출기의 개략적인 블록도.
도 17은 비절연 스위치들에 사용하기에 특히 적당한 본 발명에 따른 이벤트 검출기의 개략적인 블록도.
그러므로, 본 발명의 목적은 다수의 다른 유형의 장치들중 임의의 하나를 인식하기 위한 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 인식된 장치를 매칭하기 위하여 그 기능을 제공하도록 구성될 수 있는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 입력 장치들이든 출력 장치들이든 다른 장치들을 인식하거나 인식 및 제공할 수 있는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 임피던스 특성들 및 스펙트랄 시그네이쳐를 포함하는 다수의 방식으로 하나의 장치를 인식할 수 있는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 모노 및 스테레오 입력 및 출력 장치들을 구별하고 밸런싱 및 언밸런싱 로드들을 검출할 수 있는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 새로운 장치들을 인식하기 위하여 학습할 수 있는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 다수의 커넥터들 또는 터미널들을 사용하고 비용을 절감하기 위하여 동일한 여기 및 분석 회로들을 사용할 수 있는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 작은 민감도 및 보다 덜 비싼 응답 분석기를 사용할 수 있게 하는 프로그램 가능 전류 소스를 사용하는 개선된 식별 시스템을 제공하는 것이다.
본 발명의 다른 목적은 다중 잭들이 이용될때 및 비절연 스위치들이 이용될때 조차 플러그 인 또는 플러그 아웃 이벤트를 올바르게 식별하는 이벤트 검출기 회로를 제공하는 것이다.
본 발명은 컴퓨터 시스템 또는 사운드 시스템 같은 정보 처리 시스템의 커넥터들, 터미널들 또는 잭들에 접속된 장치가 하드웨어 및/또는 소프트웨어, 판정 트리들 또는 저장된 룩업 테이블들을 사용하여 공지된 장치들의 그룹의 임피던스 또는 주파수 응답 같은 전기적 특성들과 상기 장치를 매칭함으로서 자동적으로 식별될 수 있고, 상기 식별은 스피커들, 마이크로폰들, 축음기들, 및 테이프와 CD 플레이어들, 및 다른 오디오 및 비디오 장치들 같은 다수의 다른 입력 및 출력 장치들에 대한 터미널을 구성하기 위하여 사용될 수 있다.
본 발명은 정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나로서 하나의 장치를 식별하기 위한 식별 시스템을 특징으로 한다. 검사 모드에서 장치에 검사 신호를 공급하기 위한 여기 회로 및 장치의 전기 특성을 측정하기 위한 검사 방법에서 상기 장치에 인가된 검사 신호에 응답하는 응답 분석기 회로가 있다. 식별 회로는 다수의 다른 장치들중 하나로서 터미널에 접속된 장치를 식별하기 위하여 다수의 장치들의 전기 특성들의 표현과 상기 장치의 전기 특성의 표현을 매칭하도록 상기 장치의 측정된 전기 특성에 응답한다.
바람직한 실시예에서, 여기 회로는 전류 소스를 포함할 수 있다. 전류 소스는 전류를 장치에 제공하거나 장치로부터 전류를 감소시킬 수 있다. 여기 회로는 전류 소스를 터미널에 선택적으로 접속시키기 위한 여기 스위칭 회로를 포함할 수 있다. 전류 소스는 다수의 전류 소스 유니트들을 포함할 수 있다. 응답 분석기 회로는 전류 소스가 장치에 접속된후 장치의 전압을 감지하기 위한 샘플 및 홀드 회로를 포함할 수 있다. 응답 분석기 회로는 샘플 및 홀드 회로에 응답하는 아날로그 대 디지탈 컨버터를 포함할 수 있다. 식별 회로는 다수의 다른 장치들의 전기적 특성 표현과 장치의 전기적 특성 표현을 매칭하기 위하여 판정 트리를 사용할 수 있다. 식별 회로는 장치의 특성 표현과 매칭하기 위하여 다수의 장치들의 특성들의 표현들을 저장하기 위한 저장 장치를 포함할 수 있다. 식별된 장치를 제공하기 위하여 재구성 장치의 식별에 응답하고 터미널에 접속되는 재구성 회로가 있을 수 있다. 재구성 회로는 입력 및 출력 증폭기들과, 터미널에 상기 증폭기들을 선택적으로 접속시키기 위한 재구성 스위칭 회로를 포함할 수 있다. 재구성 회로는 낮은 온 임피던스 및 높은 오프 임피던스 사이에서 증폭기들을 선택적으로 변이할 수 있는 인에이블 입력들을 가진 입력 및 출력 증폭기들을 포함할 수 있다.
터미널에 접속된 장치의 존재 및 부재를 검출하기 위한 이벤트 검출기가 있을 수 있다. 하나의 실시예에서, 다중 터미널들이 있을수 있고 이벤트 검출기는 노드와, 장치들이 하나 이상의 터미널들에 접속되는지에 따라 가변하도록 노드에서 전압을 조절하기 위한 터미널들 사이에 접속된 저항 래더(ladder) 네트워크 및 노즈에서 전압이 변화되었는지를 검출하기 위한 비교 회로를 포함한다. 통상적으로, 비교 회로는 아날로그 대 디지탈 컨버터이고 저항 래더 네트워크는 각각의 터미널 및 노드 사이에 접속된 다른 값의 저항들을 포함한다. 다른 실시예에서, 다중 터미널들은 절연되고 이벤트 검출기는 오디오 신호의 존재로 인하 노드에서의 전압 변화 및 터미널 플러그 인 또는 플러그 아웃 이벤트를 구별하기 위한 수단을 더 포함한다. 일실시예에서 상기 구별 수단은 노드에서 전압 변화가 안정한지를 검출하기 위한 타이머에 응답하는 논리 회로를 포함한다.
전기 특성은 임피던스이거나 주파수 응답일 수 있고 응답 분석기 회로는 주파수 응답 분석기를 포함할 수 있다. 다수의 터미널들 및 각각의 터미널들에 여기 회로를 선택적으로 접속하기 위한 다수의 여기 스위칭 회로들이 있을 수 있다. 터미널은 팁 및 링 잭을 포함할 수 있다. 여기 회로는 팁 접촉부에 검사 신호를 공급할 수 있고 응답 분석기는 링 접촉부에 반응할 수 있다. 터미널은 링 및 링 잭을 포함할 수 있고 여기 회로는 링 접촉부에 검사 신호를 공급할 수 있으며 응답 분석기 회로는 팁 접촉부에 응답할 수 있다. 응답 분석기 회로는 샘플 및 홀드 회로를 터미널에 선택적으로 접속하기 위한 분석기 스위칭 회로를 포함할 수 있다. 다수의 터미널들 및 각각의 터미널들과 응답 분석기 회로를 선택적으로 접속하기 위한 분석기 스위칭 회로들이 있을 수 있다. 여기 회로는 다수의 다른 전류 레벨들을 장치에 선택적으로 인가하기 위하여 응답 분석기에 응답하는 프로그램 가능 전류 소스를 포함할 수 있다.
본 발명은 정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나로서 장치를 인식하기 위한 식별 시스템을 특징으로 한다. 검사 모드에서 장치에 검사 신호를 공급하기 위한 여기 회로 및 장치의 전기적 특성을 측정하기 위해 검사 모드에서 장치에 인가되는 검사 신호에 응답하는 응답 분석기 회로가 있다. 장치의 측정된 전기 특성에 응답하는 식별 회로는 다수의 다른 장치들중 하나로서 터미널에 접속된 장치를 재구성하기 위하여 다수의 장치들의 전기적 특성들의 표현들과 장치의 전기적 특성의 표현을 매칭한다. 터미널에 접속된 재구성 회로는 식별된 장치에 제공하기 위하여 재구성하기 위한 장치의 식별에 응답할 수 있다.
여기 회로는 전류 소스를 포함할 수 있다. 전류 소스는 전류를 장치에 제공할 수 있다. 전류 소스는 장치로부터 전류를 줄일 수 있다. 여기 회로는 전류 소스를 터미널에 선택적으로 접속하기 위한 여기 스위칭 회로를 포함할 수 있다. 전류 소스는 다수의 전류 소스 유니트들을 포함할 수 있다. 응답 분석기 회로는 전류 소스가 장치에 접속된후 장치의 전압을 감지하기 위한 샘플 및 홀드 회로를 포함할 수 있다. 응답 분석기 회로는 샘플 및 홀드 회로에 응답하는 아날로그 대 디지탈 컨버터를 포함할 수 있다.
식별 회로는 다수의 다른 장치들과 장치의 전기적 특성 표현을 매칭하기 위한 판정 트리를 포함할 수 있다. 식별 회로는 장치의 특성 표현과 매칭하기 위하여 다수의장치들의 특성들의 표현들을 저장하기 위한 저장 장치를 포함할 수 있다. 재구성 회로는 입력 및 출력 증폭기들 및 상기 증폭기들을 터미널에 선택적으로 접속하기 위한 재구성 스위칭 회로를 포함할 수 있다. 재구성 회로는 낮은 온 임피던스 및 높은 오프 임피던스 사이에서 증폭기들을 선택적으로 변이시킬 수 있는 인에이블 입력들을 가진 입력 및 출력 증폭기들을 포함할 수 있다. 터미널에 접속된 장치의 존재 및 부재를 검출하기 위한 이벤트 검출기가 있을 수 있다. 모니터되는 전기 특성은 임피던스일 수 있거나 주파수 응답일 수 있고 응답 분석기는 주파수 응답 분석기를 포함할 수 있다. 다수의 터미널들 및 각각의 터미널들과 여기 회로를 선택적으로 접속하기 위한 다수의 여기 스위칭 회로들이 있을 수 있다. 티머널은 팁 및 링 잭을 포함할 수 있고 여기 회로는 팁 접촉부에 검사 신호를 공급할 수 있고 응답 분석기 회로는 링 접촉부에 응답할 수 있다. 반대로, 터미널은 팁 및 링 잭을 포함할 수 있고 여기 회로는 링 접촉부에 검사 신호를 공급할 수 있고 응답 분석기는 팁 접촉부에 응답할 수 있다. 응답 분석기 회로는 터미널에 샘플 및 홀드 회로를 선택적으로 접속하기 위한 분석기 스위칭 회로를 포함할 수 있다. 다수의 터미널들이 있을 수 있고 각각의 터미널들과 응답 분석기 회로를 선택적으로 접속하기 위한 분석기 스위칭 회로들이 있을 수 있다. 여기 회로는 장치에 다수의 다른 전류 레벨들을 선택적으로 인가하기 위하여 응답 분석기 회로에 응답하는 프로그램 가능 전류 소스를 포함할 수 있다.
본 발명은 검사 모드에서 장치에 검사 신호를 공급하고 검사 모드에서 장치에 인가된 검사 신호에 응답하여 장치의 전기적 특성을 측정하는 것을 포함하는 정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나로서 장치를 인식하기 위한 식별 방법을 특징으로 한다. 장치의 전기적 특성의 표현은 다수의 다른 장치들중 하나로서 터미널에 접속된 장치를 인식하기 위하여 다수의 다른 장치들중 하나로서 장치에 접속된 장치를 인식하기 위해 다수의 장치들의 전기적 특성 표현들과 매칭된다.
바람직한 실시예에서, 다수의 다른 장치들과 장치의 전기적 특성의 매칭 표현은 판정 트리를 사용할 수 있다. 저장 장치는 장치의 특성 표현과 매칭하기 위하여 다수의 장치들의 특성들의 표현을 저장할 수 있다. 시스템은 식별된 장치에 터미널을 인식시키기 위하여 장치의 식별에 응답할 수 있다. 터미널에 접속된 장치의 존재 및 부재를 검출하기 위한 이벤트 검출기가 있을 수 있다. 전기적 특성은 임피던스이거나 주파수 응답일 수 있다. 터미널은 팁 및 링 잭을 포함할 수 있고 검사 신호는 팁 접촉부에 인가될 수 있고 응답은 링 접촉부로부터 수신된다. 터미널은 팁 및 링 잭을 포함할 수 있고 검사 신호는 링 접촉부에 인가될 수 있고 응답은 팁 접촉부로부터 수신될 수 있다. 여기 회로는 다수의 다른 전류 레벨들을 장치에 선택적으로 인가하기 위하여 응답 분석기 회로에 응답하는 프로그램 가능 전류 소스를 포함할 수 있다.
본 발명에 다른 다수의 터미널들에 대한 장치 플러그 인 또는 플러그 아웃 이벤트를 검출하기 위한 시스템은 노드 및 장치들이 하나 이상의 터미널들에 접속되었는지에 따라 가변하도록 노드에서 전압을 조절하기 위한 터미널들 사이에 접속된 저항 래더 네트워크를 포함한다. 그 다음 비교 회로는 노드에서의 전압이 변화했는지를 검출한다.
일실시예에서, 비교 회로는 아날로그 대 디지탈 컨버터이고 저항 래더 네트워크는 각각의 터미널 및 노드 사이에 접속된 다른 값의 저항을 포함한다. 다중 터미널들이 절연될때, 이벤트 검출기는 오디오 신호 및 터미널 플러그 인 또는 플러그 아웃 이벤트의 존재로 인해 노드에서의 전압 변화 사이를 판변하도록 구성된 논리 회로를 더 포함할 수 있다.
다수의 터미널들에 대한 장치 플로그 인 또는 플러그 아웃 이벤트를 검출하기 위한 하나의 시스템은 노드, 및 장치들이 하나 이상의 터미널들에 접속되었는지에 따라 가변하도록 노드에서 전압을 조절하기 위한 터미널들 사이에 접속된 저항 래더 네트워크, 노드에서의 전압이 변화되었는지를 검출하기 위한 비교 회로, 및 터미널 플러그 인 또는 플러그 아웃 이벤트(예를들어, 노이즈 또는 오디오 신호로 인함) 때문이 아닌 노드에서의 전압 변화 및 터미널 플러그 인 또는 플러그 아웃 이벤트로 인한 노드에서 전압 변화 사이를 판별하도록 구성된 논리 회로를 포함한다.
다른 목적들, 특징들 및 장점들은 바람직한 실시예의 다음 설명 및 첨부 도면으로부터 당업자에게 명백할 것이다.
하기되는 바람직한 실시예 또는 실시예들과 달리, 본 발명은 다른 실시예들이고 다양한 방식으로 실행 또는 수행된다. 따라서, 본 발명이 다음 설명에 나타나거나 도면들에서 도시된 구성의 사양 및 구성요소들의 배열들에 대한 애플리케이션에 제한이 없다.
도 1은, 소프트웨어(14)를 포함하고 내부 또는 외부 입력/출력 장치들일 수 있는 디스플레이(16), 마우스(18), 키보드(20) 및 저장 장치(22) 같은 종래 연관된 장치들을 가지는 컴퓨터(12)를 포함하는 정보 처리 시스템(10)을 도시한다. 이 시스템에 따라, 로드 또는 로드들(24)은 스피커들, 마이크로폰들, 축음기들, 테이프 및 CD 플레이어들 및 레코더들 같은 다양한 입력/출력 장치들 및 내부 또는 외부가 본 발명에 따라 식별된 종래 성질의 서포트 구성요소들(28)을 통하여 상호접속된 잭들 같은 임의의 터미널 유형일 수 있는 커넥터 또는 커넥터들(26)을 통해 접속되는지에 따른 모든 방식의 오디오 및 비쥬얼 입력/출력 장치들을 포함한다. 본 발명에 따라, 로드 감지 회로(30)는 커넥터들(26)을 통하여 로드(24)에 검사 신호들을 전송하고 각각의 잭들 또는 커넥터들(26)에서 각각의 로드들의 식별을 결정하기 위한 응답을 분석한다. 본 발명의 개선된 버젼에서, 재구성 회로(32)는 로드 감지 회로(30)에 의해 특정 잭에서 특정 로드의 식별에 응답하고 커넥터들과 연결된 회로들을 재구성하여, 입력인지 출력인지, 오디오인지 비디오인지를 식별된 로드를 위하여 적당하게 제공한다. 일실시예에서, 양쪽 회로들(30 및 32)은 코덱(11)의 일부이지만 본 발명에서 필수적인 제한은 없다.
도 2의 로드 감지 회로(30)는 여기 회로(34), 응답 분석기(36) 및 식별 회로(38)를 포함한다. 도 2에는 종래 플러그/언플러그 이벤트 검출 회로(38)가 도시된다. 본 회로에 대한 부가적인 실시예들은 도 16 및 17을 참조하여 하기된다. 커넥터들은 도 2에서 오디오 잭들(26a) 및 오디오 유형의 장치로서 공지되지 않은 장치(24a)를 가리킨다. 여기 회로(34)는 서포트 구성요소들(28) 및 잭(26a)을 통하여 공지되지 않은 로드 장치(24a)로 검사 신호를 전송한다. 상기 검사 신호에 대한 응답은 응답 분석기 회로(36)에 의해 감지되고 식별 회로(38)에 전달된다. 응답 분석기는 임피던스이거나 주파수 범위에서 몇몇 다른 특성인 임피던스 또는 주파수 응답을 감지할 수 있다. 특성들이 어떤 것이든, 식별 회로(38)에 제공되고, 어떤 로드가 이것인지를 결정하기 위하여 공지된 로드들의 다수의 특성들중 하나와 매칭시킨다. 도 12-15의 소프트웨어 흐름도들을 참조하여 논의된 바와같이, 보다 개선된 실시예들에서, 만약 매칭이 발생하지 않으면, 사용자 인터페이스 소프트웨어는 특정 잭에 플러그되는 장치의 사용자 ID를 요구할 수 있고 그 다음 상기 ID를 저장된 룩업 테이블에 부가하거나 판정 논리 트리를 변경시켜서, 새로운 장치는 미래 매칭을 위한 공지된 장치들중 하나가 된다.
도 3의 오디오 잭(26a)은 슬리브(52), 팁 접촉부(54) 및 적당한 절연체들(58)에 의해 분리된 링 접촉부(56)를 가진 플러그(50)를 포함하는 종래 오디오 잭이다. 플러그(50)와 맞물리는 대상은 통상적으로 슬리브(62), 팁 접촉부(64), 및 링 접촉부(66)를 포함하는 잭(60)이다. 도 2의 플러그/언플러그 이벤트 검출 회로(40)는 도 3에 도시된 바와같이 간단한 스위치(40a)를 포함할 수 있어서, 플러그(50)가 슬리브(62)를 통하여 삽입될때 팁(54) 및 링(56) 부분들은 잭 이벤트 스위치 접촉부(68)로부터 멀리 잭(60)의 링 접촉부를 구동하여, 플러그가 잭에 있거나 없는 것을 제어 소프트웨어 또는 하드웨어에게 알려주기 위하여 사용될 수 있는 신호를 증폭기(70)에 제공한다. 부가적인 이벤트 검출기 회로 실시예들은 도 16 및 도 17을 참조하여 하기에 논의된다.
일실시예에서, 도 4에 도시된 바와같이, 서포트 구성요소들(28b)은 바이어스 저항들(80 및 82) 및 캐패시터들(84 및 86)을 포함할 수 있다. 재구성 회로(32b)는 터미널 또는 잭에서 미지의 장치가 입력 장치로서 식별되었는지 출력 장치 로서 식별되었는지에 따라 인에이블될 이득 제어부들(93 및 95)를 가진 입력 증폭기들(92 및 94)뿐 아니라 출력 증폭기들(88 및 90)을 포함한다. 88, 90, 92 및 94의 증폭기들의 접속 또는 분리는 비록 보다 정교한 장치들이 사용될 수 있을지라도, 스위치들(96, 98, 100, 102)의 사용에 의해 간단히 이루어질 수 있다. 예를들어, 각각의 증폭기들(88-94)은 증폭기가 오프 상태에서의 높은 임피던스 및 온 상태에서의 낮은 임피던스를 나타내도록 하는 인에이블 입력(104, 106, 108, 110)을 가질 수 있다. 다른 증폭기(112)는 스위치(114)가 폐쇄될때 바이어스 저항들(80 및 82)을 구동하기 위하여 사용될 수 있다. 스위치(116)는 혼선을 피하기 위하여 바이어스 저항들(80 및 82)을 접지하는데 이용할 수 있다.
여기 회로(34)는 프로그램될 수 있는 현재 모드 DAC인 전류 소스(118)를 포함한다. 즉, 검사 전류로서 3, 4, 또는 임의의 수의 단계들에서 다른 레벨의 전류들을 생산하는 것에 관한 것이다. 통상적으로, 가장 낮은 전류는 미지의 로드 장치로 전달되고 만약 리터닝 입력이 분석을 위하여 불충분하면, 데이타 분석 논리 회로(132)는 전류 소스(118)를 다음 레벨로 이동시킬 것이다. 이것은 보다 적은 감도를 사용하게 하여 보다 낮은 비용의 응답 분서기 회로(36)를 허용한다. 이것은 리턴 신호가 분석을 위하여 충분할때까지 계속될 것이다. 여기 회로(34)는 스위치들(120 및 122)을 포함한다. 스위치(120)가 폐쇄될때, 검사 신호는 캐패시터(86)를 통하여 링 접촉부(62)에 전달된다. 응답 분석기(36)는 아날로그 대 디지탈 컨버터(124), 바람직하게 스위치들(128 및 130)와 함께 프로그램 가능 증폭기 및 샘플 및 홀드 회로(126)를 포함한다. 식별 회로(38)는 데이타 분석 논리 회로(132)를 포함한다.
동작시, 캐패시터들(84 및 86)은 통상적으로 폐쇄된 스위치들(96 및 98)을 가진 입력 또는 출력 증폭기들(88 및 90)을 통하여 충전된다. 일단 충전되면 스위치들(96 및 98)은 개방된다. 그 다음 데이타 분석 논리 회로(132)로부터의 라인(134)상 신호는 전류 소스(118)를 작동시켜 폐쇄된 스위치(120) 및 캐패시터(86)를 통하여 제 1 최하위 전류 레벨을 제공한다. 이것은 단계 1 동작이다. 단계 1에서, 스위치(128)는 폐쇄되어, 캐패시터(86)상 전압의 검사 전류 효과는 증폭기(126)에 의해 스위치(128)를 통해 감지된다. 이 신호는 디지탈 신호로 전환되고 데이타 분석 논리 회로(132)로 제공된다. 단계 2에서, 스위치들(122 및 130)은 폐쇄되어, 검사 전류는 캐패시터(84)로 전달되고 캐패시터(84)에 저장된 전압 전류의 효과는 증폭기(136)에 의해 스위치(130)를 통해 감지되고 다시 신호는 ADC 컨버터(124)에 의해 디지탈 유형으로 전환되고 데이타 분석 논리 회로(132)에 전달된다.발전되어
단계 3에서, 스위치(122)는 폐쇄되어, 전류는 스위치(128)의 폐쇄가 링(62)에 접속되는 캐패시터(86)에서 감지가 종료되는 것을 의미하는 동안, 팁(166)에 접속된 캐패시터(84)에 공급된다. 따라서, 단계 1에서 시스템은 팁 및 링중 하나를 검사하고, 단계 2에서 다른 것을 검사하고, 단계 3에서 팁 및 링 모두를 통해 검사한다. 단계 3에서 팁에 전류가 제공되고 링에서 감지하는 동안, 그 반대가 선택적으로 행해지거나, 양쪽은 단계 4에서 부가에 의해 행해질 수 있다. 일단 장치가 데이타 분석 논리 회로(132)에서 식별되면, 적당한 신호들은 잭(60)에 접속된 바와같이 식별되는 장치의 유형 및 성질을 수용하도록 입력 및 출력 식별기들중 적당한 하나를 팁 및 링에 접속시키기 위하여 스위치들(96, 98, 100 및 102)을 동작시키도록 개발될 수 있다.
재구성 회로는 폐쇄 스위치(114) 및 개방 스위치(116)에 의해 마이크로폰(스테레오 또는 모노)에 제공할 수 있어서, 저항기들(80 및 82)을 통하여 마이크로폰에 바이어스 전류를 제공한다. 증폭기(92)는 오디오 ADC에 의해 디지탈화하는 것 같은 추가 처리를 위한 인입 신호를 버퍼한다. 검출된 스테레오 마이크로폰의 경우, 증폭기(94)는 유사한 처리를 위해 스테레오 쌍의 제 2 신호를 버퍼하기 위하여 110에서 인에이블된다. 양쪽 경우들에서 증폭기들(88 및 90)은 높은 임피던스가 개방 스위치들(96 및 98)에 의해 또는 제어부들(104 및 106)을 사용하여 상기 개방 스위치들을 디스에이블링함으로써 노드들(N1 및 N2)에 발생되게 한다. 만약 스피커들이 검출되면, 증폭기(112) 및 저항들(80 및 82)에 의해 제공된 바이어스는 바람직하지 않다. 이런 이유 때문에, 스위치(114)는 개방되고 스위치(116)는 저항들(80 및 82)을 통하여 팁(66) 및 링(60)에서의 신호들 사이에서 임의의 원하지 않는 바이어스 및 임의의 심각한 혼선 경로를 제거한다. 오디오 잭(60)에 접속된 스피커들에 제공된 출력 신호들은 만약 제공되면 제어부들(104 및 106)에 의해 인에이블되는 증폭기들(88 및 90)에 의해 구동되고, 만약 제공되면 폐쇄될 수 있는 스위치들(96 및 98)에 직접 또는 상기 스위치들을 통하여 노드들(N1 및 N2)에 접속된다.
만약 종래 통신 헤드폰이 오디오 잭(60)에 접속된 것이 검출되면 스위치(114)는 폐쇄되고 스위치들(116 및 117)은 개방된다. 이것은 저항(80)를 통하여 팁(66)에 접속된 헤드폰의 마이크로폰에 바이어스를 제공한다. 입력 신호는 추가 처리 회로들에 인입 오디오 신호를 접속시키기 위하여 폐쇄된 제어부(108) 및 스위치(100)에 의해 인에이블되는 증폭기(92)에 캐패시터(84)를 통하여 결합된다. 증폭기(88)는 만약 제공되면 개방되는 제어부(104) 및/또는 스위치(96)에 의해 디스에이블된다. 링 터미널(62)에 접속된 수화기에 전달되는 출력 신호는 만약 제공되면 스위치(98)를 폐쇄함으로써 접속되고 제어부(106)에 의해 인에이블되는 증폭기(90)를 사용하여 캐패시터(86)를 통하여 제공된다. 증폭기(94)는 제어부(114)에 의해 디스에이블될 수 있다.
만약 라인 레벨 입력 장치가 검출되면, 바이어스가 필요없고, 따라서 스위치(114)는 개방되고 스위치(116)는 폐쇄된다. 증폭기들(88, 90, 92 및 94) 및 스위치들(96, 98, 100 및 102)의 조건들은 스테레오 마이크로폰 경우에 대해 동일하게 기술된다. 단지 예외는 라인 레벨 입력 신호들이 종래 마이크로폰 레벨들보다 큰 것이다. 따라서, 만약 증폭기들(92 및 94)이 프로그램 가능한 이득 제어를 가졌다면, 이 이득은 스테레오 마이크로폰보다 라인 레벨 장치에 대해 낮은 값으로 프로그램된다.
데이타 분석 논리 회로(132)는 도 5의 판정 트리에 따라 동작할 수 있다. 입력들은 단계 2에서 팁 값(140), 단계 1에서 링 값(142), 및 단계 3에서 팁 링 값(144)을 포함한다. 그 다음 논리부는 팁이 예를들어 단계(146)에서 6 오움 미만인지에 대해 질문한다. 만약 단계(148)에서, 6 오움 미만이면, 미지의 장치가 4 오움 스피커이다라는 것이 기록된다. 만약 6 오움 미만이 아니면, 질문은 단계(150)에서 팁이 13 오움 미만의 저항을 가지는지에 대한 질문한다. 만약 대답이 단계(152)에서 예이면, 미지의 장치가 8 오움 스피커인 것이 기록된다. 만약 팁 저항 임피던스가 13 오움 미만이 아니면, 질문은 팁 저항이 240 오움 미만인지에 대해 단계(154)에서 질문된다. 만약 대답이 예이면, 추가 질문은 링 임피던스가 팁 임피던스의 1/2 이상인지에 대한 단계(156)에서 이루어진다. 만약 그렇다면, 미지의 장치는 헤드폰인 것으로 단계(158)에서 기록된다. 만약 그렇지 않으면, SPDIF 또는 디지탈 스피커들로서 단계(160)에서 기록된다. 만약 단계(150)에서, 팁이 240 오움 미만이 아니면, 질문은 단계(162)에서 3,000 오움 미만인지에 대해 이루어진다. 그렇다면, 질문은 링이 단계(164)에서 팁 임피던스의 1/2 이상인지에 대해 이루어진다. 만약 그렇지 않다면, 미지의 장치가 모노 마이크로폰인 것을 단계(166)에서 결정한다. 만약 링이 팁 임피던스의 1/2 이상이면, 질문은 팁 링 임피던스가 단계(168)에서 팁 임피던스 값의 1/2 이상인지에 대해 이루어진다. 만약 그렇다면, 단계(170)에서, 미지의 장치는 모노 마이크로폰의 다른 유형인 것으로 기록된다. 그러나, 만약 단계(168)에서, 팁 대 링 임피던스 값이 팁 임피던스의 1/2 이상이 아니면, 단계(172)에서 장치는 스테레오 마이크로폰으로서 식별된다. 만약 팁이 단계(162)에서 3,000 오움 미만이 아닌 것이 결정되면, 질문은 팁이 30,000 오움 미만인지에 대해 단계(174)에서 이루어진다. 만약 그렇다면, 질문은 팁 임피던스가 팁 임피던스의 1/2 이상인지에 대해 단계(176)에서 이루어진다. 만약 그렇지 않다면, 단계(178)에서 장치는 미지의 것으로서 기록된다. 만약 그렇다면, 단계(180)에서 장치는 전력 스피커들로서 기록된다. 만약 팁이 30,000 오움 미만이 아니면, 장치가 터미널 또는 잭에 접속되지 않은 것을 단계(182)에서 결정한다.
전류 소스(118)의 전류 스텝 출력을 연속적으로 부스트하는 라인(134)상 출력은 단계(190)에서 아날로그 대 디지탈 컨버터(124)로부터 응답 값을 캡쳐하고 응답 값이 단계(192)에서 임계 범위보다 큰지를 결정하기 시작하는 도 6에 도시된 논리부에 따라 데이타 분석 논리 회로(132)에서 발전된다. 만약 그렇다면, 값은 단계(194)에서 데이타 분석 논리 회로에 제공된다. 만약 응답 값이 단계(192)에서 임계 범위보다 크지 않으면, 질문은 여기 레벨이 최대 범위에 있는지에 대해 단계(196)에서 이루어진다. 만약 그렇다면, 시스템은 단계(194)로 리턴하고 식별기에 상기 값을 제공하고 루프는 종료된다. 그러나, 만약 최대 범위에 있지 않으면, 여기 레벨은 단계(198)에서 증가되고 사이클은 다시 시작한다.
도 4에서 단일 여기 회로(34) 및 단일 응답 분석기 회로(36)에 의해 사용된 단일 잭(60)이 있지만, 이것은 본 발명의 필수적인 제한 사항이 아니다. 예를들어, 자신의 응답 분석기(36) 및 여기 회로에 의해 사용된 다수의 터미널들 또는 잭들 각각 하나가 있을 수 있고, 도 7에 도시된 바와같이 단일 여기 회로(34a)는 다수의 잭들(60a, 60b, 60n)을 사용하기 위하여 다수의 스위치들(120a, 122a, 120b, 122b, 120n, 122n)을 사용하여 증가되는 단일 전류 소스(118a)를 포함할 수 있다. 이와 같이, 응답 분석기 회로(36a)는 단일 아날로그 대 디지탈 컨버터(124a) 및 다수의 스위치들(128a, 130a-128n, 130n)을 가진 증폭기(126a)를 가질 수 있다. 이런 방식으로, 단일 전류 소스(118a) 및 단일 ADC(124a), 및 증폭기(126a)는 오디오 잭들(60a 내지 60n) 같은 다수의 터미널들을 사용할 수 있다.
임피던스 특성은 공지된 로드들 또는 장치들의 전기 특성들과 매칭될 수 있는 미지의 로드의 전기 특성만이 아니다. 예를들어, 미지의 장치의 주파수 응답은 공지된 장치들의 주파수 응답들과 매칭될 수 있다. 상기 경우 도 8의 ADC(124d)의 출력은 신호를 N 포인트 빠른 퓨리에 변환, FFT 계산기(202)에 전달하는 N 워드 샘플 메모리(200)에 공급될 수 있다. 이것으로부터 출력은 예를들어 식별 출력을 제공하는 데이타 분석 논리 회로(132) 또는 몇몇 다른 패턴 매칭 회로(132d)일 수 있는 식별 회로(132)에 전달된다. 선택적으로, 출력은 패턴 매칭 알고리듬들을 사용하여 조작하기 위해 CPU에 직접 전달될 수 있다. 실제로, N 워드 샘플 메모리(200) 및 N 포인트 FFT 계산기(202)의 함수는 적당하게 구성된 컴퓨터에서 식별 회로(38d)와 함께 실현될 수 있다.
판정 트리를 사용하는 대신, 간단한 저장 룩업 테이블이 사용될 수 있다. 예를들어, 도 9의 입력(210)에서 신호는 예를들어 입력(212)에서 50 밀리볼트의 전압을 증폭기(214)에 제공한다. 입력(212) 및 입력(216)에서 50 밀리볼트 사이의 차이는 전류 소스 미러들(224, 226 및 228)의 베이스들(218, 220, 22)을 구동하게 하는 출력 신호를 유발한다. 전류는 입력들(212 및 216)이 밸런스될때까지 증가할 것이다. 두개의 전류 미러들(226 및 228)이 포인트(V2)에 접속되고 단지 하나가 포인트(V1)에 접속되기 때문에, V2는 V1의 전류의 두배를 수신한다. 이들 두개의 입력들(V1 및 V2)은 양쪽 증폭기(230 및 232)에 전달된다. V1이 V2와 같거나 클때, 증폭기(230)로부터의 출력(JS0)은 0과 같거나, 그렇지 않으면 JS0는 1이다. V2가 V1보다 크거나 같을때, JS3인 증폭기(232)의 출력은 0이고, 그렇지 않으면 JS3는 1이다. V1이 V2와 같을때, JS0는 0이고 JS3는 0과 같다. V1 및 V2를 통하여 흐르는 전류가 클수록, 잭(60e)에 제공되는 임피던스는 낮아진다. JS1 출력과 결합된 JS0 및 JS3 출력들은 다수의 다른 가능한 장치들을 식별한다. JS1 출력은 그 출력이 전압 또는 저항(236)으로 전환되고 출력(JS1)에 전달되는 다른 전류 미러(234)로부터 전달된다. 만약 전압이 높으면 전류가 높다는 것을 의미하고, JS1은 1이고 여기서 1 또는 높은 전압은 낮은 임피던스를 가리킨다.
식별 처리는 도 10의 잭 감지 테이블을 참조하여 보다 쉽게 이해되고, 여기서 스피커들, 헤드폰들, 모노 헤드폰들, SPDIF 또는 디지탈 스피커들, 원격 통신 장치들 또는 마이크로폰 각각 같은 상기 장치들이 컬럼들(JS1, JS3 및 JS0)에 리스트된 바와같은 구별되는 3개으 비트 디지탈 코드에 의해 표현되는 것이 도시된다. 부가적인 컬럼(JS4)은 플러그가 잭에 제공되거나 제공되지 않는 것을 가리키는 도 2의 플러그/언플러그 이벤트 검출 회로(40)로부터 출력될 수 있도록 부가된다. JS4가 1일때, 잭에 아무것도 없을때, 그것은 0이다. 이것은 아무것도 부착되지 않을때 아무런 부가적인 특성을 제공하지 않는다.
도 9의 재구성 회로(32e)에서, 트랜지스터들(250 및 252) 및 저항들(254, 256 및 258)은 입력(260)상 레벨에 의해 제어되는 프로그램 가능 마이크로폰 바이어스 소스를 형성하기 위하여 결합한다. 이것은 마이크로폰 또는 전기통신 헤드폰이 오디오 잭(60e)에 접속되고 검출될때 활성화되어, 팁 터미널(66e)에 바이어스를 제공한다. 프로그램 가능한 바이어스는 헤드폰, 또는 아날로그 또는 디자탈 스피커가 검출될때 접지되는 입력(260)에 의해 비활성화될 것이다. 스위치(262)는 저항(268) 및 인덕터(270)를 통하여 신호를 오디오 잭(60e) 팁 터미널(66e)에 결합하는 캐패시터(266)에 좌측 헤드폰 출력 신호(264)를 조건적으로 접속시킨다. 인덕터들(270 및 272)은 캐패시터들(84e 및 86e)과 각각 결합하여, 두개의 채널 고주파 EMI 필터를 형성한다. 이 필터는 선택적이고 인덕터들(270 및 272)은 단락 회로들에 의해 대체될 수 있다. 스위치(274)는 저항(280) 및 인덕터(272)를 통하여 오디오 잭(60e)의 링 터미널(62e)에 이 신호를 결합하는 캐패시터(278)에 우측 채널 헤드폰 출력 신호(276)를 조건적으로 접속시킨다.
아날로그 스피커들, 모노 헤드폰, 또는 헤드 폰들이 검출될때, 스위치들(262 및 274)은 각각 입력들(282 및 284)상 신호들을 활성화함으로써 폐쇄된다. 신호(260)는 접지되어 인가된 바이어스가 없도록 한다. SPDIF 출력 신호(286)는 접지되거나 높은 임피던스일 수 있다. 디지탈(SPDIF) 스피커들이 검출될때 조건들은 SPDIF 신호가 캐패시터(288) 및 저항(290)를 통하여 잭(60e)에 전송되는 것을 제외하고 동일하고, 출력들이 터미널들(264 및 276)에 접속되는 증폭기들(292, 294)은 소리없는 상태가 되고, 따라서 잭(60e)에 간섭 신호들이 제공되지 않고 구성요소들(266 및 268)을 사용하여 SPDIF 신호에 대한 AC 종결을 제공한다. 전기통신 헤드폰에 대하여, 260은 터미널(66e)에 접속된 헤드폰 마이크로폰에 바이어스를 제공하기 위한 높은 레벨로 설정된다. 스위치(262)는 마이크로폰으로부터의 신호가 크게 감쇠되지 않도록 개방된다. 이 신호는 저항(296)를 통하여 오디오 코덱 회로의 마이크로폰 입력으로 추가 처리를 위하여 제공된다. 캐패시터(298)는 저항(296)와 결합하여 로우 패스 필터에 상기 신호를 결합한다. 이런 필터링은 바람직하지만 선택적이다. 오디오 신호는 터미널(276)에 부착된 출력 증폭기를 접속시키는 스위치(274)를 폐쇄함으로써 터미널(62e)에 접속된 전기통신 헤드폰의 수화기에 제공된다. 입력(286)은 높은 임피던스 상태로 프로그램된다.
표준 모노 컴퓨터에 대하여 마이크로폰 입력(260)은 바이어스를 제공하기 위하여 높고, 스위치들(262 및 274)은 개방되고 입력(286)에 접속된 SPDIF 출력은 높은 임피던스 상태로 프로그램된다. 터미널(66e)상 인입 마이크로폰 신호는 인덕터(270) 및 저항(296)를 통해 코덱 마이크로폰 입력에 제공된다.
본 발명의 방법 및 시스템에 따라, 완전한 시스템은 3개의 메인 부분의 소프트웨어, 즉 사용자 인터페이스 애플리케이션(250), 도 11의 미들웨어 애플리케이션(252) 및 코덱 드라이버 소프트웨어(254)를 사용한다. 사용자 인터페이스(250)는 도 1의 컴퓨터(12) 같은 사용자 장치와 인터페이스하고, 여기서 소프트웨어는 일반적으로 14로 표현된다. 사용자 인터페이스 애플리케이션은 마우스, 키보드, 터치스크린, 펜, 또는 임의의 다른 종류의 입력뿐 아니라 PC 모니터들, CCD 디스플레이들, 플라즈마 디스플레이들, PDA 스크린들 등 같은 디스플레이들을 포함할 수 있다. 레코더들, 플레이어들 및 다른 것들(256) 같은 다양한 애플리케이션들은 필터들 등 같은 데이타 처리 회로들(258)을 통하여 코덱 드라이버(254)에 전달될 수 있다. 로드 감지 회로(30')는 특정 장치가 접속되는 서포트 회로들(28') 및 잭들(60')과의 맞물림으로부터 결정될때, 이 정보를 코덱 드라이버(254)에 전달하는 CPU 프로세서(12')에 이 정보를 전달한다. 로드 감지 회로(30')는 도 4에서 아날로그대 디지탈 컨버터(124)로부터 원래의 데이타를 직접적으로 도 1의 코덱 드라이버(254)에 전달하고, 또한 데이타 분석 논리 회로로부터의 처리된 데이타 또는 응답 분석기(36)의 다른 출력을 코덱 드라이버에 전달한다. 이런 방식으로, CPU 프로세서(12')와 관련한 코덱 드라이버(254)는 미지의 장치의 식별을 결정하기 위하여 원 데이타 및 로드 감지 회로(30')의 결정을 사용하여 로드 감지 회로(30')에 의해 제공된 것과 무관하게 결정을 하고 잭(60')에 접속된 미지의 장치의 식별에 대해 자체적으로 결정을 한다.
미들웨어 애플리케이션(252)은 이런 동작을 돕고 사용자 인터페이스 애플리케이션(250)과 관련하여 데이타베이스에 새로운 장치들을 부가할 수 있다. 부착된 장치를 인식할 수 없을때, 사용자 인터페이스를 통하여 상기 장치가 무엇이고 미래 참조를 위하여 임피던스 또는 스펙트랄 시그네이쳐 같은 전기 특성들과 함께 식별을 저장하는 것을 사용자에게 요구한다.
사용자 인터페이스 메시징은 도 12의 단계(260)에서 오디오 잭 장치 변화 통지를 얻는 임무를 시작한다. 만약 장치 변화를 겪을때, 예를들어 만약 장치들이 단계(262)에서 질문된 바와같이 제거되었다면, 단계(264)에서 통지가 사용자에게 디스플레이된다. 만약 장치 제거가 없다는 것이 대답되면, 시스템은 단계(266)에서 어떤 장치가 무선 잭에 플러그되고 사용자 검증을 요구하는지에 대해 가장 우수한 추측을 디스플레이한다. 그 다음 코덱 드라이버는 만약 필요하면 하드웨어의 재구성을 단계(268)에서 통지받고, 사용자는 수정이 올바르지 않거나 서포트되지 않는 것을 단계(270)에서 통지받는다.
미들웨어 애플리케이션은 도 13의 272에서 지시된 바와같은 다수의 기능들을 수행한다. 상기 기능은 장치 데이타베이스 리스트들, 장치 학습 및 저장 및 검색 기능들에 대한 사용자 메시징, 로드 측정, 맵핑을 수행한다. 부가적으로, 식별 회로에 의해 제공된 식별부상에서 실제 로드 주변 장치를 보다 잘 결정하기 위하여 하드웨어 플랫폼 회로 사양들을 사용한다. 또한 전류 I/O 수정 및 구성 데이타의 트랙을 유지할 것이다. 이것을 수행하기 위하여 서포트 회로 정보(274) 및 구성 파일을 유지하고, 일단 식별되면, 적당한 회로는 거기에 접속된 특정 장치에 터미널을 제공하기 위하여 재구성될 수 있다. 또한 표준 장치 임피던스 특성들을 리스트하는 데이타베이스 및 사용자 자신의 OEM에 의해 식별된 부가적인 장치들로 업데이트된 표준 장치 데이타베이스 특성들의 학습 장치 데이타베이스를 포함한다(276). 마지막으로, 구성 데이타베이스는 시스템이 파워 오프된 동안 어떤 잭 및 미들웨어 애플리케이션이 임의의 변화들을 검출하기 위하여 시작시 이런 구성을 검사하는가에 대한 장치의 리스트를 유지한다.
코덱 드라이버는 도 14에서 임의의 I/O 접속 플러그 인 또는 플러그 아웃 이벤트(280)를 검출한다. 코덱 드라이버는 단계(282)에서 잭의 판독 레벨을 바탕으로 장치가 삽입되었는지 제거되었는지를 각각의 잭에 대해 알린다. 만약 장치가 제거되면 사용자 인터페이스는 통지받을 것이다. 메시징에 의해 사용자 인터페이스에 미들웨어 애플리케이션(252) 및 미들웨어 애플리케이션 통신을 갖는 커넥터 이벤트들의 통신을 포함하는 이들 예비 이벤트들후, 초기 로드 측정 사이클은 단계(284)에서 시작된다. 식별 시스템 및 원 임피던스, 팁 또는 링 또는 양쪽 모두를 특징으로 하는 장치는 얻어진다(286). 정보(288)는 미들웨어 애플리케이션에 전달되어 식별을 해석하고 인증한다. 이런 포인트에서 만약 입력 또는 출력 또는 특정 임피던스 매칭에 대한 잭을 재구성하는 것이 필요하면, 이것은 행해진다(290). 다른 애플리케이션들 및 필터 드라이버들은 이런 옵션(292)에서 목료된 바와같이 턴온되거나 턴오프될 수 있다.
도 15의 시작에서, 사용자 인터페이스 애플리케이션은 잭들 또는 I/O 커넥터들(300) 모두에서 주변 감지 사이클을 수행하고 셧다운 전에 구성과 비교한다(302). 만약 구성이 다르면, 단계(304), 사용자 메시징은 접속된 다른 주변부를 가진 각각의 잭에 대해서 시작된다(306). 만약 변화가 아무것도 없으면, 임무는 행해진다.
잭 이벤트 검출은 도 16에서 코덱(11), 또는 시스템에서 잭에 플러그되거나 언플러그되는 장치를 검출하기 위한 본 발명에 따른 다른 시스템의 능력이다. 이벤트 검출 메카니즘은 필요한 액션을 취하고 반응하도록 다시 신호(예를들어, CPU는 모니터하기 위한 시스템 소프트웨어용 레지스터(register)의 상태 신호를 중단하고 알린다)를 트리거한다. 반응 실시예들은 헤드폰들의 플러그가 EQ를 턴온 또는 턴오프할때, 다중 채널 오디오를 2 채널들로 다운하여 혼합하고 서라운드 채널들의 소리를 줄이고, 플러그된 것의 장치 특성을 측정하고, 사용자에게 메세징하는 것이다.
단일 잭에 대하여, 잭 스위치 핀들로부터 코덱 및 하나의 코덱 핀(JS)로 하나의 DC 전압 경로는 잭에서 이벤트들을 검출하기에 충분하다. JS 핀에 잭상의 스위치 핀을 접속하는 것은 잭에 무언가가 플러그되었는지 아닌지에 따라 높거나 낮은 논리(코덱에서 풀업 저항기를 통하여 높고, 애플리케이션 회로에서 풀 다운 저항기를 통해 낮음)를 발생시킬 것이다. 논리 '0'에서 논리 '1'로 및 그 반대로 천이는 시스템에 대한 이벤트 신호이다.
종래 시스템들은 도 16 및 도 17에 도시된 바와같이, 이벤트들 메카니즘들을 검출하기 위하여 잭에 대해 전용 핀을 가지기 보다 오히려 잭들(60a-60n)같은 다수의 잭들을 가진다. 필수적으로, 이들 시스템들은 본 발명에 따라 각각의 잭에 무언가가 플러그되든지(또는 아니든지)에 따라, JS 핀 노드(400)에서 DC 전압 레벨이 다를 도 16의 저항 래더 네트워크(410a) 또는 도 17의 410b를 포함한다. 초기 DC 바이어스 전압은 저항기(411)를 통하여 애플리케이션들 회로상 코덱(11) 내부 또는 선택적으로 외부의 아날로그 또는 디지탈 공급 전압으로 설정된다. 코덱(11) 내부에서, 낮은 해상도의 아날로그 대 디지탈 컨버터(ADC)(412)는 JS 핀 노드(400)상 전압을 측정한다. 전압 레벨이 변화할때, 장치는 저항기 래더 네트워크(410)에 접속된 시스템의 잭(60)에 플러그되거나 제거된다. ADC(412)는 이벤트가 발생한 잭이 무엇이고 만약 무언가가 플러그 인 되었는지 아닌지 JS 핀 노드(400)의 전압 레벨을 바탕으로 결정하는 소프트웨어에 전압 측정치를 전송한다. 저항 래더 네트워크(410)는 장치들이 다른 값의 저항기들(R1-RN)을 선택함으로써 하나 이상의 터미널들(60)에 접속되는지에 따라 가변하도록 JS 핀 노드(400)와 같이 전압을 조절한다.
도 16은 잭 스위치들(60a-60n)이 오디오 신호로부터 절연되는 다중 잭 시스템에 대한 방법을 개시한다. 절연된 잭 스위치들은 폐쇄될때(또는 개방될때) 오디오 신호 라인들에 접속하지 않는 것을 의미한다. 이 경우, JS 핀 노드(400)에 대한 전압은 DC만이다. 절연된 잭들은 비절연된 잭들보다 우수하다. 도 3을 참조하여 상기된 바와같이, 잭(60a)에 삽입된 플러그는 스위치(68)가 개방되도록 하여 JS 핀(400)과 같은 전압 레벨을 변화시킨다.
도 17은 다중 잭 시스템(60a'-60n')용 저항 래더(410b)를 개시하고, 여기서 잭 스위치는 오디오 신호로부터 절연되지 않는다. 이 경우, 아무것도 잭에 있지 않을때 스위치 핀들은 JS 핀(400) 경로를 오디오 신호 라인들에 단락시킨다. 만약 오디오가 예를들어 입력 장치로부터 동작하고 있으면, 이 오디오 신호는 DC 전압에 따라 상승하여, 변화된다. JS 핀(400)에서 RC 필터(414)는 AC 오디오 신호중 적어도 몇몇을 분리하고 그것을 접지에 흘려보낸다. 핀(400)에서 임의의 전압 리플 또는 변화들은 타임아웃 세트와 함께 코덱(11a) 내부의 타이머(416)에 의해 "분리"되어, DC 전압을 상승시키는 잔류 오디오에 의해 발생되는 잭 이벤트 오검출들은 발생하지 않을 것이다. 논리 회로 또는 수단(418)은 타이머(416) 및 ADC(412)에 응답하여, ADC(412)로부터의 출력이 타미어(416)에 의해 설정된 시간 기간 동안 변화하는지를 검사한다. 만약 ADC 출력이 연속적인 시간 기간들에 걸쳐 계속 변화하면, 오디오 신호는 제공되고 JS 차단 신호는 생성된다. 반대로, 만약 ADC 출력이 변화되지만 안정하게 유지되면, JS 차단 신호는 생성된다. 이런 동일한 해결책은 노이즈를 차단하기 위한 절연된 잭들에서도 사용될 수 있다.
비록 본 발명의 특정 특징들이 몇몇 도면들에서 도시되고 다른 것들에서 도시되지 않았지만, 이것은 각각의 특징이 본 발명에 따른 다른 특징들중 임의의 또는 모든 것과 결합될 수 있을때만 편리하다. 여기에 사용된 낱말들 "인클루딩", "컴프라이징", "해빙" 및 "위드"는 폭넓고 광범위하게 해석될 수 있고 임의의 물리적 상호관계로 제한되지 않는다. 게다가, 본 출원에 개시된 임의의 실시예들은 단지 가능한 실시예로서 취해지지 않는다.
다른 실시예들은 당업자에 의해 발생할 것이고 다음 청구항들내에 있다.

Claims (63)

  1. 정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나로서 하나의 장치를 인식하기 위한 식별 시스템에 있어서,
    검사 모드에서 장치에 검사 신호를 공급하기 위한 여기 회로;
    상기 장치의 전기적 특성을 측정하기 위하여 검사 모드에서 상기 장치에 인가된 검사 신호에 응답하는 응답 분석기 회로; 및
    상기 다수의 다른 장치들중 하나로서 터미널에 접속된 상기 장치를 인식하기 위하여 상기 다수의 장치들의 전기적 특성들의 표현들과 상기 장치의 전기적 특성의 표현을 매칭하기 위한 상기 장치의 측정된 전기적 특성에 응답하는 식별 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  2. 제 1 항에 있어서, 상기 여기 회로는 전류 소스를 포함하는 것을 특징으로 하는 식별 시스템.
  3. 제 2 항에 있어서, 상기 전류 소스는 전류를 상기 장치에 제공하는 것을 특징으로 하는 식별 시스템.
  4. 제 2 항에 있어서, 상기 전류 소스는 상기 장치로부터 전류를 감소시키는 것을 특징으로 하는 식별 시스템.
  5. 제 2 항에 있어서, 상기 여기 회로는 상기 전류 소스를 상기 터미널에 선택적으로 접속하기 위한 여기 스위칭 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  6. 제 2 항에 있어서, 상기 전류 소스는 다수의 전류 소스 유니트들을 포함하는 것을 특징으로 하는 식별 시스템.
  7. 제 2 항에 있어서, 상기 응답 분석기 회로는 상기 전류 소스가 상기 장치에 접속된후 상기 장치의 전압을 감지하기 위한 샘플 및 홀드 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  8. 제 7 항에 있어서, 상기 응답 분석기 회로는 상기 샘플 및 홀드 회로에 응답하는 아날로그 대 디지탈 컨버터를 포함하는 것을 특징으로 하는 식별 시스템.
  9. 제 1 항에 있어서, 상기 식별 회로는 상기 다수의 다른 장치들의 전기 특성 표현과 상기 장치의 전기 특성의 표현을 매칭하기 위한 판정 트리를 사용하는 것을 특징으로 하는 식별 시스템.
  10. 제 1 항에 있어서, 상기 식별 회로는 상기 장치의 특성 표현과 매칭하기 위하여 상기 다수의 장치들의 상기 특성 표현을 저장하기 위한 저장 장치를 포함하는 것을 특징으로 하는 식별 시스템.
  11. 제 1 항에 있어서, 상기 터미널에 접속되고 식별된 상기 장치에 제공하기 위하여 재구성하기 위한 상기 장치의 식별에 응답하는 재구성 회로를 더 포함하는 것을 특징으로 하는 식별 시스템.
  12. 제 11 항에 있어서, 상기 재구성 회로는 입력 및 출력 증폭기들 및 상기 터미널에 상기 증폭기들을 선택적으로 접속하기 위한 재구성 스위칭 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  13. 제 11 항에 있어서, 상기 재구성 회로는 낮은 온 임피던스 및 높은 오프 임피던스 사이에서 증폭기들을 선택적으로 변이시킬 수 있는 인에이블 입력들을 가진 입력 및 출력 증폭기들을 포함하는 것을 특징으로 하는 식별 시스템.
  14. 제 1 항에 있어서, 상기 터미널에 접속된 장치의 존재 및 부재를 검출하기 위한 이벤트 검출기를 더 포함하는 것을 특징으로 하는 식별 시스템.
  15. 제 14 항에 있어서, 다중 터미널들이 있고 상기 이벤트 검출기는,
    노드 및 장치들이 하나 이상의 터미널들에 접속되었는지에 따라 가변하도록 상기 노드에서 전압을 조절하기 위한 터미널들 사이에 접속된 저항기 래더 네트워크; 및
    상기 노드에서 전압이 변화되었는지를 검출하기 위한 비교 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  16. 제 15 항에 있어서, 상기 비교 회로는 아날로그 대 디지탈 컨버터를 포함하는 것을 특징으로 하는 식별 시스템.
  17. 제 15 항에 있어서, 상기 저항 래더 네트워크는 각각의 터미널 및 노드 사이에 접속된 다른 값의 저항기들을 포함하는 것을 특징으로 하는 식별 시스템.
  18. 제 15 항에 있어서, 상기 다중 터미널들은 절연되지 않고 상기 이벤트 검출기는 오디오 신호의 존재로 인한 노드에서의 전압 변화 및 터미널 플러그 인 또는 플러그 아웃 이벤트 사이를 판별하기 위한 수단을 더 포함하는 것을 특징으로 하는 식별 시스템.
  19. 제 18 항에 있어서, 상기 판별 수단은 상기 노드에서 전압 변화가 안정한지를 검출하기 위한 타이머에 응답하는 논리 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  20. 제 1 항에 있어서, 상기 전기 특성은 임피던스인 것을 특징으로 하는 식별 시스템.
  21. 제 1 항에 있어서, 상기 전기 특성은 주파수 임피던스이고 상기 응답 분석기 회로는 주파수 응답 분석기를 포함하는 것을 특징으로 하는 식별 시스템.
  22. 제 1 항에 있어서, 다수의 터미널들 및 각각의 상기 터미널들과 상기 여기 회로를 선택적으로 접속하기 위한 다수의 여기 스위칭 회로들을 포함하는 것을 특징으로 하는 식별 시스템.
  23. 제 1 항에 있어서, 상기 터미널은 팁 및 링 잭을 포함하고, 상기 여기 회로는 팁 접촉부에 검사 신호를 공급하고 상기 응답 분석기 회로는 링 접촉부에 응답하는 것을 특징으로 하는 식별 시스템.
  24. 제 1 항에 있어서, 상기 터미널은 팁 및 링 잭을 포함하고, 상기 여기 회로는 링 접촉부에 검사 신호를 공급하고 상기 응답 분석기 회로는 팁 접촉부에 응답하는 것을 특징으로 하는 식별 시스템.
  25. 제 1 항에 있어서, 상기 응답 분석기 회로는 상기 샘플 및 홀드 회로를 상기 터미널에 선택적으로 접속하기 위한 분석기 스위칭 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  26. 제 1 항에 있어서, 다수의 터미널들 및 각각의 상기 터미널들과 상기 응답 분석기 회로를 선택적으로 접속하기 위한 분석기 스위칭 회로들을 포함하는 것을 특징으로 하는 식별 시스템.
  27. 제 1 항에 있어서, 상기 여기 회로는 상기 장치에 다수의 다른 전류 레벨들을 선택적으로 공급하기 위한 상기 응답 분석기 회로에 응답하는 프로그램 가능 전류 소스를 포함하는 것을 특징으로 하는 식별 시스템.
  28. 정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나로서 하나의 장치를 인식하기 위한 식별 시스템에 있어서,
    검사 모드에서 검사 신호를 장치에 공급하기 위한 여기 회로;
    상기 장치의 전기 특성을 측정하기 위한 검사 모드에서 상기 장치에 인가된 검사 신호에 응답하는 응답 분석기 회로;
    상기 다수의 다른 장치들중 하나로서 상기 터미널에 접속된 상기 장치를 인식하기 위해 상기 다수의 장치들의 전기 특성 표현과 상기 장치의 전기 특성 표현을 매칭하기 위한 상기 장치의 측정된 전기 특성에 응답하는 식별 회로; 및
    상기 터미널에 접속되고 식별된 상기 장치에 제공하도록 재구성하기 위해 상기 장치의 식별에 응답하는 재구성 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  29. 제 28 항에 있어서, 상기 여기 회로는 전류 소스를 포함하는 것을 특징으로 하는 식별 시스템.
  30. 제 29 항에 있어서, 상기 전류 소스는 상기 장치에 전류를 제공하는 것을 특징으로 하는 식별 시스템.
  31. 제 29 항에 있어서, 상기 전류 소스는 상기 장치로부터 전류를 줄이는 것을 특징으로 하는 식별 시스템.
  32. 제 29 항에 있어서, 상기 여기 회로는 상기 전류 소스를 상기 터미널에 선택적으로 접속하기 위한 여기 스위칭 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  33. 제 29 항에 있어서, 상기 전류 소스는 다수의 전류 소스 유니트들을 포함하는 것을 특징으로 하는 식별 시스템.
  34. 제 29 항에 있어서, 상기 응답 분석기 회로는 상기 전류 소스가 상기 장치에 접속된후 상기 장치의 전압을 감지하기 위한 샘플 및 홀드 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  35. 제 34 항에 있어서, 상기 응답 분석기 회로는 상기 샘플 및 홀드 회로에 응답하는 아날로그 대 디지탈 컨버터를 포함하는 것을 특징으로 하는 식별 시스템.
  36. 제 28 항에 있어서, 상기 식별 회로는 상기 다수의 다른 장치들의 전기 특성 표현과 상기 장치의 전기 특성 표현을 매칭하기 위한 판정 트리를 포함하는 것을 특징으로 하는 식별 시스템.
  37. 제 28 항에 있어서, 상기 식별 회로는 상기 장치의 특성의 표현과 매칭하기 위해 상기 다수의 장치들의 특성 표현을 저장하기 위한 저장 장치를 포함하는 것을 특징으로 하는 식별 시스템.
  38. 제 28 항에 있어서, 상기 재구성 회로는 입력 및 출력 증폭기들 및 상기 터미널에 상기 증폭기들을 선택적으로 접속하기 위한 재구성 스위칭 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  39. 제 28 항에 있어서, 상기 재구성 회로는 낮은 온 임피던스 및 높은 오프 임피던스 사이에서 상기 증폭기들을 선택적으로 변이시킬 수 있는 인에이블 입력들을 가진 입력 및 출력 증폭기들을 포함하는 것을 특징으로 하는 식별 시스템.
  40. 제 28 항에 있어서, 상기 터미널에 접속된 장치의 존재 및 부재를 검출하기 위하여 이벤트 검출기를 더 포함하는 것을 특징으로 하는 식별 시스템.
  41. 제 28 항에 있어서, 상기 전기 특성은 임피던스인 것을 특징으로 하는 식별 시스템.
  42. 제 28 항에 있어서, 상기 전기 특성은 주파수 응답이고 상기 응답 분석기 회로는 주파수 응답 분석기를 포함하는 것을 특징으로 하는 식별 시스템.
  43. 제 28 항에 있어서, 다수의 터미널들 및 상기 터미널들 각각과 상기 여기 여기 회로를 선택적으로 접속시키기 위한 다수의 여기 스위칭 회로들을 포함하는 것을 특징으로 하는 식별 시스템.
  44. 제 28 항에 있어서, 상기 터미널은 팁 및 링 잭을 포함하고, 상기 여기 회로는 검사 신호를 팁 접촉부에 공급하고 상기 응답 분석기 회로는 링 접촉부에 응답하는 것을 특징으로 하는 식별 시스템.
  45. 제 28 항에 있어서, 상기 터미널은 팁 및 링 잭을 포함하고, 상기 여기 회로는 검사 신호를 링 접촉부에 공급하고 상기 응답 분석기 회로는 팁 접촉부에 응답하는 것을 특징으로 하는 식별 시스템.
  46. 제 28 항에 있어서, 상기 응답 분석기 회로는 상기 터미널에 상기 샘플 및 홀드 회로를 선택적으로 접속하기 위한 분석기 스위칭 회로를 포함하는 것을 특징으로 하는 식별 시스템.
  47. 제 28 항에 있어서, 다수의 터미널들 및 상기 각각의 터미널들과 상기 응답 분석기 회로를 선택적으로 접속하기 위한 분석기 스위칭 회로들을 포함하는 것을 특징으로 하는 식별 시스템.
  48. 제 28 항에 있어서, 상기 여기 회로는 다수의 다른 전류 레벨들을 상기 장치에 선택적으로 공급하기 위하여 상기 응답 분석기 회로에 응답하는 프로그램 가능한 전류 소스를 포함하는 것을 특징으로 하는 식별 시스템.
  49. 정보 처리 시스템의 적어도 하나의 터미널에 접속된 다수의 다른 유형의 장치들중 하나로서 하나의 장치를 인식하기 위한 식별 방법에 있어서,
    검사 모드에서 장치에 검사 신호를 공급하는 단계;
    검사 모드에서 상기 장치에 공급된 검사 신호에 응답하여 상기 장치의 전기 특성을 측정하는 단계; 및
    상기 다수의 다른 장치들중 하나로서 터미널에 접속된 상기 장치를 구성하기 위하여 상기 다수의 장치들의 전기 특성들의 표현과 상기 장치의 전기 특성 표현을 매칭하는 단계를 포함하는 것을 특징으로 하는 식별 방법.
  50. 제 49 항에 있어서, 상기 다수의 다른 장치들의 전기 특성 표현과 상기 장치의 전기 특성 표현을 매칭하는 것은 판정 트리를 사용하는 것을 특징으로 하는 식별 방법.
  51. 제 49 항에 있어서, 저장 장치는 상기 장치의 특성 표현과 매칭하기 위한 상기 다수의 장치들의 특성 표현들을 저장하는 것을 특징으로 하는 식별 방법.
  52. 제 49 항에 있어서, 식별된 상기 장치에 제공하도록 상기 터미널을 재구성하기 위하여 상기 장치의 식별에 응답하는 단계를 더 포함하는 것을 특징으로 하는 식별 방법.
  53. 제 49 항에 있어서, 상기 장치 터미널에 접속된 장치의 존재 및 부재를 검출하기 위하여 이벤트 검출기를 더 포함하는 것을 특징으로 하는 식별 방법.
  54. 제 49 항에 있어서, 상기 전기 특성은 임피던스인 것을 특징으로 하는 식별 방법.
  55. 제 49 항에 있어서, 상기 전기 특성은 주파수 응답인 것을 특징으로 하는 식별 방법.
  56. 제 49 항에 있어서, 상기 터미널은 팁 및 링 잭을 포함하고, 상기 검사 신호는 팁 접촉부에 인가되고 상기 응답은 링 접촉부로부터 수신되는 것을 특징으로 하는 식별 방법.
  57. 제 49 항에 있어서, 상기 단자는 팁 및 링 잭을 포함하고, 상기 검사 신호는 링 접촉부에 제공되고 상기 응답은 팁 접촉부로부터 수신되는 것을 특징으로 하는 식별 방법.
  58. 제 49 항에 있어서, 상기 여기 회로는 다수의 다른 전류 레벨들을 상기 장치에 선택적으로 공급하기 위한 상기 응답 분석기 회로에 응답하는 프로그램 가능 전류 소스를 포함하는 것을 특징으로 하는 식별 방법.
  59. 다수의 터미널들에 대한 장치 플러그 인 또는 플러그 아웃 이벤트를 검출하기 위한 시스템에 있어서,
    노드 및 장치들이 하나 이상의 터미널들에 접속되었는지에 따라 가변하도록 상기 노드에서 전압을 조절하기 위한 터미널들 사이에 접속된 저항 래더 네트워크; 및
    노드에서 전압이 변화되었는지를 검출하기 위한 비교 회로를 포함하는 것을 특징으로 하는 검출 시스템.
  60. 제 59 항에 있어서, 상기 비교 회로는 아날로그 대 디지탈 컨버터를 포함하는 것을 특징으로 하는 검출 시스템.
  61. 제 59 항에 있어서, 상기 저항 래더 네트워크는 각각의 터미널 및 노드 사이에 접속된 다른 값의 저항기들을 포함하는 것을 특징으로 하는 검출 시스템.
  62. 제 59 항에 있어서, 상기 다수의 터미널들은 절연되지 않고 이벤트 검출기는 오디오 신호의 존재로 인한 노드에서의 전압 변화 및 터미널 플러그 인 또는 플러그 아웃 이벤트 사이를 판별하도록 구성된 논리 회로를 더 포함하는 것을 특징으로 하는 검출 시스템.
  63. 다수의 터미널들에 대한 장치 플러그 인 또는 플러그 아웃 이벤트를 검출하기 위한 시스템에 있어서,
    노드 및 장치들이 하나 이상의 터미널들에 접속되었는지에 따라 가변하도록 상기 노드에서 전압을 조절하기 위한 터미널들 사이에 접속된 저항 래더 네트워크;
    상기 노드에서 전압이 변화되었는지를 검출하기 위한 비교 회로; 및
    터미널 플러그 인 또는 플러그 아웃 이벤트로 인한 노드에서의 전압 변화 및 터미널 플러그 인 또는 플러그 아웃 이벤트로 인한 노드에서의 전압 변화 사이를 판별하도록 구성된 논리 회로를 포함하는 것을 특징으로 하는 검출 시스템.
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