KR20010093629A - 플라즈마 디스플레이 패널의 구동방법 및 플라즈마디스플레이 장치 - Google Patents

플라즈마 디스플레이 패널의 구동방법 및 플라즈마디스플레이 장치 Download PDF

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Abstract

본 발명은 ALIS 방식의 PDP로 플리커를 저감한 표시를 행한 경우에도 이상 방전이 발생하지 않는 플라즈마 디스플레이 패널의 구동방법의 실현하는 것은 과제로 한다.
본 발명에서는, 복수의 제1 및 제2 전극(15, 16)을 교호로 인접하여 배치하고, 제1 전극의 한쪽에 인접하는 제2 전극으로 제1 표시 라인을 형성하고, 다른 쪽에 인접하는 제2 전극으로 제2 표시 라인을 형성하고, 1화면의 표시필드를 복수의 서브 필드(SF1 ∼ SFn)로 구성하고, 표시를 행하는 서브 필드를 조합함으로써 계조 표시를 행하는 플라즈마 디스플레이 패널의 구동방법에 있어서, 1화면의 표시필드는 제1 표시 라인에 의해 표시되는 서브 필드와 제2 표시 라인에 의해 표시되는 서브 필드를 구비하고, 동일한 서브 필드는 제1 및 제2 표시 라인의 한쪽에 의해서만 표시된다.

Description

플라즈마 디스플레이 패널의 구동방법 및 플라즈마 디스플레이 장치{METHOD OF DRIVING PLASMA DISPLAY PANEL AND PLASMA DISPLAY APPARATUS}
본 발명은 플라즈마 디스플레이 패널의 구동방법 및 플라즈마 디스플레이 장치에 관한 것이며, 특히 복수의 제1 및 제2 전극을 인접하여 배치하고, 모든 전극간에서 표시 라인을 형성하는 "Alternate Lighting of Surfaces"(이하 ALIS로 생략한다) 방식의 플라즈마 디스플레이 패널의 구동방법 및 플라즈마 디스플레이 장치에 관한 것이다.
플라즈마 디스플레이 패널(PDP)은 자기발광형이므로 시인성(視認性)이 좋고, 박형이며 대화면표시 및 고속표시가 가능하므로, CRT 대신의 표시패널로서 주목되고 있다. 일반적인 PDP는 도1a에 나타낸 바와 같이, n(여기서는 512)개의 Y전극(11)과 X전극(12)을 인접하여 교호로 배치되고, n조의 Y전극(11)과 X전극(12)의 조(組)를 형성하고, 각 조의 Y전극(11)과 X전극(12) 사이에서 표시를 위한 발광을 한다. Y전극과 X전극은 표시전극으로 불리고(유지전극 또는 서스테인 전극으로도 불린다.), 실제로는 표시전극이 뻗은 방향에 수직인 방향으로 어드레스전극이 설치되나 여기서는 생략되어 있다. 따라서 n개의 표시 라인을 형성하려면 2n개의 표시전극(Y전극과 X전극)이 필요하다.
이에 대하여 일본 특허 제2801893호에는, 도1b에 나타낸 바와 같은 모든 표시전극간에서 표시를 위한 발광을 행하는 방식이 개시되어 있다. 이 방식은 ALIS 방식으로 불린다. ALIS 방식의 상세한 구성은 일본 특허 제2801893호에 개시되어 있으며, 여기서는 본 발명에 관계되는 점에 대해서만 간단하게 설명하겠다. 도1b에 나타낸 바와 같이, ALIS 방식의 PDP에서는 n개(여기서는 512개)의 Y전극(제1 전극)(15-O, 15-E)과 n+1개의 X전극(제2 전극)(16-O, 16-E)을 인접하여 교호로 배치하여, 모든 표시전극(Y전극과 X전극) 사이에서 표시발광을 행한다. 따라서 2n+1개의 표시전극에서 2n개의 표시 라인이 형성된다. 즉 ALIS 방식은 도1a의 구성과 동등한 표시전극 수로 2배의 세밀도를 실현할 수 있다. 또 방전공간을 헛되지 않게 사용할 수 있고, 또한 전극 등에 의한 차광이 작아 높은 개구율이 얻어지기 때문에, 고휘도가 실현되는 등의 특징을 갖는다.
도2는 ALIS 방식의 표시방법이다. 모든 표시전극간을 표시하기 위한 방전에 이용하지만, 그들 방전을 동시에 발생할 수는 없다. 그래서 표시를 홀수 라인과 짝수 라인으로 시간적으로 분할하여 행하는 소위 인터레이스 주사를 실시한다. 도2에 나타낸 바와 같이, 홀수 필드에서는 홀수번째의 표시 라인에 의해 표시를 행하고, 짝수 필드에서는 짝수번째의 표시 라인에 의해 표시를 행하여, 전체로서는 홀수 필드와 짝수 필드의 표시를 합친 표시를 얻을 수 있다.
도3은 ALIS 방식의 유지방전기간에 있어서의 동작원리를 나타낸 도면이고, 도3a는 홀수 필드의 동작을, 도3b는 짝수 필드의 동작을 나타낸다. 홀수 필드에서는 전극 Y1과 X2에 전압 Vs를 인가하고, X1과 Y2를 그라운드 레벨로 하고, X1과 Y1 간 및 X2와 Y2 간에서, 즉 홀수 표시 라인에서 방전을 발생시킨다. 이때 짝수 표시 라인인 Y1과 X2 사이의 전위차는 0이므로 방전은 발생하지 않는다. 마찬가지로 짝수 필드에서는, 전극 X1과 Y1에 전압 Vs를 인가하고, Y2와 X2를 그라운드 레벨로 하여, Y1과 X2 사이 및 Y2와 X1 사이에서 즉 짝수 표시 라인에서 방전을 발생시킨다.
도4는 ALIS 방식의 PDP의 구동회로를 나타낸 도면이다. X전극과 Y전극이 평행하게 교호로 배치되고, 거기에 수직 방향으로 어드레스전극(19)이 배치된다. 참조번호 15-O는 홀수번째의 Y전극을, 15-E는 짝수번째의 Y전극을, 16-O는 홀수번째의 X전극을, 16-E는 짝수번째의 X전극을 나타낸다. Y전극은 스캔 드라이버(23)에 접속되어 있다. 스캔 드라이버(23)에는 스위치(24)가 설치되어 있고, 어드레스 기간에는 차례로 스캔 펄스가 인가되도록 전환되고, 유지방전기간에는 홀수 Y전극 15-O는 제1 Y서스테인 펄스(유지 펄스) 발생회로(25)에, 짝수 Y전극 15-E는 제2 Y서스테인 펄스 발생회로(26)에 접속되도록 전환된다. 홀수 X전극 16-O는 제1 X서스테인 펄스 발생회로(21)에, 짝수 X전극 16-E는 제2 X서스테인 펄스 발생회로(22)에 접속된다. 어드레스전극(19)은 어드레스 드라이버(27)에 접속된다.
도5와 도6은 ALIS 방식의 PDP의 구동파형을 나타낸 도면이고, 도5는 홀수 필드의 구동파형을, 도6은 짝수 필드의 구동파형을 나타낸다. 도5에 나타낸 바와 같이 리세트 기간에는 모든 X전극과 Y전극간에 전압 펄스를 인가하고, 모든 표시 라인으로 초기화방전을 한다. 어드레스 기간은 전반과 후반으로 분할된다. 홀수 필드에서는 어드레스 기간의 전반에, 홀수 Y전극(Y1)에 순차 스캔 펄스를 인가한다. 이때 홀수 X전극(X1, X3)에는 정(正)의 전압이 인가되고, 짝수 X전극(X2)은 그라운드 레벨로 되고, 짝수 Y전극(Y2)에는 작은 부(負)의 전압이 인가되므로, 홀수 X전극과 홀수 Y전극 사이에서 어드레스 펄스가 인가된 어드레스 라인에서만 어드레스 방전이 이루어져서 벽전하가 축적된다. 홀수 필드의 어드레스 기간의 후반에서는 짝수 Y전극(Y2)에 순차 스캔 펄스를 인가하고, 짝수 X전극(X2)에는 정의 전압이 인가되고, 홀수 X전극(X1, X3)은 그라운드 레벨로 되고, 홀수 Y전극(Y1)에는 작은 부의전압이 인가되므로, 짝수 X전극과 짝수 Y전극 사이에서만 어드레스 방전이 행하여진다. 이와 같이 하여 홀수 표시 라인에 표시데이터에 대응한 전하가 축적된다. 그리고 유지방전기간에는 홀수 X전극과 홀수 Y전극간 및 짝수 X전극과 짝수 Y전극간에 역상(逆相)의 유지 펄스(서스테인 펄스)가 인가되고, 홀수 표시 라인으로 유지방전, 즉 표시발광이 이루어진다. 유지방전의 회수(유지 펄스 수)로 필드의 휘도가 결정된다.
도6에 나타낸 바와 같이 짝수 필드의 어드레스 기간의 전반에서는, 홀수 Y전극과 짝수 X전극 사이에서 어드레스 방전이 행하여지고, 후반에서는 짝수 Y전극과 홀수 X전극 사이에서 어드레스 방전이 행하여지고, 홀수 Y전극과 짝수 X전극간 및 짝수 Y전극과 홀수 X전극간에 역상의 유지 펄스가 인가되어, 짝수 표시 라인에 의해 표시발광이 행하여진다.
PDP에서는 1표시 필드를 복수의 서브 필드로 분할하고, 표시하는 계조에 따라서 점등하는 서브 필드를 조합함으로써 계조 표시를 한다. 각 서브 필드에서는 도5 또는 도6에 나타낸 구동파형이 인가되어서 상기와 같은 동작이 행하여진다. 각 서브 필드의 휘도는 상기한 바와 같이 유지 펄스 수에 의해서 결정되고, 각 서브 필드의 휘도를 바꾸어서 가능한 한 적은 서브 필드 수로, 가능한 한 다수의 계조를 표현한다. 계조를 더욱 더 효과적으로 표현하는 것은, 각 서브 필드의 휘도비가 1 : 2 : 4 : 8 … 이라는 형태로 2의 누승(累乘)이 되도록 설정되어 있는 경우로서 종래부터 널리 사용되고 있다. 그러나 후술한 바와 같이 색 오류 윤곽(color false contour)의 문제가 있으므로 일본 특개평9-311662호 공보에 개시되어 있는 바와 같이, 같은 휘도의 서브 필드를 복수 설치하는 경우도 있다.
도7은 ALIS 방식으로 서브 필드법을 행하는 경우의 구동 시퀀스를 나타낸 도면이다. 도시한 바와 같이 1표시 필드는 홀수 필드와 짝수 필드로 나누어진다. 1초에 30필드 표시하는 경우, 1 필드의 표시기간은 33.3ms이고, 홀수 필드와 짝수 필드는 각각 16.7ms의 기간이다. 홀수 필드와 짝수 필드는 각각 n개의 서브 필드(SF)로 분할되고, 홀수 필드의 각 SF에서는 도5에 나타낸 바와 같은 동작이, 짝수 필드의 각 SF에서는 도6에 나타낸 바와 같은 동작이 행하여진다. 각 SF는 휘도에 따라서 유지방전기간의 길이, 즉 유지방전의 회수가 결정되어 있다.
ALIS 방식은 인터레이스 표시에 유사한 표시 방식이고, 도7의 예에서는 각 라인은 홀수 필드와 짝수 필드 중의 어느 것으로 표시되므로, 30Hz로 표시되는 것에 의해 플리커가 문제가 된다. 통상, 영상표시이면 30Hz의 플리커는 큰 문제는 되지 않지만, 문자 등을 표시하는 경우에는 문제가 되는 경우가 있다. 그래서 인터레이스 방식의 PDP를 문자표시 등의 용도로 사용하는 경우에, 도8에 나타낸 바와 같이 홀수 표시 라인 또는 짝수 표시 라인의 한쪽만을 반복 사용하는 편필드 방식이 사용된다. 즉 1표시 필드는 홀수 필드와 짝수 필드로 분할되지 않는다. 편필드 방식은 표시할 수 있는 라인 수는 절반으로 되지만, 각 표시 라인은 60Hz로 표시되므로, 고세밀도보다 플리커가 문제가 되는 용도에서 사용된다. 또 홀수 표시 라인 또는 짝수 표시 라인의 한쪽만을 사용한 경우, 사용하는 한쪽 표시 라인만이 열화되므로, 예를 들면 1일에 1회 또는 전원기동시 등에 표시 라인을 전환하여 수명 연장을 도모하는 것이 일본 특원평10-135398호에 개시되어 있다.
ALIS 방식의 PDP를 도8에 나타낸 바와 같은 편필드 방식으로 동작시킨 경우, X전극과 Y전극의 조를 넘어서 강대한 방전이 발생하여, 그 이후 정상적인 동작이 이루어질 수 없게 되거나, 패널 내의 절연층이나 구동회로가 파괴되는 등의 문제가 발생하였다.
이 문제는 도9a에 나타낸 바와 같이, 동작에 따라서 패널의 한쪽 측에 부의 전하가 축적되고, 다른 쪽 측에 정의 전하가 축적되어, 축적된 전하가 어느 정도 이상으로 되면, 도9b에 나타낸 바와 같이 전극을 넘어서 방전이 발생하는 것으로 생각된다. 그 원인에 대하여는 충분히 해명되어 있지 않으나, 이하와 같은 것을 생각할 수 있다. 도10에 나타낸 바와 같이 어드레스 기간에는 어드레스전극과 Y전극간의 방전을 트리거로 하여 X전극과 Y전극간의 방전이 발생한다. 그 때에 방전에 의해서 발생한 전자와 이온은 방전공간 내의 전하에 의해서 이동하고, 전자는 양극인 X전극측에, 이온은 음극인 Y전극측으로 이동하여 전극의 표면에 각각 축적된다. 어드레스 방전 후의 유지방전에서는, X전극과 Y전극간에 교호로 역극성의 전압이 인가되어 방전이 이루어지지만, 어드레스시의 X전극과 Y전극간의 200V의 전위차에 대하여 유지 펄스는 150∼180V의 낮은 전압이어서, 어드레스시에 이동한 전하를 완전히 원래의 상태로 되돌릴 수는 없다. ALIS 방식의 PDP에서는 일반적인 PDP에 비해서 홀수 Y전극과 짝수 X전극간 및 홀수 X전극과 짝수 Y전극간의 간격이 좁고, 조 내의 전극에 축적된 전자 또는 이온이 방전시에 인접하는 조의 전극으로 이동하는 것을 생각할 수 있다. 그 때문에 표시동작을 반복하면 전자와 이온(또는 전자만)은각각 패널의 양측(또는 한쪽 측)으로 이동하여, 거기서 축적되는 것으로 생각된다.
좌우간 ALIS 방식의 PDP에서 편필드 방식으로 동작시키면 상기와 같은 문제가 발생하였다. 이러한 문제는 ALIS 방식의 PDP로 인터레이스 주사를 행하는 경우에는 발생하지 않았다.
본 발명은 이러한 문제를 해결하는 것이며, ALIS 방식의 PDP로 플리커를 저감한 표시를 행한 경우에도, 정상적인 동작이 이루질 수 없게 되거나, 패널을 파괴하는 것과 같은 이상 방전이 발생하지 않는 플라즈마 디스플레이 패널의 구동방법 및 플라즈마 디스플레이 장치의 실현을 목적으로 한다.
도1은 양측 전극 사이의 방전을 이용하는 방식(ALIS 방식)의 PDP를 설명하는 도면.
도2는 ALIS 방식에서의 표시를 나타낸 도면.
도3은 ALIS 방식의 동작원리를 나타낸 도면.
도4는 ALIS 방식의 PDP의 구동회로를 나타낸 도면.
도5는 ALIS 방식의 구동파형(홀수 필드)을 나타낸 도면.
도6은 ALIS 방식의 구동파형(짝수 필드)을 나타낸 도면.
도7은 ALIS 방식으로 서브 필드법을 행하는 경우의 구동 시퀀스를 나타낸 도면.
도8은 한쪽 표시 라인만을 사용하는 방식(편필드 방식(one-sided field method))의 표시를 나타낸 도면.
도9는 편필드 방식에 의한 문제를 설명하는 도면.
도10은 편필드 방식에 의한 문제의 예상되는 원인을 설명하는 도면.
도11은 본 발명의 원리구성을 나타낸 도면.
도12는 본 발명에서의 방전동작을 나타낸 도면.
도13은 본 발명의 실시예의 서브필드 구성을 나타낸 도면.
도14는 본 발명의 제1실시예의 표시 시퀀스를 나타낸 도면.
도15는 본 발명의 제2 실시예의 표시 시퀀스를 나타낸 도면.
※ 도면의 주요부분에 대한 부호의 설명 ※
15 … 제1 전극(Y전극)
15-O … 홀수 Y전극
15-E … 짝수 Y전극
16 … 제2 전극(X전극)
16-O … 홀수 X전극
16-E … 짝수 X전극
19 … 어드레스전극
21 … 제1 X서스테인 펄스 발생회로
22 … 제2 X서스테인 펄스 발생회로
23 … 스캔 드라이브
25 … 제1 Y서스테인 펄스 발생회로
26 … 제2 Y서스테인 펄스 발생회로
27 … 어드레스 드라이버
도11은 본 발명의 원리구성을 나타낸 도면이다.
도시한 바와 같이 본 발명의 플라즈마 디스플레이 패널의 구동방법 및 플라즈마 디스플레이 장치에서는, 1화면표시 필드를 구성하는 서브 필드 중, 몇 개(제1 군의 서브 필드)를 제1 표시 라인으로, 나머지(제2군의 서브 필드)를 제2 표시 라인에 의해 표시하고, 전체로서 1표시 필드가 얻어져서 계조 표시가 행하여진다. 환언하면 제1 표시 라인에 의해 표시되는 제1 군의 서브 필드만으로는 정상적인 계조 표시가 되지 않고, 또한 제2 표시 라인에 의해 표시되는 제2군의 서브 필드만으로는 정상적인 계조 표시가 되지 않는다.
본 발명에 의하면 1표시 필드는, 홀수 필드와 짝수 필드로 분할되지 않으므로, 분할된 경우에 비해서 2배의 주파수로 표시되기 때문에 플리커는 발생하지 않는다. 또한 실험으로 확인한 바는 상기의 전극의 조를 넘어서 강대한 방전이 발생하는 일이 없어졌다. 이것은 짧은 기간에 제1 및 제2 표시 라인에 의해 표시를 행하기 때문에, 전하는 편재하지 않는 것으로 생각된다.
제1 표시 라인에 의해 표시하는 서브 필드와 제2 표시 라인에 의해 표시하는 서브 필드를 어떻게 분할할 것인지에 대하여는 각종의 분할 방법을 생각할 수 있다. 예를 들면 복수의 서브 필드를 전반군과 후반군으로 분할하고, 전반군의 서브 필드는 제1 및 제2 표시 라인의 한쪽에 의해 표시하고, 후반군의 서브 필드는 다른 쪽에 의해 표시하는 것을 생각할 수 있다.
도12는 이 경우의 방전 상태를 나타낸 도면이다. 도시한 바와 같이 전반군의 서브 필드에서는 홀수 표시 라인에서 방전이 행하여져서, 각 조 내에서 전하가 이동하여 편재되지만, 후반군의 서브 필드에서는 짝수 표시 라인에서 방전이 행하여져서, 전하는 역방향으로 이동하기 때문에 전하의 편재는 생기지 않는다.
또 서브 필드 순으로 교호로 제1 및 제2 표시 라인에 의해 표시하는 것도 생각할 수 있다. 또한 절반 이상의 휘도가 큰 계조는, 제1 및 제2 표시 라인의 양쪽에 의해 표시하는 것을 생각할 수 있다.
또 일본 특개평9-311662호 공보에 개시되어 있는 바와 같이, 같은 휘도의 서브 필드를 복수 설치하는 경우에는, 같은 휘도의 서브 필드 중 몇 개는 제1 표시 라인으로, 나머지는 제2 표시 라인에 의해 표시한다.
실시예
이하 본 발명의 실시예를 설명하겠다. 여기서 설명하는 실시예의 PDP는 일본 특허 제2801893호에 개시된 바와 같은 ALIS 방식의 구조를 갖는 PDP이고, 구동회로도 동일한 것을 사용할 수 있으나, 표시 시퀀스만이 다르다. 따라서 ALIS 방식의 PDP의 구조 및 구동회로에 대한 설명은 생략하고, 표시 시퀀스에 대해서만 설명하겠다.
도13은 본 발명의 제1실시예 및 제2 실시예의 PDP장치의 서브필드 구성을 나타낸 도면이다. 이 서브필드 구성은 일본 특개평9-311662호 공보에 개시된 것과 같은 색 오류 윤곽의 발생을 억제하기 위한 구성이고, 도시한 바와 같이 서브 필드 SF1 ∼ SF10의 휘도비를 10 : 8 : 6 : 4 : 2 : 1 : 4 : 6 : 8 : 10으로 한다. 이들 서브 필드를 조합함으로써, 0에서 59계조까지 표현할 수 있고, 도면에서는 예로서 10계조에 대한 조합례를 나타내고 있다. 또 복수의 휘도비에 대하여 똑같은 휘도비인 서브 필드가 2개씩 존재하기 때문에, 같은 계조라도 서브 필드의 조합은 복수이고, 그의 조합을 바꾸는 경우도 있다.
도14는 본 발명의 제1실시예의 PDP장치의 표시 시퀀스를 나타낸 도면이다. 도시한 바와 같이 1표시 필드의 전반에서는 도13의 서브필드 구성 중의 SF1∼SF5를 표시하고, 후반에서는 SF6∼SF10을 표시한다. 도13의 서브필드 구성에서는 휘도비가 큰 서브 필드를 대칭으로 배치하고, 저계조를 표시하는 경우에는 중앙의 서브 필드가 선택되나, 고계조를 표시할 때에는 전반과 후반의 서브 필드가 선택된다. 따라서 극히 낮은 계조 이외에서는 전반과 후반의 서브 필드가 반드시 발광하도록 된다. 즉 제1 및 제2 표시 라인은 양쪽 모두 발광한다. 이에 의해서 전하의 편재는 생기지 않는다.
도15는 본 발명의 제2 실시예의 PDP장치의 표시 시퀀스를 나타낸 도면이다.도시한 바와 같이 홀수번째의 서브 필드(SF1, SF3, SF5, SF7, SF9)는 제1 표시 라인에 의해 표시되고, 짝수번째의 서브 필드(SF2, SF4, SF6, SF8, SF10)는 제2 표시 라인에 의해 표시된다. 이 경우, 같은 휘도비의 SF1과 SF10, SF9와 SF2, SF3과 SF8, 및 SF7과 SF4는, 각각 제1 표시 라인과 제2 표시 라인에 의해 표시된다. 따라서 전하의 편재는 생기지 않는다.
또 본 발명에 의하면 제1 표시 라인과 제2 표시 라인의 양쪽이 발광하기 때문에, 도8에 나타낸 편필드 방식에 비해서 표시가 원활하게 되는 등의 효과도 있다.
또 제1 표시 라인과 제2 표시 라인의 양쪽이 발광하기 때문에, 한쪽 표시 라인만을 사용한 경우에 비해서, 수명 연장을 도모할 수 있다.
이상 설명한 바와 같이 본 발명에 의하면, ALIS 방식의 PDP로 플리커를 저감한 표시를 행한 경우에도, 정상적인 동작이 이루어지지 않게 되거나, 패널을 파괴되는 것과 같은 이상 방전이 발생하지 않는다.
또 플리커가 없는 표시인 편필드 방식에 비해서, 화상이 원활하게 표시되어 패널의 수명 연장을 도모할 수 있다.

Claims (6)

  1. 복수의 제1 및 제2 전극을 교호로 인접하여 배치하고, 상기 제1 전극의 한쪽에 인접하는 상기 제2 전극으로 제1 표시 라인을 형성하고, 상기 제1 전극의 다른 쪽에 인접하는 상기 제2 전극으로 제2 표시 라인을 형성하고, 1화면의 표시필드를 계조 표시를 행하기 위한 1조의 서브 필드로 구성하고, 상기 1조의 서브 필드 중의 표시를 행하는 서브 필드를 조합함으로써 계조 표시를 행하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 1조의 서브 필드는 상기 제1 표시 라인에 의해 표시되는 서브 필드와, 상기 제2 표시 라인에 의해 표시되는 서브 필드를 구비하고, 각 서브 필드는 상기 제1 및 제2 표시 라인의 한쪽에 의해서만 표시되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제1항에 있어서,
    상기 1조의 서브 필드를 전반군과 후반군으로 분할하고, 전반군의 서브 필드는 상기 제1 및 제2 표시 라인의 한쪽에 의해 표시하고, 후반군의 서브 필드는 상기 제1 및 제2 표시 라인의 다른 쪽에 의해 표시하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제1항에 있어서,
    서브 필드 순으로 교호로 상기 제1 및 제2 표시 라인에 의해 표시하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제1항에 있어서,
    절반 이상의 휘도가 큰 계조는 상기 제1 및 제2 표시 라인의 양쪽에 의해 표시되는 서브 필드를 포함한 플라즈마 디스플레이 패널의 구동방법.
  5. 제1항에 있어서,
    상기 1조의 서브 필드는 같은 크기의 휘도를 갖는 적어도 2개의 서브 필드를 포함하고, 상기 적어도 2개의 서브 필드의 하나는 상기 제1 표시 라인에 의해 표시되고, 상기 적어도 2개의 서브 필드의 나머지는 상기 제2 표시 라인에 의해 표시되는 플라즈마 디스플레이 패널의 구동방법.
  6. 복수의 제1 및 제2 전극을 교호로 인접하여 배치하고, 상기 제1 전극의 한쪽에 인접하는 상기 제2 전극으로 제1 표시 라인을 형성하고, 상기 제1 전극의 다른 쪽에 인접하는 상기 제2 전극으로 제2 표시 라인을 형성하고, 1화면의 표시필드를 계조 표시를 행하기 위한 1조의 서브 필드로 구성하고, 상기 1조의 서브 필드 중 표시를 행하는 서브 필드를 조합함으로써 계조 표시를 행하는 플라즈마 디스플레이 장치에 있어서,
    상기 1조의 서브 필드는 상기 제1 표시 라인에 의해 표시되는 서브 필드와,상기 제2 표시 라인에 의해 표시되는 서브 필드를 구비하고, 각 서브 필드는 상기 제1 및 제2 표시 라인의 한쪽에 의해서만 표시되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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