KR20000011968A - 전자구성요소의제조방법 - Google Patents
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Abstract
전자 구성요소를 제작하는 방법은, 티타늄 또는 텅스텐으로 이루어진 하부 금속층(201, 202) 위에 땜납으로 이루어진 상부 금속층(502)을 배치하는 단계와, 에칭액, 에칭 혼합물의 온도를 제어하기 위한 첨가제, 및 상기 상부 층(502)의 재증착을 감소시키기 위한 다른 첨가제를 포함하는 에칭 혼합물(601)로 상기 상부 금속층(502)에 대해 상기 하부 금속층(201,202)을 선택적으로 에칭하는 단계를 포함한다.
Description
본 발명은 일반적으로 전자공학, 보다 상세하게는 전자 구성요소의 제조 방법에 관한 것이다.
티타늄과 텅스텐의 금속층은 전자 구성요소에서 장벽 층으로서 공통으로 사용된다. 특히, 반도체 구성요소는 금속 이온이 하부의 반도체 기판으로 확산되거나 오염시키기는 것을 방지하기 위하여 이들 장벽 층을 사용한다. 과산화수소는 28년 동안 이들 장벽 층을 에칭하기 위하여 사용되어 왔다. 과산화수소 에칭 공정에 많은 개선이 이루어져 왔다. 그러나, 에칭 공정은 여전히 특정 상황에서는 제어하기 힘들다.
따라서, 전자 구성요소를 제작하기 위한 금속 층 에칭의 개선된 방법에 대한 필요성이 존재한다.
도 1은 본 발명에 따른 전자 구성요소의 일부를 도시하는 실시예의 단면도.
도 2 내지 도 7은 본 발명에 따라 후속 제조 단계 이후의 전자 구성요소의 일부를 도시하는 실시예의 단면도.
<도면 주요 부분에 대한 부호의 설명>
100 : 전자 구성요소 101 : 기판
103 : 전도성 층 104 : 절연성 층
105,401 : 구멍 201,202,203 : 금속층
301 : 마스크 501,502 : 금속층
601 : 에칭액 혼합물
도시의 단순화와 명확성을 위하여, 도면에서의 부품은 필수적으로 동일 축적으로 도시되지는 않았고, 다른 도면에서의 동일한 참조 번호는 동일한 부품을 나타낸다.
도 1은 전자 구성요소(100)의 일부의 단면도를 도시한다. 구성요소(100)는 기판(101)을 포함한다. 기판(101)은 반도체 장치를 지지하는데, 상기 반도체 장치는 일반적으로 도 1에서 부품(102)으로 표시된다. 반도체 장치는 관련 기술분야에서 공지된 제조 기술을 사용하여 기판(101)에서 형성될 수 있다. 예컨대, 반도체 장치는 다이오드, 트랜지스터, 집적 회로 등이 될 수 있다. 기판(101)은 반도체 기판으로 이루어질 수 있고, 적절한 전기 배선과, 반도체 장치의 다른 부분의 차단을 위하여 위에 놓이는 전기 전도성 층과 전기 절연성 층을 포함할 수 있다. 기판(101)은 또한 다수의 반도체 장치를 포함하는 반도체 웨이퍼를 나타낼 수 있다.
기판(101)의 전기 전도성 층과 전기 절연성 층의 일부의 예는 층(103 및 104)를 각각 포함할 수 있다. 층(103)은 위에 놓이는 본딩 패드가 될 수 있고, 기판(101) 내의 반도체 장치에 전기적으로 연결된다. 층(104)은 위에 놓여 기판(101)을 보호하는 보호층, 반도체 장치 및 층(103)이 될 수 있다. 층(103)은 알루미늄(Al), 구리(Cu) 등으로 이루어질 수 있고, 층(104)은 이산화 실리콘, 질화 실리콘 등으로 이루어질 수 있다. 층(104)은 위에 놓여 층(103)의 중앙 부분을 노출시키는 구멍(105)을 갖는다. 구멍(105)은 해당 기술 분야에서 공지된 마스킹 및 에칭 공정에 의해 층(104) 내에서 형성될 수 있다.
도 2는 복합 금속층이 층(103 및 104)위에 제공된 후 구성요소(100)의 단면을 도시한다. 특히, 금속층(201)은 층(103)의 노출 부위와 접촉하기 위하여 구멍(105) 내에 배치되거나 증착된다. 그후 금속층(202)은 층(201)위에 배치되거나 증착되고, 금속층(203)은 층(202)위에 배치되거나 증착된다. 층(201 및 202)은 이후에 설명되는 이유 때문에 장벽 층인 것이 바람직하고, 층(203)은 후속 도금 단계를 위한 개시 층(seed layer)인 것이 바람직하다. 모든 층(201, 202 및 203)은 본래의 장소에서 각각 대략 70 nm, 대략 200 nm, 대략 500 nm의 두께로 순차적으로 스퍼터링될 수 있다. 한 예로서, 층(203)은 납땜이 가능한 금속, 바람직하게는 Cu로 구성될 수 있다. 부가적으로, 층(201)은 질화텅스텐 티타늄(TiWNx)으로 이루어지는 것이 바람직하고, 층(202)은 텅스텐 티타늄(TiW)으로 이루어지는 것이 바람직하다. 층(203)이 Cu로 이루어진 바람직한 실시예에 있어서, 층(201)의 TiWNx는 층(202)의 TiW보다 더 양호한 응력 완화와 더 양호한 확산 장벽 특성을 제공하기 때문에, 또한 층(203)의 Cu는 층(201)의 TiWNx보다는 층(202)의 TiW에 보다 더 잘 부착하기 때문에, 두 개의 장벽 층이 사용되는 것이 바람직하다. 층(201)의 TiWNx와 층(202)의 TiW는 서로 잘 부착된다.
도 3 및 도 4는 후속 제조 단계 이후 구성요소(100)의 단면을 도시한다. 도 3에 있어서, 마스크(301)는 층(201, 202 및 203) 위에 형성된다. 바람직한 실시예에 있어서, 마스크(301)는 포토레지스트로 이루어진다. 도 4에 있어서, 개구부(401)는 층(203)의 중앙 부위를 노출시키기 위하여 마스크(301) 내에 형성된다. 개구부(401)는 포토레지스터를 현상함으로써 쉽게 형성될 수 있다.
도 5는 후속 제조 단계 이후의 구성요소(100)의 단면을 도시한다. 금속층(501)은 층(203)과 접촉하기 위하여 마스크(301)의 구멍(401)에 배치되거나 증착되고, 금속층(502)은 층(501) 위에 배치되거나 증착된다. 층(501)은 관련 기술 분야에서 공지된 전기 도금 기술을 사용하여 층(203) 위에 도금될 수 있다. 유사하게, 층(502)은 관련 기술 분야에서 공지된 기술을 사용하여 층(501) 위에 도금될 수 있다. 층(501)은 마스크(301)의 두께보다 얇은 두께로 도금되는 것이 바람직하다. 한 예로서, 층(501)은 대략 9 내지 50 μm의 두께로 도금될 수 있고, 층(502)은 대략 25 내지 75μm의 두께로 마스크(301) 위에 도금될 수 있다. 층(501)은 층(201 및 202)과 다르지만 층(203)과는 유사한 재질로 이루어지는 것이 바람직하다. 층(502)은 주석(Sn)과 납(Pb)의 땜납으로 이루어지는 것이 바람직하다.
마스크(301)는 층(501 및 502)이 마스크(301)에 의해 덮이는 층(203)의 많은 부분 위에 도금되는 것을 방지한다. 그러므로, 층(501 및 502)은 마스크(301) 아래에 놓이는 층(201, 202 및 203)의 부분 위에는 존재하지 않는다. 층(501과 502)의 도금은 종래 기술의 스크린 인쇄 기술과 비교하여 더 적은 형상의 형성 즉 미세 피치 접촉 돌기를 가능케 한다.
도 6은 후속 제조 단계 이후 구성요소(100)의 단면을 도시한다. 먼저, 도 3, 도 4 및 도 5의 마스크(301)는 관련 기술 분야에서 공지된 기술을 사용하여 제거된다. 이후, 층(203)의 노출 부위는 관련 기술 분야에서 공지된 에칭 기술을 사용하여 제거된다.
이후, 층(203)의 제거된 부분 아래에 놓이는 층(201 및 202)의 부분은 에칭액 혼합물(601)을 사용하여 제거된다. 층(203, 501 및 502) 역시 층(201 및 202)의 에칭 도중에 혼합물(601)에 동시에 노출된다. 그러나, 혼합물(601)은 양호하게 층(203, 501 및 502) 위의 층(201 및 202)을 선택적으로 에칭한다. 이러한 에칭 단계는 혼합물(601)의 용액기(bath), 스프레이 등에서 이루어질 수 있다.
종래 기술에 있어서, 30 중량%의 과산화수소(H2O2)로만 이루어진 에칭액은 이러한 에칭 단계를 수행하기 위하여 사용된다. 그러나, 층(502)이 납(Pb)으로 구성되고, 층(501)이 Cu로 구성될 때, 이러한 종래 기술의 에칭액을 사용할 때 몇가지 문제점이 발생한다. 첫 번째로, 종래 기술의 에칭액 온도는, 층(501 및 502)의 Pb와 Cu에 각각 노출될 때, H2O2의 촉매 분해에 기인하여 급격하게 상승한다. 이러한 온도 상승은 층(201 및 202)의 에칭 속도를 제어가 불가능하게 상승시킨다. 두 번째로 층(201 및 202)의 부분은 층(502)으로부터 Pb의 재증착에 의해 덮인다. 이러한 재증착은 층(201 및 202)의 아래 놓이는 부분을 마스킹하고, 이들 부분의 에칭을 방지한다.
에칭액 혼합물(601)은 종래 기술의 에칭액과는 다르다. 혼합물(601)은 층(203, 501 및 502) 위의 층(201 및 202)을 선택적으로 에칭하기 위하여 H2O2의 습식 에칭액을 포함한다. 층(502)이 Pb로 이루어질 때, 혼합물(601)은 층(202) 위에 Pb의 재증착을 억제하기 위한 첨가제를 포함할 수 있다. 한 예로서, 이러한 첨가제는 에틸렌 디니트릴로 테트라아세틱산(EDTA : Ethylene Dinitrilo Tetraacetic acid)으로 구성될 수 있다. 순수한 EDTA가 혼합물(601) 내에서 사용될 수 있지만, 2수산화 EDTA 테트라소디움염(EDTA-Na4-2H2O)이 선호되는데, 이는 EDTA-Na4-2H2O가 EDTA보다 H2O2에서 용해가 잘 되기 때문이다. 2수산화 EDTA 디소디움염(EDTA-Na2-2H2O)은 혼합물(601)에서도 사용될 수 있는 EDTA의 다른 형태이지만, 층(501)이 Cu로 이루어져 있을 경우, EDTA-Na2-2H2O는 선호되지 않는데, 왜냐하면 순수한 EDTA 또는 EDTA-Na4-2H2O가 사용되는 경우와 비교하여 결과적으로 보다 더 높은 Cu 에칭 속도 때문이다. 이와 같은 더 높은 Cu 에칭 속도는 층(501 및 203)의 큰 언더컷(undercut)을 생성하고, 신뢰도와 다른 문제점을 야기할 수 있다. Pb의 재증착을 더 감소시키기 위하여, 층(502)은, 대략 층(502)의 50 중량%보다 낮은 Pb 함유물을 갖는 것이 바람직하다.
혼합물(601)은, 혼합물(601)의 온도를 안정화시키고, 층(201 및 202)의 에칭 도중 H2O2의 재증착을 감소시키기 위한 첨가제를 포함할 수도 있다. 한 예로서, 이러한 다른 첨가제는 1,2-디아미노 사이클로헥산 테트라아세틱산(1,2-Diamino Cyclohexane Tetraacetic Acid : DCTA)으로 이루어질 수 있는데, 이는 1,2-사이클로헥실렌디니트릴로 테트라아세틱산(1,2-cyclohexylenedinitrilo tetraacetic Acid)으로도 알려져 있다. DCTA의 특정 형태의 한 예로서 일수산화 DCTA(DCTA-H2O)가 혼합물(601) 내에서 사용될 수 있다.
관련 기술 분야에서 사용되는 바와 같이, "pH"는 용액 또는 혼합물의 산도 또는 염기도를 나타낸다. 1의 pH값은 극단적인 산 용액을 나타내고, 14의 pH값은 극단적인 염기 용액을 나타낸다. H2O2의 30 중량% 용액은 대략 4의 pH값을 갖는다. 층(201 및 202)의 가장 효율적이고 가장 안정한 에칭을 위하여, 혼합물(601)은 또한 대략 4의 pH값을 갖는 것이 바람직하다. 그러나, EDTA가 혼합물(601)에 첨가될 때, 혼합물(601)의 pH값은 증가할 수 있다. 더욱이, DCTA가 혼합물(601)에 첨가될 때, 혼합물(601)의 pH값은 감소한다. 그러므로, 혼합물(601)에 첨가되는 EDTA 및 DCTA의 양은 혼합물(601)의 pH값을 대략 4가 되게 하는 것이 바람직하다.
상술된 모든 표준의 균형을 맞추기 위하여, 대략 1 내지 30g의 DCTA와 대략 1 내지 50g의 EDTA가 H2O230 중량%의 대략 34ℓ에 첨가될 수 있다. 모든 표준을 최적화하는 양호한 실시예에 있어서, 혼합물(601)은 H2O230 중량%의 30ℓ에 대해 대략 6.8g의 EDTA, 대략 DCTA의 20.4g의 비율을 갖는다. 혼합물(601)은 동질의 용액인 것이 바람직하지만, 혼합물(601)은 에칭 공정 도중에 연속적으로 교반될 필요는 없다. 실제, 혼합물(601)은 혼합물(601)의 유용한 수명을 연장하기 위하여 에칭 공정 도중에 연속적으로 교반되지 않는 것이 바람직하다.
혼합물(601)의 에칭 속도를 증가시키기 위하여, 혼합물(601)은 상온 이상으로 가열된다. 특히, 혼합물(601)은 대략 60 내지 90℃까지 가열될 수 있다. 온도가 더 높을수록, 층(201 및 202)에 대한 더 높은 에칭 속도를 얻는다. 예컨대, 에칭 속도는 60℃와 비교하여 75℃에서의 에칭 속도가 두 배이다. 그러나, 혼합물(601)은 더 높은 온도에서 증발되고, 이는 혼합물(601)의 성분의 선호되는 비율과 혼합물(601)의 pH값을 저해한다. 혼합물(601)의 낮은 온도는 에칭 속도를 떨어뜨리고, 더 긴 에칭 시간을 필요로 하는데, 이는 에칭 공정의 처리량을 감소시킨다. 혼합물(601)의 낮은 온도는 또한 혼합물(601)에 대한 층(502)의 노출을 증가시키고, 증가된 노출은 층(502)가 Sn과 Pb로 이루어졌을 때 층(502)을 산화시킨다. 일부 경우에 있어서, 층(502)의 이러한 산화는 후속하는 땜납의 용제 단계동안 제거될 수 있지만, 층(502)의 산화는 최소로 유지되는 것이 바람직하다. 이들 계수를 최적화하면서, 혼합물(601)은 분당 대략 23 nm의 TiWNx/TiW 에칭 속도를 얻기 위하여 대략 70℃에서 사용되는 것이 바람직한데, 상기 에칭 속도는 층(203, 501 및 502)에 대한 에칭 속도보다는 실질적으로 상당히 높은 것이다.
도 7은 층(502)을 역류시킨 후 구성요소(100)의 단면을 도시한다. 이러한 역류 단계는 층(502)을 대략 8 내지 200 μm의 직경을 갖는 구형 대상으로 그 형태를 다시 취하게 한다. 층(502)의 이러한 곡면의 형태는 기판 또는 장치의 리드프레임 그리드 배열 등에 대한 접속을 용이하게 한다. 층(502)은 예컨대 60% Sn과 40%의 Pb와 같은 낮은 온도의 땜납으로 이루어지는 것이 바람직하다. 낮은 온도의 땜납은 리드프레임 위에서 기판 또는 장치의 조립을 용이하게 한다.
그러므로, 전자 구성요소를 제작하는 개선된 방법은 종래 기술의 단점을 극복하기 위하여 제공된다. 이러한 방법은 적은 형상의 접촉 돌기의 구성을 가능케 하는데, 이러한 돌기는 종래 기술의 스크린 프린팅 기술에 의해 제작될 수 없다. 여기에서 개시된 에칭 방법은 H2O2의 분해를 감소시키고, 에칭액 혼합물의 온도를 제어하거나 유지하고, Pb의 재증착과 전체 금속화 스택의 언더컷 모두를 억압, 최소화 또는 감소시킨다.
본 발명이 주로 양호한 실시예를 참조하여 특별히 도시되고 기술되었지만, 당업자라면 형태와 상세 사항에서의 변화가 본 발명의 사상과 범주를 벗어남이 없이 이루어질 수 있음을 이해할 수 있을 것이다. 예컨대, 특정 화학 조성 및 특정 화학 비율과 같이 여기에서 설명된 상세한 숫치는 예컨대 본 발명의 이해를 돕기 위하여 제공되었고, 본 발명의 범주를 제한하려고 제공된 것은 아니다. 다른 예로서, 혼합물(601)의 EDTA 및 DCTA는 EDTA와 DCTA의 것과 유사한 특성을 갖는 다른 합성물 또는 키일레이트제로 대체될 수 있다. 더욱이, 혼합물(601)은 H2O2와 DCTA만으로 이루어질 수 있고, H2O2와 EDTA만으로 이루어질 수 있다. 또한 30 중량%와는 다른 H2O2의 농도가 혼합물(601) 내에서 사용될 수 있다. 따라서, 본 발명의 설명은 제한하려는 것은 아니다. 대신에 본 발명의 설명은 본 발명의 범주를 설명하기 위한 것이고, 본 발명의 범주는 다음의 청구범위에서 설명된다.
Claims (5)
- 전자 구성요소를 제작하는 방법에 있어서,금속층을 에칭하기 위하여, 과산화수소와 1,2-사이클로헥실렌디니트릴로 테트라아세틱산(1,2-cyclohexylenedinitrilo tetraacetic Acid)을 포함하는 혼합물을 사용하는 단계를 포함하는 전자 구성요소를 제작하는 방법.
- 제 1항에 있어서, 상기 혼합물을 사용하는 단계는, 에틸렌 디니트릴로 테트라아세틱산을 포함하는 혼합물을 제공하는 단계를 더 포함하는 전자 구성요소를 제작하는 방법.
- 제 1항에 있어서, 상기 혼합물을 사용하는 단계는, 에틸렌 디니트릴로 테트라아세틱산을 위해 2수산화 에틸렌 디니트릴로 테트라아세틱산 테트라소디움염을 준비하는 단계를 더 포함하는 전자 구성요소를 제작하는 방법.
- 제 1항에 있어서, 상기 혼합물을 사용하는 단계는, 1,2-사이클로헥실렌디니트릴로 테트라아세틱산을 위해 일산화 1,2-사이클로헥실렌디니트릴로 테트라아세틱산을 준비하는 단계를 더 포함하는 전자 구성요소를 제작하는 방법.
- 전자 구성요소를 제작하는 방법에 있어서,제 1 금속층을 제공하는 단계와,상기 제 1 금속층 위에 놓이는 제 2 금속층을 배치하는 단계로서, 상기 제 2 금속층은 상기 제 1 금속층과는 다르고, 상기 제 2 금속층은 제 1 금속층의 일부 위에서는 존재하지 않는, 제 2 금속층을 배치하는 단계와,상기 제 2 금속층 위의 상기 제 1 금속층을 선택적으로 에칭하기 위하여 에칭액 혼합물에 상기 제 1 및 제 2 금속층을 동시에 노출시키는 단계로서, 상기 에칭액 혼합물은 에칭액, 상기 에칭 혼합물의 온도를 제어하기 위한 제 1 첨가제, 및 상기 제 2 금속층의 재증착을 감소시키기 위한 제 2 첨가제를 포함하는, 제 1 및 제 2 금속층을 동시에 노출시키는 단계를 포함하는 전자 구성요소를 제작하는 방법.
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