KR102623770B1 - 성막 방법 - Google Patents
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- 238000000034 method Methods 0.000 title claims abstract description 262
- 238000012545 processing Methods 0.000 claims abstract description 334
- 230000008569 process Effects 0.000 claims abstract description 180
- 238000004140 cleaning Methods 0.000 claims abstract description 65
- 239000000758 substrate Substances 0.000 claims abstract description 53
- 230000002829 reductive effect Effects 0.000 claims abstract description 12
- 230000008021 deposition Effects 0.000 claims abstract description 11
- 239000007789 gas Substances 0.000 claims description 581
- 239000002243 precursor Substances 0.000 claims description 70
- 125000001424 substituent group Chemical group 0.000 claims description 46
- 239000000463 material Substances 0.000 claims description 45
- FZHAPNGMFPVSLP-UHFFFAOYSA-N silanamine Chemical compound [SiH3]N FZHAPNGMFPVSLP-UHFFFAOYSA-N 0.000 claims description 37
- -1 tungsten halide Chemical class 0.000 claims description 37
- 239000001301 oxygen Substances 0.000 claims description 18
- 229910052760 oxygen Inorganic materials 0.000 claims description 18
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical group [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 claims description 17
- QVGXLLKOCUKJST-UHFFFAOYSA-N atomic oxygen Chemical compound [O] QVGXLLKOCUKJST-UHFFFAOYSA-N 0.000 claims description 16
- 125000003277 amino group Chemical group 0.000 claims description 15
- IJGRMHOSHXDMSA-UHFFFAOYSA-N Atomic nitrogen Chemical compound N#N IJGRMHOSHXDMSA-UHFFFAOYSA-N 0.000 claims description 14
- 238000000151 deposition Methods 0.000 claims description 12
- 238000006116 polymerization reaction Methods 0.000 claims description 10
- 239000012948 isocyanate Substances 0.000 claims description 8
- 150000002513 isocyanates Chemical class 0.000 claims description 6
- 229910052721 tungsten Inorganic materials 0.000 claims description 5
- 229910052796 boron Inorganic materials 0.000 claims description 4
- 150000001875 compounds Chemical class 0.000 claims description 4
- 125000002887 hydroxy group Chemical group [H]O* 0.000 claims description 4
- 239000010937 tungsten Substances 0.000 claims description 4
- 150000001412 amines Chemical class 0.000 claims description 3
- 150000002366 halogen compounds Chemical class 0.000 claims description 3
- 229910052757 nitrogen Inorganic materials 0.000 claims description 3
- XJDNKRIXUMDJCW-UHFFFAOYSA-J titanium tetrachloride Chemical compound Cl[Ti](Cl)(Cl)Cl XJDNKRIXUMDJCW-UHFFFAOYSA-J 0.000 claims description 3
- 230000015572 biosynthetic process Effects 0.000 abstract description 39
- 238000005516 engineering process Methods 0.000 abstract description 5
- 238000009832 plasma treatment Methods 0.000 abstract description 4
- 239000010408 film Substances 0.000 description 162
- 239000010409 thin film Substances 0.000 description 98
- 239000010410 layer Substances 0.000 description 83
- 238000005530 etching Methods 0.000 description 45
- 238000000231 atomic layer deposition Methods 0.000 description 44
- 238000010586 diagram Methods 0.000 description 36
- 230000001681 protective effect Effects 0.000 description 30
- 238000001179 sorption measurement Methods 0.000 description 29
- 238000010926 purge Methods 0.000 description 24
- 150000002500 ions Chemical class 0.000 description 21
- 239000012044 organic layer Substances 0.000 description 21
- 230000036961 partial effect Effects 0.000 description 16
- 239000011261 inert gas Substances 0.000 description 15
- 229910052710 silicon Inorganic materials 0.000 description 13
- 239000010703 silicon Substances 0.000 description 13
- 229910052731 fluorine Inorganic materials 0.000 description 11
- NBVXSUQYWXRMNV-UHFFFAOYSA-N fluoromethane Chemical compound FC NBVXSUQYWXRMNV-UHFFFAOYSA-N 0.000 description 11
- 239000003507 refrigerant Substances 0.000 description 11
- VYPSYNLAJGMNEJ-UHFFFAOYSA-N silicon dioxide Inorganic materials O=[Si]=O VYPSYNLAJGMNEJ-UHFFFAOYSA-N 0.000 description 10
- 239000000126 substance Substances 0.000 description 10
- 239000011737 fluorine Substances 0.000 description 9
- UFHFLCQGNIYNRP-UHFFFAOYSA-N Hydrogen Chemical compound [H][H] UFHFLCQGNIYNRP-UHFFFAOYSA-N 0.000 description 8
- 125000004429 atom Chemical group 0.000 description 8
- 230000008859 change Effects 0.000 description 8
- 229910001873 dinitrogen Inorganic materials 0.000 description 8
- 238000010438 heat treatment Methods 0.000 description 8
- 229910052814 silicon oxide Inorganic materials 0.000 description 8
- 238000006243 chemical reaction Methods 0.000 description 7
- 239000001257 hydrogen Substances 0.000 description 7
- 229910052739 hydrogen Inorganic materials 0.000 description 7
- 230000002265 prevention Effects 0.000 description 7
- 238000009792 diffusion process Methods 0.000 description 6
- YCKRFDGAMUMZLT-UHFFFAOYSA-N Fluorine atom Chemical compound [F] YCKRFDGAMUMZLT-UHFFFAOYSA-N 0.000 description 5
- 229910052782 aluminium Inorganic materials 0.000 description 5
- XAGFODPZIPBFFR-UHFFFAOYSA-N aluminium Chemical compound [Al] XAGFODPZIPBFFR-UHFFFAOYSA-N 0.000 description 5
- 230000007423 decrease Effects 0.000 description 5
- 238000001514 detection method Methods 0.000 description 5
- 238000011144 upstream manufacturing Methods 0.000 description 5
- QGZKDVFQNNGYKY-UHFFFAOYSA-N Ammonia Chemical compound N QGZKDVFQNNGYKY-UHFFFAOYSA-N 0.000 description 4
- MYMOFIZGZYHOMD-UHFFFAOYSA-N Dioxygen Chemical compound O=O MYMOFIZGZYHOMD-UHFFFAOYSA-N 0.000 description 4
- 150000001723 carbon free-radicals Chemical class 0.000 description 4
- 229910001882 dioxygen Inorganic materials 0.000 description 4
- 230000006870 function Effects 0.000 description 4
- 239000010453 quartz Substances 0.000 description 4
- 150000003254 radicals Chemical class 0.000 description 4
- 238000007789 sealing Methods 0.000 description 4
- 238000003860 storage Methods 0.000 description 4
- 230000015556 catabolic process Effects 0.000 description 3
- 238000004590 computer program Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 3
- 229910052736 halogen Inorganic materials 0.000 description 3
- 150000002367 halogens Chemical group 0.000 description 3
- 239000011810 insulating material Substances 0.000 description 3
- 229920000877 Melamine resin Polymers 0.000 description 2
- 229910004298 SiO 2 Inorganic materials 0.000 description 2
- 229920001807 Urea-formaldehyde Polymers 0.000 description 2
- 229910021529 ammonia Inorganic materials 0.000 description 2
- 125000000484 butyl group Chemical group [H]C([*])([H])C([H])([H])C([H])([H])C([H])([H])[H] 0.000 description 2
- 238000004364 calculation method Methods 0.000 description 2
- 239000000919 ceramic Substances 0.000 description 2
- 239000007795 chemical reaction product Substances 0.000 description 2
- 238000012937 correction Methods 0.000 description 2
- 125000001495 ethyl group Chemical group [H]C([H])([H])C([H])([H])* 0.000 description 2
- 230000009477 glass transition Effects 0.000 description 2
- 125000004435 hydrogen atom Chemical group [H]* 0.000 description 2
- 230000007246 mechanism Effects 0.000 description 2
- 125000002496 methyl group Chemical group [H]C([H])([H])* 0.000 description 2
- 238000012986 modification Methods 0.000 description 2
- 230000004048 modification Effects 0.000 description 2
- 125000004433 nitrogen atom Chemical group N* 0.000 description 2
- 125000004430 oxygen atom Chemical group O* 0.000 description 2
- 238000001020 plasma etching Methods 0.000 description 2
- 239000000047 product Substances 0.000 description 2
- 125000001436 propyl group Chemical group [H]C([*])([H])C([H])([H])C([H])([H])[H] 0.000 description 2
- 239000002356 single layer Substances 0.000 description 2
- 239000010936 titanium Substances 0.000 description 2
- 238000012546 transfer Methods 0.000 description 2
- XLYOFNOQVPJJNP-UHFFFAOYSA-N water Substances O XLYOFNOQVPJJNP-UHFFFAOYSA-N 0.000 description 2
- VXEGSRKPIUDPQT-UHFFFAOYSA-N 4-[4-(4-methoxyphenyl)piperazin-1-yl]aniline Chemical compound C1=CC(OC)=CC=C1N1CCN(C=2C=CC(N)=CC=2)CC1 VXEGSRKPIUDPQT-UHFFFAOYSA-N 0.000 description 1
- 102100020970 ATP-binding cassette sub-family D member 2 Human genes 0.000 description 1
- 229930185605 Bisphenol Natural products 0.000 description 1
- ZOXJGFHDIHLPTG-UHFFFAOYSA-N Boron Chemical compound [B] ZOXJGFHDIHLPTG-UHFFFAOYSA-N 0.000 description 1
- OKTJSMMVPCPJKN-UHFFFAOYSA-N Carbon Chemical compound [C] OKTJSMMVPCPJKN-UHFFFAOYSA-N 0.000 description 1
- 239000004593 Epoxy Substances 0.000 description 1
- 101100321983 Homo sapiens ABCD2 gene Proteins 0.000 description 1
- 239000004640 Melamine resin Substances 0.000 description 1
- 101100055268 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) ALD3 gene Proteins 0.000 description 1
- 101100055273 Saccharomyces cerevisiae (strain ATCC 204508 / S288c) ALD5 gene Proteins 0.000 description 1
- 229910018557 Si O Inorganic materials 0.000 description 1
- 229910003902 SiCl 4 Inorganic materials 0.000 description 1
- BLRPTPMANUNPDV-UHFFFAOYSA-N Silane Chemical compound [SiH4] BLRPTPMANUNPDV-UHFFFAOYSA-N 0.000 description 1
- ATJFFYVFTNAWJD-UHFFFAOYSA-N Tin Chemical compound [Sn] ATJFFYVFTNAWJD-UHFFFAOYSA-N 0.000 description 1
- RTAQQCXQSZGOHL-UHFFFAOYSA-N Titanium Chemical compound [Ti] RTAQQCXQSZGOHL-UHFFFAOYSA-N 0.000 description 1
- POJUHYOPQSSOFP-UHFFFAOYSA-N [SiH4].N[SiH3] Chemical compound [SiH4].N[SiH3] POJUHYOPQSSOFP-UHFFFAOYSA-N 0.000 description 1
- 230000002159 abnormal effect Effects 0.000 description 1
- 150000008065 acid anhydrides Chemical class 0.000 description 1
- 239000000654 additive Substances 0.000 description 1
- 230000000996 additive effect Effects 0.000 description 1
- 101150063578 ald1 gene Proteins 0.000 description 1
- 101150023727 ald2 gene Proteins 0.000 description 1
- 238000013459 approach Methods 0.000 description 1
- 239000008280 blood Substances 0.000 description 1
- 210000004369 blood Anatomy 0.000 description 1
- 239000006227 byproduct Substances 0.000 description 1
- 229910052799 carbon Inorganic materials 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 239000000470 constituent Substances 0.000 description 1
- 239000002826 coolant Substances 0.000 description 1
- 230000003247 decreasing effect Effects 0.000 description 1
- KSFBTBXTZDJOHO-UHFFFAOYSA-N diaminosilicon Chemical compound N[Si]N KSFBTBXTZDJOHO-UHFFFAOYSA-N 0.000 description 1
- PZPGRFITIJYNEJ-UHFFFAOYSA-N disilane Chemical compound [SiH3][SiH3] PZPGRFITIJYNEJ-UHFFFAOYSA-N 0.000 description 1
- 238000009826 distribution Methods 0.000 description 1
- 230000007613 environmental effect Effects 0.000 description 1
- 239000003822 epoxy resin Substances 0.000 description 1
- 125000001153 fluoro group Chemical group F* 0.000 description 1
- 150000002431 hydrogen Chemical class 0.000 description 1
- 230000010354 integration Effects 0.000 description 1
- 230000001678 irradiating effect Effects 0.000 description 1
- 239000007769 metal material Substances 0.000 description 1
- 229910052756 noble gas Inorganic materials 0.000 description 1
- 150000002835 noble gases Chemical group 0.000 description 1
- 150000002894 organic compounds Chemical class 0.000 description 1
- 150000002926 oxygen Chemical class 0.000 description 1
- 239000002245 particle Substances 0.000 description 1
- 238000000059 patterning Methods 0.000 description 1
- 239000005011 phenolic resin Substances 0.000 description 1
- 150000002989 phenols Chemical class 0.000 description 1
- 238000000206 photolithography Methods 0.000 description 1
- 229920006122 polyamide resin Polymers 0.000 description 1
- 229920005668 polycarbonate resin Polymers 0.000 description 1
- 239000004431 polycarbonate resin Substances 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920000647 polyepoxide Polymers 0.000 description 1
- 229920001225 polyester resin Polymers 0.000 description 1
- 239000004645 polyester resin Substances 0.000 description 1
- 229920005749 polyurethane resin Polymers 0.000 description 1
- 238000002360 preparation method Methods 0.000 description 1
- 230000009257 reactivity Effects 0.000 description 1
- 238000002407 reforming Methods 0.000 description 1
- 230000002441 reversible effect Effects 0.000 description 1
- 229920006395 saturated elastomer Polymers 0.000 description 1
- 229910000077 silane Inorganic materials 0.000 description 1
- LIVNPJMFVYWSIS-UHFFFAOYSA-N silicon monoxide Inorganic materials [Si-]#[O+] LIVNPJMFVYWSIS-UHFFFAOYSA-N 0.000 description 1
- 239000005049 silicon tetrachloride Substances 0.000 description 1
- 238000012719 thermal polymerization Methods 0.000 description 1
- 229910052719 titanium Inorganic materials 0.000 description 1
- AZDRQVAHHNSJOQ-XCIZNGPVSA-N trideuterioalumane Chemical compound [2H][Al]([2H])[2H] AZDRQVAHHNSJOQ-XCIZNGPVSA-N 0.000 description 1
- VEDJZFSRVVQBIL-UHFFFAOYSA-N trisilane Chemical compound [SiH3][SiH2][SiH3] VEDJZFSRVVQBIL-UHFFFAOYSA-N 0.000 description 1
- WFKWXMTUELFFGS-UHFFFAOYSA-N tungsten Chemical compound [W] WFKWXMTUELFFGS-UHFFFAOYSA-N 0.000 description 1
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- H—ELECTRICITY
- H01—ELECTRIC ELEMENTS
- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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- H01L21/02107—Forming insulating materials on a substrate
- H01L21/02225—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer
- H01L21/0226—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
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- H01L21/0226—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process
- H01L21/02263—Forming insulating materials on a substrate characterised by the process for the formation of the insulating layer formation by a deposition process deposition from the gas or vapour phase
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- C23—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
- C23C—COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
- C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
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- C23C16/30—Deposition of compounds, mixtures or solid solutions, e.g. borides, carbides, nitrides
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- C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
- C23C16/44—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
- C23C16/455—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
- C23C16/45523—Pulsed gas flow or change of composition over time
- C23C16/45525—Atomic layer deposition [ALD]
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- C23C16/00—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
- C23C16/44—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
- C23C16/455—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for introducing gases into reaction chamber or for modifying gas flows in reaction chamber
- C23C16/45523—Pulsed gas flow or change of composition over time
- C23C16/45525—Atomic layer deposition [ALD]
- C23C16/45527—Atomic layer deposition [ALD] characterized by the ALD cycle, e.g. different flows or temperatures during half-reactions, unusual pulsing sequence, use of precursor mixtures or auxiliary reactants or activations
- C23C16/45536—Use of plasma, radiation or electromagnetic fields
- C23C16/4554—Plasma being used non-continuously in between ALD reactions
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- C23C16/44—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
- C23C16/458—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for supporting substrates in the reaction chamber
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- C23C16/458—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for supporting substrates in the reaction chamber
- C23C16/4582—Rigid and flat substrates, e.g. plates or discs
- C23C16/4583—Rigid and flat substrates, e.g. plates or discs the substrate being supported substantially horizontally
- C23C16/4586—Elements in the interior of the support, e.g. electrodes, heating or cooling devices
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- C23C16/44—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
- C23C16/46—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating characterised by the method used for heating the substrate
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- C23C16/44—Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
- C23C16/52—Controlling or regulating the coating process
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- H01L21/02123—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon
- H01L21/0217—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing silicon the material being a silicon nitride not containing oxygen, e.g. SixNy or SixByNz
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- H01L21/02172—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides
- H01L21/02175—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates characterised by the material of the layer the material containing at least one metal element, e.g. metal oxides, metal nitrides, metal oxynitrides or metal carbides characterised by the metal
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- H01L21/02205—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition
- H01L21/02208—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si
- H01L21/02219—Forming insulating materials on a substrate characterised by the type of layer, e.g. type of material, porous/non-porous, pre-cursors, mixtures or laminates the layer being characterised by the precursor material for deposition the precursor containing a compound comprising Si the compound comprising silicon and nitrogen
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- H01L21/00—Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
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Abstract
[과제] 성막을 행하는 플라즈마 처리의 진행 정도에 상관없이 피처리 기판에 대한 막의 형성 양태를 균일하게 할 수 있는 기술을 제공한다.
[해결수단] 일 실시형태에 따른 방법은, 피처리 기판 상에 형성된 패턴에 성막하는 성막 방법으로서, 피처리 기판은 감압 환경 하에서 플라즈마 처리 가능한 공간에 마련된 배치대에 배치되고, 공간에는 배치대에 대향하고 있으며 고주파 전력의 공급이 가능한 상부 전극이 배치된다. 이 방법은, 피처리 기판의 주면의 복수의 영역마다 피처리 기판의 주면의 온도를 조절하는 공정을 실행한 후에, 피처리 기판의 패턴에 퇴적막을 형성하는 제1 공정과, 전력을 상부 전극에만 공급하여 공간에 플라즈마를 발생시킴으로써 공간을 클리닝하는 제2 공정을 구비하는 시퀀스를 반복하여 실행한다.
[해결수단] 일 실시형태에 따른 방법은, 피처리 기판 상에 형성된 패턴에 성막하는 성막 방법으로서, 피처리 기판은 감압 환경 하에서 플라즈마 처리 가능한 공간에 마련된 배치대에 배치되고, 공간에는 배치대에 대향하고 있으며 고주파 전력의 공급이 가능한 상부 전극이 배치된다. 이 방법은, 피처리 기판의 주면의 복수의 영역마다 피처리 기판의 주면의 온도를 조절하는 공정을 실행한 후에, 피처리 기판의 패턴에 퇴적막을 형성하는 제1 공정과, 전력을 상부 전극에만 공급하여 공간에 플라즈마를 발생시킴으로써 공간을 클리닝하는 제2 공정을 구비하는 시퀀스를 반복하여 실행한다.
Description
본 발명의 실시형태는 성막 방법에 관한 것이다.
전자 디바이스의 고집적화에 동반된 미세화에 따라, 피처리 기판 상의 패턴 형성에 있어서, 고정밀도의 최소 선폭(CD: Critical Dimension)의 제어가 요구된다. 플라즈마 에칭에 있어서의 최소 선폭의 변동 요인으로서는, 일반적으로 플라즈마가 생성되는 처리 공간에 노출되는 플라즈마 처리 장치의 구성 부품(예컨대, 플라즈마를 발생시키는 처리 용기의 내벽면이나, 처리 용기에 접속되는 각종 배관의 내벽면 등)의 표면 상태가 변화하는 것을 들 수 있다. 이러한 플라즈마 처리 장치의 구성 부품의 표면 상태 변화에 대응하는 기술이 여러 가지 개발되어 있다(예컨대 특허문헌 1∼3을 참조).
플라즈마 처리에 있어서는, 처리 용기(챔버) 내의 환경이 플라즈마 처리의 진행에 따라서 변화되고, 그 환경 변화에 기인하여, 피처리 기판(웨이퍼)에 대한 플라즈마 처리의 효과도 변화할 수 있다. 예컨대, 피처리 기판에 성막을 행하는 경우에는, 피처리 기판에 대하여 막이 형성될 뿐만 아니라, 처리 용기의 내벽면에 대하여도 막이 형성되는 경우가 있다. 성막을 행하는 플라즈마 처리의 진행에 동반하여 처리 용기의 내벽면에 막이 형성됨에 따라서, 막의 형성에 이용되는 가스 중 내벽면에 흡착되는 부분이 차지하는 비율도 변화되고, 이 변화에 따라, 상기 가스 중 피처리 기판에 도달할 수 있는 부분이 차지하는 비율도 변화할 수 있기 때문에, 플라즈마 처리의 진행에 따라 피처리 기판에 대한 막의 형성 양태도 변화할 수 있다. 따라서, 성막을 행하는 플라즈마 처리의 진행 정도에 상관없이 피처리 기판에 대한 막의 형성 양태를 균일하게 할 수 있는 기술이 요구되고 있다.
일 양태에서는, 피처리 기판 상에 형성된 패턴에 성막하는 성막 방법이 제공된다. 피처리 기판은 감압 환경 하에서 플라즈마 처리 가능한 공간에 마련된 배치대에 배치되고, 공간에는 배치대에 대향하고 있으며 고주파 전력의 공급이 가능한 상부 전극이 배치된다. 이 방법은, 피처리 기판 주면의 복수의 영역마다 피처리 기판의 주면 온도를 조절하는 공정을 실행한 후에, 피처리 기판의 패턴에 퇴적막을 형성하는 제1 공정과 전력을 상부 전극에만 공급하여 공간에 플라즈마를 발생시킴으로써 공간을 클리닝하는 제2 공정을 구비하는 시퀀스를 반복하여 실행한다.
피처리 기판 주면의 온도에 의해서 주면에 형성되는 막의 두께는 변화할 수 있다. 그러나, 클리닝이 이루어지지 않고서 퇴적막의 형성이 반복되는 경우에는, 퇴적막의 형성이 반복되는 중에 피처리 기판 주면의 온도에 따른 막 두께의 변화 정도가 저감되고, 이로써, 피처리 기판 주면의 온도를 유효하게 조절할 수 없는 경우가 생길 수 있다. 이에 대하여, 상기 성막 방법에서는, 피처리 기판의 주면이 온도 조절된 후에 퇴적막의 형성이 이뤄지는데, 퇴적막의 형성이 행해질 때마다 클리닝도 행해지기 때문에, 퇴적막의 형성이 반복되더라도, 피처리 기판 주면의 온도 조절은, 피처리 기판 주면에 있어서의 퇴적막의 두께 제어에 있어서 충분히 유효하게 기능할 수 있다.
일 실시형태에서는, 온도 조절 공정은, 주면의 온도와 퇴적막의 막 두께의 대응을 나타내는 미리 취득된 대응 데이터를 이용하여, 복수의 영역마다 주면의 온도를 조절한다. 이와 같이, 미리 취득된 대응 데이터가 이용되기 때문에, 피처리 기판 주면의 온도 조절이 보다 정확하고 재현성 좋게 실행될 수 있다.
일 실시형태에서는, 제1 공정은, 전구체의 재료를 포함하는 제1 가스를 공간에 공급하여, 전구체를 패턴의 표면에 흡착시키는 공정과, 제2 가스의 플라즈마를 발생시켜, 플라즈마를 전구체에 공급하는 공정을 구비한다. 이와 같이, 퇴적막을 형성하는 제1 공정에서는, 우선 전구체의 재료를 포함하는 제1 가스에 의해서 피처리 기판의 패턴의 표면에 전구체를 흡착시키고, 이후에 상기 전구체에 대하여 제2 가스의 플라즈마를 공급함으로써, 피처리 기판의 패턴의 표면에 퇴적막을 형성한다. 따라서, ALD법(ALD: Atomic Layer Deposition)과 같은 방법에 의해서 피처리 기판의 패턴의 표면에 퇴적막을 형성할 수 있다.
일 실시형태에서는, 상기 제1 가스는 아미노실란계 가스이고, 제2 가스는 산소 또는 질소를 함유한다. 또한, 제2 공정에서는, 공간에 제3 가스의 플라즈마를 발생시키고, 제3 가스는 할로겐 화합물을 함유한다.
일 실시형태에서는, 제1 가스인 아미노실란계 가스는 1∼3개의 규소 원자를 갖는 아미노실란을 포함한다. 또한, 일 실시형태에서는, 제1 가스인 아미노실란계 가스는 1∼3개의 아미노기를 갖는 아미노실란을 포함할 수 있다.
일 실시형태에서는 제1 가스는 할로겐화텅스텐을 함유한다. 또한, 일 실시형태에서는 제1 가스는 사염화티탄 또는 테트라키스디메틸아미노티탄을 함유한다. 또한, 일 실시형태에서는 제1 가스는 할로겐화붕소를 함유한다.
일 실시형태에서는, 제1 공정(이하, 공정(a)이라고 한다)은, 전자 공여성의 제1 치환기를 포함하는 제1 가스(이하, 공정(a)에서 이용되는 경우에는 가스(a1)라고 한다)를 공간에 공급하여 제1 치환기를 패턴의 표면에 흡착시키는 공정과, 전자 흡인성의 제2 치환기를 포함하는 제2 가스(이하, 공정(a)에서 이용되는 경우에는 가스(a2)라고 한다)를 제1 치환기에 공급하는 공정을 구비한다. 이와 같이, 퇴적막을 형성하는 공정(a)에서는, 우선 전자 공여성의 제1 치환기를 포함하는 가스(a1)에 의해서 피처리 기판의 패턴의 표면에 제1 치환기를 흡착시키고, 이후에 상기 제1 치환기에 대하여 전자 흡인성의 제2 치환기를 포함하는 가스(a2)를 공급함으로써 중합 반응을 생성하고, 이 중합 반응에 의해서 피처리 기판의 패턴의 표면에 퇴적막이 형성될 수 있다.
일 실시형태에서는, 상기한 공정(a)은 이소시아네이트와 아민과의 중합 반응, 또는 이소시아네이트와 수산기를 갖는 화합물과의 중합 반응에 의해서 퇴적막을 형성한다.
이상 설명한 것과 같이, 성막을 행하는 플라즈마 처리의 진행 정도에 상관없이 피처리 기판에 대한 막의 형성 양태를 균일하게 할 수 있는 기술이 제공된다.
도 1은 일 실시형태에 따른 피처리 기판을 처리하는 방법을 도시하는 흐름도이다.
도 2는 도 1에 도시하는 방법의 실행에 이용되는 일 실시형태에 따른 플라즈마 처리 장치의 일례를 도시하는 도면이다.
도 3은 일 실시에 따른 피처리 기판을 처리하는 방법에 있어서 구분된 피처리 기판 주면의 복수 영역의 일부를 일례로서 모식적으로 도시하는 도면이다.
도 4는 (a)부, (b)부, (c)부, (d)부를 갖추고, 도 1에 도시하는 각 공정의 실시 전 및 실시 후의 피처리 기판의 상태를 도시하는 단면도이다.
도 5는 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시하는 방법의 각 공정의 실시 후의 피처리 기판의 상태를 도시하는 단면도이다.
도 6은 도 1에 도시하는 방법의 각 공정의 실행 중에 있어서의, 가스의 공급 및 고주파 전원의 공급 상태를 도시하는 도면이다.
도 7은 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시하는 방법에 있어서의 보호막의 형성 모습을 모식적으로 도시하는 도면이다.
도 8은 도 1에 도시하는 방법에 의해서 형성되는 보호막의 막 두께와 피처리 기판의 주면 온도의 관계를 모식적으로 도시하는 도면이다.
도 9는 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시하는 방법에 있어서의 피에칭층의 에칭 원리를 도시하는 도면이다.
도 10은 도 2에 도시하는 처리 용기의 내측에 있어서의 막의 형성 양태를 도시하는 도면이다.
도 11은 도 1에 도시하는 클리닝 공정의 실행 시간 또는 도 1에 도시하는 클리닝 공정에 이용되는 고주파 전력과, 클리닝에 의한 막의 잔막의 상관을 도시하는 도면이다.
도 12는 도 2에 도시하는 처리 용기 내의 위치와 플라즈마 밀도의 상관을 도시하는 도면이다.
도 13은 도 2에 도시하는 처리 용기 내의 위치와 플라즈마 밀도의 상관을 도시하는 도면이다.
도 14는 처리 용기 내에 있어서의 전구체의 소비 비율과 ALD(ALD: Atomic Layer Deposition)의 사이클수의 상관을 도시하는 도면이다.
도 15는 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압)의 정도와 ALD의 사이클수의 상관을 도시하는 도면이다.
도 16은 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압)의 정도와 피흡착 표면에 있어서의 전구체의 흡착량의 정도의 상관의 온도 의존성을 도시하는 도면이다.
도 17은 ALD의 각 사이클에 있어서 클리닝을 행하는 경우에 있어서의 DPC와 클리닝이 행해지지 않는 경우의 DPC를 비교하는 도면이다.
도 18은 클리닝이 행해지지 않는 처리 용기 내에 있어서의 ALD의 사이클수와 DPC의 상관을 도시하는 도면이다.
도 19는 클리닝이 행해진 처리 용기 내에 있어서의 ALD의 사이클수와 DPC의 상관을 도시하는 도면이다.
도 20은 피처리 기판의 1장마다의 처리 시간의 내역을 도시하는 도면이다.
도 21은 피처리 기판의 1장마다에 있어서의 박막 형성 공정의 반복 횟수와 처리 시간의 상관을 도시하는 도면이다.
도 22는 가스 공급 시스템의 개요도이다.
도 23은 도 22에 도시하는 가스 공급 시스템이 이용된 경우에 있어서의 상부 전극의 개략적인 단면도이다.
도 2는 도 1에 도시하는 방법의 실행에 이용되는 일 실시형태에 따른 플라즈마 처리 장치의 일례를 도시하는 도면이다.
도 3은 일 실시에 따른 피처리 기판을 처리하는 방법에 있어서 구분된 피처리 기판 주면의 복수 영역의 일부를 일례로서 모식적으로 도시하는 도면이다.
도 4는 (a)부, (b)부, (c)부, (d)부를 갖추고, 도 1에 도시하는 각 공정의 실시 전 및 실시 후의 피처리 기판의 상태를 도시하는 단면도이다.
도 5는 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시하는 방법의 각 공정의 실시 후의 피처리 기판의 상태를 도시하는 단면도이다.
도 6은 도 1에 도시하는 방법의 각 공정의 실행 중에 있어서의, 가스의 공급 및 고주파 전원의 공급 상태를 도시하는 도면이다.
도 7은 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시하는 방법에 있어서의 보호막의 형성 모습을 모식적으로 도시하는 도면이다.
도 8은 도 1에 도시하는 방법에 의해서 형성되는 보호막의 막 두께와 피처리 기판의 주면 온도의 관계를 모식적으로 도시하는 도면이다.
도 9는 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시하는 방법에 있어서의 피에칭층의 에칭 원리를 도시하는 도면이다.
도 10은 도 2에 도시하는 처리 용기의 내측에 있어서의 막의 형성 양태를 도시하는 도면이다.
도 11은 도 1에 도시하는 클리닝 공정의 실행 시간 또는 도 1에 도시하는 클리닝 공정에 이용되는 고주파 전력과, 클리닝에 의한 막의 잔막의 상관을 도시하는 도면이다.
도 12는 도 2에 도시하는 처리 용기 내의 위치와 플라즈마 밀도의 상관을 도시하는 도면이다.
도 13은 도 2에 도시하는 처리 용기 내의 위치와 플라즈마 밀도의 상관을 도시하는 도면이다.
도 14는 처리 용기 내에 있어서의 전구체의 소비 비율과 ALD(ALD: Atomic Layer Deposition)의 사이클수의 상관을 도시하는 도면이다.
도 15는 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압)의 정도와 ALD의 사이클수의 상관을 도시하는 도면이다.
도 16은 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압)의 정도와 피흡착 표면에 있어서의 전구체의 흡착량의 정도의 상관의 온도 의존성을 도시하는 도면이다.
도 17은 ALD의 각 사이클에 있어서 클리닝을 행하는 경우에 있어서의 DPC와 클리닝이 행해지지 않는 경우의 DPC를 비교하는 도면이다.
도 18은 클리닝이 행해지지 않는 처리 용기 내에 있어서의 ALD의 사이클수와 DPC의 상관을 도시하는 도면이다.
도 19는 클리닝이 행해진 처리 용기 내에 있어서의 ALD의 사이클수와 DPC의 상관을 도시하는 도면이다.
도 20은 피처리 기판의 1장마다의 처리 시간의 내역을 도시하는 도면이다.
도 21은 피처리 기판의 1장마다에 있어서의 박막 형성 공정의 반복 횟수와 처리 시간의 상관을 도시하는 도면이다.
도 22는 가스 공급 시스템의 개요도이다.
도 23은 도 22에 도시하는 가스 공급 시스템이 이용된 경우에 있어서의 상부 전극의 개략적인 단면도이다.
이하 도면을 참조하여 다양한 실시형태에 관해서 상세히 설명한다. 또한, 각 도면에 있어서 동일하거나 또는 상당하는 부분에 대해서는 동일한 부호를 붙이기로 한다. 도 1은 일 실시형태에 따른 피처리 기판(이하, 웨이퍼(W)라고 하는 경우가 있다)을 처리하는 방법을 도시하는 흐름도이다. 도 1에 도시한 방법(MT)은 피처리 기판을 성막하는 성막 방법의 일 실시형태이다. 방법(MT)(피처리 기판을 처리하는 방법)은 도 2에 도시하는 플라즈마 처리 장치(10)에 의해서 실행된다.
도 2는 도 1에 도시한 방법(MT)의 실행에 이용되는 일 실시형태에 따른 플라즈마 처리 장치의 일례를 도시하는 도면이다. 도 2에는 방법(MT)의 다양한 실시형태에서 이용할 수 있는 플라즈마 처리 장치(10)의 단면 구조가 개략적으로 도시되어 있다. 도 2에 도시한 것과 같이, 플라즈마 처리 장치(10)는 평행 평판의 전극을 갖춘 플라즈마 에칭 장치이며, 처리 용기(12)를 갖추고 있다.
처리 용기(12)는 예컨대 대략 원통 형상을 갖고 있고, 처리 공간(Sp)을 획정한다. 처리 용기(12)는 예컨대 알루미늄의 재료를 갖고 있고, 처리 용기(12)의 내벽면에는 양극 산화 처리가 실시되어 있다. 처리 용기(12)는 보안 접지되어 있다.
처리 용기(12)의 바닥부 상에는 예컨대 대략 원통형의 지지부(14)가 마련되어 있다. 지지부(14)는 예컨대 절연 재료를 갖고 있다. 지지부(14)의 절연 재료는 석영과 같이 산소를 포함할 수 있다. 지지부(14)는, 처리 용기(12) 내에 있어서, 처리 용기(12)의 바닥부로부터 연직 방향으로(바닥부에서 천장 측의 상부 전극(30)으로 향한 방향으로) 연장되어 있다.
처리 용기(12) 내에는 배치대(PD)가 마련되어 있다. 배치대(PD)는 지지부(14)에 의해서 지지되어 있다. 배치대(PD)는 배치대(PD)의 상면에서 웨이퍼(W)를 유지한다. 웨이퍼(W)의 주면은, 배치대(PD)의 상면에 접촉하는 웨이퍼(W)의 이면의 반대 측에 있으며, 상부 전극(30)을 향하고 있다. 배치대(PD)는 하부 전극(LE) 및 정전 척(ESC)을 갖고 있다. 하부 전극(LE)은 제1 플레이트(18a) 및 제2 플레이트(18b)를 포함하고 있다.
제1 플레이트(18a) 및 제2 플레이트(18b)는 예컨대 알루미늄 등의 금속 재료를 갖고 있으며, 예컨대 대략 원반 형상을 갖고 있다. 제2 플레이트(18b)는 제1 플레이트(18a) 상에 마련되어 있고, 제1 플레이트(18a)에 전기적으로 접속되어 있다.
제2 플레이트(18b) 상에는 정전 척(ESC)이 마련되어 있다. 정전 척(ESC)은, 도전막인 전극을, 한 쌍의 절연층 사이 또는 한 쌍의 절연 시트 사이에 배치한 구조를 갖고 있다. 정전 척(ESC)의 전극에는 직류 전원(22)이 스위치(23)를 통해 전기적으로 접속되어 있다. 웨이퍼(W)는 배치대(PD)에 배치되어 있는 경우에 정전 척(ESC)에 접한다.
웨이퍼(W)의 이면(주면의 반대쪽의 면)은 정전 척(ESC)에 접한다. 정전 척(ESC)은, 직류 전원(22)으로부터의 직류 전압에 의해서 생기는 쿨롱력 등의 정전력에 의해서 웨이퍼(W)를 흡착한다. 이에 따라, 정전 척(ESC)은 웨이퍼(W)를 유지할 수 있다.
제2 플레이트(18b)의 주연부 상에는, 웨이퍼(W)의 엣지 및 정전 척(ESC)을 둘러싸도록 포커스 링(FR)이 배치되어 있다. 포커스 링(FR)은 에칭의 균일성을 향상시키기 위해서 마련되어 있다. 포커스 링(FR)은, 에칭 대상의 막 재료에 의해서 적절하게 선택되는 재료를 갖고 있으며, 예컨대 석영 재료를 가질 수 있다.
플라즈마 처리 장치(10)에는 웨이퍼(W)의 온도를 조절하는 온도 조절부(HT)가 마련되어 있다. 온도 조절부(HT)는 정전 척(ESC)에 내장되어 있다. 온도 조절부(HT)에는 히터 전원(HP)이 접속되어 있다. 히터 전원(HP)에서 온도 조절부(HT)로 전력이 공급됨으로써 정전 척(ESC)의 온도가 조절되어, 정전 척(ESC) 상에 배치되는 웨이퍼(W)의 온도가 조절된다. 또한, 온도 조절부(HT)는 제2 플레이트(18b) 내에 매립되어 있는 것도 가능하다.
온도 조절부(HT)는, 열을 발하는 복수의 가열 소자와, 이 복수의 가열 소자 각각의 주위의 온도를 각각 검출하는 복수의 온도 센서를 구비한다. 복수의 가열 소자 각각은, 웨이퍼(W)가 정전 척(ESC) 상에 위치 정렬되어 배치되어 있는 경우에, 도 3에 도시한 것과 같이 웨이퍼(W) 주면의 복수의 영역(ER)마다(복수의 영역마다) 마련되어 있다. 도 3은 방법(MT)에 있어서 구분된 웨이퍼(W) 주면의 복수의 영역(ER)의 일부를 일례로서 모식적으로 도시하는 도면이다. 후술하는 제어부(Cnt)는, 웨이퍼(W)가 정전 척(ESC) 상에 위치 정렬되어 배치되어 있는 경우에, 웨이퍼(W) 주면의 복수의 영역(ER)의 각각에 대응하는 가열 소자 및 온도 센서를 영역(ER)과 관련시켜 인식한다. 제어부(Cnt)는, 영역(ER)과, 영역(ER)에 대응하는 가열 소자 및 온도 센서를, 복수의 영역(ER)마다 예컨대 숫자나 문자 등의 번호 등에 의해서 식별할 수 있다. 제어부(Cnt)는, 하나의 영역(ER)의 온도를, 그 하나의 영역(ER)에 대응하는 부위에 마련된 온도 센서에 의해서 검출하고, 이 하나의 영역(ER)에 대한 온도 조절을, 상기 하나의 영역(ER)에 대응하는 부위에 마련된 가열 소자에 의해서 행한다. 또한, 웨이퍼(W)가 정전 척(ESC) 상에 배치되어 있는 경우에 하나의 온도 센서에 의해서 검출되는 온도는, 웨이퍼(W) 중 상기 온도 센서 상의 영역(ER)의 온도와 마찬가지다.
제2 플레이트(18b)의 내부에는 냉매 유로(24)가 마련되어 있다. 냉매 유로(24)는 온도 조절 기구를 구성하고 있다. 냉매 유로(24)에는, 처리 용기(12)의 외부에 설치된 칠러 유닛(도시 생략)으로부터 배관(26a)을 통해 냉매가 공급된다. 냉매 유로(24)에 공급되는 냉매는 배관(26b)을 통해 칠러 유닛으로 되돌려진다. 이와 같이, 냉매 유로(24)에는 냉매가 순환하는 식으로 공급된다. 이 냉매의 온도를 제어함으로써, 정전 척(ESC)에 의해서 지지된 웨이퍼(W)의 온도가 제어될 수 있다. 플라즈마 처리 장치(10)에는 가스 공급 라인(28)이 마련되어 있다. 가스 공급 라인(28)은, 전열 가스 공급 기구로부터의 전열 가스, 예컨대 He 가스를, 정전 척(ESC)의 상면과 웨이퍼(W) 이면의 사이에 공급한다.
플라즈마 처리 장치(10)는 상부 전극(30)을 구비한다. 상부 전극(30)은 처리 용기(12) 내의 천장 측(처리 용기(12) 내에서 지지부(14)가 마련되어 있는 측의 반대쪽)에 마련되어 있다. 상부 전극(30)은 배치대(PD)의 상측에 있어서 배치대(PD)와 대향 배치되어 있다.
하부 전극(LE)과 상부 전극(30)은 상호 대략 평행하게 마련되어 있으며, 평행 평판 전극을 구성한다. 상부 전극(30)과 하부 전극(LE)의 사이에는, 웨이퍼(W)에 플라즈마 처리를 행하기 위한 처리 공간(Sp)이 제공되어 있다. 상부 전극(30)은 절연성 차폐 부재(32)를 통해 처리 용기(12)의 상부에 지지되어 있다. 절연성 차폐 부재(32)는 절연 재료의 재료를 갖고 있으며, 예컨대 석영과 같이 산소를 포함할 수 있다. 상부 전극(30)은 전극판(34) 및 전극 지지체(36)를 포함할 수 있다. 전극판(34)은 처리 공간(Sp)에 면하고 있고, 전극판(34)에는 복수의 가스 토출 구멍(34a)이 마련되어 있다.
전극판(34)은 일 실시형태에서는 실리콘(이하, 규소라고 하는 경우가 있다)을 함유한다. 다른 실시형태에서는 전극판(34)은 산화실리콘(SiO2)을 함유할 수 있다.
전극 지지체(36)는 전극판(34)을 착탈이 자유롭게 지지하는 것으로, 예컨대 알루미늄 등의 도전성 재료를 가질 수 있다. 전극 지지체(36)는 수냉 구조를 가질 수 있다. 전극 지지체(36)의 내부에는 가스 확산실(36a)이 마련되어 있다. 가스 확산실(36a)로부터는, 가스 토출 구멍(34a)에 연통하는 복수의 가스 통류 구멍(36b)이 아래쪽으로 연장되어 있다.
플라즈마 처리 장치(10)는 제1 고주파 전원(62) 및 제2 고주파 전원(64)을 구비한다. 제1 고주파 전원(62)은, 플라즈마 생성용의 제1 고주파 전력을 발생하는 전원이며, 27∼100[MHz]의 주파수, 일례에서는 60[MHz]의 고주파 전력을 발생한다. 또한, 제1 고주파 전원(62)은 펄스 사양을 갖추고 있으며, 예컨대 주파수 0.1∼50[kHz], Duty 5∼100%로 제어 가능하다.
제1 고주파 전원(62)은 정합기(66)를 통해 상부 전극(30)에 접속되어 있다. 정합기(66)는, 제1 고주파 전원(62)의 출력 임피던스와 부하 측(하부 전극(LE) 측)의 입력 임피던스를 정합시키기 위한 회로이다. 또한, 제1 고주파 전원(62)은 정합기(66)를 통해 하부 전극(LE)에 접속되어 있어도 좋다.
제2 고주파 전원(64)은, 웨이퍼(W)에 이온을 인입하기 위한 제2 고주파 전력, 즉 고주파 바이어스 전력을 발생하는 전원이며, 400[kHz]∼40.68[MHz] 범위 내의 주파수, 일례에서는 13.56[MHz] 주파수의 고주파 바이어스 전력을 발생한다. 또한, 제2 고주파 전원(64)은 펄스 사양을 갖추고 있으며, 예컨대 주파수 0.1∼50[kHz], Duty 5∼100%로 제어 가능하다.
제2 고주파 전원(64)은 정합기(68)를 통해 하부 전극(LE)에 접속되어 있다. 정합기(68)는, 제2 고주파 전원(64)의 출력 임피던스와 부하 측(하부 전극(LE) 측)의 입력 임피던스를 정합시키기 위한 회로이다.
플라즈마 처리 장치(10)는 전원(70)을 추가로 구비하고 있다. 전원(70)은 상부 전극(30)에 접속되어 있다. 전원(70)은, 처리 공간(Sp) 내에 존재하는 양이온을 전극판(34)에 인입하기 위한 전압을 상부 전극(30)에 인가한다. 일례에서는, 전원(70)은 마이너스의 직류 전압을 발생하는 직류 전원이다. 이러한 전압이 전원(70)으로부터 상부 전극(30)에 인가되면, 처리 공간(Sp)에 존재하는 양이온이 전극판(34)에 충돌한다. 이에 따라, 전극판(34)으로부터 이차 전자 및/또는 실리콘이 방출될 수 있다.
처리 용기(12) 내의 바닥부 측(처리 용기(12) 내의 천장 측의 반대쪽이며, 처리 용기(12) 내에서 지지부(14)가 마련되어 있는 측) 또한 지지부(14)와 처리 용기(12)의 측벽의 사이에는 배기 플레이트(48)가 마련되어 있다. 배기 플레이트(48)는 예컨대 알루미늄재에 Y2O3 등의 세라믹스가 피복될 수 있다. 배기 플레이트(48)의 하측 또한 처리 용기(12)에는 배기구(12e)가 마련되어 있다.
배기구(12e)에는 배기관(52)을 통해 배기 장치(50)가 접속되어 있다. 배기 장치(50)는, 예컨대 터보 분자 펌프 등의 진공 펌프를 갖고 있으며, 처리 용기(12)의 처리 공간(Sp) 내의 공간을 원하는 진공도까지 감압할 수 있다. 처리 용기(12)의 측벽에는 웨이퍼(W)의 반입출구(12g)가 마련되어 있고, 반입출구(12g)는 게이트 밸브(54)에 의해 개폐 가능하게 되어 있다.
플라즈마 처리 장치(10)에서는, 후술하는 것과 같이 유기 함유의 아미노실란계 가스를 공급하기 때문에, 플라즈마 처리 장치(10)는, 유기 함유의 아미노실란계 가스를 공급하는 배관과, 다른 프로세스 가스(예컨대 산소 가스)를 공급하는 배관을 분리시키는 포스트믹스 구조를 갖춘다. 유기 함유의 아미노실란계 가스는 반응성이 비교적 높기 때문에, 유기 함유의 아미노실란계 가스의 공급과 다른 프로세스 가스의 공급을 동일한 배관에 의해서 행하는 경우에는, 배관 내에 흡착하는 유기 함유의 아미노실란계 가스의 성분과 다른 프로세스 가스 성분이 반응하여, 이 반응에 의한 반응 생성물이 배관 내에 퇴적되는 경우가 있다.
배관 내에 퇴적된 반응 생성물은, 클리닝 등에 의한 제거가 곤란하여, 파티클의 원인, 그리고 배관의 위치가 플라즈마 영역에 가까운 경우에는 이상 방전의 원인이 될 수 있다. 따라서, 유기 함유의 아미노실란계 가스의 공급과 다른 프로세스 가스의 공급을 각각 따로따로의 배관으로 행할 필요가 있다. 플라즈마 처리 장치(10)의 포스트믹스 구조에 의해서, 유기 함유의 아미노실란계 가스의 공급과 다른 프로세스 가스의 공급이 각각 따로따로의 배관에 의해서 행해진다.
플라즈마 처리 장치(10)의 포스트믹스 구조는 적어도 2개의 배관(가스 공급관(38), 가스 공급관(82))을 구비한다. 가스 공급관(38)과 가스 공급관(82)에는 모두 밸브군(42) 및 유량 제어기군(45)을 통해 가스 소스군(40)이 접속되어 있다.
가스 소스군(40)은 복수의 가스 소스를 갖고 있다. 복수의 가스 소스는, 유기 함유된 아미노실란계 가스(예컨대 가스(G1)에 포함되는 가스)의 소스, 플루오로카본계 가스(CxFy 가스(x, y는 1∼10의 정수))(예컨대 공정 ST3 및 공정 ST7에서 이용되는 가스 및 가스(G4)에 포함되는 가스)의 소스, 산소 원자를 포함하는 가스(산소 가스 등)(예컨대 가스(G2)에 포함되는 가스)의 소스, 불소 원자를 포함하는 가스(예컨대 가스(G3)에 포함되는 가스)의 소스, 질소 원자를 포함하는 가스(예컨대 공정 ST8에서 이용되는 가스)의 소스, 수소 원자를 포함하는 가스(예컨대 공정 ST8에서 이용되는 가스)의 소스 및 Ar 가스(예컨대 가스(G5)에 포함되는 가스, 퍼지 가스 및 역류 방지 가스) 등의 불활성 가스의 소스 등 각종 가스의 소스를 포함할 수 있다.
유기 함유의 아미노실란계 가스로서, 아미노기의 수가 비교적 적은 분자 구조를 갖는 가스가 이용될 수 있으며, 예컨대 모노아미노실란(H3-Si-R(R은 유기를 포함하고 있으며 치환되어 있어도 좋은 아미노기))이 이용될 수 있다. 상기한 유기 함유의 아미노실란계 가스(후술하는 가스(G1)에 포함되는 가스)는, 1∼3개의 규소 원자를 가질 수 있는 아미노실란을 포함할 수 있거나, 또는 1∼3개의 아미노기를 갖는 아미노실란을 포함할 수 있다.
1∼3개의 규소 원자를 갖는 아미노실란은, 1∼3개의 아미노기를 갖는 모노실란(모노아미노실란), 1∼3개의 아미노기를 갖는 디실란, 또는 1∼3개의 아미노기를 갖는 트리실란일 수 있다. 또한, 상기한 아미노실란은 치환되어 있어도 좋은 아미노기를 가질 수 있다. 또한, 상기한 아미노기는 메틸기, 에틸기, 프로필기 및 부틸기의 어느 것에 의해서 치환될 수 있다. 또한, 상기한 메틸기, 에틸기, 프로필기 또는 부틸기는 할로겐에 의해서 치환될 수 있다.
플루오로카본계 가스로서는 CF4 가스, C4F6 가스, C4F8 가스 등의 임의의 플루오로카본계 가스가 이용될 수 있다. 불활성 가스로서는 질소 가스, Ar 가스, He 가스 등의 임의의 가스가 이용될 수 있다.
밸브군(42)은 복수의 밸브를 포함하고 있고, 유량 제어기군(45)은 매스플로우 컨트롤러 등의 복수의 유량 제어기를 포함하고 있다. 가스 소스군(40)의 복수의 가스 소스의 각각은, 밸브군(42)의 대응하는 밸브 및 유량 제어기군(45)의 대응하는 유량 제어기를 통해 가스 공급관(38) 및 가스 공급관(82)에 접속되어 있다. 따라서, 플라즈마 처리 장치(10)는, 가스 소스군(40)의 복수의 가스 소스 중 선택된 1 이상의 가스 소스로부터의 가스를, 개별로 조정된 유량으로 처리 용기(12)의 처리 공간(Sp) 내에 공급하는 것이 가능하다.
처리 용기(12)에는 가스 도입구(36c)가 마련되어 있다. 가스 도입구(36c)는, 처리 용기(12) 내에 있어서 배치대(PD) 상에 배치된 웨이퍼(W)의 위쪽에 마련된다. 가스 도입구(36c)는 가스 공급관(38)의 일단에 접속되어 있다. 가스 공급관(38)의 타단은 밸브군(42)에 접속되어 있다.
가스 도입구(36c)는 전극 지지체(36)에 마련되어 있다. 가스 도입구(36c)는, 가스 확산실(36a)을 통해 처리 공간(Sp)으로, 플루오로카본가스계 가스, 산소 원자를 포함하는 가스, 불소 원자를 포함하는 가스, 질소 원자 및 수소 원자를 포함하는 가스, Ar 가스, 퍼지 가스(불활성 가스 등을 포함하는 가스), 역류 방지 가스(불활성 가스 등을 포함하는 가스) 등을 유도한다. 가스 도입구(36c)로부터 가스 확산실(36a)을 통해 처리 공간(Sp)에 공급되는 상기한 다양한 가스는, 웨이퍼(W) 상이며 웨이퍼(W)와 상부 전극(30) 사이의 공간 영역에 공급된다.
처리 용기(12)에는 가스 도입구(52a)가 마련되어 있다. 가스 도입구(52a)는, 처리 용기(12) 내에 있어서 배치대(PD) 상에 배치된 웨이퍼(W)의 측방에 마련되어 있다. 가스 도입구(52a)는 가스 공급관(82)의 일단에 접속되어 있다. 가스 공급관(82)의 타단은 밸브군(42)에 접속되어 있다.
가스 도입구(52a)는 처리 용기(12)의 측벽에 마련되어 있다. 가스 도입구(52a)는, 처리 공간(Sp)으로, 유기 함유의 아미노실란계 가스를 포함하는 가스, 역류 방지 가스(불활성 가스 등을 포함하는 가스) 등을 유도한다. 가스 도입구(52a)로부터 처리 공간(Sp)에 공급되는 상기한 다양한 가스는, 웨이퍼(W) 상이며 웨이퍼(W)와 상부 전극(30) 사이의 공간 영역에, 웨이퍼(W)의 측방으로부터 공급된다.
가스 도입구(36c)에 접속되는 가스 공급관(38)과 가스 도입구(52a)에 접속되는 가스 공급관(82)은 상호 교차하지 않는다. 환언하면, 가스 도입구(36c) 및 가스 공급관(38)을 포함하는 가스의 공급 경로와 가스 도입구(52a) 및 가스 공급관(82)을 포함하는 가스의 공급 경로는 상호 교차하지 않는다.
플라즈마 처리 장치(10)에서는, 처리 용기(12)의 내벽을 따라서 디포짓 실드(46)가 착탈이 자유롭게 마련되어 있다. 디포짓 실드(46)는 지지부(14)의 외주에도 마련되어 있다. 디포짓 실드(46)는, 처리 용기(12)에 에칭 부생물(디포짓)이 부착되는 것을 방지하는 것으로, 예컨대 알루미늄재에 Y2O3 등의 세라믹스가 피복될 수 있다. 디포짓 실드는, Y2O3 외에, 예컨대 석영과 같이 산소를 포함하는 재료를 가질 수 있다.
제어부(Cnt)는 프로세서, 기억부, 입력 장치, 표시 장치 등을 갖춘 컴퓨터이며, 도 2에 도시한 플라즈마 처리 장치(10)의 각 부를 제어한다. 제어부(Cnt)는, 플라즈마 처리 장치(10)에 있어서, 밸브군(42), 유량 제어기군(45), 배기 장치(50), 제1 고주파 전원(62), 정합기(66), 제2 고주파 전원(64), 정합기(68), 전원(70), 히터 전원(HP), 칠러 유닛 등에 접속되어 있다.
제어부(Cnt)는, 도 1에 도시한 방법(MT)의 각 공정에 있어서 플라즈마 처리 장치(10)의 각 부를 제어하기 위한 컴퓨터 프로그램(입력된 레시피에 기초한 프로그램)을 따라서 동작하여 제어 신호를 송출한다. 플라즈마 처리 장치(10)의 각 부는 제어부(Cnt)로부터의 제어 신호에 의해서 제어된다.
제어부(Cnt)는, 구체적으로는, 도 2에 도시한 플라즈마 처리 장치(10)에 있어서, 제어 신호를 이용하여, 가스 소스군(40)으로부터 공급되는 가스의 선택 및 유량, 배기 장치(50)의 배기, 제1 고주파 전원(62) 및 제2 고주파 전원(64)으로부터의 전력 공급, 전원(70)으로부터의 전압 인가, 히터 전원(HP)의 전력 공급, 칠러 유닛으로부터의 냉매 유량 및 냉매 온도 등을 제어하는 것이 가능하다.
또한, 본 명세서에서 개시되는 피처리 기판을 처리하는 방법(MT)의 각 공정은, 제어부(Cnt)에 의한 제어에 의해서 플라즈마 처리 장치(10)의 각 부를 동작시킴으로써 실행될 수 있다. 제어부(Cnt)의 기억부에는, 방법(MT)을 실행하기 위한 컴퓨터 프로그램 및 방법(MT)의 실행에 이용되는 각종 데이터가 독출이 자유롭게 저장되어 있다.
다시 도 1을 참조하여 방법(MT)에 관해서 상세히 설명한다. 이하에서는, 방법(MT)의 실행에 플라즈마 처리 장치(10)가 이용되는 예에 관해서 설명한다. 또한, 이하의 설명에 있어서 도 1∼도 3과 함께 추가로 도 4∼도 10을 참조한다.
도 4는 (a)부, (b)부, (c)부, (d)부를 갖추고, 도 1에 도시한 각 공정의 실시 전 및 실시 후의 웨이퍼(W)의 상태를 도시하는 단면도이다. 도 5는 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시한 방법의 각 공정의 실시 후의 웨이퍼(W)의 상태를 도시하는 단면도이다. 도 6은 도 1에 도시한 방법(MT)의 각 공정의 실행 중에 있어서의, 가스의 공급 및 고주파 전원의 공급 상태를 도시하는 도면이다. 도 7은 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시한 방법(MT)에 있어서의 보호막(SX)의 형성 모습을 모식적으로 도시하는 도면이다. 도 8은 도 1에 도시한 방법(MT)의 성막 공정(시퀀스 SQ1 및 공정 ST6)에 의해서 성막되는 보호막(SX)의 막 두께와 웨이퍼(W) 주면의 온도 관계를 모식적으로 도시하는 도면이다. 도 9는 (a)부, (b)부, (c)부를 갖추고, 도 1에 도시한 방법(MT)에 있어서의 피에칭층(EL)의 에칭 원리를 도시하는 도면이다. 도 10은 처리 용기(12) 내측에 있어서의 막 형성 양태를 도시하는 도면이다.
방법(MT)은, 웨이퍼(W) 상에 형성된 패턴(웨이퍼(W)의 주면에 형성되어 있는 요철에 의해서 획정되는 패턴이며, 예컨대 후술하는 마스크(MK1)에 의해서 획정되는 패턴)에 성막하는 성막 방법이다. 웨이퍼(W)는 감압 환경 하에서 플라즈마 처리 가능한 처리 공간(Sp)에 마련된 배치대(PD)에 배치되어 있다. 상기한 것과 같이, 플라즈마 처리 장치(10)에 있어서 처리 공간(Sp)에는 배치대(PD)에 대향되어 있고 고주파 전력의 공급이 가능한 상부 전극(30)이 배치되어 있다. 도 1에 도시한 것과 같이, 방법(MT)은 공정 ST1∼공정 ST10을 갖춘다. 방법(MT)은, 시퀀스 SQ1(시퀀스 SQ1 중 공정 ST5a∼공정 ST5d을, 후술하는 것과 같이 박막 형성 공정이라고 하는 경우가 있다), 시퀀스 SQ2를 갖춘다. 우선, 공정 ST1에 있어서, 도 4(a)에 도시한 웨이퍼(W)를 도 2에 도시한 웨이퍼(W)로서 준비한다. 공정 ST1에서는, 도 10의 상태(CON1)에 도시한 것과 같이, 처리 용기(12)의 내측에 있는 플라즈마 처리 장치(10)의 모든 구성 부품의 표면(예컨대, 플라즈마를 발생시키는 처리 용기(12)의 내벽면 등이며, 이하 단순히 처리 용기(12) 내측의 표면이라고 하는 경우가 있다)은 처리 공간(Sp)에 노출되어 있다.
공정 ST1에 있어서 준비되는 웨이퍼(W)는, 도 4(a)에 도시한 것과 같이, 기판(SB), 피에칭층(EL), 유기막(OL), 반사방지막(AL) 및 마스크(MK1)를 갖는다. 피에칭층(EL)은 기판(SB) 상에 마련된다. 피에칭층(EL)은, 유기막(OL)에 대하여 선택적으로 에칭되는 재료를 갖는 층이며 절연막이 이용된다. 피에칭층(EL)은 예컨대 산화실리콘을 가질 수 있다. 또한, 피에칭층(EL)은 다결정 실리콘 등의 다른 재료를 갖는 경우가 있다.
유기막(OL)은 피에칭층(EL) 상에 마련된다. 유기막(OL)은 탄소를 포함하는 층이며, 예컨대 SOH(스핀 온 하드마스크)층이다. 반사방지막(AL)은 실리콘 함유의 반사방지막이고, 유기막(OL) 상에 마련된다. 마스크(MK1)는 반사방지막(AL) 상에 마련된다. 마스크(MK1)는 레지스트 재료를 갖는 레지스트 마스크이며, 포토리소그래피 기술에 의해서 레지스트층이 패터닝됨으로써 제작된다. 마스크(MK1)는 반사방지막(AL)을 부분적으로 덮고 있다. 마스크(MK1)는 반사방지막(AL)을 부분적으로 노출시키는 개구를 구획하고 있다. 마스크(MK1)의 패턴은 예컨대 라인 앤드 스페이스 패턴이다. 또한, 마스크(MK1)는 평면에서 봤을 때 원형의 개구를 제공하는 패턴을 가질 수 있다. 또는, 마스크(MK1)는 평면에서 봤을 때 타원형의 개구를 제공하는 패턴을 가질 수 있다.
공정 ST1에서는, 도 4(a)에 도시한 웨이퍼(W)가 준비되고, 웨이퍼(W)가 플라즈마 처리 장치(10)의 처리 용기(12)의 처리 공간(Sp) 내에 수용되어, 배치대(PD) 상에 배치된다.
공정 ST1에 계속되는 공정 ST2에서는 웨이퍼(W)에 이차 전자가 조사된다. 구체적으로는, 가스 공급관(38)을 통해 가스 도입구(36c)에서 처리 용기(12)의 처리 공간(Sp) 내로 수소 가스 및 희가스가 공급되고, 제1 고주파 전원(62)으로부터 고주파 전력이 공급됨으로써 플라즈마가 생성된다. 또한, 전원(70)에 의해서 상부 전극(30)에 마이너스의 직류 전압이 인가된다. 이에 따라, 처리 공간(Sp) 중의 양이온이 상부 전극(30)에 인입되고, 이 양이온이 상부 전극(30)에 충돌한다. 양이온이 상부 전극(30)에 충돌함으로써 상부 전극(30)으로부터는 이차 전자가 방출된다. 방출된 이차 전자가 웨이퍼(W)에 조사됨으로써 마스크(MK1)가 개질된다. 공정 ST2의 종료 시에는 처리 용기(12)의 처리 공간(Sp) 내부는 퍼지된다.
상부 전극(30)에 인가되는 마이너스의 직류 전압의 절대치의 레벨이 높은 경우에는, 전극판(34)에 양이온이 충돌함으로써, 상기 전극판(34)의 구성 재료인 실리콘이 이차 전자와 함께 방출된다. 방출된 실리콘은, 플라즈마에 노출되게 된 플라즈마 처리 장치(10)의 구성 부품으로부터 방출되는 산소와 결합한다. 이 산소는, 예컨대 지지부(14), 절연성 차폐 부재(32) 및 디포짓 실드(46) 등의 부재로부터 방출된다. 이러한 실리콘과 산소의 결합에 의해 산화실리콘의 화합물이 생성되고, 이 산화실리콘의 화합물이 웨이퍼(W) 상에 퇴적되어 마스크(MK1)를 덮어 보호한다.
이들 개질과 보호 효과에 의해서, 후속되는 공정에 의한 마스크(MK1)의 손상이 억제된다. 또한, 공정 ST2에서는, 이차 전자의 조사에 의한 개질이나 보호막의 형성을 위해서, 제2 고주파 전원(64)의 바이어스 전력을 최소한으로 하여 실리콘의 방출을 억제하여도 좋다.
공정 ST2에 계속되는 공정 ST3에서는 반사방지막(AL)을 에칭한다. 구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터, 도 6의 부호 SRa에 나타내는 것과 같이, 가스 공급관(38) 및 가스 도입구(36c)를 통해, 플루오로카본계 가스를 포함하는 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다. 이 경우, 도 6의 부호 SRb에 나타내는 것과 같이 가스 도입구(52a)로부터는 가스를 공급하지 않거나, 또는 도 6의 부호 SRb의 파선에 나타내는 것과 같이 가스 공급관(82) 및 가스 도입구(52a)를 통해 역류 방지 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
그리고, 도 6의 부호 SRc에 나타내는 것과 같이 제1 고주파 전원(62)으로부터 고주파 전력을 공급하고, 도 6의 부호 SRd에 나타내는 것과 같이 제2 고주파 전원(64)으로부터 고주파 바이어스 전력을 공급한다. 배기 장치(50)를 동작시킴으로써, 처리 용기(12)의 처리 공간(Sp) 내 공간의 압력을 미리 설정된 압력으로 설정한다. 이에 따라, 플루오로카본계 가스의 플라즈마가 생성된다.
생성된 플라즈마 중의 불소를 포함하는 활성종은, 반사방지막(AL)의 전체 영역 중 마스크(MK1)로부터 노출된 영역을 에칭한다. 이 에칭에 의해, 도 4(b)에 도시한 것과 같이, 반사방지막(AL)으로부터 마스크(ALM)가 형성된다. 공정 ST3에 의해서 형성되는 유기막(OL)에 대한 마스크는, 마스크(MK1)와 마스크(ALM)를 갖는다.
공정 ST3에 계속되는 공정 ST4에서는, 공정 ST2의 방법과 같은 식으로 하여, 도 4(c)에 도시한 것과 같이, 마스크(MK1)의 표면, 마스크(ALM)의 표면, 유기막(OL)의 표면에 산화실리콘의 보호막(PF)을 형성한다. 공정 ST4의 종료 시에는, 처리 용기(12)의 처리 공간(Sp) 내부는 퍼지된다. 또한, 공정 ST3 후에는 공정 ST4을 행하지 않고서 시퀀스 SQ1를 실행하도록 하여도 좋다.
공정 ST4에 이어서, 도 1에 도시한 방법(MT)에서는, 시퀀스 SQ1를 1회 이상 실행한다. 시퀀스 SQ1는 공정 ST5a∼공정 ST5f을 갖춘다. 시퀀스 SQ1는, 웨이퍼(W)의 패턴에 퇴적막(보호막(SX)을 구성하는 박막)을 형성하는 제1 공정(공정 ST5a∼공정 ST5d)과, 제1 공정에 이어서, 전력을 상부 전극(30)에만 공급하여 처리 공간(Sp)에 플라즈마를 발생시킴으로써 처리 공간(Sp)을 클리닝하는 제2 공정(공정 ST5e∼공정 ST5f)을 구비한다. 시퀀스 SQ1 및 공정 ST6을 포함하는 성막 공정은, 도 4(d)에 도시한 것과 같이, ALD법(ALD: Atomic Layer Deposition)과 같은 방법에 의해서, 플라즈마 처리 장치(10)의 처리 용기(12) 내에 수용된 웨이퍼(W)의 주면에 대하여 박막(보호막(SX)을 구성하는 막)을 컨포멀(Conformal)하게 형성하는 박막 형성 공정(공정 ST5a, 공정 ST5b, 공정 ST5c, 공정 ST5d)과 함께, 박막 형성 공정에 이어서, 처리 용기(12) 내부 중 웨이퍼(W)의 상측(처리 용기(12) 내의 천장 측)에 있는 영역을 클리닝하는 클리닝 공정(공정 ST5e, 공정 ST5f)을 포함한다.
성막 공정은, 박막 형성 공정과 클리닝 공정을 포함하는 시퀀스 SQ1를, 공정 ST6을 통해 반복 실행하여, 도 4(d)에 도시한 것과 같이 웨이퍼(W)의 주면에 보호막(SX)을 형성한다. 시퀀스 SQ1의 1회의 실행에서는, 박막 형성 공정의 실행에 의해서 웨이퍼(W)의 주면에 박막(보호막(SX)을 구성하는 막)이 형성됨과 더불어, 이 박막의 형성에 기인하여 처리 용기(12)의 내측에 형성되는 박막(도 10에 도시한 박막(SXa)) 중 처리 용기(12)의 상부(처리 용기(12) 내의 천장 측)에 있는 부분이 클리닝 공정의 실행에 의해서 제거된다.
공정 ST5a에서는, 전구체(층 Ly1)의 재료를 포함하는 제1 가스(가스 G1)를 처리 공간(Sp)에 공급하고, 이 전구체를 패턴(마스크(MK1)에 의해서 획정되는 패턴)의 표면에 흡착시킨다. 공정 ST5a에서는, 처리 용기(12)의 처리 공간(Sp) 내에 가스(G1)를 도입한다. 구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터, 도 6의 부호 SRb에 나타내는 것과 같이, 가스 공급관(82) 및 가스 도입구(52a)를 통해, 가스(G1)를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다. 이 경우, 도 6의 부호 SRa에 나타내는 것과 같이, 가스 도입구(36c)로부터는 가스를 공급하지 않거나, 또는 도 6의 부호 SRa의 파선에 나타내는 것과 같이, 가스 공급관(38) 및 가스 도입구(36c)를 통해 역류 방지 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
공정 ST5a에서는, 도 6의 부호 SRc, 부호 SRd에 나타내는 것과 같이, 가스(G1)의 플라즈마를 생성하지 않는다. 가스(G1)는 예컨대 유기 함유의 아미노실란계 가스이다. 가스(G1)는 유기 함유의 아미노실란계 가스로서 모노아미노실란(H3-Si-R(R은 아미노기))을 포함한다.
도 7(a)에 도시한 것과 같이, 가스(G1)의 분자가 반응 전구체로서 웨이퍼(W)의 주면에 부착된다. 가스(G1)의 분자(예컨대 모노아미노실란)는 화학 결합에 기초한 화학 흡착에 의해서 웨이퍼(W)의 주면에 부착되는 것이며, 플라즈마는 이용되지 않는다. 공정 ST5a에서는, 웨이퍼(W)의 온도는 섭씨 0도 이상이면서 마스크(MK1)에 포함되는 재료의 유리 전이 온도 이하(예컨대 섭씨 200도 이하) 정도이다.
또한, 상기 온도 범위에서 화학 결합에 의해서 표면에 부착 가능하며 또한 실리콘을 함유하는 것이라면, 모노아미노실란 이외의 가스도 이용할 수 있다. 디아미노실란(H2-Si-R2(R은 아미노기)) 및 트리아미노실란(H-Si-R3(R은 아미노기))에 관해서는, 모노아미노실란보다도 복잡한 분자 구조를 갖기 때문에, 가스(G1)로서 이용하는 경우에 있어서 균일한 막의 형성을 실현하기 위해서는, 아미노기를 자기 분해하기 위해서 열처리가 행해지는 경우도 있다.
가스(G1)에 모노아미노실란계 가스가 일례로서 선택되는 이유는, 모노아미노실란이 비교적 높은 전기 음성도를 가지면서 또한 극성을 갖는 분자 구조를 가짐으로써 화학 흡착이 비교적 용이하게 행해질 수 있다고 하는 데에 기인한다. 가스(G1)의 분자가 웨이퍼(W)의 주면에 부착함으로써 형성되는 층(Ly1)(도 7(b)을 참조)은, 상기 부착이 화학 흡착이기 때문에 단분자층(단일층)에 가까운 상태가 된다.
모노아미노실란의 아미노기(R)가 작을수록 웨이퍼(W)의 주면에 흡착되는 분자의 분자 구조도 작아지기 때문에, 분자의 크기에 기인하는 입체 장해가 저감되고, 이로써 가스(G1)의 분자가 웨이퍼(W)의 주면에 균일하게 흡착될 수 있고, 층(Ly1)은 웨이퍼(W)의 주면에 대하여 균일한 막 두께로 형성될 수 있다. 예컨대, 가스(G1)에 포함되는 모노아미노실란(H3-Si-R)이 웨이퍼(W) 주면의 OH기와 반응함으로써 반응 전구체인 H3-Si-O가 형성되고, 이로써 H3-Si-O의 단분자층인 층(Ly1)이 형성된다. 따라서, 웨이퍼(W)의 주면에 대하여, 반응 전구체의 층(Ly1)이 웨이퍼(W)의 패턴 밀도에 의존하지 않고서 균일한 막 두께로 컨포멀하게 형성될 수 있다.
공정 ST5a에 계속되는 공정 ST5b에서는, 처리 용기(12)의 처리 공간(Sp) 내의 공간을 퍼지한다. 구체적으로는 공정 ST5a에 있어서 공급된 가스(G1)가 배기된다. 공정 ST5b에서는, 퍼지 가스로서 질소 가스 등의 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급하여도 좋다. 즉, 공정 ST5b의 퍼지는, 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 흘리는 가스 퍼지, 또는 진공 상태에 의한 퍼지의 어느 것이라도 좋다. 공정 ST5b에서는, 웨이퍼(W) 상에 과잉 부착된 분자도 제거될 수 있다. 이상에 의해서, 반응 전구체의 층(Ly1)은 매우 얇은 단분자층으로 된다.
공정 ST5b에 계속되는 공정 ST5c은, 제2 가스(가스 G2)의 플라즈마를 발생시켜, 상기 플라즈마를 전구체(공정 ST5a에 의해서 형성된 전구체이며 층(Ly1))에 공급하는 공정이다. 공정 ST5c에서는, 처리 용기(12)의 처리 공간(Sp) 내에서 가스(G2)의 플라즈마(P1)를 생성한다. 공정 ST5c에 있어서, 가스(G2)의 플라즈마(P1)가 생성될 때의 웨이퍼(W)의 온도는, 섭씨 0도 이상이며 또한 마스크(MK1)에 포함되는 재료의 유리 전이 온도 이하(예컨대 섭씨 200도 이하)이다. 구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터, 도 6의 부호 SRa에 나타내는 것과 같이, 가스 공급관(38) 및 가스 도입구(36c)를 통해, 산소(O)를 포함하는 가스(G2)를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다. 가스(G2)는 산소 또는 질소를 함유한다. 가스(G2)는 예컨대 O2 가스(산소 가스)를 포함할 수 있다. 이 경우, 도 6의 부호 SRb에 나타내는 것과 같이, 가스 도입구(52a)로부터는 가스를 공급하지 않거나, 또는 도 6의 부호 SRb의 파선에 나타내는 것과 같이, 가스 공급관(82) 및 가스 도입구(52a)를 통해 역류 방지 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
그리고, 도 6의 부호 SRc에 나타내는 것과 같이 제1 고주파 전원(62)으로부터 고주파 전력을 공급하지만, 도 6의 부호 SRd에 나타내는 것과 같이 제2 고주파 전원(64)의 바이어스 전력을 인가하지 않는다. 배기 장치(50)를 동작시킴으로써, 처리 용기(12)의 처리 공간(Sp) 내의 공간의 압력을 미리 설정된 압력으로 설정한다. 또한, 제1 고주파 전원(62)을 이용하지 않고서 제2 고주파 전원(64)만을 이용하여 플라즈마를 생성할 수도 있다.
상술한 것과 같이 공정 ST5a의 실행에 의해서 웨이퍼(W)의 주면에 부착된 분자(층(Ly1)의 단분자층을 구성하는 분자)는 실리콘과 수소의 결합을 포함한다. 실리콘과 수소의 결합 에너지는 실리콘과 산소의 결합 에너지보다도 낮다. 따라서, 도 7(b)에 도시한 것과 같이, 산소 가스를 포함하는 가스(G2)의 플라즈마(P1)가 생성되면, 산소의 활성종, 예컨대 산소 라디칼이 생성되고, 층(Ly1)의 단분자층을 구성하는 분자의 수소가 산소로 치환되어, 도 7(c)에 도시한 것과 같이, 산화실리콘인 층(Ly2)이 단분자층으로서 형성된다.
공정 ST5c에 계속되는 공정 ST5d에서는, 처리 용기(12)의 처리 공간(Sp) 내의 공간을 퍼지한다. 구체적으로는 공정 ST5c에 있어서 공급된 가스(G2)가 배기된다. 공정 ST5d에서는, 퍼지 가스로서, 예컨대 질소 가스 등의 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급하여도 좋다. 즉, 공정 ST5d의 퍼지는, 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 흘리는 가스 퍼지, 또는 진공 상태에 의한 퍼지의 어느 것이라도 좋다.
이상 설명한 것과 같이, 공정 ST5b에서 퍼지가 행해지고, 공정 ST5b에 계속되는 공정 ST5c에서 층(Ly1)을 구성하는 분자의 수소가 산소로 치환된다. 따라서, 박막 형성 공정(공정 ST5a∼공정 ST5d)의 실행에 의해서, 원자층 레벨의 막 두께의 박막(보호막(SX)을 구성하는 막)이 웨이퍼(W)의 주면 상에 형성된다. 1회의 박막 형성 공정의 실행에 의해서, ALD법과 마찬가지로, 산화실리콘의 층(Ly2)을, 웨이퍼(W)의 주면 상에, 마스크(MK1)의 조밀(粗密)에 상관없이 얇고 균일한 막 두께로 컨포멀하게 형성할 수 있다. 더욱이, 박막 형성 공정의 실행에 의해서, 도 10의 상태(CON2)에 도시한 것과 같이, 처리 용기(12) 내측의 표면에 박막(SXa)이 부착된다.
공정 ST5d에 계속되는 공정 ST5e은, 처리 용기(12) 내부 중 웨이퍼(W)의 상측에 있는 영역을 클리닝한다. 보다 구체적으로, 공정 ST5e은, 처리 용기(12) 내측에 있어서의 상부 전극(30) 측의 표면을 클리닝한다. 공정 ST5e에서는, 박막 형성 공정의 실행에 의해서 처리 용기(12) 내측의 표면에 부착된 박막(SXa) 중 상부 전극(30) 측의 표면에 부착된 부분(처리 용기(12) 내부 중 웨이퍼(W) 상측의 영역에 있는 부분)을, 도 10의 상태(CON3)에 도시한 것과 같이 제거한다.
공정 ST5e은 처리 공간(Sp)에 제3 가스(가스 G3)의 플라즈마를 발생시킨다. 공정 ST5e에서는, 처리 용기(12)의 처리 공간(Sp) 내에서 가스(G3)의 플라즈마를 생성한다. 공정 ST5e은, 웨이퍼(W)의 상측에 있는 상부 전극(30)으로부터 공급되는 고주파 전력을 이용하여 처리 용기(12) 내에 가스(G3)의 플라즈마를 생성한다. 공정 ST5e은, 제2 고주파 전원(64)을 이용한 바이어스 전압을 인가하지 않는다. 구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터, 도 6의 부호 SRa에 나타내는 것과 같이, 가스 공급관(38) 및 가스 도입구(36c)를 통해, 가스(G3)를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다. 이 경우, 도 6의 부호 SRb에 나타내는 것과 같이, 가스 도입구(52a)로부터는 가스를 공급하지 않거나, 또는 도 6의 부호 SRb의 파선에 나타내는 것과 같이, 가스 공급관(82) 및 가스 도입구(52a)를 통해 역류 방지 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
공정 ST5e에서는, 이하의 프로세스 조건(이하, 조건군(CND)이라고 한다)이 이용된다. 즉, 조건군(CND)은, 도 6의 부호 SRc에 나타내는 것과 같이 제1 고주파 전원(62)으로부터 고주파 전력을 공급하지만, 도 6의 부호 SRd에 나타내는 것과 같이 제2 고주파 전원(64)의 바이어스 전력을 인가하지 않는다고 하는 조건을 갖춘다. 조건군(CND)은 또한 와이드 갭 조건을 갖춘다. 본 설명에서 와이드 갭 조건이란, 전극 간격이 30[mm] 이상으로 되어 있는 상태를 의미한다. 예컨대 압력 100[mTorr]의 조건의 하에 있어서, 전극 간격이 30[mm] 미만인 경우에 갭 길이에 의존한 전자·이온 밀도 변동의 저감이 실험적으로 확인되고 있으며, 따라서 적어도 30[mm] 이상의 전극 간격을 갖고 있는 것이 바람직하다. 조건군(CND)은, 또한 배기 장치(50)를 동작시킴으로써, 처리 용기(12)의 처리 공간(Sp) 내의 공간의 압력을 미리 설정된 비교적 높은 압력으로 설정한다고 하는 조건을 갖춘다. 본 설명에서 높은 압력이란, 대략 100[mTorr] 이상의 압력이다. 100[mTorr] 이상의 압력 하에서는, 평균 자유 공정이 1[mm] 이하가 되어, 웨이퍼(W) 측으로의 라디칼, 이온의 입사가 충분히 저감되어, 웨이퍼(W) 측의 에칭 레이트가 억제될 수 있다.
공정 ST5e의 클리닝에 있어서의 에칭 레이트는, 공정 ST5e의 상기 프로세스조건(조건군 CND)에 의해서, 상부 전극(30) 측(처리 용기(12) 내의 상부) 쪽이 웨이퍼(W) 측(처리 용기(12) 내의 하부)보다도 비교적 높다. 조건군(CND)은, 상기한 것과 같이, 제1 고주파 전원(62)으로부터의 고주파 전력만을 공급하는 조건과, 처리 용기(12)의 처리 공간(Sp) 내의 압력을 비교적 높은 압력으로 하는 조건과, 와이드 갭 조건을 갖춘다.
조건군(CND) 중, 제1 고주파 전원(62)으로부터만 고주파 전력을 공급한다고 하는 조건에 의해서, 플라즈마 밀도 및 전자 밀도를 상부 전극(30) 측에 편재시킬 수 있다. 조건군(CND) 중, 처리 용기(12)의 처리 공간(Sp) 내의 압력을 비교적 높은 압력으로 하는 조건과 와이드 갭 조건에 의해서, 플라즈마 밀도 및 전자 밀도의 각 밀도 분포를 보다 상부 전극(30) 측에 편재시킬 수 있다.
시스(Sheath) 폭은 전자 밀도의 변동에 의해 변동되며, 시스 전압은 애노드/캐소드의 비에 의해서 결정된다. 본 설명에 있어서 애노드/캐소드의 비란, 면적비를 의미하고 있으며, 예컨대, 상부 전극(30) 및 하부 전극(LE)의 면적과, 각각에 도통하고 있는(각각의 전극과 동일 전위의) 부분의 면적을 합한 합계 면적이라고 말할 수 있다. 조건군(CND)에 있어서, 캐소드는 상부 전극(30)을 포함하고, 애노드는 웨이퍼(W)(하부 전극 LE)와 처리 용기(12) 내의 내벽을 포함하며, 애노드 측의 영역 쪽이 캐소드 측의 영역보다도 상대적으로 넓기 때문에 시스 전압도 저감된다.
따라서, 조건군(CND)에 있어서, 전자 밀도 및 시스 전압, 그리고 이온 에너지가, 도 12 및 도 13에 도시한 것과 같이, 상부 전극(30)으로부터 격리된 웨이퍼(W) 측에 있어서 충분히 저감되기 때문에, 조건군(CND)이 이용되는 공정 ST5e의 클리닝에 있어서, 에칭 레이트는 웨이퍼(W) 측 쪽이 상부 전극(30) 측보다도 작다.
도 12는 처리 용기(12) 내의 위치와 플라즈마 밀도의 상관을 도시하고 있으며, 도 12의 횡축은 처리 용기(12) 내의 위치를 나타내고, 도 12의 종축은 플라즈마 밀도를 나타내고 있다. 도 13은 처리 용기(12) 내의 위치와 플라즈마 밀도의 상관을 도시하고 있으며, 도 13의 횡축은 처리 용기(12) 내의 위치를 나타내고, 도 13의 종축은 이온 에너지를 나타내고 있다. 여기서, 플라즈마 밀도는, 플라즈마 중의 전자 밀도 및 이온 밀도를 의미하고 있다. 또한, 전자 밀도와 이온 밀도는 대략 같기 때문에, 플라즈마 밀도의 증감은 전자 밀도 및 이온 밀도의 증감을 반영하고 있다.
조건군(CND)에 따르면, 도 11에 도시한 것과 같이, 상부 전극(30) 측(처리 용기(12) 내의 상부)에 있어서의 박막(SXa)의 제거가, 웨이퍼(W) 측(처리 용기(12) 내의 하부)에 있어서의 박막(SXa)의 제거보다도 빠르게 완료된다.
도 11은 도 1에 도시한 클리닝 공정의 클리닝(공정 ST5e) 실행 시간 또는 도 1에 도시한 클리닝 공정의 클리닝(공정 ST5e)에 이용되는 고주파 전력과, 상기 클리닝에 의한 박막(SXa)의 나머지 두께와의 상관을 도시한 도면이다. 도 11의 횡축은, 공정 ST5e의 클리닝의 실행 시간 또는 공정 ST5e의 클리닝에 이용되는 제1 고주파 전원(62)의 고주파 전력을 나타내고 있고, 도 11의 종축은, 공정 ST5e의 클리닝 후의 박막(SXa)의 나머지 두께를 나타내고 있다.
공정 ST5e의 클리닝에 있어서, 상부 전극(30) 측의 에칭량(ET[nm])은, 상부 전극(30) 측의 에칭 레이트(ER[nm/sec])와 에칭 시간(T[sec])의 곱(ET[nm]=ER[nm/sec]×T[sec])이다. 에칭 시간(T[sec])은 공정 ST5e의 클리닝 실행 시간이다. 에칭 레이트는 제1 고주파 전원(62)의 고주파 전력(RF[W])에 대략 비례하기 때문에, 공정 ST5e의 클리닝에 있어서, 상부 전극(30) 측의 에칭량(ET[nm])은 RF[W]×T[sec]에 비례한다.
따라서, 공정 ST5e의 클리닝 실행 시에 있어서의 상부 전극(30) 측의 박막(SXa)의 막 두께(FT[nm])를 에칭량(ET[nm])으로 설정하면(FT[nm]=ET[nm]), FT[nm]=RF[W]×T[sec]를 만족하는 RF[W], T[sec]를 이용함으로써, 도 11에 도시한 것과 같이 웨이퍼(W)에 대한 에칭을 충분히 억제하면서 상부 전극(30) 측의 박막(SXa)을 충분히 제거할 수 있다. 이와 같이, 공정 ST5e의 클리닝에 있어서 설정할 수 있는 RF[W], T[sec]의 조합은, 비교적 높은 자유도를 가지고, 조건군(CND)과 정합하도록 적합하게 선택될 수 있다.
가스(G3)의 가스종은, 가스(G1)의 가스종 및 가스(G2)의 가스종의 조합, 즉, 특히 처리 용기(12)의 내측에 형성되는 박막(SXa)의 재료에 따라서 적합하게 선택될 수 있다.
박막(SXa)이 SiO2를 포함하는 물질인 경우, 예컨대 가스(G1)는 유기 함유의 아미노실란계 가스를 포함하는 가스 또는 사염화실리콘(SiCl4)을 포함하는 가스이고, 가스(G2)는 O2 가스, CO2 가스, CO 가스 등의 산소(O)를 포함하는 가스이고, 가스(G3)는 할로겐 화합물을 함유하며, 예컨대 CF4 가스, NF3 가스, SF6 가스 등의 불소(F)를 포함하는 가스일 수 있다.
박막(SXa)이 텅스텐(W)을 포함하는 물질인 경우, 예컨대 가스(G1)는 WF6 가스 등의 할로겐화텅스텐을 포함하는 가스이고, 가스(G2)는 수소(H2)를 포함하는 가스이고, 가스(G3)는 CF4 가스, NF3 가스, SF6 가스 등의 불소(F)를 포함하는 가스일 수 있다.
박막(SXa)이 TiO, TiN 등의 티탄(Ti)을 포함하는 물질인 경우, 예컨대, 가스(G1)는 사염화티탄(TiCl4) 또는 테트라키스디메틸아미노티탄(TDMAT)을 포함하는 가스이고, 가스(G2)는 물(H2O) 또는 암모니아(NH3)를 포함하는 가스이고, 가스(G3)는 CF4 가스, NF3 가스, SF6 가스, Cl2 가스 등의 할로겐(F, Cl 등)을 포함하는 가스일 수 있다.
박막(SXa)이 BOx, BN 등의 붕소(B)를 포함하는 물질인 경우, 예컨대 가스(G1)는 BBr3 가스, BCl3 가스 등의 할로겐화붕소를 포함하는 가스이고, 가스(G2)는 물(H2O) 또는 암모니아(NH3)를 포함하는 가스이고, 가스(G3)는 CF4 가스, NF3 가스, SF6 가스, Cl2 가스 등의 할로겐(F, Cl 등)을 포함하는 가스일 수 있다.
박막(SXa)이 유기막인 경우, 가스(G1) 및 가스(G2)는 모두 유기 화합물 가스를 포함한다. 보다 구체적으로, 박막(SXa)이 유기막인 경우, 가스(G1) 및 가스(G2)에 관해서는, (a) 가스(G1)가 전자 공여성의 치환기(제1 치환기)를 포함하며 또한 가스(G2)가 전자 흡인성의 치환기(제2 치환기)를 포함할 수 있다. 또는 (b) 가스(G1)가 전자 흡인성의 치환기를 포함하며 또한 가스(G2)가 전자 공여성의 치환기를 포함할 수 있다. 박막(SXa)이 유기막인 경우, 가스(G3)는 O2 가스, CO2 가스, CO 가스 등의 산소(O)를 포함하는 가스이다. 또한, 박막(SXa)이 유기막인 경우, 제1 공정(공정 ST5a∼공정 ST5d)은, 전자 공여성의 치환기를 포함하는 가스(G1)를 처리 공간(Sp)에 공급하여, 전자 공여성의 치환기를 패턴(웨이퍼(W)의 주면에 형성되어 있는 요철에 의해서 획정되는 패턴이며, 예컨대 마스크(MK1)에 의해서 획정되는 패턴)의 표면에 흡착시키는 공정이고, 제2 공정(공정 ST5e∼공정 ST5f)은, 전자 흡인성의 치환기를 포함하는 가스(G2)를 전자 공여성의 치환기에 공급하는 공정이다. 이와 같이, 전자 공여성의 치환기를 포함하는 가스(G1)의 재료와 전자 흡인성의 치환기를 포함하는 가스(G2)의 재료가 중합 반응함으로써, 퇴적막(보호막(SX)을 구성하는 박막)이 형성될 수 있다.
박막(SXa)이 유기막인 경우, 공정 ST5c에 있어서 플라즈마는 생성되지 않고, 유기막인 박막(SXa)은 가스(G1)의 재료와 가스(G2)의 재료가 중합 또는 열중합됨으로써 형성된다. 이와 같이 가스(G1)의 재료와 가스(G2)의 재료가 중합 또는 열중합하는 경우에 있어서도, ALD법과 마찬가지로 자기 제어(self-limiting)가 작용한다.
박막(SXa)이 유기막인 경우, 박막 형성 공정(특히 공정 ST5a 및 공정 ST5c)에 있어서, 웨이퍼(W)의 온도는 예컨대 섭씨 30도 이상 섭씨 200도 이하로 조절되는 경우가 있다.
박막(SXa)이 유기막인 경우에 관해서 보다 구체적으로 설명한다. 박막(SXa)이 유기막인 경우의 이하의 설명에서는, 편의상 가스(G1) 및 가스(G2) 중 어느 한쪽의 가스를 가스(GA)라고 하고, 가스(G1) 및 가스(G2) 중 상기 가스(GA) 이외의 나머지 한쪽의 가스를 가스(GB)라고 한다.
박막(SXa)이 유기막(요소 수지)인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 디아민 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 이소시아네이트 화합물을 포함하는 가스일 수 있다. 박막(SXa)이 요소 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 요소를 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 알데히드 화합물을 포함하는 가스일 수 있다.
제1 공정은, 이소시아네이트와 아민과의 중합 반응 또는 이소시아네이트와 수산기를 갖는 화합물과의 중합 반응에 의해서 퇴적막(보호막(SX)을 구성하는 박막)을 형성할 수 있다.
박막(SXa)이 폴리아미드 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 디아민 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 디카르복실산 화합물을 포함하는 가스일 수 있다.
박막(SXa)이 폴리에스테르 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 디올 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 디카르복실산 화합물을 포함하는 가스일 수 있다.
박막(SXa)이 폴리카보네이트 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 비스페놀 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 포스겐 화합물을 포함하는 가스일 수 있다.
보호막(SX)이 폴리우레탄 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 알코올 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 이소시아네이트 화합물을 포함하는 가스일 수 있다.
박막(SXa)이 에폭시 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 아민 화합물 또는 산무수물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 에폭시 화합물을 포함하는 가스일 수 있다.
박막(SXa)이 페놀 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 페놀 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 알데히드 화합물을 포함하는 가스일 수 있다.
박막(SXa)이 멜라민 수지인 경우, 예컨대, 가스(GA)는 전자 공여성의 치환기를 갖는 멜라민 화합물을 포함하는 가스이고, 가스(GB)는 전자 흡인성의 치환기를 갖는 알데히드 화합물을 포함하는 가스일 수 있다.
공정 ST5e에 계속되는 공정 ST5f에서는, 처리 용기(12)의 처리 공간(Sp) 내의 공간을 퍼지한다. 구체적으로는 공정 ST5e에 있어서 공급된 가스(G3)가 배기된다. 공정 ST5f에서는, 퍼지 가스로서, 예컨대 질소 가스 등의 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급하여도 좋다. 즉, 공정 ST5f의 퍼지는, 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 흘리는 가스 퍼지, 또는 진공 상태에 의한 퍼지의 어느 것이라도 좋다.
시퀀스 SQ1에 계속되는 공정 ST6에서는, 시퀀스 SQ1의 실행을 종료하는지 여부를 판정한다. 구체적으로는, 공정 ST6에서는, 시퀀스 SQ1의 실행 횟수가 미리 설정된 횟수에 달했는지 여부를 판정한다. 시퀀스 SQ1의 실행 횟수의 결정은, 웨이퍼(W) 상에 성막되는 보호막(SX)의 막 두께를 결정하는 것이다.
즉, 1회(단위 사이클)의 시퀀스 SQ1의 실행에 의해서 형성되는 박막의 막 두께와 시퀀스 SQ1의 실행 횟수의 곱에 의해서, 최종적으로 웨이퍼(W) 상에 형성되는 보호막(SX)의 막 두께가 실질적으로 결정된다. 따라서, 웨이퍼(W) 상에 형성되는 보호막(SX)의 원하는 막 두께에 따라서 시퀀스 SQ1의 실행 횟수가 설정된다.
공정 ST6에 있어서 시퀀스 SQ1의 실행 횟수가 미리 설정된 횟수에 달하지 않았다고 판정되는 경우에는(공정 ST6: NO), 시퀀스 SQ1의 실행이 다시 반복된다. 한편, 공정 ST6에 있어서 시퀀스 SQ1의 실행 횟수가 미리 설정된 횟수에 달했다고 판정되는 경우에는(공정 ST6: YES), 시퀀스 SQ1의 실행이 종료되고,공정 ST7으로 이행한다.
이에 따라, 도 4(d)에 도시한 것과 같이, 웨이퍼(W)의 주면 상에 산화실리콘의 보호막(SX)이 형성된다. 즉, 시퀀스 SQ1가 미리 설정된 횟수만큼 반복됨으로써, 미리 설정된 막 두께를 갖는 보호막(SX)이 마스크(MK1)의 조밀에 상관없이 균일한 막으로 컨포멀하게 웨이퍼(W)의 주면에 형성된다.
보호막(SX)은, 도 4(d)에 도시한 것과 같이, 영역(R11), 영역(R21) 및 영역(R31)을 포함한다. 영역(R31)은, 마스크(MK1)의 측면 상 및 마스크(ALM)의 측면 상에 있어서 그 측면을 따라서 연장되는 영역이다. 영역(R31)은 유기막(OL)의 표면에서부터 영역(R11)의 아래쪽까지 연장되어 있다. 영역(R11)은 마스크(MK1)의 상면 상 및 영역(R31) 상에서 연장되어 있다. 영역(R21)은, 인접하는 영역(R31)의 사이에서 또한 유기막(OL)의 표면 상에서 연장되어 있다.
상술한 것과 같이, 시퀀스 SQ1는 ALD법과 같은 방법에 의해서 보호막(SX)을 형성하기 때문에, 마스크(MK1)의 조밀에 상관없이, 영역(R11), 영역(R21) 및 영역(R31)의 각각의 막 두께는 상호 대략 같은 막 두께가 된다.
또한, 상기한 시퀀스 SQ1 및 공정 ST6의 성막 공정에서 성막되는 보호막(SX)의 막 두께는 웨이퍼(W)의 주면 온도에 따라서 증감하기 때문에, 공정 ST4 실행 후의 시퀀스 SQ1의 실행 전에, 웨이퍼(W) 주면의 복수 영역(ER)(도 3을 참조)마다 온도 조절부(HT)를 이용하여 웨이퍼(W) 주면의 온도를 조절함으로써, 웨이퍼(W) 주면 상에 있어서 보호막(SX)의 막 두께를 조절하는 공정(이하의 설명에서는 온도 조절 공정이라고 하는 경우가 있다)을 행할 수 있다. 이 온도 조절 공정은, 일 실시형태에서는 공정 ST1(웨이퍼를 준비하는 공정)에 포함될 수 있지만, 이것에 한하지 않고, 맨 처음에 공정 ST5a의 실행 전이라면, 예컨대 공정 ST4 후에 실행되는 것도 가능하다.
상기한 온도 조절 공정에 있어서, 제어부(Cnt)는, 시퀀스 SQ1 및 공정 ST6의 성막 공정에 있어서의 웨이퍼(W) 주면의 온도와 트렌치(웨이퍼(W)의 주면에 형성된 패턴에 포함되는 트렌치)의 내면에 퇴적하는 막(시퀀스 SQ1 및 공정 ST6의 성막 공정에 의해서 형성되는 막)의 막 두께와의 대응을 나타내는 미리 취득된 대응 데이터(DT)를 이용하여, 상기 트렌치에 있어서, 상기 막의 형성에 의해서 웨이퍼(W) 주면에 있어서의 트렌치 폭의 변동을 저감하도록(또는 웨이퍼(W) 주면의 영역(ER) 마다 트렌치 폭을 원하는 폭으로 하도록) 웨이퍼(W) 주면의 온도를 복수의 영역(ER)마다 조절한다. 대응 데이터(DT)는, 웨이퍼(W) 주면의 온도마다 시퀀스 SQ1 및 공정 ST6의 성막 공정과 동일한 조건(웨이퍼(W) 주면의 온도를 제외한 조건) 하에서 웨이퍼(W)의 주면에 막을 퇴적시킴으로써 미리 얻어진 데이터이며, 제어부(Cnt)의 기억부에 독출이 자유롭게 저장되어 있다.
즉, 온도 조절 공정에 있어서, 제어부(Cnt)는, 영역(ER)마다의 원하는 막 두께에 대응하는 온도가 되도록, 웨이퍼(W) 주면의 온도를, 온도 조절부(HT)와 대응 데이터(DT)를 이용하여 영역(ER)마다 조절한다. 온도 조절 공정에 의해서 온도 조절된 웨이퍼(W)의 주면에 대하여 시퀀스 SQ1 및 공정 ST6의 성막 공정을 행함으로써, 웨이퍼(W) 주면에 있어서의 트렌치 폭을 원하는 폭으로 할 수 있으며, 특히 트렌치 폭의 변동을 저감할 수 있다.
도 8을 참조하여 설명한다. 도 8에 도시하는 선 GRa은, 시퀀스 SQ1에 의해서 형성되는 박막(보호막(SX)을 구성하는 막)의 막 두께와, 이 막이 형성되는 웨이퍼(W) 주면의 온도와의 대응을 나타내고 있으며, 아레니우스(Arrhenius)의 식(아레니우스 플롯)에 대응하고 있다. 도 8의 횡축은 시퀀스 SQ1에 의해서 박막이 형성되는 웨이퍼(W) 주면의 온도를 나타내고 있다. 도 8의 종축은 시퀀스 SQ1에 의해서 형성되는 박막의 막 두께를 나타내고 있다. 특히, 도 8의 횡축에 나타내는 막 두께는, 시퀀스 SQ1에 있어서 이용되는 ALD법에 있어서의 자기 제어(self-limited) 영역에 이르는 시간 이상의 시간으로 형성되는 박막의 막 두께이다.
도 8에 도시한 것과 같이, 웨이퍼(W) 주면의 온도가 값 T1인 경우에, 웨이퍼(W)의 상기 주면에 형성되는 막의 막 두께는 값 W1이 되고, 웨이퍼(W)의 상기 주면의 온도가 값 T2(T2>T1)인 경우에 웨이퍼(W)의 상기 주면에 형성되는 막의 막 두께는 값 W2(W2>W1)이 된다. 이와 같이, ALD법을 이용한 경우, 웨이퍼(W) 주면의 온도를 높일수록 상기 주면에 형성되는 보호막(SX)의 막 두께를 두껍게 할 수 있다.
웨이퍼(W) 주면의 온도와, 보호막(SX)의 형성에 이용되는 전구체(층 Ly1)의 두께의 상관에 관해서 설명한다. 도 7에 도시한 전구체(층 Ly1)의 두께는, 웨이퍼(W) 주면의 온도에 따라서 증감할 수 있지만, 전구체의 두께와 웨이퍼(W) 주면의 온도의 상관성 정도는 처리 용기(12) 내의 환경에 의존한다.
도 14에 도시한 것과 같이, 전구체의 재료를 포함하는 가스(일 실시형태에서는 가스(G1))는 피흡착 표면(일 실시형태에서는 웨이퍼(W)의 주면)에의 전구체의 흡착, 처리 용기(12)의 내벽면에의 전구체의 흡착, 처리 용기(12)에 있어서 흡착되지 않고서 그대로 배기 중 어느 것에 의해 소비된다. 도 14는, 처리 용기(12) 내에 있어서의 전구체의 소비 비율과 ALD(일 실시형태에서는 공정 ST5a∼공정 ST5d의 박막 형성 공정)의 사이클수의 상관을 도시한 도면이다. 도 14의 횡축은 ALD의 사이클수를 나타내고, 도 14의 종축은 전구체의 소비 비율을 나타낸다.
도 14에 도시한 것과 같이, 피흡착 표면에 흡착되는 전구체의 비율(영역 Q1a) 및 처리 용기(12)의 내벽면에 흡착되는 전구체의 비율(영역 Q1b)의 합계는, 처리 용기(12) 내에서 흡착되지 않고서 그대로 배기되는 전구체의 비율(영역 Q2)과 비교하여 크다.
ALD에 있어서, 전구체는 피흡착 표면에 화학 흡착하며, 원자층의 1층분만큼 흡착한다. 이 경우, 피흡착 표면에는 전구체가 화학 흡착(화학 결합)하기 위한 특정 치환기가 노출되어 있지 않으면 안 되지만, 클리닝 직후의 처리 용기(12)의 내벽면은, 화학 흡착에 필요한 치환기가 노출되어 있지 않다. 이 때문에, ALD의 복수 사이클의 초기에 있어서는, 전구체가 처리 용기(12)의 내벽면에 대하여, 화학 흡착이 아니라 물리 흡착에 의해서, 1층이 아니라 다층 흡착하여, 필요 이상으로 전구체를 소비할 수 있다.
따라서, ALD의 복수 사이클의 초기에 있어서는, 도 15에 도시한 것과 같이, 피흡착 표면에 도달하는 전구체의 유량(분압) 정도는 비교적 작다. 전구체의 재료를 포함하는 가스에 있어서의 이러한 저유량 조건 하에서는, 원자층의 몇 층분에 상당하는 분자수의 변동에 의한 영향은 비교적 크고, 따라서, 막 두께의 제어에 있어서 비교적 높은 분해능이 실현될 수 있다.
도 15는 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 전구체의 재료를 포함하는 가스의 유량(분압) 정도와 ALD의 사이클수의 상관을 도시한 도면이다. 도 15의 횡축은 ALD의 사이클수를 나타내고, 도 15의 종축은 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도를 나타낸다.
한편, ALD의 복수 사이클의 후기에 있어서는, 처리 용기(12)의 내벽면에 막이 형성되어, 화학 흡착에 필요한 치환기가 표면에 노출되게 된다. 이 결과, 처리 용기(12)의 내벽면은 원자층의 1층분의 전구체밖에 소비하지 않고, 결과적으로 도 15에 도시한 것과 같이, 피흡착 표면에 도달하는 전구체의 재료를 포함하는 가스의 유량(분압) 정도가 커진다. 이와 같이, ALD의 사이클수의 증가와 함께, 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도가 커진다.
피흡착 표면에 있어서의 전구체의 흡착량은 피흡착 표면의 온도에 따라 변화된다. 도 16은 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도와 피흡착 표면에 있어서의 전구체의 흡착량 정도의 상관의 온도 의존성을 도시한 도면이다. 도 16의 횡축은 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도를 나타내고, 도 16의 종축은 피흡착 표면에 있어서의 전구체의 흡착량 정도를 나타내고 있다.
도 16에 도시한 것과 같이, ALD에 있어서, 피흡착 표면에 있어서의 전구체의 흡착량은, 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도와 피흡착 표면의 온도에 의존한다. 피흡착 표면의 온도가 비교적 낮은 경우(도 16의 파선), 피흡착 표면에 있어서의 전구체의 재료를 포함하는 가스의 유량(분압) 정도가 비교적 작으면(영역 K1), 피흡착 표면에 있어서의 전구체의 흡착량 정도가 비교적 작고, 피흡착 표면에 있어서의 전구체의 재료를 포함하는 가스의 유량(분압) 정도가 비교적 커질수록(영역 K2), 피흡착 표면에 있어서의 전구체의 흡착량 정도도 커져, 전구체의 흡착량이 포화치에 가까워진다.
한편, 피흡착 표면의 온도가 비교적 높은 경우(도 16의 실선), 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도가 비교적 작은 경우(영역 K1)에 있어서도, 피흡착 표면에 있어서의 전구체의 흡착량 정도가 크고, 따라서, 피흡착 표면에 있어서의 전구체의 흡착량 정도는, 전구체의 재료를 포함하는 가스의 피흡착 표면에 있어서의 유량(분압) 정도가 비교적 넓은 범위에 걸쳐(영역 K2), 대략 포화 흡착량 정도로 되고 있다.
일 실시형태에서는, 시퀀스 SQ1와 같이, ALD(공정 ST5a∼공정 ST5d)의 각 사이클의 실행마다 처리 용기(12) 내부가 클리닝(공정 ST5e∼공정 ST5f)되기 때문에, ALD의 각 사이클의 실행 시에는, 처리 용기(12) 내부는 항상 클리닝 후의 상태로 되어 있다. 처리 용기(12) 내부의 클리닝 후의 상태는, 도 14 및 도 15에 도시한 것과 같은 ALD의 복수 사이클의 초기에 있어서의 처리 용기(12) 내부의 상태에 대응하고 있기 때문에, 일 실시형태에 있어서 ALD(공정 ST5a∼공정 ST5d)의 각 사이클의 실행 시에는, 항상 전구체의 재료를 포함하는 가스(가스 G1)의 피흡착 표면(웨이퍼(W)의 주면)에 있어서의 유량(분압) 정도가 비교적 작고, 따라서, 도 16의 영역(K1)의 경우에 해당되어, 웨이퍼(W) 주면에 있어서의 전구체의 흡착량 정도는, 웨이퍼(W) 주면의 온도 증감에 따라 충분히 효과적으로 증감될 수 있다.
시퀀스 SQ1와 같이, ALD(공정 ST5a∼공정 ST5d)의 각 사이클의 실행마다 처리 용기(12) 내부가 클리닝(공정 ST5e∼공정 ST5f)되는 경우, 도 17의 선 Gc1에 나타내는 것과 같이, ALD의 사이클수의 증가에 상관없이, 피흡착 표면(웨이퍼(W)의 주면)에 있어서의 DPC(Deposition per cycle)[nm/cycle]는 비교적 작은 값으로 대략 일정하게 유지된다. 한편, ALD의 각 사이클의 실행마다 클리닝을 행하지 않는 경우에는, 도 17의 선 Gc2에 나타내는 것과 같이, 피흡착 표면에 있어서의 DCP[nm/cycle]는 ALD의 사이클수의 증가에 따라 증가한다.
도 17은 ALD의 각 사이클에 있어서 클리닝을 행하는 경우에 있어서의 DPC와, 클리닝을 행하지 않는 경우의 DPC를 비교하는 도면이다. 도 17의 횡축은 ALD의 사이클수를 나타내고, 도 17의 종축은 피흡착 표면에 있어서의 DPC[nm/cycle]를 나타낸다.
또한, 이와 같이 웨이퍼(W) 주면에의 전구체의 흡착량을 비교적 적게 억제함으로써, 원자층의 1층분보다도 작은 단위로 DPC[nm/cycle]를 제어하는 것이 가능하게 된다. 일 실시형태로서는, 웨이퍼(W)의 주면과 처리 용기(12) 내의 내벽면을 합계한 면적에 대하여 원자층의 1층분을 흡착했을 때의 흡착량(분자수)이, ALD의 1 사이클 당 전구체의 공급량(분자수)의 예컨대 20% 이상으로 한다. 즉, 웨이퍼(W)의 주면 및 처리 용기(12) 내의 내벽면 전면을 피복할 뿐인 전구체의 총량에 대하여, 전구체의 급량이 충분히 크지 않을 때, 전구체의 분압은 작아지기 때문에, 온도차에 의한 흡착량의 차가 생기기 쉽게 된다. 이 조건을 만족하기 위해서는, 전구체의 재료를 포함하는 가스(G1)의 유량을 충분히 낮게 설정하는 것과, 처리 용기(12)의 용적을 크게 하는 것의 두 가지 방법을 들 수 있다.
처리 용기(12) 내부가 클리닝되지 않는 경우에는, 도 18에 도시한 것과 같이, 1 사이클 당 형성될 수 있는 막의 두께 DCP[nm/cycle]는 비교적 크지만, ALD의 사이클 증가에 상관없이 DCP[nm/cycle]는 대략 일정한 값으로 될 수 있다. 도 18은 클리닝이 행해지지 않은 처리 용기(12) 내에 있어서의 ALD의 사이클수와 DPC의 상관을 도시한 도면이다. 도 18의 횡축은 ALD의 사이클수를 나타내고, 도 18의 종축은 DPC[nm/cycle]를 나타내고 있다.
웨이퍼(W) 주면의 온도에 의해서 주면에 형성되는 막의 두께는 변화할 수 있지만, 도 18에 도시한 것과 같이, 클리닝이 이뤄지지 않고서 퇴적막의 형성이 반복되는 경우에는, 퇴적막의 형성이 반복되는 중에 웨이퍼(W) 주면의 온도에 따른 막 두께의 변화 정도가 저감하고, 따라서, 웨이퍼(W) 주면의 온도 조절을 유효하게 행할 수 없는 경우가 생길 수 있다. 이에 대하여, 일 실시형태에 있어서의 방법(MT)의 성막 방법에서는, 웨이퍼(W) 주면이 온도 조절된 후에 퇴적막의 형성이 행해지지지만, 퇴적막의 형성이 행해질 때마다 클리닝도 행해지기 때문에, 퇴적막의 형성이 반복되더라도, 웨이퍼(W) 주면의 온도 조절은, 웨이퍼(W) 주면에 있어서의 퇴적막의 막 두께 제어에 있어서 충분히 유효하게 기능할 수 있다. 또한, 미리 취득된 대응 데이터(DT)가 이용되기 때문에, 웨이퍼(W) 주면의 온도 조절이 보다 정확하게 재현성 좋게 실행될 수 있다.
실제로, 처리 용기(12) 내부가 클리닝되는 경우에는, 도 19에 도시한 것과 같이, 1 사이클 당 형성될 수 있는 막의 두께 DCP[nm/cycle]는 비교적 작고, ALD의 사이클 증가에 따라 DCP[nm/cycle]도 증가한다. 도 19는 클리닝이 행해진 처리 용기(12) 내에 있어서의 ALD의 사이클수와 DPC의 상관을 도시한 도면이다. 도 19의 횡축은 ALD의 사이클수를 나타내고, 도 19의 종축은 DPC[nm/cycle]를 나타내고 있다.
또한, 시퀀스 SQ1는, 상기한 것과 같이, ALD법과 같은 방법에 의해서 성막을 행하는 박막 형성 공정(공정 ST5a∼공정 ST5d)과, 웨이퍼(W)의 상측(처리 용기(12) 내의 천장 측)에 있어서의 처리 용기(12)의 내측 부분을 상기 박막 형성 공정의 1회의 실행마다 클리닝하는 클리닝 공정(공정 ST5e, 공정 ST5f)을 갖춘다. 박막 형성 공정은 ALD법과 같은 방법이기 때문에, 1회의 박막 형성 공정에 의해서 처리 용기(12)의 내측에 형성되는 막의 막 두께는 원자층 레벨의 막 두께이다. 이 때문에, 1회의 박막 형성 공정의 실행마다 행해지는 클리닝 공정에서는, 이러한 원자층 레벨의 막 두께의 막이 제거되기 때문에, 클리닝 공정의 실행 시간이 충분히 짧더라도 처리 용기(12) 내측의 막 중 웨이퍼(W) 상측에 있어서의 부분이 충분히 제거될 수 있다.
예컨대 1장의 웨이퍼(W) 에 대하여 시퀀스 SQ1를 20회 반복하는 처리 시간은, 클리닝 공정을 행하지 않고서 박막 형성 공정만을 20회 반복하는 처리 시간과 이 박막 형성 공정 후에 처리 용기(12) 내측의 클리닝을 1회만 행하는 처리 시간(웨이퍼를 이용한 클리닝의 경우에는 그 웨이퍼의 반송에 드는 처리 시간을 포함한다)을 합계한 처리 시간과 비교하여 짧아질 수 있다.
도 20은 박막 형성 공정을 20회 행한 경우에 있어서의 웨이퍼(W)의 1장마다의 처리 시간의 내역을 도시한 도면이다. 도 21은 웨이퍼(W)의 1장마다 박막 형성 공정의 반복 횟수와 처리 시간의 상관을 도시한 도면이다.
클리닝 공정을 행하지 않고서 박막 형성 공정만을 20회 반복함과 더불어 박막 형성 공정을 20회 반복하여 행한 후에 웨이퍼를 이용하여 처리 용기(12) 내측의 클리닝을 1회만 행하는 경우의 처리 시간(처리 시간 TP1이라고 한다)의 내역이, 도 20의 장방형 GR1에 표시되어 있다. 장방형 GR1에 있어서 부호 ALD1에 나타내는 부분은 박막 형성 공정의 20회분의 처리 시간을 나타내고 있다. 박막 형성 공정의 1회분의 처리 시간을 40[s/회] 정도라고 하면, 박막 형성 공정의 20회분의 처리 시간은 800[s](=40[s/회]×20[회]) 정도가 된다.
장방형 GR1에 있어서 부호 DC1에 나타내는 부분은, 박막 형성 공정이 20회 반복하여 행해진 경우에 처리 용기(12) 내측의 클리닝에 드는 처리 시간을 나타내고 있다. 박막 형성 공정이 20회 반복하여 행해진 경우에 처리 용기(12) 내측의 클리닝에 드는 처리 시간은 300[s] 정도이다. 장방형 GR1에 있어서 부호 TR1에 나타내는 부분은 처리 용기(12) 내측의 클리닝에 이용되는 웨이퍼의 반송에 드는 처리 시간을 나타내고 있다. 웨이퍼의 반송에 드는 처리 시간은 60[s] 정도이다.
따라서, 장방형 GR1에 의해서 표시되는 처리 시간, 즉, 클리닝 공정을 행하지 않고서 박막 형성 공정만을 20회 반복함과 더불어 박막 형성 공정을 20회 반복하여 행한 후에 웨이퍼를 이용하여 처리 용기(12) 내측의 클리닝을 1회만 행하는 경우의 처리 시간 TP1은 1160[s] 정도가 된다.
또한, 클리닝 공정을 행하지 않고서 박막 형성 공정만을 20회 반복함과 더불어 박막 형성 공정을 20회 반복하여 행한 후에 웨이퍼를 이용하지 않고서 처리 용기(12) 내측의 클리닝을 1회만 행하는 경우의 처리 시간(처리 시간 TP2이고 한다)의 내역이, 도 20의 장방형 GR2에 표시되어 있다. 장방형 GR2에 있어서 부호 ALD2에 나타내는 부분은 박막 형성 공정의 20회분의 처리 시간을 나타내고 있다. 박막 형성 공정의 1회분의 처리 시간을 40[s/회] 정도로 하면, 박막 형성 공정의 20회분의 처리 시간은 800[s](=40[s/회]×20[회]) 정도가 된다.
장방형 GR2에 있어서 부호 DC2에 나타내는 부분은, 박막 형성 공정이 20회 반복하여 행해진 경우에 처리 용기(12) 내측의 클리닝에 드는 처리 시간을 나타내고 있다. 박막 형성 공정이 20회 반복하여 행해진 경우에 처리 용기(12) 내측의 클리닝에 드는 처리 시간은 300[s] 정도이다.
따라서, 장방형 GR2에 의해서 표시되는 처리 시간, 즉, 클리닝 공정을 행하지 않고서 박막 형성 공정만을 20회 반복함과 더불어 박막 형성 공정을 20회 반복하여 행한 후에 웨이퍼를 이용하지 않고서 처리 용기(12) 내측의 클리닝을 1회만 행하는 경우의 처리 시간 TP2은 1100[s] 정도가 된다.
한편, 박막 형성 공정과 박막 형성 공정 후에 행하는 클리닝 공정을 갖춘 시퀀스 SQ1를 20회 반복하여 행하는 경우의 처리 시간(처리 시간 TP3이라고 한다)의 내역이, 도 20의 장방형 GR3에 표시되어 있다. 장방형 GR3에 있어서 부호 ALD3에 나타내는 부분은, 박막 형성 공정과 박막 형성 공정 후에 행하는 클리닝 공정을 구비하는 시퀀스 SQ1의 20회분의 처리 시간을 나타내고 있다. 박막 형성 공정과 클리닝 공정을 갖춘 시퀀스 SQ1의 1회분의 처리 시간을 45[s/회] 정도로 하면, 시퀀스 SQ1의 20회분의 처리 시간은 900[s](=45[s/회]×20[회]) 정도가 된다.
도 21에 도시한 것과 같이, 박막 형성 공정의 반복 횟수가 많을수록 상기한 처리 시간 TP1 및 처리 시간 TP2은 본 실시형태에 따른 상기한 처리 시간 TP3과 비교하여 길어져, 양자의 차는 현저하게 된다.
도 1로 되돌아가 설명한다. 공정 ST6에 계속되는 공정 ST7에서는, 영역(R11) 및 영역(R21)을 제거하도록 보호막(SX)을 에칭(에치백)한다. 영역(R11) 및 영역(R21)의 제거를 위해서는 이방성의 에칭 조건이 필요하다. 이 때문에, 공정 ST7에서는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터 가스 공급관(38) 및 가스 도입구(36c)를 통해, 플루오로카본계 가스를 포함하는 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
그리고, 제1 고주파 전원(62)으로부터 고주파 전력을 공급한다. 제2 고주파 전원(64)으로부터 고주파 바이어스 전력을 공급한다. 배기 장치(50)를 동작시킴으로써, 처리 용기(12)의 처리 공간(Sp) 내의 공간의 압력을 미리 설정된 압력으로 설정한다. 이에 따라, 플루오로카본계 가스의 플라즈마가 생성된다.
생성된 플라즈마 중 불소를 포함하는 활성종은, 고주파 바이어스 전력에 의한 연직 방향으로의 인입에 의해서, 영역(R11) 및 영역(R21)을 우선적으로 에칭한다. 그 결과, 도 5(a)에 도시한 것과 같이, 영역(R11) 및 영역(R21)이 선택적으로 제거되고, 남겨진 영역(R31)에 의해서 마스크(MS)가 형성된다. 마스크(MS)와 보호막(PF) 및 마스크(ALM)는 유기막(OL) 표면 상의 마스크(MK2)를 구성한다.
공정 ST7에 계속되는 공정 ST8에서는 유기막(OL)을 에칭한다. 구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터 가스 공급관(38)및 가스 도입구(36c)를 통해, 질소 가스와 수소 가스를 포함하는 가스를 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
그리고, 제1 고주파 전원(62)으로부터 고주파 전력을 공급한다. 제2 고주파 전원(64)으로부터 고주파 바이어스 전력을 공급한다. 배기 장치(50)를 동작시킴으로써, 처리 용기(12)의 처리 공간(Sp) 내의 공간의 압력을 미리 설정된 압력으로 설정한다. 이에 따라, 질소 가스와 수소 가스를 포함하는 가스의 플라즈마가 생성된다.
생성된 플라즈마 중의 수소의 활성종인 수소 라디칼은, 유기막(OL)의 전체 영역 중 마스크(MK2)로부터 노출된 영역을 에칭한다. 이에 따라, 도 5(b)에 도시한 것과 같이, 유기막(OL)으로부터 마스크(OLM)가 형성된다. 또한, 유기막(OL)을 에칭하는 가스로서는 산소를 포함하는 가스를 이용하여도 좋다.
도 1에 도시한 방법(MT)에서는, 공정 ST8에 이어서 시퀀스 SQ2를 1회 이상 실행한다. 시퀀스 SQ2는, 도 5(b) 및 도 5(c)에 도시한 것과 같이, ALE(Atomic Layer Etching)법과 같은 방법에 의해서, 피에칭층(EL) 중 마스크(OLM)로 덮여 있지 않은 영역을, 마스크(OLM)의 소밀(疏密)에 상관없이 높은 선택비로 정밀하게 에칭하는 공정이며, 시퀀스 SQ2에 있어서 순차 실행되는 공정 ST9a, 공정 ST9b, 공정 ST9c, 공정 ST9d을 포함한다.
공정 ST9a은, 처리 용기(12)의 처리 공간(Sp) 내에서 가스(G4)의 플라즈마를 생성하여, 도 5(b)에 도시한 것과 같이, 이 플라즈마에 포함되는 라디칼을 포함하는 혼합층(MX)을 피에칭층(EL)의 표면의 원자층에 형성한다. 혼합층(MX)은, 피에칭층(EL) 중 마스크(OLM)에 의해서 덮여 있지 않은 영역의 표면의 원자층에 형성된다. 공정 ST9a에 있어서, 웨이퍼(W)가 정전 척(ESC) 상에 배치되어 있는 상태에 있어서, 처리 용기(12)의 처리 공간(Sp) 내에 가스(G4)를 공급하여, 가스(G4)의 플라즈마를 생성한다.
가스(G4)는, 실리콘을 함유하는 피에칭층(EL)의 에칭에 알맞은 에천트 가스(Etchant gas)이며, 예컨대 플루오로카본계 가스와 희가스를 포함하고, 예컨대 CxFy/Ar 가스일 수 있다. CxFy는 예컨대 CF4일 수 있다. 구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터, 플루오로카본계 가스와 희가스를 포함하는 가스(G4)를, 가스 공급관(38) 및 가스 도입구(36c)를 통해, 처리 용기(12)의 처리 공간(Sp) 내에 공급한다.
그리고, 제1 고주파 전원(62)으로부터 고주파 전력을 공급하고, 제2 고주파 전원(64)으로부터 고주파 바이어스 전력을 공급하여, 배기 장치(50)를 동작시킴으로써 처리 용기(12)의 처리 공간(Sp) 내의 공간의 압력을 미리 설정된 압력으로 설정한다. 이와 같이 하여, 가스(G4)의 플라즈마가 처리 용기(12)의 처리 공간(Sp) 내에서 생성된다. 가스(G4)의 플라즈마는 탄소 라디칼 및 불소 라디칼을 포함한다.
도 9에 있어서, 하얗게 된 동그라미(백환)는 피에칭층(EL)을 구성하는 원자를 나타내고 있고, 검게 칠한 동그라미(흑환)는 라디칼을 나타내고 있고, 동그라미로 둘러싸인 「+」는 후술하는 가스(G5)에 포함되는 희가스의 원자의 이온(예컨대 Ar 원자의 이온)을 나타내고 있다. 도 9(a)에 도시한 것과 같이, 공정 ST9a에 의해서, 가스(G4)의 플라즈마에 포함되는 탄소 라디칼 및 불소 라디칼이 피에칭층(EL)의 표면에 공급된다.
이와 같이, 공정 ST9a에 의해서, 피에칭층(EL)을 구성하는 원자와 탄소 라디칼 및 불소 라디칼을 포함하는 혼합층(MX)이, 도 5(b)에 도시한 것과 같이, 피에칭층(EL)의 표면에 형성된다.
이상과 같이, 가스(G4)가 플루오로카본계 가스를 포함하기 때문에, 공정 ST9a에 있어서, 피에칭층(EL) 표면의 원자층에 불소 라디칼 및 탄소 라디칼이 공급되어, 상기 원자층에 상기 양 라디칼을 함유하는 혼합층(MX)이 형성될 수 있다.
공정 ST9a에 계속되는 공정 ST9b에서는, 처리 용기(12)의 처리 공간(Sp) 내의 공간을 퍼지한다. 구체적으로는 공정 ST9a에 있어서 공급된 가스(G4)가 배기된다. 공정 ST9b에서는, 퍼지 가스로서, 예컨대 질소 가스 또는 희가스(예컨대 Ar 가스 등) 등의 불활성 가스를, 처리 용기(12)의 처리 공간(Sp) 내에 공급하여도 좋다. 즉, 공정 ST9b의 퍼지는, 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 흘리는 가스 퍼지, 또는 진공 상태에 의한 퍼지의 어느 것이라도 좋다.
공정 ST9b에 계속되는 공정 ST9c에서, 처리 용기(12)의 처리 공간(Sp) 내에 있어서 가스(G5)의 플라즈마를 생성하고, 이 플라즈마에 바이어스 전압을 인가하여 혼합층(MX)을 제거한다. 가스(G5)는 희가스를 포함하며, 예컨대 Ar 가스를 포함할 수 있다.
구체적으로는, 가스 소스군(40)의 복수의 가스 소스 중 선택한 가스 소스로부터 희가스(예컨대 Ar 가스)를 포함하는 가스(G5)를, 가스 공급관(38) 및 가스 도입구(36c)를 통해 처리 용기(12)의 처리 공간(Sp) 내에 공급하고, 제1 고주파 전원(62)으로부터 고주파 전력을 공급하고, 제2 고주파 전원(64)으로부터 고주파 바이어스 전력을 공급하여, 배기 장치(50)를 동작시킴으로써 처리 용기(12)의 처리 공간(Sp) 내의 공간의 압력을 미리 설정된 압력으로 설정한다. 이와 같이 하여, 가스(G5)의 플라즈마가 처리 용기(12)의 처리 공간(Sp) 내에서 생성된다.
생성된 플라즈마 중의 가스(G5)의 원자의 이온(예컨대 Ar 원자의 이온)은, 고주파 바이어스 전력에 의한 연직 방향으로의 인입에 의해서, 피에칭층(EL) 표면의 혼합층(MX)에 충돌하여, 이 혼합층(MX)에 에너지를 공급한다. 도 9(b)에 도시한 것과 같이, 공정 ST9c에 의해서, 피에칭층(EL)의 표면에 형성된 혼합층(MX)에 가스(G5)의 원자의 이온을 통해 에너지가 공급되고, 이 에너지에 의해서 피에칭층(EL)으로부터 혼합층(MX)이 제거될 수 있다.
이상과 같이, 가스(G5)가 희가스를 포함하기 때문에, 공정 ST9c에 있어서, 피에칭층(EL)의 표면에 형성된 혼합층(MX)은 상기 희가스의 플라즈마가 바이어스 전압에 의해서 받는 에너지에 의해서 상기 표면으로부터 제거될 수 있다.
공정 ST9c에 계속되는 공정 ST9d에서는, 처리 용기(12)의 처리 공간(Sp) 내의 공간을 퍼지한다. 구체적으로는 공정 ST9c에 있어서 공급된 가스(G5)가 배기된다. 공정 ST9d에서는, 퍼지 가스로서, 예컨대 질소 가스 또는 희가스(예컨대 Ar 가스 등) 등의 불활성 가스를 처리 용기(12)에 공급하여도 좋다. 즉, 공정 ST9d의 퍼지는, 불활성 가스를 처리 용기(12)의 처리 공간(Sp) 내에 흘리는 가스 퍼지, 또는 진공 상태에 의한 퍼지의 어느 것이라도 좋다.
도 9(c)에 도시한 것과 같이, 공정 ST9d에서 행해지는 퍼지에 의해서, 피에칭층(EL) 표면의 혼합층(MX)을 구성하는 원자 및 가스(G5)의 플라즈마에 포함되는 과잉 이온(예컨대 Ar 원자의 이온)도 충분히 제거될 수 있다.
시퀀스 SQ2에 계속되는 공정 ST10에서는, 시퀀스 SQ2의 실행을 종료하는지 여부를 판정한다. 구체적으로는 공정 ST10에서는, 시퀀스 SQ2의 실행 횟수가 미리 설정된 횟수에 달했는지 여부를 판정한다. 시퀀스 SQ2의 실행 횟수의 결정은 피에칭층(EL)에 대한 에칭 정도(깊이)를 결정하는 것이다.
시퀀스 SQ2는, 기판(SB)의 표면에 이를 때까지 피에칭층(EL)을 에칭하도록 반복하여 실행될 수 있다. 즉, 1회(단위 사이클)의 시퀀스 SQ2의 실행에 의해서 에칭되는 피에칭층(EL)의 두께와 시퀀스 SQ2의 실행 횟수의 곱이, 피에칭층(EL) 자체의 전체 두께가 되도록 시퀀스 SQ2의 실행 횟수가 결정될 수 있다. 따라서, 피에칭층(EL)의 두께에 따라서 시퀀스 SQ2의 실행 횟수가 설정될 수 있다.
공정 ST10에 있어서 시퀀스 SQ2의 실행 횟수가 미리 설정된 횟수에 달하지 않았다고 판정되는 경우에는(공정 ST10: NO), 시퀀스 SQ2의 실행이 다시 반복된다. 한편, 공정 ST10에 있어서 시퀀스 SQ2의 실행 횟수가 미리 설정된 횟수에 달했다고 판정되는 경우에는(공정 ST10: YES), 시퀀스 SQ2의 실행이 종료된다.
시퀀스 SQ1의 박막 형성 공정(공정 ST5a∼공정 ST5d)에 의해서 처리 용기(12)의 내측에 형성된 박막(SXa)(보다 구체적으로는, 처리 용기(12)의 내측에 형성된 박막(SXa) 중 클리닝 공정(공정 ST5e, 공정 ST5f)에 의한 클리닝 후에 남은 부분이며, 도 10의 상태(CON2)에 도시하는 상태의 박막(SXa))은, 이상 설명한 시퀀스 SQ2 및 공정 ST10을 포함하는 공정에 의해서, 도 10의 상태(CON1)에 도시하는 것과 같이 전부 제거된다.
이상과 같이, 시퀀스 SQ2 및 공정 ST10을 포함하는 공정은, ALE법과 같은 방법에 의해, 마스크(OLM)를 이용하여 시퀀스 SQ2를 반복하여 실행하여 피에칭층(EL)을 원자층마다 제거하여, 피에칭층(EL)을 정밀하게 에칭한다.
상기 설명한 도 1에 도시한 방법(MT)의 실행에 의해서, 예컨대 하기하는 효과가 일례로서 발휘될 수 있다. 박막 형성 공정(공정 ST5a∼공정 ST5d)의 1회의 실행에 의해서 박막이 형성될 때마다 클리닝 공정(공정 ST5e, 공정 ST5f)이 행해지기 때문에, 처리 용기(12) 내부 중 웨이퍼(W) 상측에 있는 영역(처리 용기(12) 내부 중 상부 전극(30) 측의 영역)에 대한 클리닝 공정에 의한 상기 박막의 제거는 용이하게 된다.
또한, 박막 형성 공정에서는, 가스(G1)에 의해서 웨이퍼(W)의 주면에 반응 전구체(예컨대 도 7(b)에 도시한 층(Ly1))이 형성되고, 가스(G2)에 의해서 상기 반응 전구체에 대하여 박막이 컨포멀하게 형성될 수 있다. 이 박막은 처리 용기(12) 내에도 형성될 수 있지만, 처리 용기(12) 내부 중 웨이퍼(W)의 상측에 있는 영역(처리 용기(12) 내부 중 상부 전극(30) 측의 영역)에 대해서는, 처리 용기(12)의 상부 전극(30)으로부터 공급되는 고주파 전력을 이용하여 생성되는 가스(G3)의 플라즈마에 의해서 제거(클리닝)될 수 있다.
또한, 가스를 공급하는 구성은 도 2에 도시한 것에 한정되지 않는다. 즉, 도 2에 도시한 가스 도입구(36c), 가스 공급관(38), 가스 소스군(40), 밸브군(42), 유량 제어기군(45), 가스 도입구(52a), 가스 공급관(82)을 이용하지 않고, 도 22에 도시한 가스 공급 시스템(1)을 이용하여도 좋다. 도 22는 가스 공급 시스템(1)의 개요도이다. 도 22에 도시한 가스 공급 시스템(1)은, 플라즈마 처리 장치(10)의 처리 용기(12) 내의 처리 공간(Sp)에 가스를 공급하는 시스템의 일례이다. 도 22에 도시한 가스 공급 시스템(1)은, 제1 유로(L1), 제2 유로(L2), 가스 토출 구멍(34a), 가스 토출 구멍(34b), 복수의 다이어프램 밸브(다이어프램 밸브(DV1), 다이어프램 밸브(DV2), 다이어프램 밸브(DV3), 다이어프램 밸브(DV4))를 구비한다.
제1 유로(L1)는 제1 가스의 제1 가스 소스(GS1)에 접속되어 있다. 제1 유로(L1)는, 처리 공간(Sp)의 천장을 구성하는 천장 부재(예컨대 상부 전극(30))의 내부 또는 처리 용기(12) 측벽의 내부에 형성되어 있다. 복수의 가스 토출 구멍(34b)은 제1 유로(L1)와 처리 공간(Sp)을 연통시킨다. 제2 유로(L2)는 제2 가스의 제2 가스 소스(GS2)에 접속되어 있다. 제2 유로(L2)는 상기 천장 부재의 내부 또는 처리 용기(12) 측벽의 내부에 형성되어 있다. 복수의 가스 토출 구멍(34a)은 제2 유로(L2)와 처리 공간(Sp)을 연통시킨다. 복수의 다이어프램 밸브(다이어프램 밸브(DV1)∼다이어프램 밸브(DV4))의 각각은, 제1 유로(L1)와 가스 토출 구멍(34b)의 사이에 있어서, 가스 토출 구멍(34b)에 대응하여 마련되어 있다.
도 22와 함께 도 23을 참조하여 가스 공급 시스템(1)의 구성을 보다 상세히 설명한다. 도 23은 도 22에 도시한 가스 공급 시스템(1)이 이용된 경우에 있어서의 상부 전극(30)의 개략적인 단면도이다. 가스 공급 시스템(1)은 제1 가스 소스(GS1) 및 제2 가스 소스(GS2)를 구비한다. 제1 가스 소스(GS1)는 제1 가스를 저류한다. 제2 가스 소스(GS2)는 제2 가스를 저류한다. 제1 가스 및 제2 가스는 임의이다. 일례로서, 제2 가스는 프로세스의 메인 가스, 제1 가스는 프로세스의 첨가 가스로 하여도 좋다. 또한, 가스(G1)는 가스 도입구(52a)로부터 처리 공간(Sp)에 도입되는 가스이고, 가스(G2)는 가스 도입구(36c)로부터 처리 공간(Sp)에 도입되는 가스라도 좋다.
가스 공급 시스템(1)은 제1 메인 유로(L10) 및 제2 메인 유로(L20)를 구비한다. 제1 메인 유로(L10)는, 제1 가스 소스(GS1)와 처리 용기(12)의 제1 유로(L1)를 공급구(IN1)를 통해 접속한다. 제2 메인 유로(L20)는, 제2 가스의 제2 가스 소스(GS2)와 처리 용기(12)의 제2 유로(L2)를 공급구(IN4)를 통해 접속한다. 제1 메인 유로(L10) 및 제2 메인 유로(L20)는 예컨대 배관으로 형성된다. 도 22 및 도 23에 도시한 제2 유로(L2)는 도 1에 도시한 가스 확산실(36a)에 대응하고 있다.
제1 유로(L1)는 제1 가스 소스(GS1)에 접속되며, 처리 용기(12)의 상부 전극(30)(천장 부재의 일례)의 내부 또는 처리 용기(12) 측벽의 내부에 형성된다. 제1 유로(L1)는, 제1 가스가 공급되는 공급구(IN1) 및 제1 가스가 배기되는 배기구(OT1)를 가지고, 공급구(IN1)에서부터 배기구(OT1)까지 연장된다. 배기구(OT1)는 배기 유로(EK)를 통해 처리 용기(12)를 배기하는 배기 장치(51)에 접속되어 있다.
제1 유로(L1)와 처리 용기(12) 내의 처리 공간(Sp)은 복수의 가스 토출 구멍(34b)에 의해서 연통되어 있다. 제1 가스는, 제1 유로(L1)에 각각 접속된 복수의 가스 토출 구멍(34b)으로부터 처리 용기(12)의 처리 공간(Sp)에 공급된다.
제1 유로(L1)와 가스 토출 구멍(34b)의 사이에는, 하나의 가스 토출 구멍(34b)에 대응하여 하나의 다이어프램 밸브가 마련되어 있다. 즉, 가스 공급 시스템(1)은 복수의 가스 토출 구멍(34b)에 대응한 복수의 다이어프램 밸브를 구비한다. 일례로서, 도 22에서는 4개의 가스 토출 구멍(34b)에 대응한 4개의 다이어프램 밸브(다이어프램 밸브(DV1)∼다이어프램 밸브(DV4))가 도시되어 있다. 4개의 다이어프램 밸브(다이어프램 밸브(DV1) 등)는 각각 독립적으로 동작 가능하다.
다이어프램 밸브의 일례는 ON/OFF 밸브이다. 복수의 가스 토출 구멍(34b)은 4개에 한정되는 것은 아니며, 2개 이상이면 된다. 또한, 복수의 다이어프램 밸브는 복수의 가스 토출 구멍(34b)의 각각에 대응하여 마련되면 되고, 4개에 한정되는 것은 아니다.
제1 유로(L1)와 가스 토출 구멍(34b)의 사이에는, 하나의 가스 토출 구멍(34b)에 대응하여 하나의 오리피스가 마련되어 있어도 좋다. 오리피스는 다이어프램 밸브보다도 상류 측에 배치된다. 일례로서, 도 22에서는 4개의 오리피스(오리피스(OK1), 오리피스(OK2), 오리피스(OK3), 오리피스(OK4))가 도시되어 있다. 각 다이어프램 밸브는, 오리피스의 출구에서 가스 토출 구멍(34b)으로 공급되는 제1 가스의 공급 타이밍을 제어한다. 복수의 오리피스는 복수의 가스 토출 구멍(34b)의 각각에 대응하여 마련되면 되고, 4개에 한정되는 것은 아니다.
제2 유로(L2)는 제2 가스 소스(GS2)에 접속되며, 처리 용기(12)의 상부 전극(30)의 내부 또는 처리 용기(12) 측벽의 내부에 형성된다. 제2 유로(L2)는 복수의 가스 토출 구멍(34a)에 접속되어 있다. 제2 가스는, 제2 유로(L2)에 각각 접속된 복수의 가스 토출 구멍(34a)에서 처리 용기(12)의 처리 공간(Sp)으로 공급된다.
가스 공급 시스템(1)은 압력식 유량 제어 장치(FC)를 구비하여도 좋다. 압력식 유량 제어 장치(FC)는 제2 메인 유로(L20)에 있어서의 제2 가스 소스(GS2)의 하류 측에 배치된다. 압력식 유량 제어 장치(FC)의 상류 측에는 일차 밸브(VL4)가 마련되고, 압력식 유량 제어 장치(FC)의 하류 측에는 이차 밸브(VL5)가 마련된다.
또한, 유량 제어 장치는, 압력식 유량 제어 장치에 한정되지 않고, 열식 유량 제어 장치나 그 밖의 원리에 기초한 유량 제어 장치라도 좋다.
제2 가스 소스(GS2)의 제2 가스는, 압력식 유량 제어 장치(FC)에 의해서 유량 및 압력이 조정되어, 처리 용기(12)의 제2 유로(L2)에 공급구(IN4)를 통해 공급된다.
가스 공급 시스템(1)은 컨트롤 밸브(VL1)를 구비하여도 좋다. 컨트롤 밸브(VL1)는 제1 메인 유로(L10)에 있어서의 제1 가스 소스(GS1)의 하류 측에 배치된다. 컨트롤 밸브(VL1)는, 공급구(IN1)의 상류에 마련되어, 공급구(IN1)에 공급되는 제1 가스를 미리 설정된 압력으로 제어한다.
컨트롤 밸브(VL1)는, 압력식 유량 제어 장치(FC)가 갖는 컨트롤 밸브와 동일한 기능을 갖는다. 컨트롤 밸브(VL1)와 공급구(IN1) 사이의 유로에 있어서, 제1 압력 검출기(PM1)가 배치되어도 좋다.
컨트롤 밸브(VL1)는, 일례로서 제1 압력 검출기(PM1)의 검출 결과에 기초하여 제1 가스의 유량을 제어한다. 보다 구체적인 일례로서는, 제어 회로(C1)가 컨트롤 밸브(VL1)의 동작을 결정한다.
제어 회로(C1)는, 제1 압력 검출기(PM1)에 의해서 검출된 압력을 입력하여, 검출된 압력의 유량 연산을 행한다. 그리고, 제어 회로(C1)는, 설정된 목표 유량과 산출한 유량을 비교하여, 차분이 작아지도록 컨트롤 밸브(VL1)의 동작을 결정한다.
또한, 제1 가스 소스(GS1)와 컨트롤 밸브(VL1)의 사이에 일차 밸브가 마련되어 있어도 좋다. 컨트롤 밸브(VL1)의 하류 또한 제1 압력 검출기(PM1)의 상류에 이차 밸브가 마련되어 있어도 좋다. 또한, 제어 회로(C1) 및 컨트롤 밸브(VL1)가 유닛(U1)으로서 유닛화되어 있어도 좋다.
가스 공급 시스템(1)은, 배기구(OT1)로부터 배기된 제1 가스의 압력을 검출하는 제2 압력 검출기(PM2)를 추가로 구비하는 경우가 있다. 이 경우, 컨트롤 밸브(VL1)는, 일례로서, 제1 압력 검출기(PM1) 및 제2 압력 검출기(PM2)의 검출 결과에 기초하여, 제1 가스의 유량을 제어한다.
보다 구체적으로는, 제1 압력 검출기(PM1)의 검출 결과와 제2 압력 검출기(PM2)의 검출 결과에 기초하여, 각 오리피스의 배치 위치의 제1 가스의 압력이 산출된다. 그리고, 압력의 산출 결과에 기초하여, 각 다이어프램 밸브에 의한 제1 가스의 공급 타이밍이 제어된다.
가스 공급 시스템(1)은, 제1 유로(L1)에 있어서의 제1 가스의 온도를 검출하는 온도 검출기(TM)(도 23을 참조)를 구비하는 경우가 있다. 이 경우, 컨트롤 밸브(VL1)는, 압력식 유량 제어 장치(FC)에 구비되는 컨트롤 밸브와 마찬가지로, 온도 검출기(TM)를 이용하여 유량 보정을 행한다. 구체적으로는, 컨트롤 밸브(VL1)는 온도 검출기(TM)의 검출 결과에 기초하여 제1 가스의 유량을 제어한다.
제1 가스 소스(GS1)의 제1 가스는, 컨트롤 밸브(VL1)에 의해서 유량 및 압력이 조정되어, 처리 용기(12)의 제1 유로(L1)에 공급구(IN1)를 통해 공급된다. 또한, 제1 유로(L1)의 배기구(OT1)에는 배기용 오리피스(OKEx)가 마련되어 있어도 좋다.
플라즈마 처리 장치(10)의 제어부(Cnt)는, 가스 공급 시스템(1)에 있어서, 컨트롤 밸브(VL1), 복수의 다이어프램 밸브(다이어프램 밸브(DV1)∼다이어프램 밸브(DV4) 등)를 동작시킨다.
제어부(Cnt)는, 가스 공급 시스템(1)에 있어서, 기억부에 기억된 레시피를 입력하여, 컨트롤 밸브(VL1)를 동작시키는 제어 회로(C1)에 신호를 출력한다. 제어부(Cnt)는, 가스 공급 시스템(1)에 있어서, 기억부에 기억된 레시피를 입력하여, 복수의 다이어프램 밸브(다이어프램 밸브(DV1)∼다이어프램 밸브(DV4) 등)의 개폐 동작을 제어한다. 제어부(Cnt)는, 가스 공급 시스템(1)에 있어서, 제어 회로(C1)를 통해 배기 장치(51)를 동작할 수 있다. 또한, 제어부(Cnt)의 기억부에는, 방법(MT)을 실행하기 위한 컴퓨터 프로그램 및 방법(MT)의 실행에 이용되는 각종 데이터(예컨대 대응 데이터(DT))가 독출이 자유롭게 저장되어 있다.
배기구(12e)에는 배기관(52)을 통해 배기 장치(50) 및 배기 장치(51)가 접속되어 있다. 배기 장치(50)는 터보 분자 펌프이고, 배기 장치(51)는 드라이 펌프이다. 배기 장치(50)는, 처리 용기(12)에 대하여, 배기 장치(51)보다도 상류 측에 설치되어 있다.
배기 장치(50)와 배기 장치(51) 사이의 배관에는 가스 공급 시스템(1)의 배기 유로(EK)가 접속되어 있다. 배기 장치(50)와 배기 장치(51)의 사이에 배기 유로(EK)가 접속됨으로써, 배기 유로(EK)에서 처리 용기(12) 내부로의 가스의 역류가 억제된다.
도 23에 도시한 것과 같이, 상부 전극(30)의 전극 지지체(36)의 내부에는, 수평 방향으로 연장되는 제1 유로(L1) 및 제2 유로(L2)가 마련되어 있다. 제1 유로(L1)는 제2 유로(L2)의 아래쪽에 위치하고 있다.
전극 지지체(36)에는, 제1 유로(L1)와 제1 유로(L1)의 하측에서 연장되는 복수의 가스 토출 구멍(34b)을 접속하는 복수의 가스 통류 구멍(36d)이 형성되어 있다. 전극 지지체(36)의 제1 유로(L1)와 가스 토출 구멍(34b)의 사이에는, 오리피스(OK1) 및 다이어프램 밸브(DV1)가 마련되어 있다. 다이어프램 밸브(DV1)의 하부에는 밸브 기능을 발휘하는 밀봉 부재(74)가 배치된다.
밀봉 부재(74)는 가요성을 갖는 부재로 구성될 수 있다. 밀봉 부재(74)는 예컨대 탄성 부재, 다이어프램, 벨로우즈 등이라도 좋다.
제1 유로(L1)를 흐르는 제1 가스는, 다이어프램 밸브(DV1)가 열림일 때, 오리피스(OK1)의 출구, 가스 통류 구멍(36d) 및 가스 토출 구멍(34b)을 통과하여, 처리 공간(Sp)에 공급된다. 다른 가스 토출 구멍(34b)도 동일한 구성을 구비한다. 또한, 전극 지지체(36)에는, 컨트롤 밸브(VL1)가 유량 보정을 행하기 위한 온도 검출기(TM)가 마련되어 있다.
전극 지지체(36)에는, 제2 유로(L2)와 제2 유로(L2)의 하측에서 연장되는 복수의 가스 토출 구멍(34a)을 접속하는 복수의 가스 통류 구멍(36b)이 형성되어 있다. 제2 가스는, 공급구(IN4)를 통해 공급되며, 복수의 가스 통류 구멍(36b), 복수의 가스 토출 구멍(34a)을 통과하여, 처리 공간(Sp)에 공급된다.
이상 적합한 실시형태에 있어서 본 발명의 원리를 나타내어 설명해 왔지만, 본 발명은 그와 같은 원리에서 일탈하지 않고서 배치 및 상세한 점이 변경될 수 있음은 당업자에 의해서 인식된다. 본 발명은 본 실시형태에 개시된 특정 구성에 한정되는 것은 아니다. 따라서, 청구범위 및 그 정신의 범위에서 오는 모든 수정 및 변경에 권리를 청구한다.
1: 가스 공급 시스템, 10: 플라즈마 처리 장치, 12: 처리 용기, 12e: 배기구, 12g: 반입출구, 14: 지지부, 22: 직류 전원, 23: 스위치, 24: 냉매 유로, 26a: 배관, 26b: 배관, 30: 상부 전극, 32: 절연성 차폐 부재, 34: 전극판, 34a: 가스 토출 구멍, 34b: 가스 토출 구멍, 36: 전극 지지체, 36a: 가스 확산실, 36b: 가스 통류 구멍, 36c: 가스 도입구, 38: 가스 공급관, 40: 가스 소스군, 42: 밸브군, 45: 유량 제어기군, 46: 디포짓 실드, 48: 배기 플레이트, 50: 배기 장치, 51: 배기 장치, 52: 배기관, 52a: 가스 도입구, 54: 게이트 밸브, 62: 제1 고주파 전원, 64: 제2 고주파 전원, 66: 정합기, 68: 정합기, 70: 전원, 74: 밀봉 부재, 82: 가스 공급관, AL: 반사방지막, ALM: 마스크, C1: 제어 회로, Cnt: 제어부, CON1: 상태, CON2: 상태, CON3: 상태, DV1: 다이어프램 밸브, DV2: 다이어프램 밸브, DV3: 다이어프램 밸브, DV4: 다이어프램 밸브, EK: 배기 유로, EL: 피에칭층, ER: 영역, ESC : 정전 척, FC: 압력식 유량 제어 장치, FR: 포커스 링, GS1: 제1 가스 소스, GS2: 제2 가스 소스, HP: 히터 전원, HT: 온도 조절부, IN1: 공급구, K1: 영역, K2: 영역, IN4: 공급구, L1: 제1 유로, L10: 제1 메인 유로, L2: 제2 유로, L20: 제2 메인 유로, LE: 하부 전극, Ly1: 층, Ly2: 층, MK1: 마스크, MK2: 마스크, MS: 마스크, MT: 방법, MX: 혼합층, OK1: 오리피스, OK2: 오리피스, OK3: 오리피스, OK4: 오리피스, OKEx: 배기용 오리피스, OL: 유기막, OLM: 마스크, OT1: 배기구, P1: 플라즈마, PD: 배치대, PF: 보호막, PM1: 제1 압력 검출기, PM2: 제2 압력 검출기, Q1a: 영역, Q1b: 영역, Q2: 영역, R11: 영역, R21: 영역, R31: 영역, SB: 기판, Sp: 처리 공간, SX: 보호막, SXa: 박막, TM: 온도 검출기, U1: 유닛, VL1: 컨트롤 밸브, VL4: 일차 밸브, VL5: 이차 밸브, W: 웨이퍼.
Claims (13)
- 피처리 기판 상에 형성된 패턴에 성막하는 성막 방법으로서, 상기 피처리 기판은 감압 환경 하에서 플라즈마 처리 가능한 공간에 마련된 배치대에 배치되고, 상기 공간에는 상기 배치대에 대향하고 있으며 고주파 전력의 공급이 가능한 상부 전극이 배치되고, 상기 방법은,
상기 피처리 기판의 주면의 복수의 영역마다 상기 피처리 기판의 상기 주면의 온도를 조절하는 온도 조절 공정을 실행한 후에,
상기 피처리 기판의 상기 패턴에 퇴적막을 형성하는 제1 공정과, 전력을 상기 상부 전극에만 공급하여 상기 공간에 플라즈마를 발생시킴으로써, 상기 공간을 클리닝하는 제2 공정을 포함하는 시퀀스를 반복하여 실행하는 성막 방법. - 제1항에 있어서, 상기 온도 조절 공정은, 상기 주면의 온도와 상기 퇴적막의 막 두께의 대응을 나타내는 미리 취득된 대응 데이터를 이용하여, 복수의 상기 영역마다 상기 주면의 온도를 조절하는 것인 성막 방법.
- 제1항 또는 제2항에 있어서, 상기 제1 공정은,
전구체의 재료를 포함하는 제1 가스를 상기 공간에 공급하여, 상기 전구체를 상기 패턴의 표면에 흡착시키는 공정과,
제2 가스의 플라즈마를 발생시켜, 상기 플라즈마를 상기 전구체에 공급하는 공정을 포함하는 것인 성막 방법. - 제3항에 있어서, 상기 제1 가스는 아미노실란계 가스인 것인 성막 방법.
- 제3항에 있어서, 상기 제2 가스는 산소 또는 질소를 함유하는 것인 성막 방법.
- 제3항에 있어서, 상기 제2 공정에서는, 상기 공간에 제3 가스의 플라즈마를 발생시키고,
상기 제3 가스는 할로겐 화합물을 함유하는 것인 성막 방법. - 제4항에 있어서, 상기 제1 가스의 아미노실란계 가스는 1∼3개의 규소 원자를 갖는 아미노실란을 포함하는 것인 성막 방법.
- 제4항에 있어서, 상기 제1 가스의 아미노실란계 가스는 1∼3개의 아미노기를 갖는 아미노실란을 포함하는 것인 성막 방법.
- 제3항에 있어서, 상기 제1 가스는 할로겐화텅스텐을 함유하는 것인 성막 방법.
- 제3항에 있어서, 상기 제1 가스는 사염화티탄 또는 테트라키스디메틸아미노티탄을 함유하는 것인 성막 방법.
- 제3항에 있어서, 상기 제1 가스는 할로겐화붕소를 함유하는 것인 성막 방법.
- 제1항 또는 제2항에 있어서, 상기 제1 공정은,
전자 공여성의 제1 치환기를 포함하는 제1 가스를 상기 공간에 공급하여, 상기 제1 치환기를 상기 패턴의 표면에 흡착시키는 공정과,
전자 흡인성의 제2 치환기를 포함하는 제2 가스를 상기 제1 치환기에 공급하는 공정을 포함하는 것인 성막 방법. - 제1항 또는 제2항에 있어서, 상기 제1 공정은, 이소시아네이트와 아민과의 중합 반응, 또는 이소시아네이트와 수산기를 갖는 화합물과의 중합 반응에 의해서 상기 퇴적막을 형성하는 것인 성막 방법.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2018001930A JP7089881B2 (ja) | 2018-01-10 | 2018-01-10 | 成膜方法 |
JPJP-P-2018-001930 | 2018-01-10 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20190085476A KR20190085476A (ko) | 2019-07-18 |
KR102623770B1 true KR102623770B1 (ko) | 2024-01-10 |
Family
ID=67140948
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020180166489A KR102623770B1 (ko) | 2018-01-10 | 2018-12-20 | 성막 방법 |
Country Status (5)
Country | Link |
---|---|
US (1) | US11367610B2 (ko) |
JP (1) | JP7089881B2 (ko) |
KR (1) | KR102623770B1 (ko) |
CN (1) | CN110029325B (ko) |
TW (1) | TWI833726B (ko) |
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2018
- 2018-01-10 JP JP2018001930A patent/JP7089881B2/ja active Active
- 2018-12-20 KR KR1020180166489A patent/KR102623770B1/ko active IP Right Grant
-
2019
- 2019-01-04 TW TW108100267A patent/TWI833726B/zh active
- 2019-01-09 US US16/243,218 patent/US11367610B2/en active Active
- 2019-01-10 CN CN201910022599.1A patent/CN110029325B/zh active Active
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JP2017010749A (ja) | 2015-06-22 | 2017-01-12 | 東京エレクトロン株式会社 | 積層封止膜形成方法および形成装置 |
JP2017011234A (ja) | 2015-06-26 | 2017-01-12 | 株式会社日立国際電気 | 半導体装置の製造方法、基板処理装置およびプログラム |
US20170098528A1 (en) | 2015-10-06 | 2017-04-06 | Tokyo Electron Limited | Method for processing target object |
JP2017212331A (ja) | 2016-05-25 | 2017-11-30 | 東京エレクトロン株式会社 | 被処理体を処理する方法 |
Also Published As
Publication number | Publication date |
---|---|
US20190214246A1 (en) | 2019-07-11 |
TW201933479A (zh) | 2019-08-16 |
CN110029325A (zh) | 2019-07-19 |
JP7089881B2 (ja) | 2022-06-23 |
TWI833726B (zh) | 2024-03-01 |
CN110029325B (zh) | 2022-06-21 |
US11367610B2 (en) | 2022-06-21 |
KR20190085476A (ko) | 2019-07-18 |
JP2019119918A (ja) | 2019-07-22 |
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