KR102620972B1 - 디스플레이 장치 - Google Patents

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Abstract

본 발명은 고온 조건에서도 고품질의 이미지 디스플레이가 가능한 디스플레이 장치를 위하여, 플렉서블 기판; 상기 플렉서블 기판 상에 배치되고 박막트랜지스터를 포함하며, 상기 플렉서블 기판까지 연장된 관통홀을 갖는, 화소회로층; 상기 화소회로층 상에 배치되며, 상기 관통홀을 통해 상기 플렉서블 기판과 컨택하는, 제1 유기막; 상기 제1 유기막 상면을 덮도록 상기 제1 유기막 상에 배치되는, 무기막; 상기 무기막 상에 배치되는, 화소전극; 및 상기 화소전극 상부에 배치되며, 제1 무기 봉지막, 제2 무기 봉지막 및 상기 제1 무기 봉지막과 상기 제2 무기 봉지막 사이에 개재된 유기 봉지막을 포함하는, 봉지층;을 구비하는, 디스플레이 장치를 제공한다.

Description

디스플레이 장치{Display apparatus}
본 발명은 디스플레이 장치에 관한 것으로서, 더 상세하게는 고온 조건에서도 고품질의 이미지 디스플레이가 가능한 디스플레이 장치에 관한 것이다.
디스플레이 장치들 중, 유기발광 디스플레이 장치는 시야각이 넓고 컨트라스트가 우수할 뿐만 아니라 응답속도가 빠르다는 장점을 가지고 있어 차세대 디스플레이 장치로서 주목을 받고 있다.
일반적으로 유기발광 디스플레이 장치는 기판 상에 박막트랜지스터 및 유기발광소자들을 형성하고, 유기발광소자들이 스스로 빛을 발광하여 작동한다. 유기발광 디스플레이 장치는 기판 상에 박막트랜지스터를 포함하는 복수의 무기막들을 적층하고, 그 상부에 유기발광소자 및 복수의 유기막들을 형성한다.
이러한 유기발광 디스플레이 장치는 휴대폰 등과 같은 소형 제품의 디스플레이부로 사용되기도 하고, 텔레비전 등과 같은 대형 제품의 디스플레이부로 사용되기도 한다.
그러나, 이러한 유기발광 디스플레이 장치가 대형화되면서 유기막들의 면적이 넓어지고, 유기발광 디스플레이 장치가 고온에 노출되면 유기막들에서 아웃 개싱(Outgassing)이 발생해 화소가 수축되는 문제점이 있었다.
본 발명은 상기와 같은 문제점을 포함하여 여러 문제점들을 해결하기 위한 것으로서, 고온 조건에서도 고품질의 이미지 디스플레이가 가능한 디스플레이 장치를 제공하는 것을 목적으로 한다. 그러나 이러한 과제는 예시적인 것으로, 이에 의해 본 발명의 범위가 한정되는 것은 아니다.
본 발명의 일 관점에 따르면, 플렉서블 기판; 상기 플렉서블 기판 상에 배치되고 박막트랜지스터를 포함하며, 상기 플렉서블 기판까지 연장된 관통홀을 갖는, 화소회로층; 상기 화소회로층 상에 배치되며, 상기 관통홀을 통해 상기 플렉서블 기판과 컨택하는, 제1 유기막; 상기 제1 유기막 상면을 덮도록 상기 제1 유기막 상에 배치되는, 무기막; 상기 무기막 상에 배치되는, 화소전극; 및 상기 화소전극 상부에 배치되며, 제1 무기 봉지막, 제2 무기 봉지막 및 상기 제1 무기 봉지막과 상기 제2 무기 봉지막 사이에 개재된 유기 봉지막을 포함하는, 봉지층;을 구비하는, 디스플레이 장치가 제공된다.
본 실시예에 있어서, 상기 제1 유기막은 상기 박막트랜지스터 상부에 위치해 상기 화소회로층 상면의 적어도 일부를 노출시키는 제1 개구를 갖고, 상기 무기막은 상기 제1 개구를 덮을 수 있다.
본 실시예에 있어서, 상기 무기막은 상기 제1 개구에 의해 노출된 상기 화소회로층 상면과 컨택할 수 있다.
본 실시예에 있어서, 상기 화소회로층의 상면은 무기막일 수 있다.
본 실시예에 있어서, 상기 무기막은 상기 제1 개구 내에 위치한 제2 개구를 갖고, 상기 화소전극은 상기 제2 개구를 통해 상기 박막트랜지스터와 전기적으로 연결될 수 있다.
본 실시예에 있어서, 상기 화소회로층은 상기 박막트랜지스터를 덮으며 무기물을 포함하는 무기 보호막을 더 포함하고, 상기 제2 개구는 상기 무기 보호막을 관통하도록 연장될 수 있다.
본 실시예에 있어서, 상기 무기막은 상기 제1 유기막의 측면을 덮도록 연장될 수 있다.
본 실시예에 있어서, 상기 관통홀은 상기 제1 유기막과 동일한 유기물로 매립될 수 있다.
본 실시예에 있어서, 상기 제1 유기막은 상기 관통홀을 통해 상기 플렉서블 기판과 직접 컨택할 수 있다.
본 실시예에 있어서, 상기 무기막 상에 배치되며, 상기 화소전극의 가장자리를 덮되 중앙부를 노출시켜 발광영역을 정의하는 제2 유기막을 더 포함할 수 있다.
본 실시예에 있어서, 상기 플렉서블 기판은 상기 플렉서블 기판을 관통하는 관통패턴을 포함할 수 있다.
본 실시예에 있어서, 상기 봉지층은 상기 제1 유기막의 외측면을 덮도록 연장될 수 있다.
본 실시예에 있어서, 상기 봉지층의 상기 제1 무기 봉지막은 상기 제1 유기막의 외측면과 면접촉할 수 있다.
본 실시예에 있어서, 상기 박막트랜지스터는 반도체층, 상기 반도체층과 적어도 일부가 중첩되는 게이트전극 및 상기 반도체층과 연결된 소스전극과 드레인전극을 포함하고, 상기 제1 유기막은 상기 소스전극 및 드레인전극 중 적어도 하나를 포함한 상기 화소회로층 상면의 적어도 일부를 노출시키는 제1 개구를 가질 수 있다.
본 실시예에 있어서, 상기 무기막은 상기 제1 개구를 통해 노출된 상기 화소회로층의 상면과 면접촉할 수 있다.
본 실시예에 있어서, 상기 무기막은 상기 소스전극 및 드레인전극 중 적어도 하나를 노출시키는 제2 개구를 가질 수 있다.
본 실시예에 있어서, 상기 화소전극은 상기 제2 개구를 통해 상기 상기 소스전극 및 드레인전극 중 적어도 하나와 전기적으로 컨택할 수 있다.
본 실시예에 있어서, 상기 플렉서블 기판은 유기물을 포함할 수 있다.
본 실시예에 있어서, 상기 제1 유기막은 상기 관통홀을 통해 상기 플렉서블 기판과 연통할 수 있다.
본 발명의 다른 관점에 따르면, 플렉서블 기판; 상기 플렉서블 기판 상에 배치되고 복수의 박막트랜지스터들을 포함하며, 상기 플렉서블 기판까지 연장된 적어도 하나 이상의 관통홀을 갖는, 화소회로층; 상기 화소회로층 상에 배치되며, 상기 관통홀을 통해 상기 플렉서블 기판과 컨택하고, 아일랜드 형태로 패터닝된 복수의 유기패턴부들을 포함하는, 제1 유기막; 상기 제1 유기막 상면을 덮도록 상기 제1 유기막 상에 배치되는, 무기막; 상기 무기막 상에 배치되며, 상기 복수의 유기패턴부들 상에 각각 배치되는 제1 화소전극, 제2 화소전극 및 제3 화소전극; 및 상기 제1 화소전극, 제2 화소전극 및 제3 화소전극 상부에 배치되며, 제1 무기 봉지막, 제2 무기 봉지막 및 상기 제1 무기 봉지막과 상기 제2 무기 봉지막 사이에 개재된 유기 봉지막을 포함하는, 봉지층;을 구비하는, 디스플레이 장치가 제공된다.
본 실시예에 있어서, 상기 화소회로층은 무기막을 포함하고, 상기 무기막은 상기 복수의 유기패턴부들이 서로 이격되어 상기 무기막의 상면의 적어도 일부가 노출된 이격영역을 가지며, 상기 무기막은 상기 이격영역과 컨택할 수 있다.
본 실시예에 있어서, 상기 관통홀은 상기 복수의 유기패턴부들에 각각 대응되도록 상기 복수의 유기패턴부들 각각의 하부에 적어도 하나 이상 구비되며, 상기 복수의 유기패턴부들 각각은 상기 관통홀을 통해 상기 플렉서블 기판과 연통될 수 있다.
본 실시예에 있어서, 상기 제1 화소전극 상에 배치되며 적색 파장의 광을 발광하는 제1 중간층, 상기 제2 화소전극 상에 배치되며 녹색 파장의 광을 발광하는 제2 중간층, 및 상기 제3 화소전극 상에 배치되며 청색 파장의 광을 발광하는 제3 중간층; 및 상기 제1 중간층, 상기 제2 중간층 및 상기 제3 중간층을 덮는 대향전극;을 더 포함할 수 있다.
본 실시예에 있어서, 상기 플렉서블 기판은 유기물을 포함할 수 있다.
전술한 것 외의 다른 측면, 특징, 이점은 이하의 발명을 실시하기 위한 구체적인 내용, 청구범위 및 도면으로부터 명확해질 것이다.
상기한 바와 같이 이루어진 본 발명의 일 실시예에 따르면, 고온 조건에서도 고품질의 이미지 디스플레이가 가능한 디스플레이 장치를 구현할 수 있다. 물론 이러한 효과에 의해 본 발명의 범위가 한정되는 것은 아니다.
도 1은 본 발명의 일 실시예에 따른 디스플레이 장치를 개략적으로 도시한 평면도이다.
도 2는 본 발명의 일 실시예에 따른 디스플레이 장치의 어느 한 화소의 등가회로도이다.
도 3은 본 발명의 일 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
도 4는 본 발명의 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
도 5는 도 4의 일부를 확대한 확대도이다.
도 6은 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
도 7 내지 도 9는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도들이다.
도 10 및 도 11은 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 평면도들이다.
도 12는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
도 13 및 도 14는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 평면도들이다.
도 15는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
도 16은 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 본 발명의 효과 및 특징, 그리고 그것들을 달성하는 방법은 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 다양한 형태로 구현될 수 있다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예들을 상세히 설명하기로 하며, 도면을 참조하여 설명할 때 동일하거나 대응하는 구성 요소는 동일한 도면부호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
이하의 실시예에서, 제1, 제2 등의 용어는 한정적인 의미가 아니라 하나의 구성 요소를 다른 구성 요소와 구별하는 목적으로 사용되었다.
이하의 실시예에서, 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
이하의 실시예에서, 포함하다 또는 가지다 등의 용어는 명세서상에 기재된 특징, 또는 구성요소가 존재함을 의미하는 것이고, 하나 이상의 다른 특징들 또는 구성요소가 부가될 가능성을 미리 배제하는 것은 아니다.
이하의 실시예에서, 막, 영역, 구성 요소 등의 부분이 다른 부분 위에 또는 상에 있다고 할 때, 다른 부분의 바로 위에 있는 경우뿐만 아니라, 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 있는 경우도 포함한다.
도면에서는 설명의 편의를 위하여 구성 요소들이 그 크기가 과장 또는 축소될 수 있다. 예컨대, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다.
어떤 실시예가 달리 구현 가능한 경우에 특정한 공정 순서는 설명되는 순서와 다르게 수행될 수도 있다. 예를 들어, 연속하여 설명되는 두 공정이 실질적으로 동시에 수행될 수도 있고, 설명되는 순서와 반대의 순서로 진행될 수 있다.
이하의 실시예에서, 막, 영역, 구성 요소 등이 연결되었다고 할 때, 막, 영역, 구성 요소들이 직접적으로 연결된 경우뿐만 아니라 막, 영역, 구성요소들 중간에 다른 막, 영역, 구성 요소들이 개재되어 간접적으로 연결된 경우도 포함한다. 예컨대, 본 명세서에서 막, 영역, 구성 요소 등이 전기적으로 연결되었다고 할 때, 막, 영역, 구성 요소 등이 직접 전기적으로 연결된 경우뿐만 아니라, 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 간접적으로 전기적 연결된 경우도 포함한다.
도 1은 본 발명의 일 실시예에 따른 디스플레이 장치를 개략적으로 도시한 평면도이다.
도 1을 참조하면, 디스플레이 장치는 플렉서블 기판(100)을 구비한다. 플렉서블 기판(100)은 디스플레이영역(DA)과 이 디스플레이영역(DA) 외측의 주변영역(PA)을 갖는다.
플렉서블 기판(100)은 유연한 재료로 형성될 수 있다. 예컨대, 플렉서블 기판(100)은 잘 휘어지고 구부러지거나 돌돌 말 수 있는 폴리이미드(PI)와 같은 재질로 형성될 수 있으나. 이는 예시적인 것일 뿐 본 발명은 이에 제한되지 않는다.
복수의 화소(PX)들이 디스플레이영역(DA)에 배치될 수 있다. 화소(PX)는 신호선 및 전원선과 전기적으로 연결된 박막트랜지스터 및 스토리지 커패시터 등을 포함하는 화소회로, 그리고 전술한 화소회로 연결된 디스플레이요소, 예컨대 유기발광다이오드(Organic light emitting didoe: OLED)를 포함할 수 있다.
화소(PX)는 유기발광다이오드를 통해 예컨대, 적색, 녹색, 청색 또는 백색의 빛을 방출할 수 있다. 본 명세서에서의 화소(PX)라 함은 전술한 바와 같이 적색, 녹색, 청색, 백색 중 어느 하나의 색상의 빛을 방출하는 화소로 이해할 수 있다. 디스플레이영역(DA)은 도시되지는 않았으나 봉지층으로 커버되어, 외기 또는 수분 등으로부터 보호될 수 있다. 화소(PX)에 구비된 디스플레이요소가 유기발광다이오드인 경우, 박막트랜지스터는 적어도 구동 박막트랜지스터 및 스위칭 박막트랜지스터를 포함할 수 있다.
도 2는 본 발명의 일 실시예에 따른 디스플레이 장치의 어느 한 화소의 등가회로도이다.
도 2를 참조하면, 화소(PX)는 화소회로(PC) 및 화소회로(PC)에 연결된 표시요소를 포함한다. 도 2에서는 표시요소로서 유기발광다이오드(OLED)를 도시하고 있다. 화소회로(PC)는 제1 박막트랜지스터(T1), 제2 박막트랜지스터(T2), 및 스토리지 커패시터(Cst)를 포함할 수 있다.
제2 박막트랜지스터(T2)는 스위칭 박막트랜지스터로서, 스캔선(SL) 및 데이터선(DL)에 연결되며, 스캔선(SL)으로부터 입력되는 스위칭 전압에 따라 데이터선(DL)으로부터 입력된 데이터 전압을 제1 박막트랜지스터(T1)로 전달한다. 스토리지 커패시터(Cst)는 제2 박막트랜지스터(T2)와 구동전압선(PL)에 연결되며, 제2 박막트랜지스터(T2)로부터 전달받은 전압과 구동전압선(PL)에 공급되는 제1 전원전압(ELVDD)의 차이에 해당하는 전압을 저장한다.
제1 박막트랜지스터(T1)는 구동 박막트랜지스터로서, 구동전압선(PL)과 스토리지 커패시터(Cst)에 연결되며, 스토리지 커패시터(Cst)에 저장된 전압 값에 대응하여 구동전압선(PL)으로부터 유기발광다이오드(OLED)를 흐르는 구동 전류(Id)를 제어할 수 있다. 유기발광다이오드(OLED)는 구동 전류(Id)에 의해 소정의 휘도를 갖는 빛을 방출할 수 있다. 유기발광다이오드(OLED)의 대향전극(예, 캐소드)는 제2 전원전압(ELVSS)을 공급받을 수 있다.
도 2에서는 화소회로(PC)가 2개의 박막트랜지스터와 1개의 스토리지 커패시터를 포함하는 것을 설명하고 있으나, 본 발명은 이에 한정되지 않는다. 박막트랜지스터의 개수 및 스토리지 커패시터의 개수는 화소회로(PC)의 설계에 따라 다양하게 변경될 수 있음은 물론이다.
도 3은 본 발명의 일 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다. 도 3은 도 1의 A-A' 선에 따른 단면에 대응할 수 있다.
도 3을 참조하면, 플렉서블 기판(100) 상에 화소회로(200)를 포함하는 화소회로층(110)이 배치된다.
플렉서블 기판(100)은 폴리에테르술폰(polyethersulphone, PES), 폴리아크릴레이트(polyacrylate, PAR), 폴리에테르 이미드(polyetherimide, PEI), 폴리에틸렌 나프탈레이트(polyethyelenen napthalate, PEN), 폴리에틸렌 테레프탈레이드(polyethyeleneterepthalate, PET), 폴리페닐렌 설파이드(polyphenylene sulfide, PPS), 폴리아릴레이트(polyallylate), 폴리이미드(polyimide, PI), 폴리카보네이트(polycarbonate, PC) 또는 셀룰로오스 아세테이트 프로피오네이트(cellulose acetate propionate, CAP)와 같은 고분자 수지를 포함할 수 있다.
화소회로층(110)은 화소회로(200)를 포함하고, 화소회로(200)는 박막트랜지스터 및 커패시터를 포함할 수 있다. 화소회로층(110)은 복수의 층들이 적층되어 형성될 수 있다.
화소회로(200)는 하나 이상의 박막트랜지스터 및 하나 이상의 커패시터를 포함할 수 있다. 일 실시예로, 화소회로(200)는 2개의 박막트랜지스터 및 1개의 커패시터를 포함할 수도 있고, 다른 실시예로 7개의 박막트랜지스터 및 2개의 커패시터를 포함할 수도 있다. 물론 화소회로(200)는 상술한 구성에 한정되는 것은 아니며, 다양한 구성으로 설계될 수 있다. 화소회로(200)의 구성은 후술할 도 4 및 도 5에서 자세히 설명한다.
화소회로층(110) 상에는 제1 유기막(120)이 배치된다. 제1 유기막(120)은 화소회로층(110)을 덮으며 화소전극(310)이 배치될 상면을 평탄하게 하는 평탄화층의 역할을 할 수 있다. 제1 유기막(120)은 예컨대, 아크릴, BCB(Benzocyclobutene), 폴리이미드(polyimide) 또는 HMDSO(Hexamethyldisiloxane) 등의 유기 절연물을 포함할 수 있다.
제1 유기막(120)은 화소회로(200)의 상부에 위치해 화소회로(200)의 상면의 적어도 일부를 노출시키는 제1 개구(120H)을 구비할 수 있다. 제1 개구(120H)를 통해 화소회로(200)와 화소전극(310)이 전기적으로 연결될 수 있다.
무기막(130)은 제1 유기막(120) 상에 배치된다. 무기막(130)은 제1 유기막(120)의 상면과 면접촉하며, 유기막(120)을 커버하도록 배치될 수 있다. 이때, 무기막(130)은 제1 유기막(120)은 제1 개구(120H)을 덮을 수 있다. 무기막(130)은 제1 개구(120H)의 내측면(120IS)을 커버하며, 제1 개구(120H)를 통해 노출된 화소회로층(110)의 상면을 커버할 수 있다. 무기막(130)은 예컨대, 산화규소(SiOx), 질화규소(SiNx), 산질화규소(SiON)와 같은 무기 절연물을 포함할 수 있다.
무기막(130)은 제1 유기막(120)의 제1 개구(120H) 내에 위치한 제2 개구(130H)를 구비한다. 제2 개구(130H)를 통해 화소전극(310)과 화소회로(200)이 전기적으로 연결될 수 있다.
무기막(130) 상에는 화소전극(310), 발광층(322), 대향전극(330)을 구비한 발광소자(300)가 배치된다.
화소전극(310)은 무기막(130) 상에 배치된다. 화소전극(310)은 각 화소마다 배치될 수 있으며, 인접한 화소전극(310)과 상호 이격된다. 화소전극(310)은 인듐틴옥사이드(ITO; indium tin oxide), 인듐징크옥사이드(IZO; indium zinc oxide), 징크옥사이드(ZnO; zinc oxide), 인듐옥사이드(In2O3: indium oxide), 인듐갈륨옥사이드(IGO; indium gallium oxide) 또는 알루미늄징크옥사이드(AZO; aluminium zinc oxide)와 같은 도전성 산화물을 포함할 수 있다. 다른 실시예로, 화소전극(310)은 은(Ag), 마그네슘(Mg), 알루미늄(Al), 백금(Pt), 팔라듐(Pd), 금(Au), 니켈(Ni), 네오디뮴(Nd), 이리듐(Ir), 크로뮴(Cr) 또는 이들의 화합물을 포함하는 반사막을 포함할 수 있다. 또 다른 실시예로, 화소전극(310)은 전술한 반사막의 위/아래에 ITO, IZO, ZnO 또는 In2O3로 형성된 막을 더 포함할 수 있다.
제2 유기막(140)은 화소전극(310)의 가장자리를 커버하며, 중앙부를 노출시켜 발광영역을 정의한다. 즉, 제2 유기막(140)은 화소정의막으로 이해될 수 있다. 화소전극(310)의 중앙부 상면은 제2 유기막(140)의 개구(OP)를 통하여 노출된다. 제2 유기막(140)은 예컨대, 아크릴, BCB(Benzocyclobutene), 폴리이미드(polyimide) 또는 HMDSO(Hexamethyldisiloxane) 등의 유기 절연물을 포함할 수 있다.
도시되어 있지는 않으나, 제2 유기막(140) 상에는 스페이서(미도시)가 위치할 수 있으며, 스페이서(미도시)는 섬(island)형으로, 복수의 스페이서(미도시)들이 디스플레이영역(DA)에서 상호 이격되어 배치될 수 있다. 스페이서(미도시)는 유기 절연물이나 무기 절연물을 포함할 수 있다.
중간층(320)은 발광층(322)을 포함한다. 발광층(322)은 적색, 녹색 및 청색의 빛을 방출하는 형광 또는 인광 물질을 포함하는 유기물로 형성될 수 있으며, 표시영역(DA) 중 화소(P)에 대응하여 패터닝될 수 있다. 중간층(320)은 발광층(322)과 화소전극(510) 사이에 개재되는 제1 기능층(321) 및 발광층(322)과 대향전극(530) 사이에 개재되는 제2 기능층(323) 중 적어도 어느 하나의 기능층을 포함할 수 있다.
제1 기능층(321)은 정공 주입층(HIL: Hole Injection Layer) 및 정공 수송층(HTL: Hole Transport Layer) 중 적어도 어느 하나를 포함할 수 있다. 정공 주입층은 애노드에서 정공을 용이하게 방출되게 하며, 정공 수송층은 정공 주입층의 정공이 발광층까지 전달되게 한다.
제2 기능층(323)은 전자 수송층(ETL: Electron Transport Layer) 및 전자 주입층(EIL: Electron Injection Layer) 중 적어도 어느 하나를 포함할 수 있다. 전자 주입층은 캐소드에서 전자를 용이하게 방출되게 하며, 전자 수송층은 전자 주입층의 전자가 발광층까지 전달되게 한다.
대향전극(530)은 발광층(322) 및 제2 유기막(140)을 덮도록 배치된다. 일체로 형성되어 표시영역(DA)을 전체적으로 커버할 수 있다. 일 실시예로서, 대향전극(530)은 은(Ag)과 마그네슘(Mg)을 함유하는 박막 금속층, 또는 인듐틴옥사이드(ITO; indium tin oxide), 인듐징크옥사이드(IZO; indium zinc oxide), 징크옥사이드(ZnO; zinc oxide), 인듐옥사이드(In2O3 indium oxide), 인듐갈륨옥사이드(IGO; indium gallium oxide) 또는 알루미늄징크옥사이드(AZO; aluminium zinc oxide)와 같은 투광성 도전층(TCO, transparent conductive oxide)일 수 있다.
화소(P) 상에는 봉지층(400)이 배치된다.
봉지층(400)은 제1, 2 무기 봉지막(410, 430)과 유기 봉지막(420)을 포함한다. 예컨대, 봉지층(400)은 제1 무기 봉지막(410), 유기 봉지막(420), 및 제2 무기 봉지막(430)이 순차적으로 적층되어 형성될 수 있다. 제1, 2 무기 봉지막(410, 430)은 실리콘 질화물, 알루미늄 질화물, 지르코늄 질화물, 티타늄 질화물, 하프늄 질화물, 탄탈륨 질화물, 실리콘 산화물, 알루미늄 산화물, 티타늄 산화물, 주석 산화물, 세륨 산화물 및 실리콘 산화질화물 중 적어도 어느 하나의 물질을 포함할 수 있다. 제1, 2 무기 봉지막(410, 430)은 예컨대 화학기상증착(CVD) 공정에 의해 형성될 수 있다.
유기 봉지막(420)은 아크릴계 수지, 메타크릴계 수지, 폴리이소프렌, 비닐계 수지, 에폭시계 수지, 우레탄계 수지, 셀룰로오스계 수지 및 페릴렌계 수지로 이루어진 군으로부터 선택된 하나 이상의 물질을 포함할 수 있다.
일 실시예로서, 유기 봉지막(420)은 HMDSO(Hexamethyldisiloxane) 또는 TEOS(tetraethly orthosilicate)와 같은 물질을 원료가스로 사용한 원자층증착(ALD: Atomic Layer Deposition) 공정에 의해 형성될 수 있다.
본 실시예에서, 화소회로층(110)은 관통홀(TH)을 구비한다. 관통홀(TH)은 화소회로층(110)을 관통하여, 플렉서블 기판(100)까지 연장되어 구비된다. 관통홀(TH)을 통해 플렉서블 기판(100) 상면의 적어도 일부가 노출된다. 관통홀(TH) 내부에는 유기물이 매립될 수 있는데, 제1 유기막(120)은 화소회로층(110) 상부에 배치되는바, 제1 유기막(120)의 일부가 관통홀(TH)에 매립될 수 있다. 관통홀(TH)을 통해 제1 유기막(120)은 플렉서블 기판(100)과 직접 컨택할 수 있다.
제2 유기막(140)의 아래에 배치된 제1 유기막(120)은 유기 절연물을 포함하는 층으로서, 디스플레이의 제조 공정 중이나 제조 이후에 유기 절연물에 열이나 빛과 같은 에너지가 가해지는 경우, 유기 절연물에 포함되어 있던 물질이 기화되면서 외부로 배출되는 현상(아웃 개싱(Out-gassing))이 야기될 수 있다. 아웃 개싱 현상에 의해 발생된 기체는 제1 유기막(120) 상에 위치하는 층들, 예컨대 중간층(320) 및 대향전극(330)을 손상시킬 수 있다.
제1 유기막(120)은 화소전극(310)이 형성되는 부분의 상면을 평탄화하게 해야하므로, 소정 이상의 두께를 갖도록 형성된다. 예컨대, 화소회로층(110)이 수 nm 내지 수백 nm의 두께로 형성되는 반면, 제1 유기막(120)은 약 1㎛ 내지 2㎛ 정도의 두께로 상대적으로 두껍게 형성된다. 이러한 제1 유기막(120)은 상술한 것과 같이 유기 절연물로 형성되므로, 제1 유기막(120)에 포함되어 있던 물질이 기화되면서 외부로 가스가 방출되는 아웃 개싱 현상이 발생한다. 방출된 아웃 개스(Out-gas)는 유기막을 타고 디스플레이 장치 내에서 이동할 수 있다.
비교예로서, 무기막(130)을 구비하지 않은 디스플레이 장치의 경우, 제1 유기막에서 발생된 아웃 개싱 현상은 제2 유기막으로 전달되며, 제2 유기막에서 발생한 아웃 개싱 현상과 함께 발광소자로 확산된다. 이러한 현상은 디스플레이 장치의 제조 공정 중 유기막의 경화(curing) 공정에서도 발생되고, 디스플레이 장치 제조 후 고온의 태양열 등에 의해서도 발생될 수 있다. 일 예로, 디스플레이 장치에 조사되는 자외선(UV)에 의해 유기물이 분해되고, O, F, S 등을 포함하는 아웃 개스(Out-gas)가 발생되어, 각 화소의 발광영역으로 확산된다. 아웃 개스(Out-gas)에 의해 각 화소의 발광영역의 축소(shrinakge) 및 이로 인한 휘도 감소의 문제점이 발생한다.
이에 본 발명의 일 실시예에 관한 디스플레이 장치에서는, 제1 유기막(120)에서 방출된 아웃개스(Out-gas)가 제2 유기막(140) 측으로 이동하여 발광소자(300)에 불량을 유발하는 것을 방지하기 위하여, 제1 유기막(120) 상에 무기막(130)을 구비한다. 또한, 화소회로층(110)에 관통홀(TH)을 형성하여, 제1 유기막(120)에서 방출된 아웃개스(Out-gas)가 관통홀(TH)을 통해 플렉서블 기판(100) 측으로 빠져나갈 수 있도록 한다. 이러한 구조를 통해 1 유기막(120)에서 방출된 아웃개스(Out-gas)가 발광소자(300) 측으로 유입되는 것을 차단함과 동시에 효과적으로 외부로 배출시킬 수 있다.
도 4는 본 발명의 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이고, 도 5는 도 4의 일부분을 확대한 확대도이며, 도 6은 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도들이다. 도 4 및 도 6에서는 화소회로(200) 및 화소회로(200)를 포함하는 화소회로층(110)의 구체적인 구조를 도시하고 있다. 도 4 및 도 6에서는 화소회로(200) 및 화소회로층(110)의 구조를 중심으로 설명한다.
도 4를 참조하면, 화소회로(200)는 박막트랜지스터(210) 및 스토리지 커패시터(220)를 포함한다. 화소회로층(110)은 플렉서블 기판(100) 상에 순차적으로 위치하는 버퍼층(101), 게이트절연층(103), 유전체 절연층(105), 층간 절연층(107) 및 무기 보호막(109)을 포함할 수 있다.
버퍼층(101)은 불순물의 침투를 방지하기 위해, 플렉서블 기판(100) 상에 배치되며, 게이트절연층(103)은 박막트랜지스터(210)의 반도체층(211)과 게이트전극(213) 사이에 개재되며, 유전체 절연층(105)은 스토리지 커패시터(220)의 하부전극(221)과 상부전극(223) 사이에 개재되고, 층간 절연층(107)은 박막트랜지스터(210)의 게이트전극(213)과 소스전극(215s) 및 드레인전극(215d) 사이에 개재된다.
버퍼층(101), 게이트절연층(103), 유전체 절연층(105), 층간 절연층(107) 및 무기 보호막(109)은 모두 절연성 무기물로 형성된다. 예컨대, 버퍼층(101), 게이트절연층(103), 유전체 절연층(105), 층간 절연층(107) 및 무기 보호막(109)은 각각 실리콘 질화물, 실리콘 산화물, 및/또는 실리콘산질화물로 형성될 수 있다.
도 4에서는, 박막트랜지스터(210)와 스토리지 커패시터(220)가 중첩되도록 배치되어, 박막트랜지스터(210)의 게이트전극(213)이 스토리지 커패시터(220)의 하부전극(221)인 경우를 도시하였으나, 본 발명은 이에 한정되지 않는다.
도 5는 도 4의 컨택부(B) 부분을 확대한 확대도이다.
도 5를 참조하면, 제1 유기막(120)은 박막트랜지스터(210)의 드레인전극(215d)에 대응하는 제1 개구(120H)를 포함하고, 무기막(130)은 그러한 제1 개구(120H) 내에 형성된 제2 개구(130H)를 포함한다.
제1 유기막(120)은 제1 개구(120H)를 통해 무기 보호막(109)의 상면(109A)의 일부를 노출시킬 수 있다. 제1 유기막(120) 상에 배치되는 무기막(130)은 제1 유기막(120)의 상면(120A) 및 제1 개구(120H)의 내측면(120IS)을 커버할 수 있다. 이때, 무기막(130)은 제1 개구(120H)를 통해 노출된 무기 보호막(109)의 상면(109A)과 직접 컨택하여 커버할 수 있다.
제2 개구(130H)는 제1 개구(120H) 내에 형성되되, 드레인전극(215d)의 상면(215da)이 직접 노출되도록 드레인전극(215d)까지 연장되어 형성될 수 있다. 즉, 제2 개구(120H)는 무기 보호막(109)에 형성된 제3 개구(109H)를 포함할 수 있으며, 제2 개구(120H)와 제3 개구(109H)는 동일한 내측면을 갖는 일체로 형성된 개구일 수 있다. 이는 제2 개구(120H)를 형성하는 과정에서 제3 개구(109H) 또한 동시에 형성되기 때문인 것으로 이해될 수 있다.
도 5에 도시된 것과 같이, 컨택부(B) 부분에서 제1 유기막(120)은 무기 보호막(109) 및 무기막(130)으로 커버될 수 있다.
도 6을 참조하면, 화소회로(200)의 박막트랜지스터(210) 및 스토리지 커패시터(220)는 서로 다른 위치에 배치될 수 있다.
화소회로(200)의 구조에 따라, 화소회로층(110)은 기판(100) 상에 순차적으로 위치하는 버퍼층(101), 게이트절연층(103), 및 층간 절연층(107)을 포함할 수 있다. 도 9에 도시된 바와 같이, 층간 절연층(107)이 스토리지 커패시터(220)의 하부전극(221)과 상부전극(223) 사이에 개재되어 유전체로서의 기능을 수행할 수 있다.
도 4 및 도 6에서는, 화소회로(200)의 박막트랜지스터(210)가 탑 게이트 타입인 경우를 설명하였으나, 본 발명은 이에 제한되지 않는다. 또 다른 실시예로, 박막트랜지스터(210)는 바텀 게이트 타입일 수 있다. 또한, 도 8에서는 스토리지 커패시터(220)의 하부전극(221)과 상부전극(223)이 각각 게이트전극(213)과 소스전극(215s) 및 드레인전극(215d)과 동일한 물질을 포함하도록 동일 층에 위치하는 경우를 설명하였으나, 본 발명은 이에 제한되지 않으며, 다양하게 변경 가능하다.
도 7 내지 도 9는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도들이다. 도 7 내지 도 9는 도 1의 B-B' 선에 따른 단면에 대응할 수 있다.
도 7 내지 도 9는 도 4와 동일한 화소회로(200)를 포함하나, 반드시 이에 한정되는 것은 아니다. 도 7 및 도 8을 디스플레이 영역(DA) 및 주변영역(PA)을 함께 도시한다. 도 7 내지 도 9에서 디스플레이 영역(DA)은 도 4와 동일한바 이하에서는 주변영역(PA)의 구조를 중심으로 설명한다.
도 7을 참조하면, 제1 유기막(120)은 주변영역(PA)까지 연장되어 배치된다. 무기막(130)은 제1 유기막(120) 상에 배치되고, 제1 유기막(120)과 함께 주변영역(PA)까지 연장되어 배치된다. 즉, 제1 개구(120H)의 내측면(120IS)을 포함한 제1 유기막(120)의 상면(120US)은 무기막(130)으로 커버될 수 있다. 주변영역(PA) 상에 배치된 제1 유기막(120)의 외측면(120OS)은 제1, 2 무기 봉지막(410, 430)으로 커버될 수 있다. 제1 유기막(120)의 외측면(120OS)은 제1 무기 봉지막(410)과 직접 컨택할 수 있다.
제1 유기막(120)은 내측면(120IS), 상면(120US)은 무기막(130)으로 커버되고, 외측면(120OS)은 무기 봉지막(410)으로 커버되며, 제1 유기막(120)의 하면(120LS)은 무기 보호막(109)으로 커버된다. 따라서, 제1 유기막(120)을 기준으로 관통홀(TH)을 제외한 제1 유기막(120)의 모든 표면이 무기막들(130, 410, 109)로 커버된다. 이를 통해, 제1 유기막(120)에서 방출된 아웃개스(Out-gas)가 이동하는 통로를 차단하며 관통홀(TH)을 통해 플렉서블 기판(100) 측으로 배출될 수 있도록 할 수 있다.
다른 실시예로, 도 8과 같이 제1 유기막(120)의 외측면(120OS)은 도전막(150)으로 커버될 수 있으며, 이 경우 도전막(150) 상에 제1, 2 무기 봉지막(410, 430)이 위치할 수 있다. 도시되어 있지 않으나, 도전막(150)은 화소회로(200)에 전원을 공급하는 전원공급배선과 전기적으로 컨택할 수 있다. 도전막(150)은 화소전극(310) 또는 대향전극(330)과 동일 물질을 포함할 수 있으나, 이에 한정되는 것은 아니다.
도 9를 참조하면, 무기막(130)이 제1 유기막(120)의 외측면(120OS)을 덮도록 연장될 수 있다. 도 9에서는 제1 개구(120H)의 내측면(120IS)을 포함한 제1 유기막(120)의 상면(120US) 및 제1 유기막(120)의 외측면(120OS)이 무기막(130)으로 커버된다.
제1 유기막(120)은 내측면(120IS), 상면(120US) 및 외측면(120OS)은 무기막(130)으로 커버되고, 제1 유기막(120)의 하면(120LS)은 무기 보호막(109)으로 커버된다. 따라서, 제1 유기막(120)을 기준으로 관통홀(TH)을 제외한 제1 유기막(120)의 모든 표면이 무기막들(130, 109)로 커버된다. 이를 통해, 제1 유기막(120)에서 방출된 아웃개스(Out-gas)가 이동하는 통로를 차단하며 관통홀(TH)을 통해 플렉서블 기판(100) 측으로 배출될 수 있도록 할 수 있다.
도 10 및 도 11은 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 평면도들이고, 도 12는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다. 도 12는 도 10 및 도 11의 C-C' 선에 따른 단면에 대응할 수 있다. 도 10 내지 도 12는 복수의 화소들을 도시한다.
도 10 내지 도 12을 참조하면, 디스플레이 영역(DA) 상에는 제1 화소전극(310R), 제2 화소전극(310G) 및 제3 화소전극(310B)이 배치된다. 제1 화소전극(310R), 제2 화소전극(310G) 및 제3 화소전극(310B)은 서로 다른 색을 발광하기 위해 구비될 수 있다. 일 실시예로, 제1 화소전극(310R)은 적색 발광용 화소전극일 수 있고, 제2 화소전극(310G)은 녹색 발광용 화소전극일 수 있으며, 제3 화소전극(310B)은 청색 발광용 화소전극일 수 있다. 제1 화소전극(310R), 제2 화소전극(310G) 및 제3 화소전극(310B)은 화소회로층(110) 상부에 위치하는데, 화소회로층(110) 상에는 제1 유기막(120)이 배치된다.
제1 유기막(120)은 섬(island)형으로 패터닝된 복수의 제1 유기패턴부(120P)들을 포함할 수 있다. 복수의 제1 유기패턴부(120P)들 상부는 도 12에 도시된 것과 같이 무기막(130)으로 커버될 수 있다.
화소전극들(310R, 310G, 310B)은 도 10과 같이 X축 방향으로 배열될 수도 있고, 도 11과 같이 X축 및 Y축 방향으로 배열될 수도 있다. 도 10 및 도 11의 화소전극들(310R, 310G, 310B)은 적색 발광용 제1 화소전극(310R) 및 녹색 발광용 제2 화소전극(310G)은 청색 발광용 제3 화소전극(310B)에 비해 작은 면적을 갖도록 형성될 수 있다. 본 발명은 이에 한정되지 않으며, 도 10 및 도 11의 구조 이외에도 펜타일 구조 등 다양한 형태로 구비될 수 있다.
도 10 및 도 11에서 복수의 제1 유기패턴부(120P)들은 각 화소, 즉 각 화소전극들(310R, 310G, 310B) 마다 패터닝된다. 도 10 및 도 11의 경우, 하나의 제1 유기패턴부(120P) 상에 화소전극들(310R, 310G, 310B)이 각각 배치될 수 있다. 다른 실시예로, 도 13 및 도 14와 같이 복수의 제1 유기패턴부(120P)들은 화소전극들(310R, 310G, 310B) 단위로 패터닝될 수도 있다. 도 13 및 도 14의 경우, 하나의 제1 유기패턴부(120P) 상에 복수의 화소전극들(310R, 310G, 310B)이 배치될 수 있다.
다시 도 10 내지 도 12를 참조하면, 각각의 화소전극들(310R, 310G, 310B) 상에는 발광영역을 정의하는 제2 유기막(140)이 배치될 수 있다. 제2 유기막(140)은 화소전극들(310R, 310G, 310B) 마다 패터닝되며, 각 화소전극들(310R, 310G, 310B)의 가장자리를 덮으며 중앙부를 노출시키는 개구들(OP1, OP2, OP3)을 구비할 수 있다. 개구들(OP1, OP2, OP3)을 통해 노출된 화소전극들(310R, 310G, 310B) 상에는 발광층들(322R, 322G, 322B)이 배치될 수 있다.
도 10 내지 도 13의 실시예들에서, 제2 유기막(140)은 복수의 제2 유기패턴부들(140P)을 포함할 수 있다. 즉, 제2 유기막(140)은 화소전극들(310R, 310G, 310B) 마다 패터닝되며, 각 화소전극들(310R, 310G, 310B)에 복수의 제2 유기패턴부들(140P)이 각각 대응할 수 있다. 복수의 제2 유기패턴부들(140P)은 각 화소전극들(310R, 310G, 310B)들 상에 서로 이격되어 배치될 수 있다.
도 13을 참조하면, 플렉서블 기판(100) 상에 화소회로(200)를 포함하는 화소회로층(110)이 배치된다. 화소회로(200)는 각 화소영역들(PAX1, PXA2, PXA3) 마다 대응되도록 배치된다. 화소회로층(110)은 플렉서블 기판(100) 전면(全面)에 배치될 수 있다. 도 13의 화소회로층(110)은 전술한 도 4의 화소회로층(110)과 동일하나, 본 발명이 이에 한정되는 것은 아니다.
화소회로층(110)에는 전술한 실시예들과 동일하게 화소회로층(110)을 관통하는 관통홀(TH)이 구비된다. 관통홀(TH)은 각 화소(300R, 300G, 300B) 별로 적어도 하나 이상 구비될 수 있다.
화소회로층(110) 상에는 제1 유기막(120)이 배치된다. 제1 유기막(120)은 화소영역(PAX1, PXA2, PXA3) 별로 패터닝된 복수의 제1 유기패턴부(120P)들을 포함할 수 있다. 복수의 제1 유기패턴부(120P)들은 이격 영역(SA)을 사이에 두고 서로 소정 간격 이격되어 배치되며, 화소회로층(110)의 상면의 적어도 일부가 이격 영역(SA)을 통해 노출될 수 있다. 도 13에서는 화소회로층(110)의 최상부에 위치한 무기 보호막(109)의 상면의 적어도 일부가 이격 영역(SA)을 통해 노출될 수 있다.
제1 유기막(120) 상에는 무기막(130)이 배치된다. 무기막(130)은 제1 유기막(120) 상에서 일체(一體)로 형성되어, 복수의 제1 유기패턴부(120P)들을 포함한 제1 유기막(120)을 커버할 수 있다. 본 실시예에서, 무기막(130)은 복수의 제1 유기패턴부(120P)들 각각의 상면(120US), 외측면(120OS) 및 내측면(120IS)을 커버할 수 있다.
무기막(130) 상부에는 제2 유기막(140)이 배치된다. 제2 유기막(140)은 복수의 제2 유기패턴부들(140P)을 포함하며, 복수의 제2 유기패턴부들(140P) 각각은 복수의 제1 유기패턴부들(120P) 상에 위치할 수 있다.
복수의 제1 유기패턴부들(120P) 및 복수의 제2 유기패턴부들(140P)의 구조를 통해, 아웃 개스가 발생할 수 있는 유기막들의 면적을 축소시킬 수 있으며, 각 화소(300R, 300G, 300B) 간에 유기층들이 접촉할 수 있는 경로를 차단시켜, 각 화소(300R, 300G, 300B) 개별로 봉지하는 것이 가능할 수 있다.
무기막(130)에 의해 복수의 제1 유기패턴부(120P)들과 복수의 제2 유기패턴부(140P)들은 서로 접촉하지 않으며 물리적으로 분리될 수 있다. 따라서, 복수의 제1 유기패턴부(120P)들 각각은 오직 관통홀(TH)을 통해서만 유기물로 형성된 플렉서블 기판(100)과 연통된다. 전술한 것과 같이, 아웃 개스는 유기층을 따라 이동하는바, 제1 유기막(120)에서 방출된 아웃 개스는 제2 유기막(140) 측으로의 경로가 차단되어 관통홀(TH)을 통해 플렉서블 기판(100) 측으로 배출될 수 있다.
도 13 및 도 14는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 평면도들이고, 도 15는 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다. 도 15는 도 13 및 도 14의 D-D' 선에 따른 단면에 대응할 수 있다. 도 13 내지 도 15는 복수의 화소들을 도시한다.
도 13 내지 도 15의 실시예는, 도 10 내지 도 12의 실시예와 비교할 때 제1 유기막(120) 및 제2 유기막(140) 구조에서 차이가 있다. 그 외의 구성들은 도 10 내지 도 12의 실시예와 동일한 바 이하에서는 차이점을 위주로 설명한다.
도 13 내지 도 15를 참조하면, 제1 유기막(120)은 복수의 제1 유기패턴부(120P)들을 구비할 수 있다. 도 13 내지 도 15에서는 하나의 제1 유기패턴부(120P)를 도시한다. 본 실시예에서, 제1 유기패턴부(120P)는 화소전극들(310R, 310G, 310B) 단위로 패터닝될 수 있다. 즉, 하나의 제1 유기패턴부(120P) 상에 복수의 화소전극들(310R, 310G, 310B)이 배치될 수 있다.
제2 유기막(140)은 복수의 제2 유기패턴부(140P)들을 구비할 수 있다. 도 13 내지 도 15에서는 하나의 제2 유기패턴부(140P)를 도시한다. 즉, 제2 유기패턴부(140P)는 제1 유기패턴부(120P) 상에서 일체로 구비되며, 화소전극들(310R, 310G, 310B)을 각각 노출시키는 개구들(OP1, OP2, OP3)을 포함할 수 있다.
이와 같은 구조를 통해 화소 단위(300R, 300G, 300B) 별로 봉지하는 것이 가능하다.
도 16은 본 발명의 또 다른 실시예에 따른 디스플레이 장치를 개략적으로 도시하는 단면도이다.
도 16을 참조하면, 전술한 제1 유기막(120)의 제1 유기패턴부(120P) 및 제2 유기막(140)의 제2 유기패턴부(140P) 구조는 스트레쳐블(stretchable)한 구조를 갖는 디스플레이 장치에도 적용될 수 있다.
도 16의 플렉서블 기판(100)은 스트레쳐블한 특성을 위해 플렉서블 기판(100)을 관통하는 관통패턴(100TH)을 구비할 수 있다.
관통패턴(100TH)을 사이에 두고 화소들이 배치될 수 있다. 발광소자(300)는 화소전극(310), 발광층(322), 대향전극(330)을 포함한다. 도 16에서는 대향전극(330)이 화소 별로 각각 배치된 것으로 도시되나, 대향전극(330)은 플렉서블 기판(100) 상부에 일체로 구비된다.
이와 같이 플렉서블 기판(100)에 관통패턴(100TH)이 형성된 디스플레이 장치에 있어서, 관통패턴(100TH)을 사이에 두고 배치된 화소들은 개별적으로 봉지될 수 있다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 당해 기술분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것 이다.
100: 플렉서블 기판
109: 무기 보호막
110: 화소회로층
120: 제1 유기막
130: 무기막
140: 제2 유기막
200: 화소회로
210: 박막트랜지스터
220: 스토리지 커패시터
300: 발광소자
400: 봉지층

Claims (24)

  1. 플렉서블 기판;
    상기 플렉서블 기판 상에 배치되고 박막트랜지스터를 포함하며, 상기 플렉서블 기판까지 연장된 관통홀을 갖는, 화소회로층;
    상기 화소회로층 상에 배치되며, 상기 관통홀을 통해 상기 플렉서블 기판과 컨택하는, 제1 유기막;
    상기 제1 유기막 상면을 덮도록 상기 제1 유기막 상에 배치되는, 무기막;
    상기 무기막 상에 배치되는, 화소전극; 및
    상기 화소전극 상부에 배치되며, 제1 무기 봉지막, 제2 무기 봉지막 및 상기 제1 무기 봉지막과 상기 제2 무기 봉지막 사이에 개재된 유기 봉지막을 포함하는, 봉지층;
    을 구비하는, 디스플레이 장치.
  2. 제1항에 있어서,
    상기 제1 유기막은 상기 박막트랜지스터 상부에 위치해 상기 화소회로층 상면의 적어도 일부를 노출시키는 제1 개구를 갖고,
    상기 무기막은 상기 제1 개구를 덮는, 디스플레이 장치.
  3. 제2항에 있어서,
    상기 무기막은 상기 제1 개구에 의해 노출된 상기 화소회로층 상면과 컨택하는, 디스플레이 장치.
  4. 제3항에 있어서,
    상기 화소회로층의 상면은 무기막인, 디스플레이 장치.
  5. 제2항에 있어서,
    상기 무기막은 상기 제1 개구 내에 위치한 제2 개구를 갖고,
    상기 화소전극은 상기 제2 개구를 통해 상기 박막트랜지스터와 전기적으로 연결되는, 디스플레이 장치.
  6. 제5항에 있어서,
    상기 화소회로층은 상기 박막트랜지스터를 덮으며 무기물을 포함하는 무기 보호막을 더 포함하고,
    상기 제2 개구는 상기 무기 보호막을 관통하도록 연장되는, 디스플레이 장치.
  7. 제1항에 있어서,
    상기 무기막은 상기 제1 유기막의 측면을 덮도록 연장되는, 디스플레이 장치.
  8. 제1항에 있어서,
    상기 관통홀은 상기 제1 유기막과 동일한 유기물로 매립되는, 디스플레이 장치.
  9. 제1항에 있어서,
    상기 제1 유기막은 상기 관통홀을 통해 상기 플렉서블 기판과 직접 컨택하는, 디스플레이 장치.
  10. 제1항에 있어서,
    상기 무기막 상에 배치되며, 상기 화소전극의 가장자리를 덮되 중앙부를 노출시켜 발광영역을 정의하는 제2 유기막을 더 포함하는, 디스플레이 장치.
  11. 제1항에 있어서,
    상기 플렉서블 기판은 상기 플렉서블 기판을 관통하는 관통패턴을 포함하는, 디스플레이 장치.
  12. 제1항에 있어서,
    상기 봉지층은 상기 제1 유기막의 외측면을 덮도록 연장되는, 디스플레이 장치.
  13. 제12항에 있어서,
    상기 봉지층의 상기 제1 무기 봉지막은 상기 제1 유기막의 외측면과 면접촉하는, 디스플레이 장치.
  14. 제1항에 있어서,
    상기 박막트랜지스터는 반도체층, 상기 반도체층과 적어도 일부가 중첩되는 게이트전극 및 상기 반도체층과 연결된 소스전극과 드레인전극을 포함하고,
    상기 제1 유기막은 상기 소스전극 및 드레인전극 중 적어도 하나를 포함한 상기 화소회로층 상면의 적어도 일부를 노출시키는 제1 개구를 갖는, 디스플레이 장치.
  15. 제14항에 있어서,
    상기 무기막은 상기 제1 개구를 통해 노출된 상기 화소회로층의 상면과 면접촉하는, 디스플레이 장치.
  16. 제15항에 있어서,
    상기 무기막은 상기 소스전극 및 드레인전극 중 적어도 하나를 노출시키는 제2 개구를 갖는, 디스플레이 장치.
  17. 제16항에 있어서,
    상기 화소전극은 상기 제2 개구를 통해 상기 소스전극 및 드레인전극 중 적어도 하나와 전기적으로 컨택하는, 디스플레이 장치.
  18. 제1항에 있어서,
    상기 플렉서블 기판은 유기물을 포함하는, 디스플레이 장치.
  19. 제18항에 있어서,
    상기 제1 유기막은 상기 관통홀을 통해 상기 플렉서블 기판과 연통하는, 디스플레이 장치.
  20. 플렉서블 기판;
    상기 플렉서블 기판 상에 배치되고 복수의 박막트랜지스터들을 포함하며, 상기 플렉서블 기판까지 연장된 적어도 하나 이상의 관통홀을 갖는, 화소회로층;
    상기 화소회로층 상에 배치되며, 상기 관통홀을 통해 상기 플렉서블 기판과 컨택하고, 아일랜드 형태로 패터닝된 복수의 유기패턴부들을 포함하는, 제1 유기막;
    상기 제1 유기막 상면을 덮도록 상기 제1 유기막 상에 배치되는, 무기막;
    상기 무기막 상에 배치되며, 상기 복수의 유기패턴부들 상에 각각 배치되는 제1 화소전극, 제2 화소전극 및 제3 화소전극; 및
    상기 제1 화소전극, 제2 화소전극 및 제3 화소전극 상부에 배치되며, 제1 무기 봉지막, 제2 무기 봉지막 및 상기 제1 무기 봉지막과 상기 제2 무기 봉지막 사이에 개재된 유기 봉지막을 포함하는, 봉지층;
    을 구비하는, 디스플레이 장치.
  21. 제20항에 있어서,
    상기 화소회로층은 무기막을 포함하고,
    상기 무기막은 상기 복수의 유기패턴부들이 서로 이격되어 상기 무기막의 상면의 적어도 일부가 노출된 이격영역을 가지며,
    상기 무기막은 상기 이격영역과 컨택하는, 디스플레이 장치.
  22. 제20항에 있어서,
    상기 관통홀은 상기 복수의 유기패턴부들에 각각 대응되도록 상기 복수의 유기패턴부들 각각의 하부에 적어도 하나 이상 구비되며, 상기 복수의 유기패턴부들 각각은 상기 관통홀을 통해 상기 플렉서블 기판과 연통되는, 디스플레이 장치.
  23. 제20항에 있어서,
    상기 제1 화소전극 상에 배치되며 적색 파장의 광을 발광하는 제1 중간층, 상기 제2 화소전극 상에 배치되며 녹색 파장의 광을 발광하는 제2 중간층, 및 상기 제3 화소전극 상에 배치되며 청색 파장의 광을 발광하는 제3 중간층; 및
    상기 제1 중간층, 상기 제2 중간층 및 상기 제3 중간층을 덮는 대향전극;
    을 더 포함하는, 디스플레이 장치.
  24. 제20항에 있어서,
    상기 플렉서블 기판은 유기물을 포함하는, 디스플레이 장치.
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