KR102138107B1 - 표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치 - Google Patents

표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치 Download PDF

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Abstract

표시 패널의 구동 방법은 하나의 프레임은 두 개의 서브 프레임으로 분할되며, 연속한 두 개의 서브 프레임동안 제1 측의 화소열 및 제2 측의 화소열과 교대로 연결되는 데이터 라인들 및 데이터 라인과 교차하는 게이트 라인들을 포함하는 표시 패널의 홀수 번째 게이트 라인들에 홀수 게이트 신호를 출력하는 단계 및 연속한 두 개의 서브 프레임동안 표시 패널의 짝수 번째 게이트 라인들에 짝수 게이트 신호를 출력하는 단계를 포함한다. 이에 따라, 표시 패널의 표시 품질을 향상시킬 수 있다.

Description

표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치 {METHOD OF DRIVING DISPLAY PANEL AND DISPLAY APPARATUS FOR PERFORMING THE SAME}
본 발명은 표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치에 관한 것으로, 보다 상세하게는 표시 품질을 향상시키기 위한 표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치에 관한 것이다.
일반적으로, 액정 표시 장치는 화소 전극을 포함하는 제1 기판, 공통 전극을 포함하는 제2 기판 및 상기 기판들 사이에 개재되는 액정층을 포함한다. 상기 두 전극에 전압을 인가하여 액정층에 전계를 생성하고, 이 전계의 세기를 조절하여 액정층을 통과하는 빛의 투과율을 조절함으로써 원하는 화상을 얻는다.
일반적으로, 표시 장치는 표시 패널 및 패널 구동부를 포함한다. 상기 표시 패널은 복수의 게이트 라인들, 복수의 데이터 라인들 및 상기 게이트 라인들 및 상기 데이터 라인들에 연결되는 복수의 화소들을 포함한다. 상기 패널 구동부는 상기 복수의 게이트 라인들에 게이트 신호를 제공하는 게이트 구동부 및 상기 데이터 라인들에 데이터 전압을 제공하는 데이터 구동부를 포함한다.
상기 표시 패널의 상기 화소들에는 공통 전압을 기준으로 정극성을 갖는 정극성 전압 및 부극성을 갖는 부극성 전압이 교대로 인가될 수 있다. 제1 프레임에서 모든 화소들에 상기 정극성 전압이 인가되고 제2 프레임에서 모든 화소에 상기 부극성 전압이 인가될 경우, 동일 계조에 대한 상기 정극성 전압 및 상기 부극성 전압의 휘도 차에 의해 깜빡거림이 시인될 수 있다.
따라서, 상기 표시 패널의 데이터 라인들에는 정극성 전압 및 부극성 전압이 교대로 인가되어 상기 표시 패널은 컬럼 반전 구동될 수 있다. 그러나, 상기 표시 패널의 상기 화소들이 컬럼 반전 구동되고, 특정 패턴이 하나의 프레임에 하나의 화소만큼 스크롤되는 경우, 세로줄 얼룩이 시인될 수 있다.
상기 세로줄 얼룩을 방지하기 위해 상기 표시 패널의 데이터 라인들에는 정극성 전압 및 부극성 전압을 교대로 인가하고, 상기 데이터 라인은 상기 데이터 라인의 제1 측의 화소 열의 화소들과 상기 데이터 라인의 제2 측의 화소 열의 화소들과 교대로 연결하여, 상기 표시 패널은 도트 반전 구동될 수 있다. 그러나, 상기 표시 패널의 상기 화소들이 도트 반전 구동 되고, 상기 표시 패널이 혼색 영상을 표시할 때, 화소 행의 화소 마다 프리챠지 양의 차이가 발생하여 가로줄 얼룩이 시인될 수 있다.
화소 전압의 충전률을 충분히 확보하기 위해 프리챠지 양을 증가시키면 상기 가로줄 얼룩이 시인되는 문제가 있고, 상기 혼색 영상으로 인한 가로줄 얼룩을 방지하기 위해 프리챠지 양을 감소시키면, 상기 표시 패널 내의 일부 영역에서는 충전률 부족으로 인한 무라가 시인될 수 있다.
이에 본 발명의 기술적 과제는 이러한 점에서 착안된 것으로, 본 발명의 목적은 충전률을 충분히 확보하면서 혼색 영상으로 인한 가로줄 얼룩을 방지하여 표시 패널의 표시 품질을 향상시키는 표시 패널의 구동 방법을 제공하는 것이다.
본 발명의 다른 목적은 상기 표시 패널의 구동 방법을 수행하기 위한 표시 장치를 제공하는 것이다.
상기한 본 발명의 목적을 실현하기 위한 일 실시예에 따른 표시 패널의 구동 방법은 하나의 프레임은 두 개의 서브 프레임으로 분할되며, 연속한 두 개의 서브 프레임동안 제1 측의 화소열 및 제2 측의 화소열과 교대로 연결되는 데이터 라인들 및 상기 데이터 라인과 교차하는 게이트 라인들을 포함하는 표시 패널의 홀수 번째 게이트 라인들에 홀수 게이트 신호를 출력하는 단계 및 연속한 두 개의 서브 프레임동안 상기 표시 패널의 짝수 번째 게이트 라인들에 짝수 게이트 신호를 출력하는 단계를 포함한다.
본 발명의 일 실시예에 있어서, 상기 홀수 게이트 신호를 출력하는 단계는 제N 프레임(N은 자연수)의 제1 서브 프레임 및 제N+1 프레임의 제2 서브 프레임동안 상기 홀수 번째 게이트 라인들에 상기 홀수 게이트 신호를 출력할 수 있다. 상기 짝수 게이트 신호를 출력하는 단계는 상기 제N 프레임의 제2 서브 프레임 및 상기 제N+1 프레임의 제1 서브 프레임동안 상기 짝수 번째 게이트 라인들에 상기 짝수 게이트 신호를 출력할 수 있다.
본 발명의 일 실시예에 있어서, 상기 홀수 게이트 신호를 출력하는 단계는 제1 수직 개시 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성하는 단계를 포함할 수 있다. 상기 짝수 게이트 신호를 출력하는 단계는 상기 제1 수직 개시 신호와 다른 타이밍을 갖는 제2 수직 개시 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성하는 단계를 포함할 수 있다.
본 발명의 일 실시예에 있어서, 상기 제2 수직 개시 신호는 마지막 홀수 번째 게이트 신호를 기초로 생성될 수 있다.
본 발명의 일 실시예에 있어서, 상기 홀수 게이트 신호를 생성하는 단계는 상기 제1 수직 개시 신호, 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제1 게이트 클럭 신호 및 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제2 게이트 클럭 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성할 수 있다. 상기 짝수 게이트 신호를 생성하는 단계는 상기 제2 수직 개시 신호, 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제3 게이트 클럭 신호 및 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제4 게이트 클럭 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성할 수 있다.
본 발명의 일 실시예에 있어서, 상기 제3 게이트 클럭 신호는 상기 제1 게이트 클럭 신호와 동일하고, 상기 제4 게이트 클럭 신호는 상기 제2 게이트 클럭 신호와 동일할 수 있다.
본 발명의 일 실시예에 있어서, 상기 화소들은 동일한 화소 열 내에서 두 행 이전의 화소의 화소 전압에 의해 프리챠지될 수 있다.
본 발명의 일 실시예에 있어서, 입력 영상 데이터를 홀수 영상 데이터 및 짝수 영상 데이터를 분리하는 단계, 제1 서브 프레임 동안 상기 홀수 영상 데이터를 기초로 생성한 홀수 데이터 전압을 상기 데이터 라인들에 출력하는 단계 및 제2 서브 프레임 동안 상기 짝수 영상 데이터를 기초로 생성한 짝수 데이터 전압을 상기 데이터 라인들에 출력하는 단계를 더 포함할 수 있다.
본 발명의 일 실시예에 있어서, 상기 입력 영상 데이터는 교대로 반복되는 홀수 영상 데이터 행 및 짝수 영상 데이터 행을 포함할 수 있다.
본 발명의 일 실시예에 있어서, 상기 입력 영상 데이터는 상부 절반에 대응하는 상기 홀수 영상 데이터 및 하부 절반에 대응하는 상기 짝수 영상 데이터를 포함할 수 있다.
상기한 본 발명의 목적을 실현하기 위한 일 실시예에 따른 표시 장치는 표시 패널, 제1 게이트 구동부 및 제2 게이트 구동부를 포함한다. 상기 표시 패널은 복수의 게이트 라인들, 복수의 데이터 라인들 및 상기 게이트 라인들 및 상기 데이터 라인들에 연결되는 복수의 화소들을 포함한다. 상기 데이터 라인은 상기 데이터 라인의 제1 측의 화소열 및 상기 데이터 라인의 제2 측의 화소열과 교대로 연결된다. 하나의 프레임은 두개의 서브 프레임으로 분할된다. 상기 제1 게이트 구동부는 연속한 두 개의 서브 프레임동안 홀수 번째 게이트 라인들에 홀수 게이트 신호를 출력한다. 상기 제2 게이트 구동부는 연속한 두 개의 서브 프레임동안 짝수 번째 게이트 라인들에 짝수 게이트 신호를 출력한다.
본 발명의 일 실시예에 있어서, 상기 제1 게이트 구동부는 제N 프레임(N은 자연수)의 제1 서브 프레임 및 제N+1 프레임의 제2 서브 프레임동안 상기 홀수 번째 게이트 라인들에 상기 홀수 게이트 신호를 출력할 수 있다. 상기 제2 게이트 구동부는 상기 제N 프레임의 제2 서브 프레임 및 상기 제N+1 프레임의 제1 서브 프레임동안 상기 짝수 번째 게이트 라인들에 상기 짝수 게이트 신호를 출력할 수 있다.
본 발명의 일 실시예에 있어서, 상기 제1 게이트 구동부는 제1 수직 개시 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성할 수 있다. 상기 제2 게이트 구동부는 상기 제1 수직 개시 신호와 다른 타이밍을 갖는 제2 수직 개시 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성할 수 있다.
본 발명의 일 실시예에 있어서, 상기 제2 수직 개시 신호는 마지막 홀수 번째 게이트 신호를 기초로 생성될 수 있다.
본 발명의 일 실시예에 있어서, 상기 제1 게이트 구동부는 상기 제1 수직 개시 신호, 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제1 게이트 클럭 신호 및 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제2 게이트 클럭 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성할 수 있다. 상기 제2 게이트 구동부는 상기 제2 수직 개시 신호, 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제3 게이트 클럭 신호 및 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제4 게이트 클럭 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성할 수 있다.
본 발명의 일 실시예에 있어서, 상기 제3 게이트 클럭 신호는 상기 제1 게이트 클럭 신호와 동일하고, 상기 제4 게이트 클럭 신호는 상기 제2 게이트 클럭 신호와 동일할 수 있다.
본 발명의 일 실시예에 있어서, 상기 화소들은 동일한 화소 열 내에서 두 행 이전의 화소의 화소 전압에 의해 프리챠지될 수 있다.
본 발명의 일 실시예에 있어서, 상기 표시 장치는 세트 보드 및 타이밍 컨트롤러를 더 포함할 수 있다. 상기 세트 보드는 입력 영상 데이터를 공급하는 영상 공급부를 포함할 수 있다. 상기 타이밍 컨트롤러는 상기 입력 영상 데이터를 수신하여 홀수 영상 데이터 및 짝수 영상 데이터를 분리하는 영상 분리부 및 상기 홀수 영상 데이터 및 상기 짝수 영상 데이터를 보정하여 데이터 신호를 생성하는 영상 보정부를 포함할 수 있다.
본 발명의 일 실시예에 있어서, 상기 영상 분리부는 1/2 프레임 메모리를 포함할 수 있다.
본 발명의 일 실시예에 있어서, 상기 표시 장치는 세트 보드 및 타이밍 컨트롤러를 더 포함할 수 있다. 상기 세트 보드는 입력 영상 데이터를 공급하는 영상 공급부 및 상기 입력 영상 데이터를 수신하여 홀수 영상 데이터 및 짝수 영상 데이터를 분리하는 영상 분리부를 포함할 수 있다. 상기 타이밍 컨트롤러는 상기 홀수 영상 데이터 및 상기 짝수 영상 데이터를 보정하여 데이터 신호를 생성하는 영상 보정부를 포함할 수 있다.
이와 같은 표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치에 따르면, 엇갈림 패턴의 패널 구조에서 홀수 번째 게이트 라인들 및 짝수 번째 게이트 라인들을 분리 구동하여 가로줄 얼룩을 방지할 수 있고, 프리챠지의 양을 충분히 확보하여 충전률 부족으로 인한 얼룩을 방지할 수 있다. 또한, 연속한 두 개의 서브 프레임동안 홀수 게이트 신호를 출력하고 연속한 두 개의 서브 프레임동안 짝수 게이트 신호를 출력하여 패턴 스크롤로 인한 무빙 아티팩트를 방지할 수 있다. 결과적으로 표시 패널의 표시 품질을 향상시킬 수 있다.
도 1은 본 발명의 일 실시예에 따른 표시 장치를 나타내는 블록도이다.
도 2는 도 1의 표시 패널의 화소 구조를 나타내는 평면도이다.
도 3은 도 1의 게이트 구동부를 나타내는 블록도이다.
도 4는 도 1의 게이트 구동부의 입출력 신호를 나타내는 타이밍도이다.
도 5a는 제1 서브 프레임에서 제2 내지 제4 데이터 라인에 연결되는 화소의 프리챠지를 나타내는 개념도이다.
도 5b는 제2 서브 프레임에서 제2 내지 제4 데이터 라인에 연결되는 화소의 프리챠지를 나타내는 개념도이다.
도 6은 도 1의 타이밍 컨트롤러 및 세트 보드를 나타내는 블록도이다.
도 7a 및 7b는 도 1의 입력 영상 데이터를 나타내는 개념도이다.
도 8은 패턴 스크롤에 의해 발생할 수 있는 무빙 아티팩트를 나타내기 위한 개념도이다.
도 9는 패턴 스크롤에 의해 도 1의 표시 패널에 표시되는 영상을 나타내기 위한 개념도이다.
도 10은 본 발명의 다른 실시예에 따른 표시 장치를 나타내는 블록도이다.
도 11은 도 10의 타이밍 컨트롤러 및 세트 보드를 나타내는 블록도이다.
이하, 첨부한 도면들을 참조하여, 본 발명을 보다 상세하게 설명하고자 한다.
도 1은 본 발명의 일 실시예에 따른 표시 장치를 나타내는 블록도이다.
도 1을 참조하면, 상기 표시 장치는 표시 패널(100), 패널 구동부 및 세트 보드(600)를 포함한다. 상기 패널 구동부는 타이밍 컨트롤러(200), 게이트 구동부(300), 감마 기준 전압 생성부(400) 및 데이터 구동부(500)를 포함한다.
상기 표시 패널(100)은 영상을 표시하는 표시부 및 상기 표시부에 이웃하여 배치되는 주변부를 포함한다.
상기 표시 패널(100)은 복수의 게이트 라인들(GL), 복수의 데이터 라인들(DL) 및 상기 게이트 라인들(GL)과 상기 데이터 라인들(DL) 각각에 전기적으로 연결된 복수의 단위 화소들을 포함한다. 상기 게이트 라인들(GL)은 제1 방향(D1)으로 연장되고, 상기 데이터 라인들(DL)은 상기 제1 방향(D1)과 교차하는 제2 방향(D2)으로 연장된다.
각 단위 화소는 스위칭 소자(미도시), 상기 스위칭 소자에 전기적으로 연결된 액정 캐패시터(미도시) 및 스토리지 캐패시터(미도시)를 포함할 수 있다. 상기 단위 화소들은 매트릭스 형태로 배치될 수 있다.
상기 표시 패널(100)의 화소 구조에 대해서는 도 2를 참조하여 상세히 후술한다.
상기 타이밍 컨트롤러(200)는 세트 보드(600)로부터 입력 영상 데이터(RGB)를 수신한다. 상기 타이밍 컨트롤러(200)는 외부의 장치로부터 입력 제어 신호(CONT)를 수신한다. 상기 입력 영상 데이터(RGB)는 적색 영상 데이터, 녹색 영상 데이터 및 청색 영상 데이터를 포함할 수 있다. 상기 입력 제어 신호(CONT)는 마스터 클럭 신호, 데이터 인에이블 신호를 포함할 수 있다. 상기 입력 제어 신호(CONT)는 수직 동기 신호 및 수평 동기 신호를 더 포함할 수 있다.
상기 타이밍 컨트롤러(200)는 상기 입력 영상 데이터(RGB) 및 상기 입력 제어 신호(CONT)를 근거로 제1 제어 신호(CONT1), 제2 제어 신호(CONT2), 제3 제어 신호(CONT3) 및 데이터 신호(DATA)를 생성한다.
상기 타이밍 컨트롤러(200)는 상기 입력 제어 신호(CONT)를 근거로 상기 게이트 구동부(300)의 동작을 제어하기 위한 상기 제1 제어 신호(CONT1)를 생성하여 상기 게이트 구동부(300)에 출력한다. 상기 제1 제어 신호(CONT1)는 수직 개시 신호 및 게이트 클럭 신호를 포함할 수 있다.
상기 타이밍 컨트롤러(200)는 상기 입력 제어 신호(CONT)를 근거로 상기 데이터 구동부(500)의 동작을 제어하기 위한 상기 제2 제어 신호(CONT2)를 생성하여 상기 데이터 구동부(500)에 출력한다. 상기 제2 제어 신호(CONT2)는 수평 개시 신호 및 로드 신호를 포함할 수 있다.
상기 타이밍 컨트롤러(200)는 상기 입력 영상 데이터(RGB)를 근거로 데이터 신호(DATA)를 생성한다. 상기 타이밍 컨트롤러(200)는 상기 데이터 신호(DATA)를 상기 데이터 구동부(500)에 출력한다. 상기 타이밍 컨트롤러(200)는 상기 데이터 신호(DATA)를 상기 게이트 구동부(300)에도 출력할 수 있다.
상기 타이밍 컨트롤러(200)는 상기 입력 제어 신호(CONT)를 근거로 상기 감마 기준 전압 생성부(400)의 동작을 제어하기 위한 상기 제3 제어 신호(CONT3)를 생성하여 상기 감마 기준 전압 생성부(400)에 출력한다.
상기 타이밍 컨트롤러(200)에 대해서는 도 6을 참조하여 상세히 설명한다.
상기 게이트 구동부(300)는 상기 타이밍 컨트롤러(200)로부터 입력 받은 상기 제1 제어 신호(CONT1)에 응답하여 상기 게이트 라인들(GL)을 구동하기 위한 게이트 신호들을 생성한다. 상기 게이트 구동부(300)는 상기 게이트 신호들을 상기 게이트 라인들(GL)에 순차적으로 출력한다.
상기 게이트 구동부(300)는 상기 표시 패널(100)에 직접 실장(mounted)되거나, 테이프 캐리어 패키지(tape carrier package: TCP) 형태로 상기 표시 패널(100)에 연결될 수 있다. 한편, 상기 게이트 구동부(300)는 상기 표시 패널(100)의 상기 주변부에 집적(integrated)될 수 있다.
상기 게이트 구동부(300)는 홀수 번째 게이트 라인과 짝수 번째 게이트 라인을 분리하여 구동한다.
상기 게이트 구동부(300)에 대해서는 도 2를 참조하여 자세히 설명한다.
상기 감마 기준 전압 생성부(400)는 상기 타이밍 컨트롤러(200)로부터 입력 받은 상기 제3 제어 신호(CONT3)에 응답하여 감마 기준 전압(VGREF)을 생성한다. 상기 감마 기준 전압 생성부(400)는 상기 감마 기준 전압(VGREF)을 상기 데이터 구동부(500)에 제공한다. 상기 감마 기준 전압(VGREF)은 각각의 데이터 신호(DATA)에 대응하는 값을 갖는다.
본 발명의 일 실시예에서, 상기 감마 기준 전압 생성부(400)는 상기 타이밍 컨트롤러(200) 내에 배치되거나 상기 데이터 구동부(500) 내에 배치될 수 있다.
상기 데이터 구동부(500)는 상기 타이밍 컨트롤러(200)로부터 상기 제2 제어 신호(CONT2) 및 상기 데이터 신호(DATA)를 입력 받고, 상기 감마 기준 전압 생성부(400)로부터 상기 감마 기준 전압(VGREF)을 입력 받는다. 상기 데이터 구동부(500)는 상기 데이터 신호(DATA)를 상기 감마 기준 전압(VGREF)을 이용하여 아날로그 형태의 데이터 전압으로 변환한다. 상기 데이터 구동부(500)는 상기 데이터 전압을 상기 데이터 라인(DL)에 출력한다.
상기 데이터 구동부(500)는 홀수 영상 데이터를 기초로 생성된 홀수 데이터 전압 및 짝수 영상 데이터를 기초로 생성된 짝수 데이터 전압을 상기 데이터 라인(DL)에 출력한다.
상기 데이터 구동부(500)는 상기 표시 패널(100)에 직접 실장되거나, 테이프 캐리어 패키지(tape carrier package: TCP) 형태로 상기 표시 패널(100)에 연결될 수 있다. 한편, 상기 데이터 구동부(500)는 상기 표시 패널(100)의 상기 주변부에 집적될 수도 있다.
도 2는 도 1의 표시 패널(100)의 화소 구조를 나타내는 평면도이다.
도 1 및 도 2를 참조하면, 상기 표시 패널(100)은 복수의 화소들을 포함한다. 상기 복수의 화소들은 상기 제1 방향(D1)으로 화소 행을 이루고, 상기 제2 방향(D2)으로 화소 열을 이룬다.
상기 게이트 라인(GL)은 상기 게이트 라인(GL)의 제1 측의 화소행과 연결된다. 즉, 상기 하나의 게이트 라인(GL)은 하나의 화소행의 화소들과 연결된다.
반면, 상기 데이터 라인(DL)은 상기 데이터 라인(DL)의 제1 측의 화소열 및 상기 데이터 라인의 제2 측의 화소열과 교대로 연결된다.
예를 들어, 제2 데이터 라인(DL2)은 제1 화소 열의 제1 화소(P11), 제2 화소 열의 제2 화소(P22), 상기 제1 화소 열의 제3 화소(P31), 상기 제2 화소 열의 제4 화소(P42)에 교대로 연결된다.
예를 들어, 제3 데이터 라인(DL3)은 상기 제2 화소 열의 제1 화소(P12), 제3 화소 열의 제2 화소(P23), 상기 제2 화소 열의 제3 화소(P32), 상기 제3 화소 열의 제4 화소(P43)에 교대로 연결된다.
예를 들어, 제4 데이터 라인(DL4)은 상기 제3 화소 열의 제1 화소(P13), 제4 화소 열의 제2 화소(P24), 상기 제3 화소 열의 제3 화소(P33), 상기 제4 화소 열의 제4 화소(P44)에 교대로 연결된다.
이웃한 상기 데이터 라인들(DL)에는 반대되는 극성의 데이터 전압이 인가된다. 또한, 상기 데이터 전압은 프레임에 따라 반전된다. 예를 들어, 제1 프레임에 제1, 3, 5, 7 데이터 라인(DL1, DL3, DL5, DL7)에 정극성의 데이터 전압(+)이 인가되면, 제2, 4, 6, 8 데이터 라인(DL2, DL4, DL6, DL8)에는 부극성의 데이터 전압(-)이 인가된다. 제2 프레임에 제1, 3, 5, 7 데이터 라인(DL1, DL3, DL5, DL7)에는 부극성의 데이터 전압(-)이 인가되고, 제2, 4, 6, 8 데이터 라인(DL2, DL4, DL6, DL8)에는 정극성의 데이터 전압(+)이 인가된다.
이와 같이, 상기 표시 패널(100)의 화소들은 데이터 라인의 컬럼 반전 방식을 통해 도트 반전의 효과를 나타낸다.
예를 들어, 제1 화소 열은 적색 화소들을 포함하는 적색 화소 열(R)일 수 있다. 제2 화소 열은 녹색 화소들을 포함하는 녹색 화소 열(G)일 수 있다. 제3 화소 열은 청색 화소들을 포함하는 청색 화소 열(B)일 수 있다. 제4 화소 열은 적색 화소들을 포함하는 적색 화소 열(R)일 수 있다. 제5 화소 열은 녹색 화소들을 포함하는 녹색 화소 열(G)일 수 있다. 제6 화소 열은 청색 화소들을 포함하는 청색 화소 열(B)일 수 있다.
도 3은 도 1의 게이트 구동부(300)를 나타내는 블록도이다. 도 4는 도 1의 게이트 구동부(300)의 입출력 신호를 나타내는 타이밍도이다. 도 5a는 제1 서브 프레임에서 제2 내지 제4 데이터 라인(DL2 내지 DL4)에 연결되는 화소의 프리챠지를 나타내는 개념도이다. 도 5b는 제2 서브 프레임에서 상기 제2 내지 제4 데이터 라인(DL2 내지 DL4)에 연결되는 화소의 프리챠지를 나타내는 개념도이다.
도 1 내지 도 5b를 참조하면, 상기 게이트 구동부(300)는 홀수 번째 게이트 라인과 짝수 번째 게이트 라인을 분리하여 구동한다. 상기 게이트 구동부(300)는 제1 게이트 구동부(320) 및 제2 게이트 구동부(340)를 포함한다. 상기 제1 게이트 구동부(320)는 상기 홀수 게이트 라인들(GL1, GL3, GL5, GL7)에 연결되어 상기 홀수 게이트 라인들(GL1, GL3, GL5, GL7)에 홀수 게이트 신호(G1, G3, G5, G7)를 출력한다. 상기 제2 게이트 구동부(340)는 상기 짝수 게이트 라인들(GL2, GL4, GL6, GL8)에 연결되어 상기 짝수 게이트 라인들(GL2, GL4, GL6, GL8)에 짝수 게이트 신호(G2, G4, G6, G8)를 출력한다.
하나의 프레임은 두 개의 서브 프레임으로 분할된다. 상기 두 개의 서브 프레임 중 하나의 프레임동안 상기 홀수 게이트 라인들(GL1, GL3, GL5, GL7)에 홀수 게이트 신호(G1, G3, G5, G7)를 출력하고, 나머지 하나의 프레임동안 상기 짝수 게이트 구동부(340)가 상기 짝수 게이트 라인들(GL2, GL4, GL6, GL8)에 짝수 게이트 신호(G2, G4, G6, G8)를 출력한다.
도 4에서 보듯이, 상기 제1 게이트 구동부(320)는 홀수 서브 프레임(ODD SF)동안 제1 수직 개시 신호(STV1)를 기초로 상기 홀수 번째 게이트 신호들을 생성할 수 있다. 상기 제2 게이트 구동부(340)는 짝수 서브 프레임(EVEN SF)동안 상기 제1 수직 개시 신호(STV1)와 다른 타이밍을 갖는 제2 수직 개시 신호(STV2)를 기초로 상기 짝수 번째 게이트 신호들을 생성할 수 있다.
예를 들어, 상기 타이밍 컨트롤러(200)는 상기 제1 게이트 구동부(320)에 상기 제1 수직 개시 신호(STV1)를 제공하고, 상기 제2 게이트 구동부(340)에 상기 제2 수직 개시 신호(STV2)를 제공할 수 있다.
이와는 달리, 상기 제2 수직 개시 신호(STV2)는 마지막 홀수 번째 게이트 신호를 기초로 생성될 수 있다. 예를 들어, 상기 제2 수직 개시 신호(STV2)는 두 개의 마지막 홀수 번째 게이트 신호들을 OR 연산하여 생성될 수 있다.
예를 들어, 상기 제1 게이트 구동부(320)는 상기 홀수 서브 프레임(ODD SF)동안 상기 제1 수직 개시 신호(STV1), 상기 제1 수직 개시 신호(STV1)와 라이징 에지가 중첩되는 제1 게이트 클럭 신호(CPV1) 및 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제2 게이트 클럭 신호(CPV2)를 기초로 상기 홀수 번째 게이트 신호들을 생성할 수 있다.
예를 들어, 제1 게이트 라인(GL1)에 인가되는 제1 게이트 신호(G1)는 상기 제1 게이트 클럭 신호(CPV1)를 기초로 생성될 수 있다. 제3 게이트 라인(GL3)에 인가되는 제3 게이트 신호(G3)는 상기 제2 게이트 클럭 신호(CPV2)를 기초로 생성될 수 있다. 제5 게이트 라인(GL5)에 인가되는 제5 게이트 신호(G5)는 상기 제1 게이트 클럭 신호(CPV1)를 기초로 생성될 수 있다. 제7 게이트 라인(GL7)에 인가되는 제7 게이트 신호(G7)는 상기 제2 게이트 클럭 신호(CPV2)를 기초로 생성될 수 있다.
예를 들어, 상기 제2 게이트 구동부(340)는 상기 짝수 서브 프레임(EVEN SF)동안 상기 제2 수직 개시 신호(STV2), 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제3 게이트 클럭 신호(CPV3) 및 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제4 게이트 클럭 신호(CPV4)를 기초로 상기 짝수 번째 게이트 신호들을 생성할 수 있다.
예를 들어, 제2 게이트 라인(GL2)에 인가되는 제2 게이트 신호(G2)는 상기 제3 게이트 클럭 신호(CPV3)를 기초로 생성될 수 있다. 제4 게이트 라인(GL4)에 인가되는 제4 게이트 신호(G4)는 상기 제4 게이트 클럭 신호(CPV4)를 기초로 생성될 수 있다. 제6 게이트 라인(GL6)에 인가되는 제6 게이트 신호(G6)는 상기 제3 게이트 클럭 신호(CPV3)를 기초로 생성될 수 있다. 제8 게이트 라인(GL8)에 인가되는 제8 게이트 신호(G8)는 상기 제4 게이트 클럭 신호(CPV4)를 기초로 생성될 수 있다.
본 발명의 일 실시예에서, 상기 제3 게이트 클럭 신호(CPV3)는 상기 제1 게이트 클럭 신호(CPV1)와 동일하고, 상기 제4 게이트 클럭 신호(CPV4)는 상기 제2 게이트 클럭 신호(CPV2)와 동일할 수 있다.
상기 홀수 서브 프레임(ODD SF)동안 상기 제1, 제3, 제5, 제7 게이트 신호들(G1, G3, G5, G7)은 상기 제1, 제3, 제5, 제7 게이트 라인들(GL1, GL3, GL5, GL7)에 출력된다. 예를 들어, 제1 수평 구간(T1)에 대응하여 상기 제1 게이트 신호(G1)는 상기 제1 게이트 라인(GL1)에 출력된다. 예를 들어, 제3 수평 구간(T3)에 대응하여 상기 제3 게이트 신호(G3)는 상기 제3 게이트 라인(GL3)에 출력된다.
상기 짝수 서브 프레임(EVEN SF)동안 상기 제2, 제4, 제6, 제8 게이트 신호들(G2, G4, G6, G8)은 상기 제2, 제4, 제6, 제8 게이트 라인들(GL2, GL4, GL6, GL8)에 출력된다. 예를 들어, 제2 수평 구간(T2)에 대응하여 상기 제2 게이트 신호(G2)는 상기 제2 게이트 라인(GL2)에 출력된다. 예를 들어, 제4 수평 구간(T4)에 대응하여 상기 제4 게이트 신호(G4)는 상기 제4 게이트 라인(GL4)에 출력된다.
상기 게이트 신호의 하이 구간의 폭은 이웃한 로드 신호(TP) 사이의 구간으로 정의되는 수평 구간의 폭보다 길 수 있다. 즉, 상기 게이트 신호에 연결되는 화소들은 프리챠지 구동된다. 본 실시예에서, 상기 화소들은 동일한 화소 열 내에서 두 행 이전의 화소의 화소 전압에 의해 프리챠지된다. 상기 제3 게이트 신호(G3)는 상기 제1 수평 구간(T1) 및 상기 제3 수평 구간(T3)과 중첩된다. 따라서, 상기 제3 게이트 라인(GL3)에 연결되는 화소들에는 상기 제1 게이트 라인(GL1)에 연결되는 화소들의 화소 전압이 프리챠지된다. 상기 제5 게이트 신호(G5)는 상기 제3 수평 구간(T3) 및 상기 제5 수평 구간(T5)과 중첩된다. 따라서, 상기 제5 게이트 라인(GL5)에 연결되는 화소들에는 상기 제3 게이트 라인(GL3)에 연결되는 화소들의 화소 전압이 프리챠지된다.
적색 화소들이 0 계조, 녹색 화소들이 255 계조, 청색 화소들이 255 계조를 나타낼 때, 짝수 게이트 라인 및 홀수 게이트 라인을 분리 구동하지 않는 종래의 표시 장치에서는 적색 화소의 화소 전압이 프리챠지되는 녹색 화소와 청색 화소의 화소 전압이 프리챠지되는 녹색 화소 사이에 휘도 차이가 발생하여 가로 줄 얼룩이 시인되는 문제점이 있었다.
도 5a 및 도 5b에서 보듯이, 적색 화소들이 0 계조, 녹색 화소들이 255 계조, 청색 화소들이 255 계조를 나타낼 때, 본 실시예에 따른 녹색 화소들은 동일한 화소 열 내에서 두 행 이전의 녹색 화소의 화소 전압에 의해 프리챠지된다. 따라서, 표시 패널 내의 녹색 화소들은 실질적으로 동일한 휘도 레벨을 갖게 되며, 가로 줄 얼룩이 방지될 수 있다.
본 실시예에서는 설명의 편의 상 8개의 게이트 라인만을 도시하였으나, 본 발명은 이에 한정되지 않는다.
본 실시예에서는 프레임 내에서 상기 홀수 서브 프레임, 상기 짝수 서브 프레임 순으로 배치되는 것으로 예시하였으나, 상기 홀수 서브 프레임 및 상기 짝수 서브 프레임의 순서는 바뀔 수 있다. 상기 홀수 서브 프레임 및 상기 짝수 서브 프레임의 순서에 대해서는 도 8 및 도 9를 참조하여 상세히 설명한다.
도 6은 도 1의 타이밍 컨트롤러(200) 및 세트 보드(600)를 나타내는 블록도이다. 도 7a 및 7b는 도 1의 입력 영상 데이터(RGB)를 나타내는 개념도이다.
본 실시예에서, 상기 입력 영상 데이터(RGB)를 홀수 영상 데이터(ORGB) 및 짝수 영상 데이터(ERGB)로 분리하는 영상 분리부(220)는 상기 타이밍 컨트롤러(200)에 포함된다.
상기 세트 보드(600)는 영상 공급부(620)를 포함한다. 상기 타이밍 컨트롤러(200)는 영상 분리부(220) 및 영상 보정부(240)를 포함한다.
상기 영상 공급부(620)는 상기 입력 영상 데이터(RGB)를 상기 영상 분리부(220)에 출력한다.
상기 영상 분리부(220)는 상기 입력 영상 데이터(RGB)를 홀수 영상 데이터(ORGB) 및 짝수 영상 데이터(ERGB)로 분리한다.
도 7a에서 보듯이, 상기 입력 영상 데이터(RGB)는 교대로 반복되는 홀수 영상 데이터 행(O) 및 짝수 영상 데이터 행(E)을 포함할 수 있다. 상기 영상 분리부(220)는 상기 홀수 영상 데이터 행(O)의 데이터를 모아 홀수 영상 데이터(ORGB)를 생성하고, 상기 짝수 영상 데이터 행(E)의 데이터를 모아 짝수 영상 데이터(ERGB)를 생성한다.
도 7b에서 보듯이, 상기 입력 영상 데이터(RGB)는 상부 절반에 대응하는 상기 홀수 영상 데이터(O) 및 하부 절반에 대응하는 상기 짝수 영상 데이터(E)를 포함할 수 있다. 상기 영상 분리부(220)는 상기 상부 절반에 대응하는 상기 홀수 영상 데이터(O)를 추출하고, 상기 하부 절반에 대응하는 상기 짝수 영상 데이터(E)를 추출한다.
상기 영상 분리부(220)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 생성하기 위해 1/2 프레임 메모리를 포함할 수 있다. 상기 1/2 프레임 메모리는 상기 홀수 영상 데이터(ORGB)를 출력하는 동안 상기 짝수 영상 데이터(ERGB)를 일시적으로 저장할 수 있다. 이와는 달리, 상기 영상 분리부(220)는 1 프레임 메모리를 포함할 수 있다.
상기 영상 분리부(220)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 상기 영상 보정부(240)에 출력한다.
상기 영상 보정부(240)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 보정하여 데이터 신호(DATA)를 생성한다. 구체적으로, 상기 영상 보정부(240)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 보정하여 홀수 데이터 신호 및 짝수 데이터 신호를 생성할 수 있다.
상기 영상 보정부(240)는 색 특성 보상부(미도시), 능동 캐패시턴스 보상부(미도시)를 포함할 수 있다.
상기 색 특성 보상부는 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 수신하여 색 특성 보상(Adaptive Color Correction, 이하, ACC라 칭함)을 수행한다. 상기 색 특성 보상부는 감마 곡선을 이용하여 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 보상할 수 있다.
상기 능동 캐패시턴스 보상부는 이전 프레임 데이터와 현재 프레임 데이터를 이용하여 상기 현재 프레임 데이터의 계조 데이터를 보정하는 능동 캐패시턴스 보상(Dynamic Capacitance Compensation, 이하, DCC라 칭함)을 수행할 수 있다.
도시한 바와는 달리, 상기 영상 분리부(220)는 상기 영상 보정부(240)의 후단에 배치될 수도 있다.
상기 데이터 구동부(500)는 상기 홀수 데이터 신호를 기초로 상기 홀수 서브 프레임 동안 상기 데이터 라인들(DL)에 홀수 데이터 전압을 출력하고, 상기 짝수 데이터 신호를 기초로 상기 짝수 서브 프레임 동안 상기 데이터 라인들(DL)에 짝수 데이터 전압을 출력한다.
도 8은 패턴 스크롤에 의해 발생할 수 있는 무빙 아티팩트를 나타내기 위한 개념도이다. 도 9는 패턴 스크롤에 의해 도 1의 표시 패널에 표시되는 영상을 나타내기 위한 개념도이다.
이하에서는 도 1 내지 도 9를 참조하여, 패턴 스크롤에 의한 무빙 아티팩트에 대해 설명한다.
도 8은 제1 프레임(FR1)의 제1 서브 프레임이 홀수 서브 프레임(ODD SF)이고, 제2 서브 프레임에 짝수 서브 프레임(EVEN SF)이며, 제2 프레임(FR2)의 제1 서브 프레임이 홀수 서브 프레임(ODD SF)이고, 제2 서브 프레임이 짝수 서브 프레임(EVEN SF)인 것을 예시한다.
도 9는 제1 프레임(FR1)의 제1 서브 프레임이 홀수 서브 프레임(ODD SF)이고, 제2 서브 프레임에 짝수 서브 프레임(EVEN SF)이며, 제2 프레임(FR2)의 제1 서브 프레임이 짝수 서브 프레임(EVEN SF)이고, 제2 서브 프레임이 홀수 서브 프레임(ODD SF)인 것을 예시한다. 본 실시예에서, 제1 게이트 구동부(320)는 연속한 두 개의 서브 프레임(ODD SF, ODD SF)동안 홀수 번째 게이트 라인들에 홀수 게이트 신호를 출력한다. 제2 게이트 구동부(340)는 연속한 두 개의 서브 프레임(EVEN SF, EVEN SF)동안 짝수 번째 게이트 라인들에 짝수 게이트 신호를 출력한다.
또한, 도 8 및 도 9에서는 직사각형의 패턴이 하나의 프레임에 1 픽셀만큼 수평 방향으로 이동하는 것을 예시한다.
도 8의 실시예에서, 상기 제1 프레임(FR1)의 제1 서브 프레임(ODD SF)은 홀수 서브 프레임이므로, 상기 제3 화소 행 및 제5 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴이 깨진다. 상기 제1 프레임(FR1)의 제2 서브 프레임(EVEN SF)은 짝수 서브 프레임이므로, 상기 제4 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴의 형상을 회복한다.
상기 제2 프레임(FR2)의 제1 서브 프레임(ODD SF)은 홀수 서브 프레임이므로, 상기 제3 화소 행 및 제5 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴이 깨진다. 상기 제2 프레임(FR2)의 제2 서브 프레임(EVEN SF)은 짝수 서브 프레임이므로, 상기 제4 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴의 형상을 회복한다.
이 때, 관찰자의 눈은 움직이는 패턴의 경계부를 따라가게 되며, 상기 제1 프레임(FR1)의 상기 제1 서브 프레임(ODD SF)의 깨진 직사각형 형상은 상기 제2 서브 프레임(FR2)의 상기 제1 서브 프레임(ODD SF)의 깨진 직사각형 형상과 동일하며, 상기 패턴의 경계부에서는 라인 바이 라인 휘도 차로 인해 무빙 아티팩트가 발생한다. 상기 무빙 아티팩트는 가로줄 얼룩으로 시인될 수 있다. 상기 패턴의 스크롤 정도가 커지면 상기 경계부에서의 무빙 아티팩트는 더욱 심화될 수 있다.
도 9의 실시예에서, 상기 제1 프레임(FR1)의 제1 서브 프레임(ODD SF)은 홀수 서브 프레임이므로, 상기 제3 화소 행 및 제5 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴이 깨진다. 상기 제1 프레임(FR1)의 제2 서브 프레임(EVEN SF)은 짝수 서브 프레임이므로, 상기 제4 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴의 형상을 회복한다.
상기 제2 프레임(FR2)의 제1 서브 프레임(EVEN SF)은 짝수 서브 프레임이므로, 상기 제4 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴이 깨진다. 상기 제2 프레임(FR2)의 제2 서브 프레임(ODD SF)은 홀수 서브 프레임이므로, 상기 제3 화소 행 및 제5 화소 행의 영상이 수평 방향으로 1 픽셀만큼 이동하여, 직사각형 패턴의 형상을 회복한다.
이 때, 관찰자의 눈은 움직이는 패턴의 경계부를 따라가게 되며, 상기 제1 프레임(FR1)의 상기 제1 서브 프레임(ODD SF)의 깨진 직사각형 형상은 상기 제2 서브 프레임(FR2)의 상기 제1 서브 프레임(EVEN SF)의 깨진 직사각형 형상과 반대의 형상을 가져, 상기 패턴의 경계부에서는 상기 깨진 직사각형 형상으로 인한 휘도 차가 보상된다. 따라서, 상기 패턴의 이동으로 인한 무빙 아티팩트가 시인되지 않을 수 있다.
본 실시예에서, 제3 프레임(FR3)은 제1 프레임(FR1)과 동일하게 홀수 서브 프레임(ODD SF), 짝수 서브 프레임(EVEN SF)을 가질 수 있고, 제4 프레임(FR4)은 제2 프레임(FR2)과 동일하게 짝수 서브 프레임(EVEN SF), 홀수 서브 프레임(ODD SF)을 가질 수 있다.
또한, 본 실시예에서, 상기 제1 프레임(FR1)은 제N 프레임으로, 상기 제2 프레임(FR2)은 제N+1 프레임으로 일반화될 수 있다.
본 실시예에 따르면, 엇갈림 패턴의 패널 구조에서 홀수 번째 게이트 라인들 및 짝수 번째 게이트 라인들을 분리 구동하여 가로줄 얼룩을 방지할 수 있다. 또한, 연속한 두 개의 서브 프레임동안 홀수 게이트 신호를 출력하고 연속한 두 개의 서브 프레임동안 짝수 게이트 신호를 출력하여 패턴 스크롤로 인한 무빙 아티팩트를 방지할 수 있다. 결과적으로 표시 패널(100)의 표시 품질을 향상시킬 수 있다.
도 10은 본 발명의 다른 실시예에 따른 표시 장치를 나타내는 블록도이다. 도 11은 도 10의 타이밍 컨트롤러(200A) 및 세트 보드(600A)를 나타내는 블록도이다.
본 실시예에 따른 게이트 구동부 및 표시 장치는 영상 분리부의 위치를 제외하면, 도 1 내지 도 9의 표시 장치와 실질적으로 동일하므로, 동일 또는 유사한 구성 요소에 대해서는 동일한 참조 번호를 사용하고, 중복되는 설명은 생략한다.
도 2 내지 도 5b, 도 7 내지 도 11을 참조하면, 상기 표시 장치는 표시 패널(100), 패널 구동부 및 세트 보드(600A)를 포함한다. 상기 패널 구동부는 타이밍 컨트롤러(200A), 게이트 구동부(300), 감마 기준 전압 생성부(400) 및 데이터 구동부(500)를 포함한다.
상기 표시 패널(100)은 복수의 게이트 라인들(GL), 복수의 데이터 라인들(DL) 및 상기 게이트 라인들(GL)과 상기 데이터 라인들(DL) 각각에 전기적으로 연결된 복수의 단위 화소들을 포함한다.
상기 타이밍 컨트롤러(200A)는 세트 보드(600A)로부터 홀수 영상 데이터(ORGB) 및 짝수 영상 데이터(ERGB)를 수신한다. 상기 타이밍 컨트롤러(200)는 외부의 장치로부터 입력 제어 신호(CONT)를 수신한다.
상기 타이밍 컨트롤러(200A)는 상기 홀수 영상 데이터(ORGB), 짝수 영상 데이터(ERGB) 및 상기 입력 제어 신호(CONT)를 근거로 제1 제어 신호(CONT1), 제2 제어 신호(CONT2), 제3 제어 신호(CONT3) 및 데이터 신호(DATA)를 생성한다.
상기 게이트 구동부(300)는 상기 타이밍 컨트롤러(200)로부터 입력 받은 상기 제1 제어 신호(CONT1)에 응답하여 상기 게이트 라인들(GL)을 구동하기 위한 게이트 신호들을 생성한다. 상기 게이트 구동부(300)는 상기 게이트 신호들을 상기 게이트 라인들(GL)에 순차적으로 출력한다.
상기 게이트 구동부(300)는 홀수 번째 게이트 라인과 짝수 번째 게이트 라인을 분리하여 구동한다. 상기 게이트 구동부(300)는 제1 게이트 구동부(320) 및 제2 게이트 구동부(340)를 포함한다. 상기 제1 게이트 구동부(320)는 상기 홀수 게이트 라인들(GL1, GL3, GL5, GL7)에 연결되어 상기 홀수 게이트 라인들(GL1, GL3, GL5, GL7)에 홀수 게이트 신호(G1, G3, G5, G7)를 출력한다. 상기 제2 게이트 구동부(340)는 상기 짝수 게이트 라인들(GL2, GL4, GL6, GL8)에 연결되어 상기 짝수 게이트 라인들(GL2, GL4, GL6, GL8)에 짝수 게이트 신호(G2, G4, G6, G8)를 출력한다.
하나의 프레임은 두 개의 서브 프레임으로 분할된다. 상기 두 개의 서브 프레임 중 하나의 프레임동안 상기 홀수 게이트 라인들(GL1, GL3, GL5, GL7)에 홀수 게이트 신호(G1, G3, G5, G7)를 출력하고, 나머지 하나의 프레임동안 상기 짝수 게이트 구동부(340)가 상기 짝수 게이트 라인들(GL2, GL4, GL6, GL8)에 짝수 게이트 신호(G2, G4, G6, G8)를 출력한다.
상기 감마 기준 전압 생성부(400)는 상기 타이밍 컨트롤러(200)로부터 입력 받은 상기 제3 제어 신호(CONT3)에 응답하여 감마 기준 전압(VGREF)을 생성한다.
상기 데이터 구동부(500)는 상기 타이밍 컨트롤러(200)로부터 상기 제2 제어 신호(CONT2) 및 상기 데이터 신호(DATA)를 입력 받고, 상기 감마 기준 전압 생성부(400)로부터 상기 감마 기준 전압(VGREF)을 입력 받는다. 상기 데이터 구동부(500)는 상기 데이터 신호(DATA)를 상기 감마 기준 전압(VGREF)을 이용하여 아날로그 형태의 데이터 전압으로 변환한다. 상기 데이터 구동부(500)는 상기 데이터 전압을 상기 데이터 라인(DL)에 출력한다.
상기 데이터 구동부(500)는 홀수 영상 데이터를 기초로 생성된 홀수 데이터 전압 및 짝수 영상 데이터를 기초로 생성된 짝수 데이터 전압을 상기 데이터 라인(DL)에 출력한다.
본 실시예에서, 상기 입력 영상 데이터(RGB)를 홀수 영상 데이터(ORGB) 및 짝수 영상 데이터(ERGB)로 분리하는 영상 분리부(640)는 상기 세트 보드(600A)에 포함된다.
상기 세트 보드(600A)는 영상 공급부(620) 및 영상 분리부(640)를 포함한다. 상기 타이밍 컨트롤러(200A)는 영상 보정부(240)를 포함한다.
상기 영상 공급부(620)는 상기 입력 영상 데이터(RGB)를 상기 영상 분리부(640)에 출력한다.
상기 영상 분리부(640)는 상기 입력 영상 데이터(RGB)를 홀수 영상 데이터(ORGB) 및 짝수 영상 데이터(ERGB)로 분리한다.
도 7a에서 보듯이, 상기 입력 영상 데이터(RGB)는 교대로 반복되는 홀수 영상 데이터 행(O) 및 짝수 영상 데이터 행(E)을 포함할 수 있다. 상기 영상 분리부(640)는 상기 홀수 영상 데이터 행(O)의 데이터를 모아 홀수 영상 데이터(ORGB)를 생성하고, 상기 짝수 영상 데이터 행(E)의 데이터를 모아 짝수 영상 데이터(ERGB)를 생성한다.
도 7b에서 보듯이, 상기 입력 영상 데이터(RGB)는 상부 절반에 대응하는 상기 홀수 영상 데이터(O) 및 하부 절반에 대응하는 상기 짝수 영상 데이터(E)를 포함할 수 있다. 상기 영상 분리부(640)는 상기 상부 절반에 대응하는 상기 홀수 영상 데이터(O)를 추출하고, 상기 하부 절반에 대응하는 상기 짝수 영상 데이터(E)를 추출한다.
상기 영상 분리부(640)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 상기 영상 보정부(240)에 출력한다.
상기 영상 보정부(240)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 보정하여 데이터 신호(DATA)를 생성한다. 구체적으로, 상기 영상 보정부(240)는 상기 홀수 영상 데이터(ORGB) 및 상기 짝수 영상 데이터(ERGB)를 보정하여 홀수 데이터 신호 및 짝수 데이터 신호를 생성할 수 있다.
상기 데이터 구동부(500)는 상기 홀수 데이터 신호를 기초로 상기 홀수 서브 프레임 동안 상기 데이터 라인들(DL)에 홀수 데이터 전압을 출력하고, 상기 짝수 데이터 신호를 기초로 상기 짝수 서브 프레임 동안 상기 데이터 라인들(DL)에 짝수 데이터 전압을 출력한다.
본 실시예에 따르면, 엇갈림 패턴의 패널 구조에서 홀수 번째 게이트 라인들 및 짝수 번째 게이트 라인들을 분리 구동하여 가로줄 얼룩을 방지할 수 있다. 또한, 연속한 두 개의 서브 프레임동안 홀수 게이트 신호를 출력하고 연속한 두 개의 서브 프레임동안 짝수 게이트 신호를 출력하여 패턴 스크롤로 인한 무빙 아티팩트를 방지할 수 있다. 결과적으로 표시 패널(100)의 표시 품질을 향상시킬 수 있다.
이상에서 설명한 본 발명에 따른 표시 패널의 구동 방법 및 이를 수행하기 위한 표시 장치에 따르면, 화소의 충전률을 확보하면서, 가로 줄 얼룩을 방지할 수 있고, 무빙 아티팩트를 방지할 수 있다. 따라서, 표시 패널의 표시 품질을 향상시킬 수 있다.
이상 실시예들을 참조하여 설명하였지만, 해당 기술 분야의 숙련된 당업자는 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
100: 표시 패널 200, 200A: 타이밍 컨트롤러
220: 영상 분리부 240: 영상 보정부
300: 게이트 구동부 320: 홀수 게이트 구동부
340: 짝수 게이트 구동부 400: 감마 기준 전압 생성부
500: 데이터 구동부 600, 600A: 세트 보드
620: 영상 공급부 640: 영상 분리부

Claims (20)

  1. 하나의 프레임은 두 개의 서브 프레임으로 분할되며, 연속한 두 개의 서브 프레임동안 제1 측의 화소열 및 제2 측의 화소열과 교대로 연결되는 데이터 라인들 및 상기 데이터 라인과 교차하는 게이트 라인들을 포함하는 표시 패널의 홀수 번째 게이트 라인들에만 홀수 게이트 신호를 출력하는 단계; 및
    연속한 두 개의 서브 프레임동안 상기 표시 패널의 짝수 번째 게이트 라인들에만 짝수 게이트 신호를 출력하는 단계를 포함하는 표시 패널의 구동 방법.
  2. 제1항에 있어서, 상기 홀수 게이트 신호를 출력하는 단계는 제N 프레임(N은 자연수)의 제1 서브 프레임 및 제N+1 프레임의 제2 서브 프레임동안 상기 홀수 번째 게이트 라인들에 상기 홀수 게이트 신호를 출력하고,
    상기 짝수 게이트 신호를 출력하는 단계는 상기 제N 프레임의 제2 서브 프레임 및 상기 제N+1 프레임의 제1 서브 프레임동안 상기 짝수 번째 게이트 라인들에 상기 짝수 게이트 신호를 출력하는 것을 특징으로 하는 표시 패널의 구동 방법.
  3. 제1항에 있어서, 상기 홀수 게이트 신호를 출력하는 단계는 제1 수직 개시 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성하는 단계를 포함하고,
    상기 짝수 게이트 신호를 출력하는 단계는 상기 제1 수직 개시 신호와 다른 타이밍을 갖는 제2 수직 개시 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성하는 단계를 포함하는 것을 특징으로 하는 표시 패널의 구동 방법.
  4. 제3항에 있어서, 상기 제2 수직 개시 신호는 마지막 홀수 번째 게이트 신호를 기초로 생성되는 것을 특징으로 하는 표시 패널의 구동 방법.
  5. 제3항에 있어서, 상기 홀수 게이트 신호를 생성하는 단계는 상기 제1 수직 개시 신호, 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제1 게이트 클럭 신호 및 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제2 게이트 클럭 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성하고,
    상기 짝수 게이트 신호를 생성하는 단계는 상기 제2 수직 개시 신호, 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제3 게이트 클럭 신호 및 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제4 게이트 클럭 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성하는 것을 특징으로 하는 표시 패널의 구동 방법.
  6. 제5항에 있어서, 상기 제3 게이트 클럭 신호는 상기 제1 게이트 클럭 신호와 동일하고, 상기 제4 게이트 클럭 신호는 상기 제2 게이트 클럭 신호와 동일한 것을 특징으로 하는 표시 패널의 구동 방법.
  7. 제1항에 있어서, 상기 화소들은 동일한 화소 열 내에서 두 행 이전의 화소의 화소 전압에 의해 프리챠지되는 것을 특징으로 하는 표시 패널의 구동 방법.
  8. 제1항에 있어서, 입력 영상 데이터를 홀수 영상 데이터 및 짝수 영상 데이터를 분리하는 단계;
    제1 서브 프레임 동안 상기 홀수 영상 데이터를 기초로 생성한 홀수 데이터 전압을 상기 데이터 라인들에 출력하는 단계; 및
    제2 서브 프레임 동안 상기 짝수 영상 데이터를 기초로 생성한 짝수 데이터 전압을 상기 데이터 라인들에 출력하는 단계를 더 포함하는 것을 특징으로 하는 표시 패널의 구동 방법.
  9. 제8항에 있어서, 상기 입력 영상 데이터는 교대로 반복되는 홀수 영상 데이터 행 및 짝수 영상 데이터 행을 포함하는 것을 특징으로 하는 표시 패널의 구동 방법.
  10. 제8항에 있어서, 상기 입력 영상 데이터는 상부 절반에 대응하는 상기 홀수 영상 데이터 및 하부 절반에 대응하는 상기 짝수 영상 데이터를 포함하는 것을 특징으로 하는 표시 패널의 구동 방법.
  11. 복수의 게이트 라인들, 복수의 데이터 라인들 및 상기 게이트 라인들 및 상기 데이터 라인들에 연결되는 복수의 화소들을 포함하고, 상기 데이터 라인은 상기 데이터 라인의 제1 측의 화소열 및 상기 데이터 라인의 제2 측의 화소열과 교대로 연결되는 표시 패널;
    하나의 프레임은 두 개의 서브 프레임으로 분할되며, 연속한 두 개의 서브 프레임동안 홀수 번째 게이트 라인들에만 홀수 게이트 신호를 출력하는 제1 게이트 구동부; 및
    연속한 두 개의 서브 프레임동안 짝수 번째 게이트 라인들에만 짝수 게이트 신호를 출력하는 제2 게이트 구동부를 포함하는 표시 장치.
  12. 제11항에 있어서, 상기 제1 게이트 구동부는 제N 프레임(N은 자연수)의 제1 서브 프레임 및 제N+1 프레임의 제2 서브 프레임동안 상기 홀수 번째 게이트 라인들에 상기 홀수 게이트 신호를 출력하고,
    상기 제2 게이트 구동부는 상기 제N 프레임의 제2 서브 프레임 및 상기 제N+1 프레임의 제1 서브 프레임동안 상기 짝수 번째 게이트 라인들에 상기 짝수 게이트 신호를 출력하는 것을 특징으로 하는 표시 장치.
  13. 제11항에 있어서, 상기 제1 게이트 구동부는 제1 수직 개시 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성하고,
    상기 제2 게이트 구동부는 상기 제1 수직 개시 신호와 다른 타이밍을 갖는 제2 수직 개시 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성하는 것을 특징으로 하는 표시 장치.
  14. 제13항에 있어서, 상기 제2 수직 개시 신호는 마지막 홀수 번째 게이트 신호를 기초로 생성되는 것을 특징으로 하는 표시 장치.
  15. 제13항에 있어서, 상기 제1 게이트 구동부는 상기 제1 수직 개시 신호, 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제1 게이트 클럭 신호 및 상기 제1 수직 개시 신호와 라이징 에지가 중첩되는 제2 게이트 클럭 신호를 기초로 상기 홀수 번째 게이트 신호들을 생성하고,
    상기 제2 게이트 구동부는 상기 제2 수직 개시 신호, 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제3 게이트 클럭 신호 및 상기 제2 수직 개시 신호와 라이징 에지가 중첩되는 제4 게이트 클럭 신호를 기초로 상기 짝수 번째 게이트 신호들을 생성하는 것을 특징으로 하는 표시 장치.
  16. 제15항에 있어서, 상기 제3 게이트 클럭 신호는 상기 제1 게이트 클럭 신호와 동일하고, 상기 제4 게이트 클럭 신호는 상기 제2 게이트 클럭 신호와 동일한 것을 특징으로 하는 표시 장치.
  17. 제11항에 있어서, 상기 화소들은 동일한 화소 열 내에서 두 행 이전의 화소의 화소 전압에 의해 프리챠지되는 것을 특징으로 하는 표시 장치.
  18. 제11항에 있어서, 입력 영상 데이터를 공급하는 영상 공급부를 포함하는 세트 보드; 및
    상기 입력 영상 데이터를 수신하여 홀수 영상 데이터 및 짝수 영상 데이터를 분리하는 영상 분리부 및 상기 홀수 영상 데이터 및 상기 짝수 영상 데이터를 보정하여 데이터 신호를 생성하는 영상 보정부를 포함하는 타이밍 컨트롤러를 더 포함하는 것을 특징으로 하는 표시 장치.
  19. 제18항에 있어서, 상기 영상 분리부는 1/2 프레임 메모리를 포함하는 것을 특징으로 하는 표시 장치.
  20. 제11항에 있어서, 입력 영상 데이터를 공급하는 영상 공급부 및 상기 입력 영상 데이터를 수신하여 홀수 영상 데이터 및 짝수 영상 데이터를 분리하는 영상 분리부를 포함하는 세트 보드; 및
    상기 홀수 영상 데이터 및 상기 짝수 영상 데이터를 보정하여 데이터 신호를 생성하는 영상 보정부를 포함하는 타이밍 컨트롤러를 더 포함하는 것을 특징으로 하는 표시 장치.
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