KR100999918B1 - 인쇄회로기판 및 그 제조 방법 - Google Patents

인쇄회로기판 및 그 제조 방법 Download PDF

Info

Publication number
KR100999918B1
KR100999918B1 KR1020080088177A KR20080088177A KR100999918B1 KR 100999918 B1 KR100999918 B1 KR 100999918B1 KR 1020080088177 A KR1020080088177 A KR 1020080088177A KR 20080088177 A KR20080088177 A KR 20080088177A KR 100999918 B1 KR100999918 B1 KR 100999918B1
Authority
KR
South Korea
Prior art keywords
printed circuit
circuit board
insulating layer
pair
roughness
Prior art date
Application number
KR1020080088177A
Other languages
English (en)
Other versions
KR20100029403A (ko
Inventor
이종진
Original Assignee
삼성전기주식회사
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 삼성전기주식회사 filed Critical 삼성전기주식회사
Priority to KR1020080088177A priority Critical patent/KR100999918B1/ko
Priority to US12/358,543 priority patent/US20100059267A1/en
Priority to JP2009015337A priority patent/JP5082117B2/ja
Publication of KR20100029403A publication Critical patent/KR20100029403A/ko
Application granted granted Critical
Publication of KR100999918B1 publication Critical patent/KR100999918B1/ko
Priority to US13/788,916 priority patent/US20130186677A1/en

Links

Images

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/10Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern
    • H05K3/20Apparatus or processes for manufacturing printed circuits in which conductive material is applied to the insulating support in such a manner as to form the desired conductive pattern by affixing prefabricated conductor pattern
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/0058Laminating printed circuit boards onto other substrates, e.g. metallic substrates
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/0271Arrangements for reducing stress or warp in rigid printed circuit boards, e.g. caused by loads, vibrations or differences in thermal expansion
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/02Apparatus or processes for manufacturing printed circuits in which the conductive material is applied to the surface of the insulating support and is thereafter removed from such areas of the surface which are not intended for current conducting or shielding
    • H05K3/022Processes for manufacturing precursors of printed circuits, i.e. copper-clad substrates
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/03Conductive materials
    • H05K2201/0332Structure of the conductor
    • H05K2201/0335Layered conductors or foils
    • H05K2201/0352Differences between the conductors of different layers of a multilayer
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/03Conductive materials
    • H05K2201/0332Structure of the conductor
    • H05K2201/0335Layered conductors or foils
    • H05K2201/0355Metal foils
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K2201/00Indexing scheme relating to printed circuits covered by H05K1/00
    • H05K2201/09Shape and layout
    • H05K2201/09009Substrate related
    • H05K2201/09136Means for correcting warpage
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/38Improvement of the adhesion between the insulating substrate and the metal
    • H05K3/382Improvement of the adhesion between the insulating substrate and the metal by special treatment of the metal
    • YGENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10TTECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
    • Y10T29/00Metal working
    • Y10T29/49Method of mechanical manufacture
    • Y10T29/49002Electrical device making
    • Y10T29/49117Conductor or circuit manufacturing
    • Y10T29/49124On flat or curved insulated base, e.g., printed circuit, etc.

Landscapes

  • Engineering & Computer Science (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Manufacturing & Machinery (AREA)
  • Structure Of Printed Boards (AREA)
  • Production Of Multi-Layered Print Wiring Board (AREA)
  • Manufacturing Of Printed Wiring (AREA)
  • Laminated Bodies (AREA)

Abstract

인쇄회로기판 및 그 제조 방법이 개시된다. 일면의 조도(roughness)가 서로 상이하게 형성되는 한 쌍의 전도층을 제공하는 단계, 및 한 쌍의 전도층 일면이 각각 절연층의 일면과 타면을 향하도록 절연층에 한 쌍의 전도층을 각각 적층하는 단계를 포함하는 인쇄회로기판 제조 방법은, 이후 인쇄회로기판에 반도체 칩을 실장하는 패키징 공정 중 또는 인쇄회로기판이 전자 제품에 적용된 후 사용되는 중에 수반되는 열에 의해 발생되는 인쇄회로기판의 휨을 저감할 수 있다.
인쇄회로기판, 조도(roughness), 휨(warpage)

Description

인쇄회로기판 및 그 제조 방법{Printed circuit board and method of manufacturing the same}
본 발명은 인쇄회로기판 및 그 제조 방법에 관한 것이다.
전자 제품이 발전함에 따라, 그 부품인 인쇄회로기판은 점차 박판화되어 가고 있으며, 이에 수반되어, 인쇄회로기판의 휨(warpage) 저감이 중요한 문제로 부각되고 있다.
즉, 인쇄회로기판에 반도체 칩 등을 실장하는 패키징(packaging) 공정을 수행함에 있어, 수 차례의 가열 및 냉각 공정에 의해 박판화된 인쇄회로기판이 휘는 문제가 발생하게 되며, 또한 인쇄회로기판과 반도체 칩이 조립된 패키지가 전자 제품에 적용되어 사용됨에 있어, 역시 가열과 냉각이 반복됨에 따라, 인쇄회로기판에 주기적인 휨이 발생하여 전자 제품의 신뢰성이 낮아지는 문제가 있다.
도 1은 종래 기술에 따른 인쇄회로기판(10)을 나타낸 단면도이다. 도 1을 참조하면, 종래 기술에 따른 인쇄회로기판(10)은, 절연층(20) 및 절연층(20)의 양면에 각각 금속층(30, 40)이 적층되어 있으며, 이들 금속층(30, 40)은 서로 동일한 조도(roughness)를 가지고 있다.
이와 같이 종래 기술에 따른 인쇄회로기판(10)은 서로 동일한 조도를 가지고 있는 금속판(30, 40)을 사용하므로, 도 1에 도시된 바와 같이, 금속층(30, 40)의 패터닝(patterning)에 의해 상하 금속층(30, 40)의 잔존율이 비대칭을 이루는 경우, 상술한 바와 같이, 반도체 칩을 실장하는 패키징 공정 및 전자 제품의 사용 도중 수반되는 열에 의하여, 인쇄회로기판(10)이 잔존율이 작은 금속층(30) 방향으로 휘는 문제가 발생하는 것이다.
본 발명은, 열에 의해 발생되는 휨을 저감할 수 있는 인쇄회로기판 및 그 제조 방법을 제공하는 것이다.
본 발명의 일 측면에 따르면, 일면의 조도(roughness)가 서로 상이하게 형성되는 한 쌍의 전도층을 제공하는 단계, 및 한 쌍의 전도층 일면이 각각 절연층의 일면과 타면을 향하도록 절연층에 한 쌍의 전도층을 각각 적층하는 단계를 포함하는 인쇄회로기판 제조 방법이 제공된다.
이 때, 전도층은 동박(copper foil)일 수 있다.
또한, 절연층은 에폭시(epoxy) 수지를 포함하여 이루어질 수 있다.
또한, 본 발명의 다른 측면에 따르면, 에폭시 수지를 포함하여 이루어지는 절연층, 및 일면의 조도가 서로 상이하게 형성되며, 일면이 각각 절연층의 일면과 타면을 향하도록 절연층에 각각 적층되는 한 쌍의 동박을 포함하는 인쇄회로기판이 제공된다.
본 발명의 실시예에 따르면, 이후 인쇄회로기판에 반도체 칩을 실장하는 패키징 공정 중 또는 인쇄회로기판이 전자 제품에 적용된 후 사용되는 중에 수반되는 열에 의해 발생되는 인쇄회로기판의 휨을 저감할 수 있다.
본 발명에 따른 인쇄회로기판 및 그 제조 방법의 실시예를 첨부도면을 참조하여 상세히 설명하기로 하며, 첨부 도면을 참조하여 설명함에 있어, 동일하거나 대응하는 구성 요소는 동일한 도면번호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
도 2는 본 발명의 일 측면에 따른 인쇄회로기판(100) 제조 방법의 일 실시예를 나타낸 순서도이다. 도 3 및 도 4는 본 발명의 일 측면에 따른 인쇄회로기판(100) 제조 방법 일 실시예의 각 공정을 나타낸 단면도이다.
본 실시예에 따르면, 일면의 조도(roughness)가 서로 상이하게 형성되는 한 쌍의 전도층(110, 120)을 제공하는 단계, 및 한 쌍의 전도층(110, 120) 일면이 각 각 절연층(130)의 일면과 타면을 향하도록 절연층(130)에 한 쌍의 전도층(110, 120)을 적층하는 단계를 포함하는 인쇄회로기판(100) 제조 방법이 제시된다.
이와 같은 본 실시예에 따르면, 이후 인쇄회로기판(100)에 반도체 칩을 실장하는 패키징(packaging) 공정 중 또는 인쇄회로기판(100)이 전자 제품에 적용된 후 사용되는 중에 수반되는 열에 의해 발생되는 인쇄회로기판(100)의 휨(warpage)을 저감할 수 있다.
이하, 도 2 내지 도 4를 참조하여, 각 공정에 대하여 보다 상세히 설명하도록 한다.
먼저, 도 3에 도시된 바와 같이, 일면의 조도(roughness)가 서로 상이하게 형성되는 한 쌍의 전도층(110, 120)을 제공한다(S110). 여기서, 한 쌍의 전도층(110, 120)은, 동박(copper foil)이며, 각 전도층(110, 120) 일면의 조도는, 서로 상이하게 형성된다.
즉, 동박인 전도층(110, 120)의 일면은, 조도를 갖도록 조화 처리(roughening treatment)된 후, 절연층(도 4의 130)과의 접착력을 보다 향상시키기 위하여, 예를 들어, 앵커링(anchoring) 공정 등이 수행될 수 있다.
이 때, 각 전도층(110, 120)의 일면은 서로 상이한 조도를 가지고 있으므로, 이 후 공정에서 절연층(도 4의 130)에 각 전도층(110, 120)을 압착하면, 조도가 큰 전도층(120)과 절연층(도 4의 130) 사이의 접착 강도는, 조도가 작은 전도층(110)과 절연층(도 4의 130) 사이의 접착 강도 보다 크다. 또한, 절연층(도 4의 130)의 전도층(110, 120)에 대한 횡방향, 즉, 너비 방향의 지지력 역시 조도가 큰 전도 층(120)에 인접한 절연층(도 4의 130) 부분이 더 크다.
다음으로, 도 4에 도시된 바와 같이, 한 쌍의 전도층(110, 120) 일면이 각각 절연층(130)의 일면과 타면을 향하도록 절연층(130)에 한 쌍의 전도층(110, 120)을 각각 적층한다(S120). 즉, 일면의 조도가 서로 상이하게 형성된 각 전도층(110, 120)을 절연층(130)의 일면 및 타면에 각각 적층하여 한 쌍의 전도층(110, 120) 사이에 절연층(130)이 개재되도록 배치한 후, 각 전도층(110, 120)과 절연층(130)을 고온에서 압착하는 것이다.
여기서, 절연층(130)은 반경화 상태의 에폭시(epoxy) 수지로 이루어질 수 있으므로, 조도가 형성된 각 전도층(110, 120)의 일면이 보다 효과적이고 용이하게 절연층(130)에 밀착될 수 있다.
또한, 이와 같이 한 쌍의 전도층(110, 120)을 절연층(130)에 적층함으로써, 상술한 바와 같이, 조도가 큰 전도층(120)과 절연층(130)과의 접착 강도가, 조도가 작은 전도층(110)과 절연층(130)과의 접착 강도보다 증가될 수 있고, 조도가 큰 전도층(120)에 인접한 절연층(130)이 전도층(120)에 대하여 보다 강한 횡방향 지지력을 가질 수 있으므로, 인쇄회로기판(100)에 가해지는 열로 인하여, 조도가 큰 전도층(120)이 더 팽창하는 경우라도, 상술한 접착 강도 및 지지력에 의해 이러한 팽창력의 불균형을 상쇄시킬 수 있다.
이하, 종래 기술과 본 실시예의 비교를 통하여, 상술한 원리를 보다 상세히 설명하도록 한다.
도 1에 도시된 종래 기술에 따른 인쇄회로기판(도 1의 10)의 경우, 각 금속층(도 1의 30, 40)은 조도가 서로 동일하므로, 각 금속층(도 1의 30, 40)을 패터닝하여 절연층(도 1의 20)의 양면에, 잔존하는 금속층(도 1의 30, 40)의 양이 서로 상이하게 되는 경우, 이후 반도체 패키징 공정 또는 전자 제품의 사용 도중 수반되는 열에 의해, 잔존량이 큰 금속층(도 1의 40)의 팽창되는 전체 양이 잔존량이 작은 금속층(도 1의 30)의 팽창되는 전체 양에 비해 크므로, 결국, 잔존량이 작은 금속층(도 1의 30) 방향으로 인쇄회로기판(도 1의 10)의 양측이 휘는 문제가 발생한다.
그러나, 본 실시예에 따르면, 각 전도층(110, 120) 일면의 조도를 서로 상이하게 형성하여, 상술한 바와 같이, 열에 의한 전도층(110, 120)의 횡방향 팽창을 억제하는 절연층(130)의 지지력을 조절할 수 있으므로, 각 전도층(110, 120)을 에칭하여 회로 패턴을 형성할 시, 조도가 큰 전도층(120)의 잔존량을 크게 하고, 조도가 작은 전도층(110)의 잔존량을 작게 하면, 조도가 큰 전도층(120)의 잔존량이 커 그에 따른 횡방향 팽창력이 증가함에도 불구하고, 조도가 큰 전도층(120)과 절연층(130)과의 강한 접착력 및 이 절연층(130)의 지지력에 의해, 팽창력이 상쇄될 수 있으므로, 결과적으로, 인쇄회로기판(100)의 휨을 저감할 수 있는 것이다.
다음으로, 도 5를 참조하여, 본 발명의 다른 측면에 따른 인쇄회로기판(200)에 대하여 설명하도록 한다.
도 5는 본 발명의 다른 측면에 따른 인쇄회로기판(200)의 일 실시예를 나타 낸 단면도이다.
본 실시예에 따르면, 에폭시 수지를 포함하여 이루어지는 절연층(230), 및 일면의 조도가 서로 상이하게 형성되며, 일면이 각각 절연층(230)의 일면과 타면을 향하도록 절연층(230)에 적층되는 한 쌍의 동박(210, 220)을 포함하는 인쇄회로기판(200)이 제시된다.
이와 같은 본 실시예에 따르면, 인쇄회로기판(200)에 반도체 칩을 실장하는 패키징 공정 중 또는 인쇄회로기판(200)이 전자 제품에 적용된 후 사용되는 중에 수반되는 열에 의해 발생되는 인쇄회로기판(200)의 휨을 저감할 수 있다.
이하, 도 5를 참조하여, 각 구성에 대하여 보다 상세히 설명하도록 한다.
절연층(230)은, 에폭시 수지를 포함하여 이루어진다. 이러한 절연층(230)은 반경화 상태에서 후술할 동박(210, 220)과 압착됨과 동시에, 가열 및 경화될 수 있으며, 이와 같이 반경화 상태의 절연층(230)을 이용함에 따라, 보다 효율적이고 용이하게 절연층(230)과 동박(210, 220)을 압착할 수 있다.
한 쌍의 동박(210, 220)은, 일면의 조도가 서로 상이하게 형성되며, 일면이 각각 절연층(230)의 일면과 타면을 향하도록 절연층(230)에 각각 적층된다. 즉, 동박(210, 220)의 각 일면은 서로 상이하게 조도가 형성되며, 절연층(230)의 일면 및 타면을 향하도록 적층된다. 이에 따라, 한 쌍의 동박(210, 220) 사이에는 절연층(230)이 개재되며, 이들 동박(210, 220)과 절연층(230)이, 상술한 바와 같이, 고온에서 압착됨으로써 인쇄회로기판(200)이 형성된다.
이와 같은 인쇄회로기판(200)은 절연층(230)의 양면에 서로 비대칭의 조도가 형성된 동박(210, 220)이 배치됨으로써, 패터닝에 따른 각 동박(210, 220)의 잔존량이 상이한 경우에도, 잔존량이 큰 동박(220)의 조도를 증가시켜 동박(220)과 절연층(230) 간의 접착력 및 절연층(230)의 지지력을 증가시킬 수 있다. 따라서, 이와 같은 접착력 및 지지력에 의해, 잔존량이 큰 동박(220)의 팽창을 억제할 수 있으므로, 결과적으로 열에 의한 인쇄회로기판(200)의 휨을 저감할 수 있다.
이상, 본 발명의 일 실시예에 대하여 설명하였으나, 해당 기술 분야에서 통상의 지식을 가진 자라면 특허청구범위에 기재된 본 발명의 사상으로부터 벗어나지 않는 범위 내에서, 구성 요소의 부가, 변경, 삭제 또는 추가 등에 의해 본 발명을 다양하게 수정 및 변경시킬 수 있을 것이며, 이 또한 본 발명의 권리범위 내에 포함된다고 할 것이다.
도 1은 종래 기술에 따른 인쇄회로기판을 나타낸 단면도.
도 2는 본 발명의 일 측면에 따른 인쇄회로기판 제조 방법의 일 실시예를 나타낸 순서도.
도 3 및 도 4는 본 발명의 일 측면에 따른 인쇄회로기판 제조 방법 일 실시예의 각 공정을 나타낸 단면도.
도 5는 본 발명의 다른 측면에 따른 인쇄회로기판의 일 실시예를 나타낸 단면도.
<도면의 주요 부분에 대한 부호의 설명>
100: 인쇄회로기판
110, 120: 전도층
130: 절연층

Claims (4)

  1. 일면의 조도(roughness)가 서로 상이하게 형성되는 한 쌍의 전도층을 제공하는 단계;
    상기 한 쌍의 전도층 일면이 각각 절연층의 일면과 타면을 향하도록 상기 절연층에 상기 한 쌍의 전도층을 각각 적층하는 단계; 및
    상기 한 쌍의 전도층 중 조도가 큰 전도층의 잔존량이 크도록, 상기 한 쌍의 전도층을 에칭하여 회로패턴을 형성하는 단계를 포함하는 인쇄회로기판 제조 방법.
  2. 제1항에 있어서,
    상기 전도층은 동박(copper foil)인 것을 특징으로 하는 인쇄회로기판 제조 방법.
  3. 제1항에 있어서,
    상기 절연층은 에폭시(epoxy) 수지를 포함하여 이루어지는 것을 특징으로 하는 인쇄회로기판 제조 방법.
  4. 에폭시 수지를 포함하여 이루어지는 절연층; 및
    일면의 조도가 서로 상이하게 형성되며, 일면이 각각 상기 절연층의 일면과 타면을 향하도록 상기 절연층에 각각 적층되는 한 쌍의 동박을 포함하고,
    상기 한 쌍의 동박 중 조도가 큰 동박이 조도가 작은 동박보다 넓은 면적을 가지는 것을 특징으로 하는 인쇄회로기판.
KR1020080088177A 2008-09-08 2008-09-08 인쇄회로기판 및 그 제조 방법 KR100999918B1 (ko)

Priority Applications (4)

Application Number Priority Date Filing Date Title
KR1020080088177A KR100999918B1 (ko) 2008-09-08 2008-09-08 인쇄회로기판 및 그 제조 방법
US12/358,543 US20100059267A1 (en) 2008-09-08 2009-01-23 Printed circuit board and method of manufacturing the same
JP2009015337A JP5082117B2 (ja) 2008-09-08 2009-01-27 印刷回路基板及びその製造方法
US13/788,916 US20130186677A1 (en) 2008-09-08 2013-03-07 Printed circuit board and method of manufacturing the same

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
KR1020080088177A KR100999918B1 (ko) 2008-09-08 2008-09-08 인쇄회로기판 및 그 제조 방법

Publications (2)

Publication Number Publication Date
KR20100029403A KR20100029403A (ko) 2010-03-17
KR100999918B1 true KR100999918B1 (ko) 2010-12-13

Family

ID=41798230

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1020080088177A KR100999918B1 (ko) 2008-09-08 2008-09-08 인쇄회로기판 및 그 제조 방법

Country Status (3)

Country Link
US (2) US20100059267A1 (ko)
JP (1) JP5082117B2 (ko)
KR (1) KR100999918B1 (ko)

Families Citing this family (9)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE102012213917A1 (de) * 2012-08-06 2014-02-20 Robert Bosch Gmbh Bauelemente-Ummantelung für ein Elektronikmodul
JP6036083B2 (ja) * 2012-09-21 2016-11-30 株式会社ソシオネクスト 半導体装置及びその製造方法並びに電子装置及びその製造方法
US9325536B2 (en) 2014-09-19 2016-04-26 Dell Products, Lp Enhanced receiver equalization
US9317649B2 (en) 2014-09-23 2016-04-19 Dell Products, Lp System and method of determining high speed resonance due to coupling from broadside layers
US9313056B1 (en) 2014-11-07 2016-04-12 Dell Products, Lp System aware transmitter adaptation for high speed serial interfaces
KR102436225B1 (ko) * 2017-07-28 2022-08-25 삼성전기주식회사 인쇄회로기판
US11355355B2 (en) * 2017-08-24 2022-06-07 Amosense Co., Ltd. Method for producing ceramic substrate, and ceramic substrate
KR20200127511A (ko) * 2019-05-02 2020-11-11 주식회사 아모센스 세라믹 기판 및 그의 제조방법
CN113540029A (zh) 2020-04-16 2021-10-22 奥特斯奥地利科技与系统技术有限公司 部件承载件以及制造和设计部件承载件的方法

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001287300A (ja) * 2000-04-04 2001-10-16 Shin Etsu Polymer Co Ltd 銅張積層基板及びその製造方法
KR100502179B1 (ko) 2002-02-25 2005-08-08 스마트알앤씨 주식회사 인쇄회로기판용 금속 피복 적층체의 제조 방법
KR100736518B1 (ko) 2004-01-26 2007-07-06 마쯔시다덴기산교 가부시키가이샤 회로 형성 기판의 제조 방법 및 회로 형성 기판의 제조용재료

Family Cites Families (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH08236939A (ja) * 1995-02-28 1996-09-13 Matsushita Electric Works Ltd 多層プリント配線板の製造方法
JP3392992B2 (ja) * 1995-08-11 2003-03-31 日立化成工業株式会社 半導体パッケージ
US5912809A (en) * 1997-01-21 1999-06-15 Dell Usa, L.P. Printed circuit board (PCB) including channeled capacitive plane structure
KR100633678B1 (ko) * 1998-02-26 2006-10-11 이비덴 가부시키가이샤 필드 바이어 구조를 갖는 다층프린트 배선판
JP2003008161A (ja) * 2001-06-26 2003-01-10 Matsushita Electric Ind Co Ltd 導電体、および回路基板
US6596384B1 (en) * 2002-04-09 2003-07-22 International Business Machines Corporation Selectively roughening conductors for high frequency printed wiring boards
JP2004207587A (ja) * 2002-12-26 2004-07-22 Dowa Mining Co Ltd 金属−セラミックス接合基板およびその製造方法
US7001662B2 (en) * 2003-03-28 2006-02-21 Matsushita Electric Industrial Co., Ltd. Transfer sheet and wiring board using the same, and method of manufacturing the same
US6964884B1 (en) * 2004-11-19 2005-11-15 Endicott Interconnect Technologies, Inc. Circuitized substrates utilizing three smooth-sided conductive layers as part thereof, method of making same, and electrical assemblies and information handling systems utilizing same
US7192654B2 (en) * 2005-02-22 2007-03-20 Oak-Mitsui Inc. Multilayered construction for resistor and capacitor formation
JP4341588B2 (ja) * 2005-06-09 2009-10-07 株式会社デンソー 多層基板及びその製造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001287300A (ja) * 2000-04-04 2001-10-16 Shin Etsu Polymer Co Ltd 銅張積層基板及びその製造方法
KR100502179B1 (ko) 2002-02-25 2005-08-08 스마트알앤씨 주식회사 인쇄회로기판용 금속 피복 적층체의 제조 방법
KR100736518B1 (ko) 2004-01-26 2007-07-06 마쯔시다덴기산교 가부시키가이샤 회로 형성 기판의 제조 방법 및 회로 형성 기판의 제조용재료

Also Published As

Publication number Publication date
JP2010067941A (ja) 2010-03-25
KR20100029403A (ko) 2010-03-17
JP5082117B2 (ja) 2012-11-28
US20130186677A1 (en) 2013-07-25
US20100059267A1 (en) 2010-03-11

Similar Documents

Publication Publication Date Title
KR100999918B1 (ko) 인쇄회로기판 및 그 제조 방법
US8387239B2 (en) Manufacturing method of embedded circuit substrate
US9253888B2 (en) Method for integrating an electronic component into a printed circuit board or a printed circuit board intermediate product, and printed circuit board or printed circuit board intermediate product
EP1599079B1 (en) Method for producing a circuit board and material for producing a circuit board
US8553417B2 (en) Heat-radiating substrate and method of manufacturing the same
JP2007149870A (ja) 回路基板及び回路基板の製造方法。
JP2010130003A (ja) 多層印刷回路基板及びその製造方法
KR101062326B1 (ko) 인쇄회로기판 및 그 제조방법
JP2014502792A (ja) 液晶高分子はんだマスクとアウタシール層とを有する電子デバイス及びその関連方法
KR100926657B1 (ko) 웨이퍼 레벨 패키지 된 인쇄회로기판 및 제조 방법
KR101044105B1 (ko) 휨 발생 방지를 위한 기판의 제조방법
KR100872131B1 (ko) 인쇄회로기판 제조방법
JP4525786B2 (ja) 電子部品及び電子部品モジュール
KR101713640B1 (ko) 부품 내장 기판
KR100482822B1 (ko) 캐패시터 내장형 인쇄 회로 기판 제조 방법
KR20090003880A (ko) 매립패턴 기판 및 그 제조 방법
JP2001326458A (ja) プリント配線基板およびその製造方法
JP2015041729A (ja) プリント配線板
JP2008085111A (ja) 配線基板とその製造方法
KR101154352B1 (ko) 임베디드 인쇄회로기판용 부재 및 그 제조 방법 및 임베디드 인쇄회로기판용 부재를 이용한 임베디드 인쇄회로기판 제조 방법
KR101044123B1 (ko) 기판 제조용 캐리어 부재 및 이를 이용한 기판의 제조방법
JP2005268690A (ja) 多層回路基板の製造方法
WO2012164719A1 (ja) 部品内蔵基板及びその製造方法
JP2007311723A (ja) 多層回路基板
JP2006093303A (ja) プリント配線板およびその製造方法

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20130916

Year of fee payment: 4

LAPS Lapse due to unpaid annual fee