KR100869794B1 - 플라즈마 표시 장치 및 그 구동 장치와 그 구동 방법 - Google Patents

플라즈마 표시 장치 및 그 구동 장치와 그 구동 방법 Download PDF

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Abstract

플라즈마 표시 장치에서, 복수의 제1 전극에 연결된 제1 인덕터에 제1 방향으로 전류를 흐르도록 하여 Vs 전압과 0V 전압 사이의 Vs/2 전압을 충전하고 있는 커패시터에 저장된 에너지를 제1 전극에 주입하여 상기 제1 전극의 전압을 증가시키며, 복수의 제1 전극에 연결된 제2 인덕터에 제2 방향으로 전류를 흐르도록 하여 제1 전극에 저장된 에너지를 상기 커패시터로 회수하여 상기 제1 전극의 전압을 감소시킨다. 이때, 복수의 제1 전극의 전압을 증가시킨 후 제1 인덕터에 제1 방향과 반대 방향으로 형성되는 전류를 제거하는 제1 전류 경로가 형성되어 있고, 복수의 제1 전극의 전압을 감소시킨 후 제2 인덕터에 제2 방향과 반대 방향으로 형성되는 전류를 제거하는 제2 전류 경로가 형성되어 있다.
PDP, 전극, 방전, 전압, 프리휠링, 공진, 전류, 인덕터, 유지 방전 펄스

Description

플라즈마 표시 장치 및 그 구동 장치와 그 구동 방법{PLASMA DISPLAY, AND DRIVING DEVICE AND METHOD THEREOF}
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이다.
도 2는 본 발명의 제1 실시 예에 따른 유지 방전 펄스를 나타내는 도면이다.
도 3은 본 발명의 제1 실시 예에 따른 유지 방전 회로(510)의 개략적으로 나타낸 도면이다.
도 4는 본 발명의 제1 실시 예에 따른 유지 방전 회로(510)의 신호 타이밍을 나타낸 도면이다.
도 5a 내지 도 5d는 각각 도 4의 신호 타이밍에 따른 도 3의 유지 방전 회로(510)의 동작을 나타낸 도면이다.
도 6은 본 발명의 제2 실시 예에 따른 유지 방전 펄스를 나타내는 도면이다.
도 7은 본 발명의 제2 실시 예에 따른 유지 방전 회로(510')를 개략적으로 나타내는 도면이다.
본 발명은 플라즈마 표시 장치 및 그 구동 장치와 그 구동 방법에 관한 것으 로, 특히 플라즈마 표시 장치의 에너지 회수 회로에 관한 것이다.
플라즈마 표시 장치는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 장치이다. 이러한 플라즈마 표시 패널에는 그 크기에 따라 수십에서 수백 만개 이상의 방전 셀이 매트릭스 형태로 배열되어 있다.
일반적으로 플라즈마 표시 장치에서는 한 프레임이 복수의 서브필드로 분할되어 구동되며, 복수의 서브필드 중 표시 동작이 일어나는 서브필드의 가중치의 조합에 의해 계조가 표시된다. 각 서브필드의 어드레스 기간 동안 켜질 셀과 켜지지 않을 셀이 선택되고 유지 기간 동안 실제로 영상을 표시하기 위해 켜질 셀에 대하여 유지 방전이 수행된다.
이러한 동작을 하기 위해서, 유지 기간 동안 유지 방전을 수행하는 전극에 하이 레벨 전압과 로우 레벨 전압이 교대로 인가된다. 이때, 유지 방전이 일어나는 두 전극은 용량성 성분으로 작용하므로, 전극에 하이 레벨 전압 또는 로우 레벨 전압을 인가하기 위해서는 무효 전력이 필요하다. 따라서 플라즈마 표시 장치의 유지 방전 회로에서는 무효 전력을 회수하여 재사용하는 에너지 회수 회로가 사용된다.
이러한 에너지 회수 회로는 두 전극에 대해서 별도로 존재하며, 각 에너지 회수 회로에는 전극의 전압을 증가시키기 위한 트랜지스터 및 다이오드와 전극의 전압을 감소시키는 위한 트랜지스터 및 다이오드가 각각 형성되어 있다. 그리고 에너지 회수 회로에는 인덕터의 전압이 허용 전압을 넘지 않도록 인덕터의 전압을 클램핑하기 위한 클램핑 다이오드가 형성된다. 이때, 인덕터를 통해 전극의 전압을 증가시킨 후 또는 인덕터를 통해 전극의 전압을 감소시킨 후에, 전극의 전압을 증 가시킬 때 또는 전극의 전압을 감소시킬 때 인덕터에 형성되는 전류 방향과 반대 방향의 전류가 클램핑 다이오드를 통해 프리휠링된다. 이로 인해서 무효 전력이 증가되어 전력 소모가 커지게 된다.
본 발명이 이루고자 하는 기술적 과제는 프리휠링되는 전류를 제거할 수 있는 플라즈마 표시 장치 및 그 구동 장치와 그 구동 방법을 제공하는 것이다.
본 발명의 한 특징에 따르면, 플라즈마 표시 장치가 제공된다. 플라즈마 표시 장치는, 복수의 제1 전극, 제1 전압을 공급하는 제1 전원과 상기 복수의 제1 전극 사이에 직렬로 연결되어 있는 제1 및 제2 트랜지스터, 상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원과 상기 복수의 제1 전극 사이에 연결되어 있는 제3 및 제4 트랜지스터, 상기 제1 전압과 상기 제2 전압 사이의 제3 전압을 충전하고 있는 커패시터, 상기 커패시터에 제1단이 연결되어 있는 제1 인덕터, 상기 커패시터에 제1단이 연결되어 있는 제2 인덕터, 상기 제1 인덕터의 제2단과 상기 제1 및 제2 트랜지스터의 접점 사이에 상기 제1 인덕터의 제1단에서 제2단으로 전류를 흐르도록 하여 상기 복수의 제1 전극의 전압을 증가시키는 상승 경로, 상기 제2 인덕터의 제2단과 상기 제3 및 제4 트랜지스터의 접점 사이에 상기 제2 인덕터의 제2단에서 제1단으로 전류를 흐르도록 하여 상기 복수의 제1 전극의 전압을 감소시키는 하강 경로, 상기 제1 인덕터의 제2단에서 제1단으로 형성되는 전류를 제거하기 위한 제1 전류 경로, 그리고 상기 제2 인덕터의 제1단에서 제1단으로 형성되는 전류 를 제거하기 위한 제2 전류 경로를 포함한다.
본 발명의 다른 한 특징에 따르면, 제1 전극과 제2 전극을 포함하는 플라즈마 표시 장치의 구동 방법이 제공된다. 이 구동 방법은, 상기 제1 전극에 연결된 제1 인덕터에 제1 방향의 전류를 흐르게 하여 제1 전압을 공급하는 제1 전원에 저장된 에너지를 상기 제1 전극에 주입하는 단계, 상기 제1 전압보다 높은 제2 전압을 공급하는 제2 전원을 통하여 상기 제1 전극에 상기 제2 전압을 인가하는 단계, 상기 제1 전극에 상기 제2 전압을 인가하는 동안 상기 제1 인덕터에 상기 제1 방향과 반대 방향으로 형성되는 전류를 상기 제1 전원으로 회수하는 단계, 상기 제1 전극에 연결된 제2 인덕터에 제2 방향의 전류를 흐르게 하여 상기 제1 전극에 저장된 에너지를 상기 제1 전원으로 회수하는 단계, 상기 제1 전압보다 낮은 제3 전압을 공급하는 제3 전원을 통하여 상기 제1 전극에 상기 제3 전압을 인가하는 단계, 그리고 상기 제1 전극에 상기 제3 전압을 인가하는 동안 상기 제2 인덕터에 상기 제2 방향과 반대 방향으로 형성되는 전류를 상기 제2 전원으로 회수하는 단계를 포함한다.
본 발명의 또 다른 특징에 따르면, 제1 전극과 제2 전극을 포함하는 플라즈마 표시 장치의 구동 장치가 제공된다. 이 구동 장치는, 상기 제1 전극에 제1단이 연결되어 있는 제1 트랜지스터, 상기 제1 전극에 제1단이 연결되어 있는 제2 트랜지스터, 상기 제1 트랜지스터의 제2단과 제1 전압을 공급하는 제1 전원 사이에 연결되어 있는 제3 트랜지스터, 상기 제2 트랜지스터의 제2단과 상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원 사이에 연결되어 있는 제4 트랜지스터, 제1 인 덕터를 포함하며, 상기 제1 인덕터에 제1 방향으로 전류를 흐르게 하여 상기 제1 전극의 전압을 증가시키는 상승 경로, 제2 인덕터를 포함하며, 상기 제2 인덕터에 제2 방향으로 전류를 흐르게 하여 상기 제1 전극의 전압을 감소시키는 하강 경로, 상기 제1 인덕터와 상기 제2 전원 사이에 연결되어 상기 제1 인덕터에 상기 제1 방향과 반대 방향으로의 전류 경로를 형성하기 위한 제1 다이오드, 그리고 상기 제2 인덕터와 상기 제1 전원 사이에 연결되어 상기 제2 인덕터에 상기 제2 방향과 반대 방향으로의 전류 경로를 형성하기 위한 제2 다이오드를 포함한다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시 예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시 예에 한정되지 않는다. 그리고 도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였으며, 명세서 전체를 통하여 유사한 부분에 대해서는 유사한 도면 부호를 붙였다.
명세서 전체에서, 어떤 부분이 다른 부분과 "연결"되어 있다고 할 때, 이는 "직접적으로 연결"되어 있는 경우뿐 아니라, 그 중간에 다른 소자를 사이에 두고 "전기적으로 연결"되어 있는 경우도 포함한다. 또한 어떤 부분이 어떤 구성요소를 "포함"한다고 할 때, 이는 특별히 반대되는 기재가 없는 한 다른 구성요소를 제외하는 것이 아니라 다른 구성요소를 더 포함할 수 있는 것을 의미한다.
그리고 명세서 전체에서 전압을 유지한다는 표현은 특정 2점간의 전위 차가 시간 경과에 따라 변화하여도 그 변화가 설계 상 허용될 수 있는 범위 내이거나 변 화의 원인이 당업자의 설계 관행에서는 무시되고 있는 기생 성분에 의한 경우를 포함한다. 또한 방전 전압에 비해 반도체 소자(트랜지스터, 다이오드 등)의 문턱 전압이 매우 낮으므로 문턱 전압을 0V로 간주하고 근사 처리한다.
먼저, 본 발명의 실시 예에 따른 플라즈마 표시 장치 및 그 구동 장치와 그 구동 방법에 대해서 도면을 참고로 하여 상세하게 설명한다.
도 1은 본 발명의 실시 예에 따른 플라즈마 표시 장치를 나타내는 도면이고, 도 2는 본 발명의 제1 실시 예에 따른 유지 방전 펄스를 나타내는 도면이다.
도 1에 나타낸 바와 같이, 본 발명의 실시 예에 따른 플라즈마 표시 장치는 플라즈마 표시 패널(100), 제어부(200), 어드레스 전극 구동부(300), 주사 전극 구동부(400) 및 유지 전극 구동부(500)를 포함한다.
플라즈마 표시 패널(100)은 열 방향으로 뻗어 있는 복수의 어드레스 전극(이하, "A 전극"이라 함)(A1-Am), 그리고 행 방향으로 서로 쌍을 이루면서 뻗어 있는 복수의 유지 전극(이하, "X 전극"이라 함)(X1-Xn) 및 주사 전극(이하, "Y 전극"이라 함)(Y1-Yn)을 포함한다. 일반적으로 X 전극(X1-Xn)은 각 Y 전극(Y1-Yn)에 대응해서 형성되어 있으며, X 전극(X1-Xn)과 Y 전극(Y1-Yn)이 유지 기간에서 화상을 표시하기 위한 표시 동작을 수행한다. Y 전극(Y1-Yn)과 X 전극(X1-Xn)은 A 전극(A1-Am)과 직교하도록 배치된다. 이때, A 전극(A1-Am)과 X 및 Y 전극(X1-Xn, Y1-Yn)의 교차부에 있는 방전 공간이 셀(110)을 형성한다. 이러한 플라즈마 표시 패널(100)의 구조는 일 예이며, 아래에서 설명하는 구동 파형이 적용될 수 있는 다른 구조의 패널도 본 발명에 적용될 수 있다.
제어부(200)는 외부로부터 영상 신호를 수신하여 어드레스 전극 구동 제어 신호, 유지 전극 구동 제어 신호 및 주사 전극 구동 제어 신호를 출력한다. 그리고 제어부(200)는 한 프레임을 복수의 서브필드로 분할하여 구동하며, 각 서브필드는 어드레스 기간 및 유지 기간을 포함한다.
어드레스 전극 구동부(300)는 제어부(200)로부터의 구동 제어 신호에 따라 A 전극(A1-Am)에 구동 전압을 인가한다.
주사 전극 구동부(400)는 제어부(200)로부터의 구동 제어 신호에 따라 Y 전극(Y1-Yn)에 구동 전압을 인가한다.
유지 전극 구동부(500)는 제어부(200)로부터의 구동 제어 신호에 따라 X 전극(X1-Xn)에 구동 전압을 인가한다.
구체적으로, 각 서브필드의 어드레스 기간 동안 어드레스 전극, 주사 전극 및 유지 전극 구동부(300, 400, 500)는 복수의 셀(110) 중에서 해당 서브필드에서 켜질 과 켜지지 않을 셀을 선택한다. 각 서브필드의 유지 기간 동안, 도 2에 도시한 바와 같이 주사 전극 구동부(400)는 Y 전극(Y1-Yn)에 하이 레벨 전압(Vs) 및 로우 레벨 전압(0V)을 교대로 가지는 유지 방전 펄스를 해당 서브필드의 가중치에 해당하는 횟수만큼 인가한다. 그리고 유지 전극 구동부(500)는 X 전극(X1-Xn)에 유지 방전 펄스를 Y 전극(Y1-Yn)에 인가되는 유지 방전 펄스와 반대 위상으로 인가한다. 이와 같이 하면, 각 Y 전극(Y1-Yn)과 각 X 전극(X1-Xn)의 전압 차가 Vs 전압과 -Vs 전압을 교대로 가지며, 이에 따라 켜질 셀에서 유지 방전이 소정 횟수만큼 반복하여 일어난다.
다음으로, 도 2의 유지 방전 펄스를 공급하는 유지 방전 회로에 대해서 도 3, 도 4 및 도 5a 내지 도 5d를 참조하여 상세하게 설명한다.
도 3은 본 발명의 제1 실시 예에 따른 유지 방전 회로(510)의 개략적으로 나타낸 도면이다. 도 3에서는 설명의 편의상 복수의 X 전극(X1-Xn)에 연결되어 있는 유지 방전 회로(510)만을 도시하였으며, 이러한 유지 방전 회로(510)는 도 1의 유지 전극 구동부(500)에 형성될 수 있다. 그리고 복수의 Y 전극(Y1-Yn)에 연결된 유지 방전 회로(410)도 도 3의 유지 방전 회로(510)와 동일한 구조를 가질 수 있으며, 도 3의 유지 방전 회로(510)와 다른 구조를 가질 수도 있다.
이러한 유지 방전 회로(510)는 X 전극(X1-Xn)에 공통으로 연결될 수도 있으며, 또는 X 전극(X1-Xn) 중 일부 전극에만 연결될 수도 있다. 그리고 유지 방전 회로(510)에서는 설명의 편의상 하나의 X 전극과 하나의 Y 전극만을 도시하였으며, X 전극과 Y 전극에 의해 형성되는 용량성 성분을 패널 커패시터(Cp)로 도시하였다.
도 3에 도시한 바와 같이, 유지 방전 회로(510)는 트랜지스터(Xs, Xr, Xf, Xg), 인덕터(Lr, Lf), 다이오드(D1, D2, Dr, Df) 및 커패시터(Cs)를 포함한다. 도 3에서는 트랜지스터(Xs, Xr, Xf, Xg)를 n채널 전계 효과 트랜지스터, 특히 NMOS(n-channel metal oxide semiconductor) 트랜지스터로 도시하였으며, 이들 트랜지스터(Xs, Xr, Xf, Xg)에는 소스에서 드레인 방향으로 바디 다이오드가 형성될 수 있다. 그리고 NMOS 트랜지스터 대신에 유사한 기능을 하는 다른 트랜지스터가 이들 트랜지스터(Xs, Xr, Xf, Xg)로 사용될 수도 있다. 또한 도 3에서는 트랜지스터(Xs, Xr, Xf, Xg)를 각각 하나의 트랜지스터로 도시하였지만, 트랜지스터(Xs, Xr, Xf, Xg)는 각각 병렬로 연결된 복수의 트랜지스터로 형성될 수 있다.
도 3을 보면, X 전극에 트랜지스터(Xr)의 소스 및 트랜지스터(Xf)의 드레인이 연결되어 있다. 트랜지스터(Xr)의 드레인은 트랜지스터(Xs)의 소스에 연결되어 있고 트랜지스터(Xs)의 드레인은 유지 방전 펄스의 하이 레벨 전압(Vs)을 공급하는 전원(Vs)에 연결되어 있다. 트랜지스터(Xf)의 소스가 트랜지스터(Xg)의 드레인에 연결되어 있고 트랜지스터(Xg)의 소스는 유지 방전 펄스의 로우 레벨 전압(0V)을 공급하는 접지단(0)에 연결되어 있다.
커패시터(Cs)의 제1단은 접지단(0)에 연결되어 있으며, 커패시터(Cs)의 제2단은 각 인덕터(Lr, Lf)의 제1단이 연결되어 있다. 커패시터(Cs)에는 유지 방전 펄스의 하이 레벨 전압(Vs)과 로우 레벨 전압(0V)의 절반에 해당하는 Vs/2 전압이 충전되어 있다. 이러한 커패시터(Cs)는 스위칭 모드 전원 공급 장치(switching mode power supply, SMPS)의 출력단에 연결될 수도 있다. 인덕터(Lr)의 제2단에는 다이오드(Dr)의 애노드가 연결되어 있고, 다이오드(Dr)의 캐소드가 트랜지스터(Xs, Xr)의 접점에 연결되어 있다. 또한 인덕터(Lf)의 제2단에는 다이오드(Df)의 캐소드가 연결되어 있고, 다이오드(Df)의 애노드가 트랜지스터(Xf, Xg)의 접점에 연결되어 있다. 이때, 다이오드(Dr)는 트랜지스터(Xr)의 턴온 시에 X 전극의 전압을 증가시키는 상승 경로를 형성하며, 다이오드(Df)는 트랜지스터(Xf)의 턴온 시에 X 전극의 전압을 감소시키는 하강 경로를 형성한다. 그리고 인덕터(Lr)의 제2단에 다이오드(D1)의 캐소드가 연결되어 있고, 다이오드(D1)의 애노드가 접지단(0)에 연결되어 있다. 또한 인덕터(Lf)의 제2단에 다이오드(D2)의 애노드가 연결되어 있고, 다이오드(D2)의 캐소드가 전원(Vs)에 연결되어 있다. 이때, 다이오드(D1)는 인덕터(Lr)의 제1단에서 제2단으로의 전류 경로를 통하여 X 전극의 전압을 증가시킨 후에, 인덕터(Lr)의 제2단에서 제1단으로 형성되는 역방향 전류를 커패시터(Cs)로 회수시키는 전류 경로를 형성하며, 다이오드(D2)는 인덕터(Lf)의 제2단에서 제1단으로의 전류 경로를 통하여 Y 전극의 전압을 감소시킨 후에, 인덕터(Lf)의 제1단에서 제2단으로 형성되는 역방향 전류를 전원(Vs)으로 회수시키는 전류 경로를 형성한다.
이어서, 도 3의 유지 방전 회로(510)의 동작에 대해서 도 4, 도 5a 내지 도 5d를 참조하여 상세하게 설명한다.
도 4는 본 발명의 제1 실시 예에 따른 유지 방전 회로(510)의 신호 타이밍을 나타낸 도면이며, 도 5a 내지 도 5d는 각각 도 4의 신호 타이밍에 따른 도 3의 유지 방전 회로(510)의 동작을 나타낸 도면이다.
먼저, 도 4 및 도 5a를 보면, 모드 1(M1)에서 트랜지스터(Xg, Xf)가 턴오프되고 트랜지스터(Xr)가 턴온되어, 도 5a에 도시된 바와 같이 커패시터(Cs), 인덕터(Lr), 다이오드(Dr), 트랜지스터(Xr) 및 패널 커패시터(Cp)의 경로로 공진이 발생한다. 그러면, 커패시터(Cs)에 충전된 에너지가 인덕터(Lr)를 통하여 X 전극에 주입되어 X 전극의 전압(Vx)이 0V 전압에서 Vs 전압까지 증가한다.
모드 2(M2)에서는 트랜지스터(Xr)가 턴온된 상태에서 트랜지스터(Xs)가 턴온되어, 도 5b에 도시된 바와 같이 전원(Vs), 트랜지스터(Xs, Xr) 및 패널 커패시터(Cp)의 경로를 통하여 X 전극에 Vs 전압이 인가된다. 그리고 도 5b에 도시한 바 와 같이 모드 1(M1)에서 X 전극의 전압(Vx)을 Vs 전압까지 증가시킨 후에 인덕터(Lr)의 제2단에서 제1단으로 형성되는 전류는 접지단(0), 다이오드(D1), 인덕터(Lr) 및 커패시터(Cs)를 통하여 커패시터(Cs)로 회수된다.
모드 3(M3)에서는 트랜지스터(Xs, Xr)가 턴오프되고 트랜지스터(Xf)가 턴온되어, 도 5c에 도시된 바와 같이 패널 커패시터(Cp), 트랜지스터(Xf), 다이오드(Df), 인덕터(Lf) 및 커패시터(Cs)의 경로로 공진이 발생한다. 이 공진에 의해 패널 커패시터(Cp)에 저장된 에너지가 인덕터(Lf)를 통하여 커패시터(Cs)로 회수되면서, X 전극의 전압(Vx)이 Vs 전압에서 0V 전압까지 감소한다.
모드 4(M4)에서는 트랜지스터(Xf)가 턴온된 상태에서 트랜지스터(Xg)가 턴온되어, 도 5d에 도시된 바와 같이 패널 커패시터(Cp), 트랜지스터(Xf, Xg) 및 접지단(0)의 경로를 통하여 X 전극에 0V 전압이 인가된다. 그리고 도 5d에 도시한 바와 같이 모드 3(M3)에서 X 전극의 전압(Vx)을 0V 전압까지 감소시킨 후에 인덕터(Lf)의 제1단에서 제2단으로 형성되는 전류는 커패시터(Cs), 인덕터(Lf), 다이오드(D2) 및 전원(Vs)을 통하여 전원(Vs)으로 회수된다.
이와 같이, 본 발명의 실시 예에서는 유지 기간 동안 모드 1(M1) 내지 모드 4(M4)가 해당 서브필드의 가중치에 해당하는 횟수만큼 반복되어 X 전극에 Vs 전압과 0V 전압이 교대로 인가될 수 있다. 그리고 모드 2(M2)에서는 모드 1(M1)에서 X 전극의 전압을 증가시키는 동안 인덕터(Lr)에 형성되는 전류 방향과 반대 방향의 전류가 제거되고, 모드 4(M4)에서는 모드 3(M3)에서 X 전극의 전압을 감소시키는 동안 인덕터(Lf)에 형성되는 전류 방향과 반대 방향의 전류가 제거되어 무효 소비 전력이 저감된다.
그리고 도 2에 도시한 바와 같이, 본 발명의 제1 실시 예에서 Y 전극에 연결된 유지 방전 회로(510)는 X 전극에 Vs 전압이 인가되는 동안 Y 전극에 0V 전압을 인가하고 X 전극에 0V 전압이 인가되는 동안 Y 전극에 Vs 전압을 인가할 수 있다.
또한 인덕터(Lf)의 인덕턴스를 인덕터(Lr)의 인덕턴스보다 크게 할 수도 있다. 이렇게 하면, 모드 1(M)에서 X 전극의 전압을 빠르게 증가시킬 수 있으므로 방전이 균일해질 수 있며, 모드 3(M3)에서 X 전극의 전압이 서서히 감소되어 전류 피크치가 낮아지며 에너지 회수 효율을 향상시킬 수 있게 된다.
이상, 본 발명의 제1 실시 예에서는 X 전극과 Y 전극에 하이 레벨 전압과 로우 레벨 전압을 교대로 가지는 유지 방전 펄스를 반대 위상으로 인가하는 경우에 대해서 설명하였지만, 이와는 달리 X 전극과 Y 전극 중 하나의 전극에만 유지 방전 펄스가 인가될 수도 있다. 아래에서는 이러한 실시 예에 대해서 도 6 및 도 7을 참조하여 상세하게 설명한다.
도 6은 본 발명의 제2 실시 예에 따른 유지 방전 펄스를 나타내는 도면이고, 도 7은 본 발명의 제2 실시 예에 따른 유지 방전 회로(510')를 개략적으로 나타내는 도면이다.
도 6에 도시한 바와 같이, 본 발명의 제2 실시 예에서는 유지 기간 동안 X 전극에 Vs 전압과 -Vs 전압을 교대로 가지는 유지 방전 펄스가 인가되고, Y 전극에는 0V 전압이 인가된다. 이와 같이 하면, 도 2의 유지 방전 펄스와 동일하게 X 전극과 Y 전극의 전압 차가 Vs 전압과 -Vs 전압을 교대로 가질 수 있다. 이때, 본 발명의 제2 실시 에에 따른 유지 방전 회로(510')는 도 7에 도시한 바와 같이 유지 방전 펄스의 로우 레벨 전압(-Vs)을 공급하는 전원(-Vs)과 커패시터(Cs)에 충전되는 전압을 제외하면 제1 실시 예와 동일하다. 구체적으로, 트랜지스터(Xg)의 소스가 로우 레벨 전압(-Vs) 전압을 공급하는 전원(-Vs)에 연결되어 있고, 다이오드(D1)의 애노드가 전원(-Vs)에 연결되어 있다. 그리고 커패시터(Cs)에는 유지 방전 펄스의 하이 레벨 전압(Vs)과 로우 레벨 전압(-Vs)의 절반에 해당하는 전압(Vs)이 충전될 수 있다. 그러면, 도 5a 내지 도 5d에 도시한 바와 같은 경로를 통하여 X 전극에 Vs 전압과 -Vs 전압을 교대로 인가될 수 있다.
그리고 도 6 및 도 7에서는 X 전극에 유지 방전 회로(510')가 연결되고 Y 전극에 0V 전압이 인가되는 것으로 가정하였지만, Y 전극에 유지 방전 회로가 연결되고 X 전극에 0V 전압이 인가될 수도 있다.
또한, 도 7의 회로에서 트랜지스터(Xs)의 드레인 및 다이오드(D2)의 캐소드를 Vs/2 전압을 공급하는 전원에 연결하고, 트랜지스터(Xg)의 소스 및 다이오드(D1)의 애노드를 -Vs/2 전압을 공급하는 전원에 연결하면, X 전극에 Vs/2 전압과 -Vs/2 전압을 교대로 가지는 유지 방전 펄스가 인가될 수 있다. 이때, 커패시터(Cs)에 Vs/2 전압과 -Vs/2 전압의 절반에 해당하는 전압(Vs/2)이 충전된다. 그리고 이 경우에는 Y 전극에 Vs/2 전압과 -Vs/2 전압을 교대로 가지는 유지 방전 펄스를 X 전극에 인가되는 유지 방전 펄스와 반대 위상으로 인가할 수 있다.
이상에서 본 발명의 실시 예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명 의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이와 같이 본 발명에 의하면, 유지 방전 회로에서 인덕터를 통해 전극의 전압을 증가시키거나 감소시키는 동안에 인덕터에 형성되었던 전류 경로와 반대 방향의 전류를 제거할 수 있어 무효 전력을 감소시킬 수 있다. 또한 전극에 하이 레벨 전압을 인가할 때 빠르게 인가할 수 있어 방전이 균일해질 수 있다.

Claims (14)

  1. 제1 전극,
    제1 전압을 공급하는 제1 전원에 연결되어 있는 제1 트랜지스터,
    상기 제1 트랜지스터와 상기 제1 전극 사이에 연결되어 있는 제2 트랜지스터,
    상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원에 연결되어 있는 제3 트랜지스터,
    상기 제3 트랜지스터와 상기 제1 전극 사이에 연결되어 있는 제4 트랜지스터,
    상기 제1 전압과 상기 제2 전압 사이의 제3 전압을 충전하고 있는 커패시터,
    상기 커패시터에 제1단이 연결되어 있고 제2단이 상기 제1 및 제2 트랜지스터의 접점에 연결되어 있는 제1 인덕터,
    상기 커패시터에 제1단이 연결되어 있고 제2단이 상기 제3 및 제4 트랜지스터의 접점에 연결되어 있는 제2 인덕터,
    상기 제1 인덕터의 제2단과 상기 제2 전원 사이에 연결되어 있는 제1 다이오드, 그리고
    상기 제2 인덕터의 제2단과 상기 제1 전원 사이에 연결되어 있는 제2 다이오드
    를 포함하는 플라즈마 표시 장치.
  2. 삭제
  3. 제1항에 있어서,
    제1 기간 동안 상기 제2 트랜지스터를 턴온 상태로 설정하고, 제2 기간 동안 상기 제2 트랜지스터가 턴온된 상태에서 상기 제1 트랜지스터를 턴온 상태로 설정하며, 제3 기간 동안 상기 제4 트랜지스터를 턴온 상태로 설정하고, 제4 기간 동안 상기 제4 트랜지스터가 턴온된 상태에서 상기 제3 트랜지스터를 턴온 상태로 설정하는 제어부를 더 포함하는 플라즈마 표시 장치.
  4. 제3항에 있어서,
    상기 제2 기간 동안 상기 제1 인덕터의 제2단에서 제1단으로 형성되는 전류가 상기 제1 다이오드를 통하여 상기 커패시터로 회수되며,
    상기 제4 기간 동안 상기 제2 인덕터의 제1단에서 제2단으로 형성되는 전류가 상기 제2 다이오드를 통하여 상기 제1 전원으로 회수되는 플라즈마 표시 장치.
  5. 제1항, 제3항 또는 제4항 중 어느 한 항에 있어서,
    상기 제1 인덕터의 제2단에 애노드가 연결되고, 상기 제1 및 제2 트랜지스터의 접점에 캐소드가 연결되어 있는 제3 다이오드, 그리고
    상기 제2 인덕터의 제2단에 캐소드가 연결되고, 상기 제3 및 제4 트랜지스터의 접점에 애노드가 연결되어 있는 제4 다이오드
    를 더 포함하는 플라즈마 표시 장치.
  6. 제1항, 제3항 또는 제4항 중 어느 한 항에 있어서,
    상기 제2 전압은 접지 전압인 플라즈마 표시 장치.
  7. 제1항, 제3항 또는 제4항 중 어느 한 항에 있어서,
    상기 제1 전압은 접지 전압인 플라즈마 표시 장치.
  8. 제1항, 제3항 또는 제4항 중 어느 한 항에 있어서,
    상기 제1 인덕터의 인덕턴스가 상기 제2 인덕터의 인덕턴스보다 작은 플라즈마 표시 장치.
  9. 제1 전극과 제2 전극을 포함하는 플라즈마 표시 장치의 구동 방법에 있어서,
    상기 제1 전극에 연결된 제1 인덕터에 제1 방향의 전류를 흐르게 하여 커패시터에 충전된 에너지를 상기 제1 전극에 주입하는 단계,
    상기 제1 전압을 공급하는 제1 전원을 통하여 상기 제1 전극에 상기 제1 전압을 인가하는 단계,
    상기 제1 전극에 상기 제1 전압을 인가하는 동안 상기 제1 인덕터에 상기 제1 방향과 반대 방향으로 형성되는 전류를 상기 커패시터로 회수하는 단계,
    상기 제1 전극에 연결된 제2 인덕터에 제2 방향의 전류를 흐르게 하여 상기 제1 전극에 저장된 에너지를 상기 커패시터로 회수하는 단계,
    상기 제1 전압보다 낮은 제2 전압을 공급하는 제2 전원을 통하여 상기 제1 전극에 상기 제2 전압을 인가하는 단계, 그리고
    상기 제1 전극에 상기 제2 전압을 인가하는 동안 상기 제2 인덕터에 상기 제2 방향과 반대 방향으로 형성되는 전류를 상기 제1 전원으로 회수하는 단계
    를 포함하며,
    상기 커패시터에는 상기 제1 전압과 상기 제2 전압의 중간 전압이 충전되어 있는 플라즈마 표시 장치의 구동 방법.
  10. 제9항에 있어서,
    상기 제1 전극에 상기 제1 전압을 인가하는 단계는 상기 제2 전극에 상기 제2 전압을 인가하는 단계를 포함하며,
    상기 제1 전극에 상기 제2 전압을 인가하는 단계는 상기 제2 전극에 상기 제1 전압을 인가하는 단계를 포함하는 플라즈마 표시 장치의 구동 방법.
  11. 삭제
  12. 삭제
  13. 삭제
  14. 삭제
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