KR100763680B1 - 이미지 센서 소자의 콘택 구조 및 그 제조 방법 - Google Patents

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Abstract

본 발명은 이미지 센서 소자의 콘택 구조 및 그 제조 방법에 관한 것으로, 특히 반도체 기판의 픽셀 영역 및 로직 영역에 각각 게이트 전극 및 소오스/드레인 영역을 형성하고, 픽셀 영역의 게이트 전극 및 소오스/드레인 영역 상부면에 얇게 블록킹 질화막을 형성하고, 로직 영역의 게이트 전극 또는 소오스/드레인 영역에 실리사이드막을 형성하고, 반도체 기판의 구조물 전면에 순차적으로 식각 정지막 및 층간 절연막을 형성한 후에, 픽셀 영역의 층간 절연막과 식각 정지막 및 블록킹 질화막의 콘택홀을 통해 소오스/드레인 영역과 연결되는 콘택을 형성함과 동시에, 로직 영역의 층간 절연막과 식각 정지막의 콘택홀을 통해 실리사이드막과 연결되는 다른 콘택을 형성한다. 그러므로, 본 발명은 픽셀 영역에 형성되는 실리사이드 블록킹막을 식각 정지막과 동일한 물질로 형성하고 그 두께를 줄임으로써, 픽셀 영역과 로직 영역의 콘택홀 식각 공정시 로직 영역의 소자 분리막 경계 부분이 과도 식각되는 것을 방지할 수 있다.
이미지 센서, 콘택, 실리사이드, 블록킹, 실리콘 질화막

Description

이미지 센서 소자의 콘택 구조 및 그 제조 방법{STRUCTURE AND METHOD FOR MANUFACTURING CONTACT OF IMAGE SENSOR DEVICE}
도 1은 종래 기술에 의한 이미지 센서 소자의 콘택 구조를 나타낸 수직 단면도,
도 2a 내지 도 2i는 종래 기술에 의한 이미지 센서 소자에서 픽셀 영역과 로직 영역의 콘택 제조 공정을 설명하기 위한 공정 순서도,
도 3은 본 발명에 따른 이미지 센서 소자의 콘택 구조를 나타낸 수직 단면도,
도 4a 내지 도 4i는 본 발명에 따른 이미지 센서 소자의 픽셀 영역과 로직 영역의 콘택 제조 공정을 설명하기 위한 공정 순서도.
＜도면의 주요부분에 대한 부호의 설명＞
100 : 반도체 기판 102 : 소자 분리막
104 : 게이트 절연막 106 : 게이트 전극
108 : 스페이서 110 : 소오스/드레인 영역
112 : 블록킹 질화막 114 : 실리사이드막
116 : 식각 정지막 118 : 층간 절연막
122a : 픽셀 영역의 콘택홀 122b : 로직 영역의 콘택홀
본 발명은 이미지 센서 소자의 콘택 구조 및 그 제조 방법에 관한 것으로서, 특히 픽셀 영역과 로직 영역의 콘택홀 식각 공정시 발생하는 로직 영역의 소자 분리막 식각 손실을 미연에 방지할 수 있는 이미지 센서 소자의 콘택 구조 및 그 제조 방법에 관한 것이다.
일반적으로, 이미지 센서 소자는 광학 영상(optical image)을 전기 신호로 변환시키는 반도체소자로서, 이중 전하결합소자(CCD : Charge Coupled Device)는 개개의 MOS(Metal-Oxide-Silicon) 커패시터가 서로 매우 근접한 위치에 있으면서 전하캐리어가 커패시터에 저장되고 이송되는 소자이다. 더욱이, 씨모스(Complementary MOS; 이하 CMOS라 함) 이미지 센서는 제어회로(control circuit) 및 신호처리회로(signal processing circuit)를 주변회로로 사용하는 CMOS 기술을 이용하여 화소수만큼 MOS 트랜지스터를 만들고 이것을 이용하여 차례차례 출력(output)을 검출하는 스위칭 방식을 채용하는 소자이다.
이러한 다양한 이미지 센서를 제조함에 있어서, 이미지 센서의 감광도(photo sensitivity)를 증가시키기 위한 노력들이 진행되고 있는바 그 중 하나가 집광기술이다. 예컨대, CMOS 이미지 센서는 빛을 감지하는 광감지 소자부분(즉, 픽셀 영역)과, 감지된 빛을 전기적신호로 처리하여 데이터화하는 CMOS 논리 회로부분(즉, 로직 영역)으로 구성되어 있다.
한편, 종래 이미지 센서 제조 공정에서 광감지 소자가 형성되는 픽셀 영역은 다이오드 누설(leakage)을 줄이기 위해서 실리사이드막을 채택하지 않는 콘택을 형성하고, 논리 회로가 형성되는 로직 영역은 고속 신호 처리를 위해서 실리사이드를 채택한 콘택을 형성하게 된다.
도 1은 종래 기술에 의한 이미지 센서 소자의 콘택 구조를 나타낸 수직 단면도이다. 도 2a 내지 도 2i는 종래 기술에 의한 이미지 센서 소자에서 픽셀 영역과 로직 영역의 콘택 제조 공정을 설명하기 위한 공정 순서도이다.
이들 도면을 참조하면, 종래 기술에 의한 이미지 센서 소자의 콘택 제조 공정은 다음과 같이 진행된다.
우선 도 2a에 도시된 바와 같이, STI(Shallow Trench Isolation) 등의 소자 분리 공정을 통해 반도체 기판(10)인 실리콘 기판의 활성 영역과 소자 분리 영역을 구분하는 소자분리막(12)을 형성하고, 이온 주입(ion implantation) 공정을 통해 기판(10)의 활성 영역에 웰(well), 문턱 전압 조절 등의 불순물 도펀트(dopant)를 이온 주입한다.
그리고 기판(10)의 활성 영역 전면에 게이트 절연막(14)으로서, 실리콘 산화막(SiO2)을 증착하고, 그 위에 도프트 폴리실리콘 등의 도전막을 증착한다. 게이트 마스크를 이용한 사진 및 건식 식각 공정을 진행하여 도전막을 패터닝하여 픽셀 영역(A) 및 로직 영역(B)에 각각 게이트 전극(16)을 형성하고, 그 하부의 게이트 절연막(14)도 식각한다.
또, 기판 전면에 절연막으로서, 실리콘 질화막(Si3N4)을 증착하고, 이를 건식 식각, 예를 들어 반응성 이온 식각(RIE : Reactive Ion Etching)하여 픽셀 영역(A) 및 로직 영역(B)의 게이트 전극(16) 측벽에 스페이서(18)를 형성한다.
계속해서, 소오스/드레인 이온 주입 공정, 예를 들어, n형 도펀트 이온을 고농도로 이온 주입하여 픽셀 영역(A) 및 로직 영역(B)의 기판(10)내에 게이트 전극(16) 또는 스페이서(18) 에지와 소자 분리막(12) 사이의 활성 영역에 소오스/드레인 영역(20)을 형성한다.
도 2b에 도시된 바와 같이, 기판 전면에 열산화 공정 또는 습식 산화 공정 등으로 실리사이드의 형성을 막는 블록킹 산화막(22)을 약 500Å∼1000Å 정도 증착하고, 사진 및 식각 공정을 진행하여 로직 영역(B)의 블록킹 산화막을 제거함으로써 픽셀 영역(A)에만 블록킹 산화막(22)이 남아 있도록 한다.
도 2c에 도시된 바와 같이, 기판 전면에 실리사이드 금속층으로서 코발트(Co)를 증착하고 어닐 처리하여 로직 영역(B)의 게이트 전극(16) 또는 소오스/드레인 영역(20)에 코발트 실리사이드막(CoSi)(24)을 형성한다. 이때, 픽셀 영역(A)의 게이트 전극(16) 또는 소오스/드레인 영역(20)에는 블록킹 산화막(22)에 의해 실리사이드막이 형성되지 않는다.
이어서 도 2d에 도시된 바와 같이, 상기 구조물 전면에 식각 정지막(26)으로서 실리콘 질화막(Si3N4)을 약 300Å 정도 증착하고, 그 위에 층간 절연막(PMD : Poly Metal Dielectric layer)(28)으로서 BPSG(BoroPhospho Silicate Glass) 또는 PSG(Phospho Silicate Glass)를 6000Å∼7000Å정도 증착하고 이를 어닐링한다. 그런 다음 화학적기계적연마(CMP : Chemical Mechanical Polishing)로 층간 절연막(28)의 표면을 평탄화한다.
계속해서 도 2e에 도시된 바와 같이, 픽셀 영역(A) 및 로직 영역(B)의 콘택홀 마스크를 이용한 사진 공정을 진행하여 층간 절연막(28)에 포토레지스트 패턴(30)을 형성한다.
그리고 도 2f에 도시된 바와 같이, 포토레지스트 패턴(30)에 의해 드러난 층간 절연막(28) 및 식각 정지막(26)을 건식 식각하여 픽셀 영역(A) 및 로직 영역(B)에 콘택홀(32a, 32b)을 각각 형성한다. 이때, 로직 영역(B)에서는 콘택홀 식각 공정에 의해 소오스/드레인 영역(20)의 실리사이드막(24) 표면이 오픈되지만, 픽셀 영역(A)에서는 블록킹 산화막(22)으로 인해 소오스/드레인 영역(20)이 오픈되지 못한다.
이를 위해 도 2g에 도시된 바와 같이, 산화막의 건식 식각 공정을 진행하여 픽셀 영역(A)의 블록킹 산화막(22)을 선택 식각함으로서 픽셀 영역(A)의 소오스/드레인 영역(20)이 오픈되도록 한다.
그 다음, 도 2h에 도시된 바와 같이, 에슁 공정을 진행하여 콘택홀 식각을 위한 포토레지스트 패턴을 제거하고, 세정 공정을 진행한다.
그리고나서, 도 2i에 도시된 바와 같이, 픽셀 영역(A) 및 로직 영역(B)의 콘택홀에 도전막으로서 도프트 폴리실리콘 또는 금속 물질을 매립하고 화학적기계적연마(CMP) 공정으로 층간 절연막(28) 표면의 도전막을 제거하여 픽셀 영역(A)의 소 오스/드레인 영역(20)과 연결되고, 로직 영역(B)의 실리사이드막(24)을 통해 소오스/드레인 영역(20)과 연결되는 콘택(36)을 각각 형성한다.
하지만, 종래 기술에 의한 이미지 센서 픽셀 영역과 로직 영역의 콘택 제조 공정시 로직 영역(B)의 콘택홀을 위한 포토레지스트 패턴(30)이 미스 얼라인되어 있을 경우 픽셀 영역(A)의 블록킹 산화막(22)을 식각할 때 로직 영역(B)에서 실리사이드(24)와 소자 분리막(12) 사이의 경계 부분에 있는 소자 분리막(12)을 과도 식각(34)하게 된다. 이러한 과도 식각된 부분(34)은 이미지 센서 소자의 누설 원인으로 작용하게 되어 제품의 수율을 저하시키게 된다.
본 발명의 목적은 상기와 같은 종래 기술의 문제점을 해결하기 위하여, 픽셀 영역에 형성되는 실리사이드 블록킹막을 식각 정지막과 동일한 물질로 형성하고 그 두께를 줄임으로써, 픽셀 영역과 로직 영역의 콘택홀 식각 공정시 로직 영역의 소자 분리막 경계 부분이 과도 식각되는 것을 방지할 수 있는 이미지 센서 소자의 콘택 구조를 제공하는데 있다.
본 발명의 다른 목적은, 픽셀 영역의 블록킹 질화막을 얇게 증착함으로써, 픽셀 영역과 로직 영역의 콘택홀을 위한 블록킹 질화막 식각 공정시 로직 영역의 소자 분리막 경계 부분이 과도 식각되는 것을 방지할 수 있는 이미지 센서 소자의 콘택 제조 방법을 제공하는데 있다.
상기 목적을 달성하기 위하여 본 발명은, 반도체 기판에 각각 게이트 전극 및 소오스/드레인 영역을 갖는 픽셀 영역 및 로직 영역을 갖는 이미지 센서 소자에 있어서, 픽셀 영역의 게이트 전극 및 소오스/드레인 영역 상부면에 얇게 형성된 블록킹 질화막과, 로직 영역의 게이트 전극 또는 소오스/드레인 영역에 형성된 실리사이드막과, 반도체 기판의 구조물 전면에 순차적으로 형성된 식각 정지막 및 층간 절연막과, 픽셀 영역의 층간 절연막과 식각 정지막 및 블록킹 질화막의 콘택홀을 통해 소오스/드레인 영역과 연결되는 콘택과, 로직 영역의 층간 절연막과 식각 정지막의 콘택홀을 통해 실리사이드막과 연결되는 다른 콘택을 포함한다.
상기 다른 목적을 달성하기 위하여 본 발명은, 픽셀 영역 및 로직 영역을 갖는 이미지 센서 소자를 제조하는 방법에 있어서, 반도체 기판의 픽셀 영역 및 로직 영역에 각각 게이트 전극 및 소오스/드레인 영역을 형성하는 단계와, 픽셀 영역의 게이트 전극 및 소오스/드레인 영역 상부면에 얇게 블록킹 질화막을 형성하는 단계와, 로직 영역의 게이트 전극 또는 소오스/드레인 영역에 실리사이드막을 형성하는 단계와, 반도체 기판의 구조물 전면에 순차적으로 식각 정지막 및 층간 절연막을 형성하는 단계와, 픽셀 영역의 층간 절연막과 식각 정지막 및 블록킹 질화막의 콘택홀을 통해 소오스/드레인 영역과 연결되는 콘택을 형성함과 동시에, 로직 영역의 층간 절연막과 식각 정지막의 콘택홀을 통해 실리사이드막과 연결되는 다른 콘택을 형성하는 단계를 포함한다.
이하, 본 발명의 가장 바람직한 실시예를 첨부한 도면을 참조하여 본 발명의 기술분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 더욱 상세히 설명하기로 한다.
도 3은 본 발명에 따른 이미지 센서 소자의 콘택 구조를 나타낸 수직 단면도이다.
도 3에 도시된 바와 같이, 본 발명의 이미지 센서 소자는, 소자 분리막(102)이 형성된 반도체 기판(100)의 활성 영역에서 픽셀 영역(A) 및 로직 영역(B)에 각각 순차적으로 게이트 절연막(104) 및 게이트 전극(106)이 형성되어 있다.
픽셀 영역(A) 및 로직 영역(B)의 게이트 전극(106) 측벽에 스페이서(108)가 형성되어 있고, 상기 게이트 전극(106) 또는 스페이서(108) 에지와 소자 분리막(102) 사이의 활성 영역에 소오스/드레인 영역(110)이 형성되어 있다.
픽셀 영역(A)의 게이트 전극(106), 스페이서(108) 및 소오스/드레인 영역(110) 상부면에 블록킹 질화막(112)이 얇게, 예를 들어 80Å∼120Å 정도 형성되어 있고, 로직 영역(B)의 게이트 전극(106) 또는 소오스/드레인 영역(110)에 실리사이드막(114)이 형성되어 있다.
픽셀 영역(A) 및 로직 영역(B)의 상기 구조물 전면에 식각 정지막(116) 및 층간 절연막(PMD)(118)이 순차적으로 형성되어 있고, 픽셀 영역(A)의 콘택홀(122a)을 통해 소오스/드레인 영역(110)과 연결되는 픽셀용 콘택(124)이 형성되어 있고, 로직 영역(B)의 콘택홀(122b)을 통해 소오스/드레인 영역 상부의 실리사이드막(114)과 연결되는 로직용 콘택(124)이 형성되어 있다.
그러므로, 본 발명에 따른 이미지 센서 소자의 콘택은, 픽셀 영역(A)에만 형성되는 실리사이드 블록킹막(112)을 식각 정지막(116)과 동일한 실리콘 질화 막(Si3N4)물질로 형성하고 그 두께를 종래보다 줄임으로써, 픽셀 영역(A)과 로직 영역(B)의 콘택홀 식각 공정시 로직 영역(B)의 소자 분리막(102) 경계 부분이 과도 식각되는 것을 방지할 수 있다.
도 4a 내지 도 4i는 본 발명에 따른 이미지 센서 소자의 픽셀 영역과 로직 영역의 콘택 제조 공정을 설명하기 위한 공정 순서도이다.
이들 도면을 참조하면, 본 발명에 따른 이미지 센서 소자의 픽셀 영역과 로직 영역의 콘택 제조 공정은 다음과 같이 진행된다.
우선 도 4a에 도시된 바와 같이, STI 등의 소자 분리 공정을 통해 반도체 기판(100)인 실리콘 기판의 활성 영역과 소자 분리 영역을 구분하는 소자분리막(102)을 형성하고, 이온 주입 공정을 통해 기판(100)의 활성 영역에 웰(well), 문턱 전압 조절 등의 불순물 도펀트를 이온 주입한다.
그리고, 반도체 기판(100)의 활성 영역 전면에 게이트 절연막(104)으로서, 실리콘 산화막(SiO2)을 증착하고, 그 위에 도프트 폴리실리콘 등의 도전막을 증착한다. 게이트 마스크를 이용한 사진 및 건식 식각 공정을 진행하여 도전막을 패터닝하여 픽셀 영역(A) 및 로직 영역(B)에 각각 게이트 전극(106)을 형성하고, 그 하부의 게이트 절연막(104)도 식각한다.
또, 기판 전면에 절연막으로서, 실리콘 질화막(Si3N4)을 증착하고, 이를 건식 식각, 예를 들어 반응성 이온 식각(RIE)하여 픽셀 영역(A) 및 로직 영역(B)의 게이트 전극(106) 측벽에 스페이서(108)를 형성한다.
계속해서, 소오스/드레인 이온 주입 공정, 예를 들어, n형 도펀트 이온을 고농도로 이온 주입하여 픽셀 영역(A) 및 로직 영역(B)의 기판(100)내에 게이트 전극(106) 또는 스페이서(108) 에지와 소자 분리막(102) 사이의 활성 영역에 소오스/드레인 영역(110)을 형성한다.
도 4b에 도시된 바와 같이, 기판 전면에 실리사이드의 형성을 막고자 실리콘 질화막(Si3N4)을 약 80Å∼120Å 정도 증착하여 블록킹 질화막(112)을 형성하고, 사진 및 식각 공정을 진행하여 로직 영역(B)의 블록킹 질화막을 제거함으로써 픽셀 영역(A)에만 블록킹 질화막(112)이 남아 있도록 한다.
도 4c에 도시된 바와 같이, 기판 전면에 실리사이드 금속층으로서 코발트(Co)를 증착하고 어닐 처리하여 로직 영역(B)의 게이트 전극(106) 또는 소오스/드레인 영역(110)에 코발트 실리사이드막(CoSi)(114)을 형성한다. 이때, 픽셀 영역(A)의 게이트 전극(106) 또는 소오스/드레인 영역(110)에는 블록킹 질화막(112)에 의해 실리사이드막이 형성되지 않는다.
그리고 도 4d에 도시된 바와 같이, 상기 구조물 전면에 식각 정지막(116)으로서 실리콘 질화막(Si3N4)을 약 300Å 정도 증착하고, 그 위에 층간 절연막(PMD)(118)으로서 BPSG 또는 PSG를 6000Å∼7000Å정도 증착하고 이를 어닐링한다. 그런 다음 화학적기계적연마(CMP)로 층간 절연막(118)의 표면을 평탄화한다.
계속해서 도 4e에 도시된 바와 같이, 픽셀 영역(A) 및 로직 영역(B)의 콘택홀 마스크를 이용한 사진 공정을 진행하여 층간 절연막(118)에 포토레지스트 패 턴(120)을 형성한다.
그리고 도 4f에 도시된 바와 같이, 포토레지스트 패턴(120)에 의해 드러난 층간 절연막(118)을 건식 식각하여 픽셀 영역(A) 및 로직 영역(B)에 콘택홀(122a, 122b)을 각각 형성한다. 이때, 픽셀 영역(A) 및 로직 영역(B)에서는 콘택홀 식각 공정에 의해 식각 정지막(116) 표면이 오픈된다. 여기서, 건식 식각 공정은, 층간 절연막(118)인 산화막과 식각 정지막(116)의 식각 선택비를 18 : 1 비율 이상의 고선택비로 하여 식각 정지막(116) 표면에서 식각 정지가 이루어지도록 한다.
계속해서 도 4g에 도시된 바와 같이, 건식 식각 공정을 진행하여 픽셀 영역(A)의 식각 정지막(116) 및 블록킹 질화막(112)을 식각함과 동시에, 로직 영역(B)의 식각 정지막(116)을 식각한다. 여기서, 건식 식각 공정은, 식각 정지막(116)과 실리 사이드막(114)의 식각 선택비를 4 :1 이상의 고선택비로 하여 식각이 이루어지도록 한다.
이러한 식각 공정으로 인해, 픽셀 영역(A)의 소오스/드레인 영역(110)이 콘택홀(122a)에 의해 오픈되고, 로직 영역(B)의 소오스/드레인 영역(110)의 실리사이드막(114) 표면이 콘택홀(122b)에 의해 오픈된다.
그 다음, 도 4h에 도시된 바와 같이, 에슁 공정을 진행하여 콘택홀 식각을 위한 포토레지스트 패턴을 제거하고, 세정 공정을 진행한다.
그리고나서, 도 4i에 도시된 바와 같이, 픽셀 영역(A) 및 로직 영역(B)의 콘택홀에 도전막으로서 도프트 폴리실리콘 또는 금속 물질을 매립하고 화학적기계적연마(CMP) 공정으로 층간 절연막(118) 표면의 도전막을 제거하여 픽셀 영역(A)의 소오스/드레인 영역(110)과 연결되고, 로직 영역(B)의 실리사이드막(114)을 통해 소오스/드레인 영역(110)과 연결되는 콘택(124)을 각각 형성한다.
그러므로, 본 발명에 따른 이미지 센서 소자의 콘택 제조 방법은, 픽셀 영역(A)에만 형성되는 실리사이드 블록킹막(112)을 식각 정지막(116)과 동일한 실리콘 질화막(Si3N4)물질로 형성하고 그 두께를 종래보다 줄임으로써, 픽셀 영역(A)과 로직 영역(B)의 콘택홀 식각 공정시 로직 영역(B)의 소자 분리막(102) 경계 부분이 과도 식각되는 것을 방지할 수 있다.
이상 설명한 바와 같이, 본 발명은 픽셀 영역에 형성되는 실리사이드 블록킹막을 식각 정지막과 동일한 실리콘 질화막(Si3N4) 물질로 형성하고 그 두께를 종래보다 얇게 줄임으로써, 픽셀 영역과 로직 영역의 콘택홀 식각 공정시 픽셀 영역과 로직 영역의 실리콘 질화막을 함께 식각하여 콘택홀을 형성한다.
그러므로, 본 발명은 로직 영역의 콘택홀을 위한 포토레지스트 패턴이 미스 얼라인되어 있을 경우 픽셀 영역의 실리사이드 블록킹막을 식각할 때 로직 영역에서 실리사이드와 소자 분리막 사이의 경계 부분에 있는 소자 분리막을 과도 식각하는 것을 막아 이미지 센서 소자의 누설 원인을 줄일 수 있다.
한편, 본 발명은 상술한 실시예에 국한되는 것이 아니라 후술되는 청구범위에 기재된 본 발명의 기술적 사상과 범주내에서 당업자에 의해 여러 가지 변형이 가능하다.

Claims (7)

  1. 반도체 기판에 각각 게이트 전극 및 소오스/드레인 영역을 갖는 픽셀 영역 및 로직 영역을 갖는 이미지 센서 소자에 있어서,
    상기 픽셀 영역의 상기 게이트 전극 및 상기 소오스/드레인 영역 상부면에 형성된 블록킹 질화막과,
    상기 로직 영역의 상기 게이트 전극 또는 상기 소오스/드레인 영역에 형성된 실리사이드막과,
    상기 반도체 기판의 구조물 전면에 순차적으로 형성된 식각 정지막 및 층간 절연막과,
    상기 픽셀 영역의 상기 층간 절연막과 상기 식각 정지막 및 상기 블록킹 질화막의 콘택홀을 통해 상기 소오스/드레인 영역과 연결되는 콘택과,
    상기 로직 영역의 상기 층간 절연막과 상기 식각 정지막의 콘택홀을 통해 상기 실리사이드막과 연결되는 다른 콘택
    을 포함하는 이미지 센서 소자의 콘택 구조.
  2. 제 1항에 있어서,
    상기 블록킹 질화막은, 80Å∼120Å의 두께를 갖는 것을 특징으로 하는 이미지 센서 소자의 콘택 구조.
  3. 픽셀 영역 및 로직 영역을 갖는 이미지 센서 소자를 제조하는 방법에 있어서,
    반도체 기판의 상기 픽셀 영역 및 상기 로직 영역에 각각 게이트 전극 및 소오스/드레인 영역을 형성하는 단계와,
    상기 픽셀 영역의 상기 게이트 전극 및 상기 소오스/드레인 영역 상부면에 블록킹 질화막을 형성하는 단계와,
    상기 로직 영역의 상기 게이트 전극 또는 상기 소오스/드레인 영역에 실리사이드막을 형성하는 단계와,
    상기 반도체 기판의 구조물 전면에 순차적으로 식각 정지막 및 층간 절연막을 형성하는 단계와,
    상기 픽셀 영역의 상기 층간 절연막과 상기 식각 정지막 및 상기 블록킹 질화막의 콘택홀을 통해 상기 소오스/드레인 영역과 연결되는 콘택을 형성함과 동시에, 상기 로직 영역의 상기 층간 절연막과 상기 식각 정지막의 콘택홀을 통해 상기 실리사이드막과 연결되는 다른 콘택을 형성하는 단계
    를 포함하는 이미지 센서 소자의 콘택 제조 방법.
  4. 제 3항에 있어서,
    상기 블록킹 질화막은, 80Å∼120Å의 두께로 형성하는 것을 특징으로 하는 이미지 센서 소자의 콘택 제조 방법.
  5. 제 3항에 있어서,
    상기 콘택을 형성하는 단계는,
    상기 픽셀 영역 및 상기 로직 영역의 상기 층간 절연막을 식각하여 콘택홀을 형성하는 단계와,
    상기 픽셀 영역의 상기 식각 정지막 및 상기 블록킹 질화막을 식각함과 동시에, 상기 로직 영역의 상기 식각 정지막을 식각하여 콘택홀을 형성하는 단계와,
    상기 콘택홀에 도전막을 매립하여 상기 픽셀 영역의 콘택홀을 통해 상기 소오스/드레인 영역과 연결되는 콘택을 형성함과 동시에, 상기 로직 영역의 콘택홀을 통해 상기 실리사이드막과 연결되는 다른 콘택을 형성하는 단계를 더 포함하는 것을 특징으로 하는 이미지 센서 소자의 콘택 제조 방법.
  6. 제 5항에 있어서,
    상기 층간 절연막에 콘택홀을 형성하는 단계에서, 상기 층간 절연막과 상기 식각 정지막의 식각 선택비를 18 : 1 이상으로 하여 상기 식각 정지막 표면에서 식각이 정지하도록 하는 것을 특징으로 하는 이미지 센서 소자의 콘택 제조 방법.
  7. 제 5항에 있어서,
    상기 로직 영역의 식각 정지막을 식각하는 단계에서, 상기 식각 정지막과 상기 실리 사이드막의 식각 선택비를 4 :1 이상으로 하는 것을 특징으로 하는 이미지 센서 소자의 콘택 제조 방법.
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