KR100332515B1 - 인쇄회로기판의 적층공정 - Google Patents
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- H05K3/46—Manufacturing multilayer circuits
- H05K3/4644—Manufacturing multilayer circuits by building the multilayer layer by layer, i.e. build-up multilayer circuits
- H05K3/4652—Adding a circuit layer by laminating a metal foil or a preformed metal foil pattern
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Abstract
Description
Claims (2)
- 내층기판과 프리프레그 및 외층으로 가공할 동박을 하나로 접착시키는 적층공정에 있어서,다수의 기판들을 분리하기 위한 서스판에 동도금하여 동박을 입히는 단계와, 상기와 같이 동박이 입혀진 서스판을 각 기판 사이에 끼운채로 레이업시키는 단계 및, 상기 레이업된 기판들을 가압가열하여 서스판에 입혀진 동박을 프리프레그를 매개로 내층기판에 접착시키는 단계를 포함하여 구성된 것을 특징으로 하는 인쇄회로기판의 적층공정.
- 제 1 항에 있어서,상기 서스판은 전기 동도금이 가능한 재질로 이루어진 것을 특징으로 하는 인쇄회로기판의 적층공정.
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KR20030048283A (ko) * | 2001-12-11 | 2003-06-19 | 파이어니어 테크놀로지 엔지니어링 컴퍼니 리미티드 | 동박 적층판의 제조 방법 |
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