KR0138370B1 - 수평블랭킹신호 보정회로 - Google Patents
수평블랭킹신호 보정회로Info
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- H04N5/00—Details of television systems
- H04N5/72—Modifying the appearance of television pictures by optical filters or diffusing screens
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Abstract
본 발명은 프로젝션(Projection)시스템에 있어서 컨버젼스 조정을 하기위한 테스트 패턴 왜곡을 방지하는 수평블랭킹신호 보정회로에 관한 것으로, 특히 블랭킹시간(Blanking time)과 귀선시간(Retrace time)을 일치시키는 수평블랭킹신호 보정회로에 관한 것이다.
이를 위하여 수평 구동부에서 수평 출력부의 트랜지스터를 구동하는 전압으로부터 수평 블랭킹신호 보정을 위한 제어신호를 발생하는 인에이블 제어신호 발생부와, 제1 블랭킹신호 검출부에서 출력하는 블랭킹펄스신호를 인에이블 제어신호 발생부에서 발생하는 제어신호에 의해서 귀선시간과 일치되도록 주기를 보정하여 출력하는 제2 블랭킹신호 검출부를 구비한다.
따라서 블랭킹신호시간과 귀선시간을 일치시킴으로써 테스트 패턴의 왜곡을 방지할 수 있는 효과가 있다.
Description
제1도는 종래의 수평 컨버젼스 조정에 따른 파형도
제2도는 본 발명에 따른 수평블랭킹신호 보정회로의 블럭도
제3도는 본 발명에 따른 수평블랭킹신호 보정회로도
제4도는 본 발명에 따른 파형도
*도면의 주요부분에 대한 부호의 설명*
10 ... 수평 구동부 20 ... 수평 출력부
30 ... 제1 블랭킹신호 검출부 40 ... 인에이블 제어신호 출력부
50 ... 제2 블랭킹신호 검출부 60 ... 트랜스
70,80 ... 인버터 90 ... RS 플립플롭
본 발명은 프로젝션(Projection)시스템에 있어서 수평블랭킹신호 보정회로에 관한 것으로, 특히 블랭킹시간(Blanking time)과 귀선시간(Retrace time)을 일치시키는 수평블랭킹신호 보정회로에 관한 것이다.
종래의 일반형(수평주파수 = 15.75㎑) 프로젝션 텔레비젼 또는 멀티싱크 프로젝션용(수평주파수 = 31.5㎑ ~ 64㎑) 디스플레이 장치와 같은 프로젝션 시스템에서 컨버젼스 (Convergence, RGB)를 맞추기 위해서는 블랭킹신호를 기준으로 하여 만든 테스트 패턴을 내장하여 컨버젼스를 조정한다.
제1도는 종래의 수평 컨버젼스 조정에 따른 파형도를 도시한 것이다.
제1(A)도는 테스트 패턴도이고, 제1(B)도는 블랭킹펄스신호 이고, 제1(C)도는 수평출력전류신호이고, 제1(d)도는 개선되어야 할 블랭킹펄스신호이다. ①은 블랭킹시간과 귀선시간의 불일치를 표시한 것이고 ②는 귀선시간을 표시한 것이다.
제1(A)도에서 화면안에 테스트 패턴이 디스플레이되는데 테스트 패턴의 최좌측과 최우측에 패턴 왜곡현상이 보인다. 왜곡현상이 일어나는 이유는 제1(B)도의 블랭킹펄스신호와 제1(C)도의 귀선시간의 불일치때문이다.
따라서 본 발명의 목적은 상기 블랭킹펄스신호와 귀선시간의 불일치를 해결하기 위하여 블랭킹펄스신호를 보정하는 수평블랭킹 보정회로를 제공하는데 있다.
상기 목적을 달성하기 위하여 수평 구동부와 수평 출력부와 제1 블랭킹신호 검출부를 구비한 프로젝션시스템의 수평블랭킹 보정회로에 있어서,
상기 수평 구동부에서 상기 수평 출력부의 트랜지스터를 구동하는 전압으로부터 수평 블랭킹신호 보정을 위한 제어신호를 발생하는 인에이블 제어신호 발생부:
상기 제1 블랭킹신호 검출부에서 출력하는 블랭킹펄스신호를 상기 인에이블 제어신호 발생부에서 제어신호에 의해서 귀선시간과 일치되도록 주기를 보정하여 출력하는 제2 블랭킹신호 검출부를 구비함을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명에 대하여 상세히 설명하기로 한다.
제2도는 본 발명에 따른 수평블랭킹 보정회로의 블럭도를 도시한 것이다.
제2도에 있어서, 수평블랭킹 보정회로의 블럭도는 수평 드라이브 전류를 구동하는 수평 구동부(10)와, 수평출력전류 신호를 발생하는 수평출력부(20)와, 1차적으로 블랭킹펄스신호를 검출하는 제1 블랭킹신호 검출부(30)와, 블랭킹 보정을 위한 인에이블 제어신호를 발생하는 Enable 제어신호 발생부(40), 보정된 블랭킹펄스신호를 출력하는 제2 블랭킹신호 검출부(50)로 구성한다.
제3도는 본 발명에 따른 수평블랭킹신호 보정회로도를 도시한 것이다.
제3도의 구성과 접속관계를 설명하면, 수평 드라이브 전류를 구동하는 부분은 다이오드(D1)와 저항(R1,R2)구성하고, 수평전류를 출력하는 부분은 고압 출력용 스위칭 트랜지스터(Q1)과 공진 콘덴서(C1,C2)과 댐핑(Damping) 다이오드(D2,D3)와, 편향코일(L)로 구성한다. 제1 블랭킹신호 검출부는 더미 트랜스(60)와 시간지연용 콘덴서 (C3,C4,C5)와 제너다이오드(Z1)와 트랜지스터(Q3)와 저항(R3~R6)로 구성한다.
인에이블 제어신호 발생부(40)는 에미터 폴로워(Q2)와 제너다이오드(Z2)와 저항(R7,R8,R9)로 구성한다. 에미터 폴로워(Q2)의 베이스측에는 상기 수평구동부의 출력과 접속하고, 에미터 폴로워(Q2)의 에미터측에는 접지(GND)와 접속하고, 에미터 폴로워(Q2)의 콜렉터 측에는 부전원(-Vcc)와 접속한다.
제2 블랭킹신호 검출부(50)는 두 개의 인버터(70,80)와 RS플립플롭(90)으로 구성한다. RS플립플롭(90)의 세트단(S)에는 인버터(80)의 출력신호와 접속하고, 리세트단(R)에는 제1 블랭킹신호 검출부의 출력신호와 접속하고, 클럭단(C)에는 인버터(70)의 출력신호와 접속한다.
제4도는 본 발명에 따른 파형도이다.
제4(A')도는 인에이블 제어신호이고, 제4(B')도는 제1 블랭킹신호 검출부의 출력신호이고, 제4(C')도는 제1 블랭킹신호의 반전신호이고, 제4(D')도는 제2 블랭킹신호 검출부의 출력신호이다. ③은 콘덴서(C5)에 의해서 시간지연된 부분이다.
다음은 제3도에 도시된 회로도의 동작을 제4도와 결부시켜 설명하기로 한다.
수평구동부에 의해서 A부분에는 -16~5V 전압파형이 출력한다. 수평출력부에서는 고압 출력용 스위치 트랜지스터(Q1)에 의해서 고전압이 발생하는 데, B부분에서 1000~1200Vp-p파형이 출력한다. B부분에서의 파형은 더미 트랜스(60)을 걸쳐 제너다이오드(Z1)에 의해 클램프 (Clamp)되면 C부분에서 제너다이오드(Z1)의 정전압에 의한 소정레벨의 파형이 발생한다. C부분의 파형이 콘덴서(C5)에 의해서 소정의 시간지연되어 D부분에서 제4(B')도와 같이 -5~0V 사이의 구형파가 출력한다.
D부분의 신호는 RS플립플롭(90)의 리셋단(R)단에 입력되고 인버터(80)에 의해 반전된 신호는 RS플립플롭(90)의 세트단(S)에 입력된다.
인에이블 제어신호 발생부(40)에서는 수평구동부의 A부분의 파형을 에미터 폴로워(Q2)에 입력하면 E부분에서는 -16~0V 사이의 파형이 출력한다. 이 파형을 5.1V 정전압을 갖는 제너다이오드(Z2)에 의해서 -5~0V 사이의 구형파에 가까운 파형을 얻을 수 있다. 또한 인버터(70)에 반전시키면 제4(A')도와 같이 출력한다.
RS플립플롭(90)에서는 제4(A')도의 파형이 클럭단에 들어오면 세트단(S)이 하이레벨이고, 리세트단(R)이 로우레벨일 때 출력단(Q)은 하이레벨이 된다. 출력신호가 하이레벨상태를 유지하다가 다시 인에이블 제어신호 출력부(40)로부터 제어신호가 출력하면 RS플립플롭(90)의 클럭단(C)에서 클럭되면서 출력단(Q)은 로우레벨이 된다. RS플립플롭(90)의 출력은 제4(D')도와 같이 출력한다. 즉, 4(D')도의 파형은 제1(D')도와 동일하게 출력하여 제2 블랭킹펄스신호가 귀선시간의 주기와 일치하게 된다.
상술한 바와같이 본 발명은 블랭킹신호시간과 귀선시간을 일치시킴으로써 테스트 패턴의 왜곡을 방지할 수 있는 효과가 있다.
Claims (3)
- 수평 구동부(10)와 수평 출력부(20)와 제1 블랭킹신호 검출부(30)를 구비한 프로젝션시스템에 있어서,상기 수평 구동부(10)에서 상기 수평 출력부(20)의 트랜지스터를 구동하는 전압으로부터 수평 블랭킹신호 보정을 위한 제어신호를 발생하는 인에이블 제어신호 발생부(40):상기 제1 블랭킹신호 검출부(30)에서 출력하는 블랭킹펄스신호를 상기 인에이블 제어신호 발생부(40)에서 발생하는 제어신호에 의해서 귀선시간과 일치되도록 주기를 보정하여 출력하는 제2 블랭킹신호 검출부(50)를 구비함을 특징으로 하는 수평블랭킹 보정회로.
- 제1항에 있어서, 상기 인에이블 제어신호 발생부(40)는 에미터 폴로워(Q2)와 제너다이오드(Z2)로 구성됨을 특징으로 하는 수평블랭킹 보정회로.
- 제1항에 있어서, 상기 제2 블랭킹신호 검출부(50)는 플립플롭(90)와 복수의 인버터(70,80)로 구성됨을 특징으로 하는 수평블랭킹 보정회로.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019930014300A KR0138370B1 (ko) | 1993-07-27 | 1993-07-27 | 수평블랭킹신호 보정회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
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| KR1019930014300A KR0138370B1 (ko) | 1993-07-27 | 1993-07-27 | 수평블랭킹신호 보정회로 |
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