JPS642554Y2 - - Google Patents
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- Publication number
- JPS642554Y2 JPS642554Y2 JP9807481U JP9807481U JPS642554Y2 JP S642554 Y2 JPS642554 Y2 JP S642554Y2 JP 9807481 U JP9807481 U JP 9807481U JP 9807481 U JP9807481 U JP 9807481U JP S642554 Y2 JPS642554 Y2 JP S642554Y2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- rectifier
- current
- control terminal
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 6
- 238000010586 diagram Methods 0.000 description 6
- 238000001514 detection method Methods 0.000 description 1
- 230000002265 prevention Effects 0.000 description 1
- 230000001960 triggered effect Effects 0.000 description 1
Description
【考案の詳細な説明】
本考案は簡単な構成で４分の１波電流を得るた
めの整流回路に関するものである。
めの整流回路に関するものである。
交流波形の電圧が極大値を示す位置は、極大値
をコンデンサーで保持し、コンパレータやオペア
ンプを使用すれば簡単に検出することができる。
しかし、これらの動作には直流電源を要するか
ら、交流を整流して半波電流を得るように、簡単
な回路で1/4波電流を得るようなわけにはいかな
い。
をコンデンサーで保持し、コンパレータやオペア
ンプを使用すれば簡単に検出することができる。
しかし、これらの動作には直流電源を要するか
ら、交流を整流して半波電流を得るように、簡単
な回路で1/4波電流を得るようなわけにはいかな
い。
本考案はこれを解決し、簡単な回路で1/4波電
流等を得んとするものである。
流等を得んとするものである。
以下、本考案の一実施例を図によつて説明す
る。第１図においてＥは交流電源、Ｌは負荷で、
これと直列にサイリスタSCRとダイオードＤが
接続されている。サイリスタSCRには並列にコ
ンデンサＣが接続され、そのゲートＧはダイオー
ドＤのカソード側に接続されている。Ｒは高抵抗
値を有する抵抗である。今電源Ｅが負荷Ｌ側を正
として第２図ａの如く交番電圧を発生したとすれ
ば、電圧が０から次第に上昇するにつれ、コンデ
ンサＣにはＬ→Ｃ→Ｄを経て電流が流れ、充電さ
れてゆく。サイリスタSCRのゲートＧはダイオ
ードＤを介してカソードと同電位にあるので導通
はしない。
る。第１図においてＥは交流電源、Ｌは負荷で、
これと直列にサイリスタSCRとダイオードＤが
接続されている。サイリスタSCRには並列にコ
ンデンサＣが接続され、そのゲートＧはダイオー
ドＤのカソード側に接続されている。Ｒは高抵抗
値を有する抵抗である。今電源Ｅが負荷Ｌ側を正
として第２図ａの如く交番電圧を発生したとすれ
ば、電圧が０から次第に上昇するにつれ、コンデ
ンサＣにはＬ→Ｃ→Ｄを経て電流が流れ、充電さ
れてゆく。サイリスタSCRのゲートＧはダイオ
ードＤを介してカソードと同電位にあるので導通
はしない。
今電圧がＡ点で最大値に達し下降に移ると、サ
イリスタSCRの極間電圧は低下するので、最大
電圧まで充電されたコンデンサＣは、サイリスタ
SCRのアノード（第２の電極）・ゲート間に接続
された抵抗Ｒを介し、サイリスタSCRのゲー
ト・カソード（ゲート側の第１の電極）を経て放
電を開始する。サイリスタSCRはこの放電々流
によつてトリガされ、直ちに導通して負荷Ｌに電
流を流す（第２図ｂ）。電源Ｅが負の半サイクル
を供給する場合にはサイリスタSCRは導通せず、
正の半サイクルとなつて再び同じ動作をくり返
す。このようにして、1/4波電流が得られる。第
２図ｂは負荷Ｌが抵抗負荷である場合の電流波形
を示している。
イリスタSCRの極間電圧は低下するので、最大
電圧まで充電されたコンデンサＣは、サイリスタ
SCRのアノード（第２の電極）・ゲート間に接続
された抵抗Ｒを介し、サイリスタSCRのゲー
ト・カソード（ゲート側の第１の電極）を経て放
電を開始する。サイリスタSCRはこの放電々流
によつてトリガされ、直ちに導通して負荷Ｌに電
流を流す（第２図ｂ）。電源Ｅが負の半サイクル
を供給する場合にはサイリスタSCRは導通せず、
正の半サイクルとなつて再び同じ動作をくり返
す。このようにして、1/4波電流が得られる。第
２図ｂは負荷Ｌが抵抗負荷である場合の電流波形
を示している。
(1) 電源に対し、第１図回路と並列にダイオード
による半波整流回路を設け、切換スイツチによ
つて、負荷に対して、交流をそのまま、あるい
は第１図回路を介して若しくは半波整流回路を
介して択一的に印加するようにすれば、１，1/
２，1/4波の電流を流すことができる。
による半波整流回路を設け、切換スイツチによ
つて、負荷に対して、交流をそのまま、あるい
は第１図回路を介して若しくは半波整流回路を
介して択一的に印加するようにすれば、１，1/
２，1/4波の電流を流すことができる。
(2) 第１図において負荷Ｌを白熱ランプとし、全
波整流用のブリツジ回路を電源Ｅとの間に挿入
すると、第２図ｂに波線で示す電流も加わり、
50Hz地域に於ても、チラツキなく明るさを減ず
ることができる。
波整流用のブリツジ回路を電源Ｅとの間に挿入
すると、第２図ｂに波線で示す電流も加わり、
50Hz地域に於ても、チラツキなく明るさを減ず
ることができる。
(3) 実施例ではサイリスタを用いた例を挙げたが
PUT等の同等の動作をするものであれば同様
である。
PUT等の同等の動作をするものであれば同様
である。
(4) また第３図ｂに示すような電圧特性を示すよ
うな二次電池（Ui−Cdアルカリ電池など）の
充電に於いても、第３図ａの如くして満充電点
（第３図ｂのＢ点）を検知し、充電々流をバイ
パスすることによつて抵抗R1の電圧降下を利
用し、発光ダイオードLEDを発光させて充電
完了を表示することができる。ここではSCR
の代わりにPUTを用いており、該PUTでは、
アノードがゲート側の第１の電極にあたり、カ
ソードが第２の電極にあたる。尚Baは電池、
D1は整流ダイオード、D2は逆流防止ダイオー
ド、Ｔはトランス、Ｅは商用電源を示す。
うな二次電池（Ui−Cdアルカリ電池など）の
充電に於いても、第３図ａの如くして満充電点
（第３図ｂのＢ点）を検知し、充電々流をバイ
パスすることによつて抵抗R1の電圧降下を利
用し、発光ダイオードLEDを発光させて充電
完了を表示することができる。ここではSCR
の代わりにPUTを用いており、該PUTでは、
アノードがゲート側の第１の電極にあたり、カ
ソードが第２の電極にあたる。尚Baは電池、
D1は整流ダイオード、D2は逆流防止ダイオー
ド、Ｔはトランス、Ｅは商用電源を示す。
叙上のように、本考案によれば、非常に簡単な
構成で４分の１波電流を得ることができる。
構成で４分の１波電流を得ることができる。
第１図は本考案案の一実施例の回路図、第２図
ａは第１図に於ける電源Ｅの電圧、電流の波形
図、第２図ｂは第１図回路の波形図、第３図ａは
本考案を利用した二次電池の充電完了検知回路の
回路図、第３図ｂはその二次電池の充電状態を示
す波形図。 符号、１：SCR：サイリスタ、Ｄ：ダイオー
ド、Ｃ：コンデンサ。
ａは第１図に於ける電源Ｅの電圧、電流の波形
図、第２図ｂは第１図回路の波形図、第３図ａは
本考案を利用した二次電池の充電完了検知回路の
回路図、第３図ｂはその二次電池の充電状態を示
す波形図。 符号、１：SCR：サイリスタ、Ｄ：ダイオー
ド、Ｃ：コンデンサ。
Claims (1)
- 【実用新案登録請求の範囲】 制御端子付三端子整流素子の制御端子と該制御
端子側の第１の電極との間に整流素子を接続して
直列回路を形成し、該直列回路に交流電源を接続
し、 上記制御端子付三端子整流素子の第２の電極と
制御端子との間に抵抗を接続し、 上記制御端子付三端子整流素子の両電極間にコ
ンデンサを並列に接続して構成し、 上記構成の回路に直列若しくは並列に負荷を接
続して成る整流回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9807481U JPS583791U (ja) | 1981-06-30 | 1981-06-30 | 整流回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9807481U JPS583791U (ja) | 1981-06-30 | 1981-06-30 | 整流回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS583791U JPS583791U (ja) | 1983-01-11 |
| JPS642554Y2 true JPS642554Y2 (ja) | 1989-01-20 |
Family
ID=29892844
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9807481U Granted JPS583791U (ja) | 1981-06-30 | 1981-06-30 | 整流回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS583791U (ja) |
-
1981
- 1981-06-30 JP JP9807481U patent/JPS583791U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS583791U (ja) | 1983-01-11 |
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