JPS641990B2 - - Google Patents
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- Publication number
- JPS641990B2 JPS641990B2 JP5239181A JP5239181A JPS641990B2 JP S641990 B2 JPS641990 B2 JP S641990B2 JP 5239181 A JP5239181 A JP 5239181A JP 5239181 A JP5239181 A JP 5239181A JP S641990 B2 JPS641990 B2 JP S641990B2
- Authority
- JP
- Japan
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- channel
- path memory
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- memory
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- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 20
- 230000005540 biological transmission Effects 0.000 description 4
- 230000004913 activation Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000903 blocking effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000006870 function Effects 0.000 description 1
- 238000003908 quality control method Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M3/00—Automatic or semi-automatic exchanges
- H04M3/22—Arrangements for supervision, monitoring or testing
- H04M3/24—Arrangements for supervision, monitoring or testing with provision for checking the normal operation
- H04M3/244—Arrangements for supervision, monitoring or testing with provision for checking the normal operation for multiplex systems
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Monitoring And Testing Of Exchanges (AREA)
- Exchange Systems With Centralized Control (AREA)
Description
【発明の詳細な説明】
本発明は、通話路メモリを介して通話を行なわ
せる時分割形電子交換機の簡易な通話路メモリの
障害検出に関する。
せる時分割形電子交換機の簡易な通話路メモリの
障害検出に関する。
通話路メモリを介して通話を行なわせるような
時分割形電子交換機においては、通話品質の大き
な部分がデイジタル系の動作によつて左右され
る。従来、このデイジタル系の中枢とも言える通
話路メモリ自体の障害を簡易に検出する手段がな
かつた。
時分割形電子交換機においては、通話品質の大き
な部分がデイジタル系の動作によつて左右され
る。従来、このデイジタル系の中枢とも言える通
話路メモリ自体の障害を簡易に検出する手段がな
かつた。
本発明はこの問題を解決したもので、通話チヤ
ネルを特定し通話路メモリの書込データと読出デ
ータとを保持比較して両データ間に不一致を検出
した場合に対応チヤネルについて通話路メモリ障
害と判定し障害検出情報を発生するものである。
ネルを特定し通話路メモリの書込データと読出デ
ータとを保持比較して両データ間に不一致を検出
した場合に対応チヤネルについて通話路メモリ障
害と判定し障害検出情報を発生するものである。
以下、図に示した一実施例により本発明の詳細
を説明する。
を説明する。
図は本発明に係る一実施例の構成を示すブロツ
ク図で、図において、X1〜Xn、X1′〜Xn′は各々
仮想的に加入者を送話系、受話系として現わし、
Ｆ，F′は各々送話、受話側の加入者回線を電子交
換機の通話路メモリに接続するインタフエス回
路、Ｓはインタフエス制御回路で中央制御装置の
制御を受けてインタフエス回路Ｆ，F′をチヤネル
毎に制御する。１は通話路メモリで、加入者X1
〜Xnからの送話データRDをメモリエリアに書込
み格納し、加入者X1′〜Xn′が受けるべき受話デ
ータSDとして読出すもので、チヤネル毎に区分
されている。２は通話路メモリ制御回路で、中央
制御装置のコントロールを受け各チヤネルについ
て送話データRDをチヤネル毎に区分された通話
路メモリ１の対応エリアに書込み格納し、特定の
受話側チヤネルに受話データSDを読出し送出さ
せる制御情報を通話路メモリ１に対して発するも
のである。３は中央制御装置で、インタフエス制
御回路Ｓを介し加入者回線のサービス状況を走査
しながら通話路メモリ１やインタフエス制御回路
Ｓを制御するものである。
ク図で、図において、X1〜Xn、X1′〜Xn′は各々
仮想的に加入者を送話系、受話系として現わし、
Ｆ，F′は各々送話、受話側の加入者回線を電子交
換機の通話路メモリに接続するインタフエス回
路、Ｓはインタフエス制御回路で中央制御装置の
制御を受けてインタフエス回路Ｆ，F′をチヤネル
毎に制御する。１は通話路メモリで、加入者X1
〜Xnからの送話データRDをメモリエリアに書込
み格納し、加入者X1′〜Xn′が受けるべき受話デ
ータSDとして読出すもので、チヤネル毎に区分
されている。２は通話路メモリ制御回路で、中央
制御装置のコントロールを受け各チヤネルについ
て送話データRDをチヤネル毎に区分された通話
路メモリ１の対応エリアに書込み格納し、特定の
受話側チヤネルに受話データSDを読出し送出さ
せる制御情報を通話路メモリ１に対して発するも
のである。３は中央制御装置で、インタフエス制
御回路Ｓを介し加入者回線のサービス状況を走査
しながら通話路メモリ１やインタフエス制御回路
Ｓを制御するものである。
これらによつて従来の電子交換機は成つてお
り、本発明はこれらに以下が追加された電子交換
機の通話路メモリチエツク方式に係るものであ
る。
り、本発明はこれらに以下が追加された電子交換
機の通話路メモリチエツク方式に係るものであ
る。
４は中央制御装置３と制御情報を授受してチエ
ツクすべきチヤネルを指示する障害検出チヤネル
指示回路、５，６は各々送話データRD、受話デ
ータSDを保持するデータ保持回路であつて障害
検出チヤネル指示回路４により指定されたチヤネ
ルアドレスデータCDと通話路メモリ制御回路２
の処理サービス中のチヤネルアドレスデータCD
とが一致したときにその書込み中の送話データ
RD、その読出した受話データSDを各々保持する
ものである。７は比較回路で、データ保持回路
５，６から転送されて来るデータ間に不一致があ
つたときに通話路メモリ１の指定チヤネル対応部
に障害ありと判定し障害検出チヤネル指示回路４
に障害検出情報ADを送出する。
ツクすべきチヤネルを指示する障害検出チヤネル
指示回路、５，６は各々送話データRD、受話デ
ータSDを保持するデータ保持回路であつて障害
検出チヤネル指示回路４により指定されたチヤネ
ルアドレスデータCDと通話路メモリ制御回路２
の処理サービス中のチヤネルアドレスデータCD
とが一致したときにその書込み中の送話データ
RD、その読出した受話データSDを各々保持する
ものである。７は比較回路で、データ保持回路
５，６から転送されて来るデータ間に不一致があ
つたときに通話路メモリ１の指定チヤネル対応部
に障害ありと判定し障害検出チヤネル指示回路４
に障害検出情報ADを送出する。
障害検出情報ADの内容としては障害検出有り
の起動警報のほかに必要ならチヤネルアドレスデ
ータや通話データを含めることもよい。
の起動警報のほかに必要ならチヤネルアドレスデ
ータや通話データを含めることもよい。
さて、中央制御装置３からチエツクすべきチヤ
ネルがチヤネルアドレスデータPCDとして指示
送出されると障害検出チヤネル指示回路４がこの
情報を受取りデータ保持回路５，６に対して保持
すべき対応チヤネルアドレスを指示する。データ
保持回路５は障害検出チヤネル指示回路４から指
示されたチヤネルアドレスデータPCDと通話路
メモリ制御回路２から得た処理サービス中のチヤ
ネルのチヤネルアドレスデータCDとが一致する
と通話路メモリ１の対応チヤネル部のメモリエリ
アに書込まれるべき送話データRDを取込み保持
し比較回路７へこの送話データRDを転送する。
ネルがチヤネルアドレスデータPCDとして指示
送出されると障害検出チヤネル指示回路４がこの
情報を受取りデータ保持回路５，６に対して保持
すべき対応チヤネルアドレスを指示する。データ
保持回路５は障害検出チヤネル指示回路４から指
示されたチヤネルアドレスデータPCDと通話路
メモリ制御回路２から得た処理サービス中のチヤ
ネルのチヤネルアドレスデータCDとが一致する
と通話路メモリ１の対応チヤネル部のメモリエリ
アに書込まれるべき送話データRDを取込み保持
し比較回路７へこの送話データRDを転送する。
一方、データ保持回路６は、障害検出チヤネル
指示回路４により指示されたチヤネルアドレスデ
ータPCDと通話路メモリ制御回路２から得た処
理サービス中のチヤネルアドレスデータCDとが
一致すると通話路メモリ１の対応チヤネル部のメ
モリエリアから読出された受話データSDを取込
み保持し比較回路７へこの受話データSDを転送
する。
指示回路４により指示されたチヤネルアドレスデ
ータPCDと通話路メモリ制御回路２から得た処
理サービス中のチヤネルアドレスデータCDとが
一致すると通話路メモリ１の対応チヤネル部のメ
モリエリアから読出された受話データSDを取込
み保持し比較回路７へこの受話データSDを転送
する。
比較回路７ではデータ保持回路５，６から転送
された送話データRD、受話データSDを比較し、
両者間に不一致が検出された場合これを障害と判
定し障害検出チヤネル指示回路４に障害検出情報
ADを送出して障害検出のアラーム起動をかけ
る。障害検出情報ADとして起動信号のほかに必
要ならチヤネルアドレスデータや、送、受話デー
タRD、SDを転送すればよい。
された送話データRD、受話データSDを比較し、
両者間に不一致が検出された場合これを障害と判
定し障害検出チヤネル指示回路４に障害検出情報
ADを送出して障害検出のアラーム起動をかけ
る。障害検出情報ADとして起動信号のほかに必
要ならチヤネルアドレスデータや、送、受話デー
タRD、SDを転送すればよい。
障害検出チヤネル指示回路４から障害検出情報
ADの中継を受けた中央制御装置３は、該当チヤ
ネルの閉塞、障害表示等の処理を行なう。
ADの中継を受けた中央制御装置３は、該当チヤ
ネルの閉塞、障害表示等の処理を行なう。
なお、チエツクを必要とするチヤネル指定は、
手動であるいはプログラムで中央制御装置３から
でも障害検出チヤネル指示回路４からでも任意に
セツトすることができよう。
手動であるいはプログラムで中央制御装置３から
でも障害検出チヤネル指示回路４からでも任意に
セツトすることができよう。
以上の説明から明らかなように、本発明によれ
ば、通話路メモリ本来の機能も構成もその変更な
しに、音声データ等通話データそのものを利用し
て簡易に通話路メモリの障害チエツクを行なうこ
とができるので、通話路系の障害時、障害箇所の
切分けができるなど、通話路の品質を容易、安価
に管理することができる利点を有する。
ば、通話路メモリ本来の機能も構成もその変更な
しに、音声データ等通話データそのものを利用し
て簡易に通話路メモリの障害チエツクを行なうこ
とができるので、通話路系の障害時、障害箇所の
切分けができるなど、通話路の品質を容易、安価
に管理することができる利点を有する。
しかも、チヤネル指定も任意に行なえるので操
作性についても有利で、電子交換の品質管理にお
いて奏する効果は極めて著大である。
作性についても有利で、電子交換の品質管理にお
いて奏する効果は極めて著大である。
図は本発明に係る通話路メモリチエツク方式の
一実施例の構成を説明するブロツク図である。 １……通話路メモリ、２……通話路メモリ制御
回路、３……中央制御装置、４……障害検出チヤ
ネル指示回路、５，６……データ保持回路、７…
…比較回路。RD……送話データ、SD……受話デ
ータ、CD……処理サービス中のチヤネルアドレ
スデータ、PCD……指定チヤネルアドレスデー
タ、AD……障害検出情報。
一実施例の構成を説明するブロツク図である。 １……通話路メモリ、２……通話路メモリ制御
回路、３……中央制御装置、４……障害検出チヤ
ネル指示回路、５，６……データ保持回路、７…
…比較回路。RD……送話データ、SD……受話デ
ータ、CD……処理サービス中のチヤネルアドレ
スデータ、PCD……指定チヤネルアドレスデー
タ、AD……障害検出情報。
Claims (1)
- １ 通話路メモリを有する時分割形電子交換機に
おいて、中央制御装置から特定チヤネルのチエツ
ク指示を与えて前記通話路メモリの該当チヤネル
エリアに書込まれるべき通話音声データと該当チ
ヤネルエリアから読出された通話音声データとを
比較して、両データ間に不一致を検出した場合に
障害検出情報を中央制御装置に送出することを特
徴とする通話路メモリチエツク方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5239181A JPS57168564A (en) | 1981-04-09 | 1981-04-09 | Channel memory checking system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5239181A JPS57168564A (en) | 1981-04-09 | 1981-04-09 | Channel memory checking system |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57168564A JPS57168564A (en) | 1982-10-16 |
| JPS641990B2 true JPS641990B2 (ja) | 1989-01-13 |
Family
ID=12913498
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5239181A Granted JPS57168564A (en) | 1981-04-09 | 1981-04-09 | Channel memory checking system |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57168564A (ja) |
-
1981
- 1981-04-09 JP JP5239181A patent/JPS57168564A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57168564A (en) | 1982-10-16 |
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