JPS6329226B2 - - Google Patents
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- JPS6329226B2 JPS6329226B2 JP56078663A JP7866381A JPS6329226B2 JP S6329226 B2 JPS6329226 B2 JP S6329226B2 JP 56078663 A JP56078663 A JP 56078663A JP 7866381 A JP7866381 A JP 7866381A JP S6329226 B2 JPS6329226 B2 JP S6329226B2
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- JP
- Japan
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- trigger
- circuit
- signal
- output
- trigger signal
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- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 claims description 26
- 230000001360 synchronised effect Effects 0.000 description 14
- 238000010586 diagram Methods 0.000 description 10
- 230000001960 triggered effect Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 230000006870 function Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 2
- 230000000630 rising effect Effects 0.000 description 2
- 230000003252 repetitive effect Effects 0.000 description 1
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R13/00—Arrangements for displaying electric variables or waveforms
- G01R13/20—Cathode-ray oscilloscopes
- G01R13/22—Circuits therefor
- G01R13/32—Circuits for displaying non-recurrent functions such as transients; Circuits for triggering; Circuits for synchronisation; Circuits for time-base expansion
Description
【発明の詳細な説明】
本発明は信号観測装置に関するものである。
オシロスコープはデイジタル機器の分野で多く
用いられているが、特にロジツク信号の観測に便
利なロジツクアナライザ（logic analyzer）にお
いて、取り込めるデータの量はそれの持つている
メモリ長によつて決定されるので、入力信号のう
ち観測したい部分を取り込むためのトリガ信号を
どのようにして発生させるかということは重要な
ことである。
用いられているが、特にロジツク信号の観測に便
利なロジツクアナライザ（logic analyzer）にお
いて、取り込めるデータの量はそれの持つている
メモリ長によつて決定されるので、入力信号のう
ち観測したい部分を取り込むためのトリガ信号を
どのようにして発生させるかということは重要な
ことである。
従来のロジツクアナライザの基本的構成の一例
を第１図に示し説明すると、２は入力信号１を基
準レベルと比較し高レベル(H)が低レベル(L)かを判
定する機能とクロツクにてサンプリングする機能
を備えた入力回路、３は入口回路２からトリガ信
号を検出するためのトリガ回路、４は入力回路２
からのデータを記憶する記憶回路、５は記憶回路
４からのデータを表示する表示回路、６はトリガ
回路３からのトリガ信号の前縁で動作し、記憶回
路４の書き込みおよび読み出し、ならびに表示回
路５の表示タイミングを制御する制御回路であ
る。
を第１図に示し説明すると、２は入力信号１を基
準レベルと比較し高レベル(H)が低レベル(L)かを判
定する機能とクロツクにてサンプリングする機能
を備えた入力回路、３は入口回路２からトリガ信
号を検出するためのトリガ回路、４は入力回路２
からのデータを記憶する記憶回路、５は記憶回路
４からのデータを表示する表示回路、６はトリガ
回路３からのトリガ信号の前縁で動作し、記憶回
路４の書き込みおよび読み出し、ならびに表示回
路５の表示タイミングを制御する制御回路であ
る。
このように構成されたロジツクアナライザにお
いて、制御回路６はトリガ回路３からのトリガ信
号のエツジ（立上り）で動作し、記憶回路４の書
き込みを停止させ、読み出しのモードに制御する
が、トリガ回路３では入力信号１が任意に設定し
た特定の状態になつたときトリガ信号を発生する
必要がある。
いて、制御回路６はトリガ回路３からのトリガ信
号のエツジ（立上り）で動作し、記憶回路４の書
き込みを停止させ、読み出しのモードに制御する
が、トリガ回路３では入力信号１が任意に設定し
た特定の状態になつたときトリガ信号を発生する
必要がある。
このためには、種々なトリガ信号を発生する必
要があり、任意に設定したトリガ条件が成立した
ときトリガ信号を発生できるように構成されてい
る。以下にその例を示す。
要があり、任意に設定したトリガ条件が成立した
ときトリガ信号を発生できるように構成されてい
る。以下にその例を示す。
(1) 多数の入力信号の論理の組合せによるコンビ
ネーシヨントリガ。
ネーシヨントリガ。
(2) 多数の入力信号のデイジタル値の範囲による
レンジトリガ。
レンジトリガ。
(3) あるパルス幅以下の信号を無効にするトリガ
フイルタ。
フイルタ。
(4) グリツチ信号を検出しそれをトリガするグリ
ツチトリガ。
ツチトリガ。
(5) ある条件の発生回路を設定し、発生回数が設
定条件を満足したときトリガするトリガイベン
トカウンタ。
定条件を満足したときトリガするトリガイベン
トカウンタ。
(6) ある条件が成立したらトリガを許可するトリ
ガイネーブル。
ガイネーブル。
(7) ある条件が成立したらトリガを禁止するトリ
ガデイセーブル。
ガデイセーブル。
(8) ある条件が成立してから更に別のある条件が
成立するとトリガを許可するシーケンシヤルト
リガ。
成立するとトリガを許可するシーケンシヤルト
リガ。
(9) トリガ条件が成立してから一定の時間おくら
すトリガデイレイ。
すトリガデイレイ。
しかしながら、これらの各方法でも観測したい
特定の状態でトリガ信号を発生できないことがあ
る。
特定の状態でトリガ信号を発生できないことがあ
る。
例えば、ある繰り返しの動作をしている被測定
回路が動作を停止する状態を観測したいとき、そ
の動作がどのような状態に停止するのか前もつて
判明していなければ、いままでのトリガ方法では
トリガ信号を発生させることができなかつた。す
なわち、何らかの原因不明の要因によつて動作を
停止してしまうような場合、トリガする方法がな
かつた。
回路が動作を停止する状態を観測したいとき、そ
の動作がどのような状態に停止するのか前もつて
判明していなければ、いままでのトリガ方法では
トリガ信号を発生させることができなかつた。す
なわち、何らかの原因不明の要因によつて動作を
停止してしまうような場合、トリガする方法がな
かつた。
本発明は以上の点に鑑み、このような問題を解
決すべくなされたもので、その目的は、このよう
な正常ならば繰り返しの動作をしている被測定回
路が何らかの原因で誤動作し、停止するようなと
き、その停止した時点で確実にトリガ信号を発生
する信号観測装置を提供することにある。
決すべくなされたもので、その目的は、このよう
な正常ならば繰り返しの動作をしている被測定回
路が何らかの原因で誤動作し、停止するようなと
き、その停止した時点で確実にトリガ信号を発生
する信号観測装置を提供することにある。
このような目的を達成するため、本発明は、内
部または外部よりの入力信号からトリガ信号を検
出するための回路を持ち、この回路の出力がある
一定時間以上なかつたことによりトリガを発生す
る手段を備え、このトリガ発生手段をトリガ信号
発生回路として備えるようにしたもので、以下、
図面に基づき本発明の実施例を詳細に説明する。
部または外部よりの入力信号からトリガ信号を検
出するための回路を持ち、この回路の出力がある
一定時間以上なかつたことによりトリガを発生す
る手段を備え、このトリガ発生手段をトリガ信号
発生回路として備えるようにしたもので、以下、
図面に基づき本発明の実施例を詳細に説明する。
第２図は本発明による信号観測装置の一実施例
を示すブロツク図で、本発明をロジツクアナライ
ザに適用した場合の一例を示すものである。
を示すブロツク図で、本発明をロジツクアナライ
ザに適用した場合の一例を示すものである。
第２図において第１図と同一符号のものは相当
部分を示し、７はトリガ回路３と制御回路６との
間に挿入されたトリガ信号発生回路で、このトリ
ガ信号発生回路７は内部または外部よりの入力信
号からトリガ信号を検出するための回路の出力が
ある一定時間以上なかつたことによりトリガを発
生するトリガ発生手段を構成している。
部分を示し、７はトリガ回路３と制御回路６との
間に挿入されたトリガ信号発生回路で、このトリ
ガ信号発生回路７は内部または外部よりの入力信
号からトリガ信号を検出するための回路の出力が
ある一定時間以上なかつたことによりトリガを発
生するトリガ発生手段を構成している。
第３図はこの第２図におけるトリガ信号発生回
路７の実施例を示すブロツク図である。この第３
図において、１０は第２図に示すトリガ回路３か
らの入力信号が印加されるトリガ信号発生回路の
入力端子、１１はその入力端子１０からの入力信
号をプリセツト入力端子１２に入力とするプリセ
ツト可能なダウンカウンタ、１３はクロツク信号
１４を入力とするダウンカウンタ１１のクロツク
入力端子、１５は数値レジスタで、この数値レジ
スタ１５の出力はダウンカウンタ１１のプリセツ
トデータ入力端子１６を介してプリセツト可能な
ダウンカウンタ１１に供給されるように構成され
ている。また、このプリセツト可能なダウンカウ
ンタ１１の出力はその出力端子１７を介してゼロ
（零）検出器１８に供給され、このゼロ検出器１
８の出力１９はトリガ信号発生回路の出力信号２
０として第２図に示す制御回路６に供給されるよ
うに構成されている。
路７の実施例を示すブロツク図である。この第３
図において、１０は第２図に示すトリガ回路３か
らの入力信号が印加されるトリガ信号発生回路の
入力端子、１１はその入力端子１０からの入力信
号をプリセツト入力端子１２に入力とするプリセ
ツト可能なダウンカウンタ、１３はクロツク信号
１４を入力とするダウンカウンタ１１のクロツク
入力端子、１５は数値レジスタで、この数値レジ
スタ１５の出力はダウンカウンタ１１のプリセツ
トデータ入力端子１６を介してプリセツト可能な
ダウンカウンタ１１に供給されるように構成され
ている。また、このプリセツト可能なダウンカウ
ンタ１１の出力はその出力端子１７を介してゼロ
（零）検出器１８に供給され、このゼロ検出器１
８の出力１９はトリガ信号発生回路の出力信号２
０として第２図に示す制御回路６に供給されるよ
うに構成されている。
つぎにこの第３図に示す実施例の動作を説明す
る。まず、第２図に示すトリガ回路３の出力端は
ダウンカウンタ１１のプリセツト入力端子１２に
接続されているので、トリガ回路３からのトリガ
信号でプリセツト可能なダウンカウンタ１１はプ
リセツトデータ入力端子１６に接続されている数
値レジスタ１５から数値を読み込み、カウント値
としてプリセツトする。これと同時にその値はダ
ウンタウンタ１１の出力端子１７にも表わされ
る。
る。まず、第２図に示すトリガ回路３の出力端は
ダウンカウンタ１１のプリセツト入力端子１２に
接続されているので、トリガ回路３からのトリガ
信号でプリセツト可能なダウンカウンタ１１はプ
リセツトデータ入力端子１６に接続されている数
値レジスタ１５から数値を読み込み、カウント値
としてプリセツトする。これと同時にその値はダ
ウンタウンタ１１の出力端子１７にも表わされ
る。
そして、数値レジスタ１５にゼロ（零）以外の
数が設定されていれば、このダウンカウンタ１１
の出力端子１７に接続されその出力を監視してい
るゼロ検出器１８からは出力１９が出ない。この
状態でクロツク信号１４がダウンカウンタ１１の
クロツク入力端子１３に与えられれば、ダウンカ
ウンタ１１はカウント値を減じてゆく。そして、
そのカウント値がゼロ（零）になればゼロ検出器
１８が動作し、出力１９が送出される。なお、こ
のダウウンカウンタ１１は零より小さな数へは進
まないものとする。
数が設定されていれば、このダウンカウンタ１１
の出力端子１７に接続されその出力を監視してい
るゼロ検出器１８からは出力１９が出ない。この
状態でクロツク信号１４がダウンカウンタ１１の
クロツク入力端子１３に与えられれば、ダウンカ
ウンタ１１はカウント値を減じてゆく。そして、
そのカウント値がゼロ（零）になればゼロ検出器
１８が動作し、出力１９が送出される。なお、こ
のダウウンカウンタ１１は零より小さな数へは進
まないものとする。
いま、数値レジスタ１５に設定してある数を
ｎ、クロツク信号１４をａ〔秒〕とすれば、第２
図に示すトリガ回路３からｎ×ａ〔秒〕より短い
周期でトリガ信号が出力されていれば、ダウンカ
ウンタ１１はゼロ（零）になる前に入力信号によ
り再びプリセツトされ、ゼロ検出器１８の出力１
９にはトリガ信号発生回路の出力信号２０が出な
い。したがつて、第２図のトリガ信号発生回路７
をもつロジツクアナライザ全体としてはトリガし
ない。
ｎ、クロツク信号１４をａ〔秒〕とすれば、第２
図に示すトリガ回路３からｎ×ａ〔秒〕より短い
周期でトリガ信号が出力されていれば、ダウンカ
ウンタ１１はゼロ（零）になる前に入力信号によ
り再びプリセツトされ、ゼロ検出器１８の出力１
９にはトリガ信号発生回路の出力信号２０が出な
い。したがつて、第２図のトリガ信号発生回路７
をもつロジツクアナライザ全体としてはトリガし
ない。
ここで、もし、トリガ回路３からトリガ信号が
出なくなれば、ダウンカウンタ１１はプリセツト
入力端子１２にトリガ信号が加わらなくなるた
め、入力信号によるプリセツト動作がなされず、
ゼロ（零）を数える。これによつて、ダウンカウ
ンタ１１の出力端子１７に接続されているゼロ検
出器１８が動作し、その出力１９はトリガ信号発
生回路の出力信号２０として制御回路６をトリガ
する。
出なくなれば、ダウンカウンタ１１はプリセツト
入力端子１２にトリガ信号が加わらなくなるた
め、入力信号によるプリセツト動作がなされず、
ゼロ（零）を数える。これによつて、ダウンカウ
ンタ１１の出力端子１７に接続されているゼロ検
出器１８が動作し、その出力１９はトリガ信号発
生回路の出力信号２０として制御回路６をトリガ
する。
このような構成のトリガ信号発生回路におい
て、数値レジスタ１５の値、あるいはクロツク信
号１４の周期を任意に設定することにより、トリ
ガ信号周期が設定した任意の周期時間より遅くな
つた場合、またはトリガ信号が停止した場合に始
めてロジツクアナライザ全体のトリガを可能にす
ることができる。
て、数値レジスタ１５の値、あるいはクロツク信
号１４の周期を任意に設定することにより、トリ
ガ信号周期が設定した任意の周期時間より遅くな
つた場合、またはトリガ信号が停止した場合に始
めてロジツクアナライザ全体のトリガを可能にす
ることができる。
第４図は第２図におけるトリガ信号発生回路７
の他の実施例を示すブロツク図で、マルチバイブ
レータによつて構成した場合の一例を示すもので
ある。
の他の実施例を示すブロツク図で、マルチバイブ
レータによつて構成した場合の一例を示すもので
ある。
この第４図において、３０は第２図に示すトリ
ガ回路３からの入力信号が印加されるトリガ信号
発生回路の入力端子、３１は入力端子３０からの
入力信号が供給される再トリガ可能なワンシヨツ
トマルチバイブレータ３２の入力端子で、このワ
ンシヨツトマルチバイブレータ３２は、通常、そ
の出力３３は高レベル（HIGH）であり、トリガ
されると、ａ〔秒〕間低レベル（LOW）になる機
等を有するトリガ信号発生回路を構成している。
３４はこのトリガ信号発生回路の出力信号であ
る。そして、このトリガ信号発生回路を構成する
再トリガ可能なワンシヨツトマルチバイブレータ
３２は第２図のトリガ回路３と制御回路６との間
に接続されている。
ガ回路３からの入力信号が印加されるトリガ信号
発生回路の入力端子、３１は入力端子３０からの
入力信号が供給される再トリガ可能なワンシヨツ
トマルチバイブレータ３２の入力端子で、このワ
ンシヨツトマルチバイブレータ３２は、通常、そ
の出力３３は高レベル（HIGH）であり、トリガ
されると、ａ〔秒〕間低レベル（LOW）になる機
等を有するトリガ信号発生回路を構成している。
３４はこのトリガ信号発生回路の出力信号であ
る。そして、このトリガ信号発生回路を構成する
再トリガ可能なワンシヨツトマルチバイブレータ
３２は第２図のトリガ回路３と制御回路６との間
に接続されている。
つぎにこの第４図に示す実施例の動作を説明す
る。まず、第２図に示すトリガ回路３の出力端は
再トリガ可能なワンシヨツトマルチバイブレータ
３２の入力端子３１に接続されているので、トリ
ガ回路３からのトリガ信号でワンシヨツトマルチ
バイブレータ３２はトリガされる。そして、この
ワンシヨツトマルチバイブレータ３２は再トリガ
可能で、その時定数はａ〔秒〕であり、通常は高
レベル（HIGH）で、トリガ信号を受けてからａ
〔秒〕間低レベル（LOW）を出力し、その後高レ
ベル（HIGH）へもどるものである。したがつ
て、トリガ回路３から時定数のａ〔秒〕より短い
周期でトリガ信号が出力されていれば、ワンシヨ
ツトマルチバイブレータ３２の出力３３は低レベ
ル（LOW）のままであり、第２図の制御回路６
をトリガしない。
る。まず、第２図に示すトリガ回路３の出力端は
再トリガ可能なワンシヨツトマルチバイブレータ
３２の入力端子３１に接続されているので、トリ
ガ回路３からのトリガ信号でワンシヨツトマルチ
バイブレータ３２はトリガされる。そして、この
ワンシヨツトマルチバイブレータ３２は再トリガ
可能で、その時定数はａ〔秒〕であり、通常は高
レベル（HIGH）で、トリガ信号を受けてからａ
〔秒〕間低レベル（LOW）を出力し、その後高レ
ベル（HIGH）へもどるものである。したがつ
て、トリガ回路３から時定数のａ〔秒〕より短い
周期でトリガ信号が出力されていれば、ワンシヨ
ツトマルチバイブレータ３２の出力３３は低レベ
ル（LOW）のままであり、第２図の制御回路６
をトリガしない。
つぎに、第２図に示すトリガ回路３からのトリ
ガ信号が時定数のａ〔秒〕以上ワンシヨツトマル
チバイブレータ３２に印加されないと、ワンシヨ
ツトマルチバイブレータ３２は低レベル（LOW）
から高レベル（HIGH）にもどり、そのトリガ信
号発生回路の出力信号３４の前縁（立上り）で第
２図に示す制御回路６をトリガする。
ガ信号が時定数のａ〔秒〕以上ワンシヨツトマル
チバイブレータ３２に印加されないと、ワンシヨ
ツトマルチバイブレータ３２は低レベル（LOW）
から高レベル（HIGH）にもどり、そのトリガ信
号発生回路の出力信号３４の前縁（立上り）で第
２図に示す制御回路６をトリガする。
このような構成のトリガ信号発生回路において
も、ワンシヨツトマルチバイブレータ３２のワン
シヨツト時間を任意に可変することにより、トリ
ガ信号周期が設定した任意の周期時間より遅くな
つた場合、またはトリガ信号が停止した場合に始
めてロジツクアナライザ全体のトリガを可能にす
ることができる。
も、ワンシヨツトマルチバイブレータ３２のワン
シヨツト時間を任意に可変することにより、トリ
ガ信号周期が設定した任意の周期時間より遅くな
つた場合、またはトリガ信号が停止した場合に始
めてロジツクアナライザ全体のトリガを可能にす
ることができる。
以上本発明におけるトリガ信号発生回路とし
て、ダウンカウンタ、再トリガ可能なワンシヨツ
トマルチバイブレータによつて構成した場合を例
をとつて説明したが、本発明はこれに限定される
ものではなく、アツプカウンタ、シフトレジスタ
などでも同様な機能をもつたものを構成すること
ができる。第５図にその具体的な構成例を示す。
て、ダウンカウンタ、再トリガ可能なワンシヨツ
トマルチバイブレータによつて構成した場合を例
をとつて説明したが、本発明はこれに限定される
ものではなく、アツプカウンタ、シフトレジスタ
などでも同様な機能をもつたものを構成すること
ができる。第５図にその具体的な構成例を示す。
第５図は第２図のトリガ信号発生回路７の更に
他の実施例を示すブロツク図である。第５図にお
いて、４０は第２図のトリガ回路３からの入力信
号が印加される入力端子、４１は入力端子４０か
らの入力信号が供給されるプリセツト可能な同期
式アツプカウンタ４２のプリセツト入力端子
（PE）、４３はクロツク信号４４が印加される同
期式アツプカウンタ４２のクロツク入力端子
（CK）、４５は数値レジスタで、この数値レジス
タ４５は同期式アツプカウンタ４２のプリセツト
データ入力端子４６を介して同期式アツプカウン
タ４２にデータD0，D1，D2，D3として出力する
ように構成されている。４７は同期式アツプカウ
ンタ４２のターミナルカウント出力端子（Tc）
で、このターミナルカウント出力端子４７（Tc）
に得られる出力はトリガ信号発生回路の出力信号
４８として第２図に示す制御回路６に供給される
と共に、インバータ４９を介して同期式アツプカ
ウンタ４２のカウントイネーブル端子５０(E)に供
給されるように構成されている。
他の実施例を示すブロツク図である。第５図にお
いて、４０は第２図のトリガ回路３からの入力信
号が印加される入力端子、４１は入力端子４０か
らの入力信号が供給されるプリセツト可能な同期
式アツプカウンタ４２のプリセツト入力端子
（PE）、４３はクロツク信号４４が印加される同
期式アツプカウンタ４２のクロツク入力端子
（CK）、４５は数値レジスタで、この数値レジス
タ４５は同期式アツプカウンタ４２のプリセツト
データ入力端子４６を介して同期式アツプカウン
タ４２にデータD0，D1，D2，D3として出力する
ように構成されている。４７は同期式アツプカウ
ンタ４２のターミナルカウント出力端子（Tc）
で、このターミナルカウント出力端子４７（Tc）
に得られる出力はトリガ信号発生回路の出力信号
４８として第２図に示す制御回路６に供給される
と共に、インバータ４９を介して同期式アツプカ
ウンタ４２のカウントイネーブル端子５０(E)に供
給されるように構成されている。
つぎにこの第５図に示す実施例の動作を説明す
る。まず、この実施例は同期式アツプカウンタ４
２を使用し、そのターミナルカウント出力をトリ
ガ信号発生回路の出力信号４８としている。そし
て、数値レジスタ４５には同期式アツプカウンタ
４２のターミナルカウント以外の数を設定してお
く。
る。まず、この実施例は同期式アツプカウンタ４
２を使用し、そのターミナルカウント出力をトリ
ガ信号発生回路の出力信号４８としている。そし
て、数値レジスタ４５には同期式アツプカウンタ
４２のターミナルカウント以外の数を設定してお
く。
いま、このトリガ信号発生回路を構成する同期
式アツプカウンタ４２に第２図のトリガ回路３か
らトリガ信号が印加されると、同期式アツプカウ
ンタ４２は数値レジスタ４５の値を読み込み、プ
リセツトされる。また、同期式アツプカウンタ４
２のカウント値はクロツクが１つ加わるたびに１
つづつ増加してゆく。そして、ターミナルカウン
トを数えると、インバータ４９によりターミナル
カウント出力端子４７（Tc）の出力信号がカウ
ントイネーブル端子５０(E)に戻されることによ
り、それ以後カウントをしなくなる。
式アツプカウンタ４２に第２図のトリガ回路３か
らトリガ信号が印加されると、同期式アツプカウ
ンタ４２は数値レジスタ４５の値を読み込み、プ
リセツトされる。また、同期式アツプカウンタ４
２のカウント値はクロツクが１つ加わるたびに１
つづつ増加してゆく。そして、ターミナルカウン
トを数えると、インバータ４９によりターミナル
カウント出力端子４７（Tc）の出力信号がカウ
ントイネーブル端子５０(E)に戻されることによ
り、それ以後カウントをしなくなる。
いま、数値レジスタ４５に設定してある数を
ｎ、クロツクをａ〔秒〕、アツプカウンタ４２のタ
ーミナルカウントの値をＴとすれば、第２図のト
リガ回路３から （Ｔ−ｎ）×ａ〔秒〕 より短い周期でトリガ信号が出力されていれば、
同期式アツプカウンタ４２はターミナルカウント
になる前に入力信号により再びプリセツトされ、
ターミナルカウント出力端子４７（Tc）、すなわ
ち、トリガ信号発生回路の出力には信号が生じな
い。したがつて、第２図のトリガ信号発生機能を
持つロジツクアナライザ全体としてはトリガしな
い。
ｎ、クロツクをａ〔秒〕、アツプカウンタ４２のタ
ーミナルカウントの値をＴとすれば、第２図のト
リガ回路３から （Ｔ−ｎ）×ａ〔秒〕 より短い周期でトリガ信号が出力されていれば、
同期式アツプカウンタ４２はターミナルカウント
になる前に入力信号により再びプリセツトされ、
ターミナルカウント出力端子４７（Tc）、すなわ
ち、トリガ信号発生回路の出力には信号が生じな
い。したがつて、第２図のトリガ信号発生機能を
持つロジツクアナライザ全体としてはトリガしな
い。
ここで、第２図のトリガ回路３よりのトリガ信
号がある周期よりも遅くなつたとき、あるいは発
生しなくなると、同期式アツプカウンタ４２はあ
る時間内にプリセツトされず、クロツク入力信号
４３（CK）へ印加されているクロツク信号４４
のためにカウントアツプ動作をし、先に数値レジ
スタ４５にプリセツトされた値と、クロツク信号
周期で決まる時間を経過すると、ターミナルカウ
ント出力端子４７（Tc）よりターミナルカウン
ト信号が出力される。そして、この出力はトリガ
信号発生回路の出力信号４８として第２図の制御
回路６に供給され、この制御回路６を動作させ
る。
号がある周期よりも遅くなつたとき、あるいは発
生しなくなると、同期式アツプカウンタ４２はあ
る時間内にプリセツトされず、クロツク入力信号
４３（CK）へ印加されているクロツク信号４４
のためにカウントアツプ動作をし、先に数値レジ
スタ４５にプリセツトされた値と、クロツク信号
周期で決まる時間を経過すると、ターミナルカウ
ント出力端子４７（Tc）よりターミナルカウン
ト信号が出力される。そして、この出力はトリガ
信号発生回路の出力信号４８として第２図の制御
回路６に供給され、この制御回路６を動作させ
る。
この第５図に示す実施例においては、同期式ア
ツプカウンタ４２を４ビツトバイナリカウンタと
したので、ターミナルカウントが出力されるカウ
ント数は“15”である。したがつて、数値レジス
タ４５を“０”から“14”までの値に任意に設定
すると同時に、クロツク信号４４を適当な周期に
設定すると、第２図のトリガ回路３よりのトリガ
信号が （Ｔ−ｎ）×ａ〔秒〕 時間以上絶えると、ロジツクアナライザ全体をト
リガする。
ツプカウンタ４２を４ビツトバイナリカウンタと
したので、ターミナルカウントが出力されるカウ
ント数は“15”である。したがつて、数値レジス
タ４５を“０”から“14”までの値に任意に設定
すると同時に、クロツク信号４４を適当な周期に
設定すると、第２図のトリガ回路３よりのトリガ
信号が （Ｔ−ｎ）×ａ〔秒〕 時間以上絶えると、ロジツクアナライザ全体をト
リガする。
なお、この第５図の実施例においては、同期式
アツプカウンタ４２として４ビツトカウンタの場
合を例にとつて説明したが、本発明はこれに限定
されるものではなく、同期式アツプカウンタ４２
および数値レジスタ４５を増すと同時に、クロツ
ク周期を可変にすれば、必要な分解能と、必要な
トリガ信号発生時間を任意に設定することができ
る回路構成となる。
アツプカウンタ４２として４ビツトカウンタの場
合を例にとつて説明したが、本発明はこれに限定
されるものではなく、同期式アツプカウンタ４２
および数値レジスタ４５を増すと同時に、クロツ
ク周期を可変にすれば、必要な分解能と、必要な
トリガ信号発生時間を任意に設定することができ
る回路構成となる。
前述したところから明らかなように、本発明に
よれば、従来のトリガ回路では実現できなかつた
ような特定な状態でトリガできる。また、従来の
トリガ回路からの信号の周期が遅くなつた場合、
または停止した場合にトリガ信号発生回路によつ
てトリガ信号を作り、それによりロジツクアナラ
イザをトリガするため、繰り返し動作している被
測定回路が停止した場合など、どのような状態で
停止したかを停止したそのことによつて、ロジツ
クアナライザにトリガがかけることができる。
よれば、従来のトリガ回路では実現できなかつた
ような特定な状態でトリガできる。また、従来の
トリガ回路からの信号の周期が遅くなつた場合、
または停止した場合にトリガ信号発生回路によつ
てトリガ信号を作り、それによりロジツクアナラ
イザをトリガするため、繰り返し動作している被
測定回路が停止した場合など、どのような状態で
停止したかを停止したそのことによつて、ロジツ
クアナライザにトリガがかけることができる。
以上説明したように、本発明によれば、従来の
信号観測装置に比して多大の効果があり、特にロ
ジツク信号の観測に便利なロジツクアナライザに
適用して顕著な効果を発揮する信号観測装置とし
ては独自のものである。
信号観測装置に比して多大の効果があり、特にロ
ジツク信号の観測に便利なロジツクアナライザに
適用して顕著な効果を発揮する信号観測装置とし
ては独自のものである。
第１図は従来のロジツクアナライザの構成の一
例を示すブロツク図、第２図は本発明による信号
観測装置の一実施例を示すブロツク図、第３図は
第２図の実施例におけるトリガ信号発生回路に係
る部分を抽出して示した実施例を示すブロツク
図、第４図は第２図の実施例におけるトリガ信号
発生回路に係る部分を抽出して示した他の実施例
を示すブロツク図、第５図は第２図の実施例にお
けるトリガ信号発生回路に係る部分を抽出して示
した更に他の実施例を示すブロツク図である。 ７……トリガ信号発生回路、１１……ダウンカ
ウンタ、１５……数値レジスタ、１８……ゼロ検
出器、３２……ワンシヨツトマルチバイブレー
タ、４２……同期式アツプカウンタ、４５……数
値レジスタ。
例を示すブロツク図、第２図は本発明による信号
観測装置の一実施例を示すブロツク図、第３図は
第２図の実施例におけるトリガ信号発生回路に係
る部分を抽出して示した実施例を示すブロツク
図、第４図は第２図の実施例におけるトリガ信号
発生回路に係る部分を抽出して示した他の実施例
を示すブロツク図、第５図は第２図の実施例にお
けるトリガ信号発生回路に係る部分を抽出して示
した更に他の実施例を示すブロツク図である。 ７……トリガ信号発生回路、１１……ダウンカ
ウンタ、１５……数値レジスタ、１８……ゼロ検
出器、３２……ワンシヨツトマルチバイブレー
タ、４２……同期式アツプカウンタ、４５……数
値レジスタ。
Claims (1)
- １ 入力信号のデータを書き込む記憶回路と、内
部または外部よりの入力信号からトリガ信号を検
出するための回路の出力が任意に設定できる一定
時間以内に繰り返し供給されているときは出力信
号を発生せず、一定時間以上供給されないときは
出力信号を発生する再トリガ可能なトリガ信号発
生回路と、トリガ信号発生回路の出力信号が発生
したとき記憶回路を書き込み状態から読み出し状
態に制御する制御回路と、読出されたデータを表
示する表示回路とから構成される信号観測装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7866381A JPS57194362A (en) | 1981-05-26 | 1981-05-26 | Observing device for signal |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7866381A JPS57194362A (en) | 1981-05-26 | 1981-05-26 | Observing device for signal |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57194362A JPS57194362A (en) | 1982-11-29 |
| JPS6329226B2 true JPS6329226B2 (ja) | 1988-06-13 |
Family
ID=13668095
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7866381A Granted JPS57194362A (en) | 1981-05-26 | 1981-05-26 | Observing device for signal |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57194362A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0386939A (ja) * | 1989-08-29 | 1991-04-11 | Asahi Optical Co Ltd | 光学式情報記録再生装置用光学系のビームスプリッタ検査装置 |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3379076B2 (ja) * | 1995-06-30 | 2003-02-17 | 株式会社アドバンテスト | 信号波形観測装置 |
| US10365300B2 (en) * | 2016-02-05 | 2019-07-30 | Tektronix, Inc. | Trigger on final occurrence |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57119267A (en) * | 1981-01-19 | 1982-07-24 | Hitachi Ltd | Checking device for logic operating condition |
-
1981
- 1981-05-26 JP JP7866381A patent/JPS57194362A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57119267A (en) * | 1981-01-19 | 1982-07-24 | Hitachi Ltd | Checking device for logic operating condition |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0386939A (ja) * | 1989-08-29 | 1991-04-11 | Asahi Optical Co Ltd | 光学式情報記録再生装置用光学系のビームスプリッタ検査装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57194362A (en) | 1982-11-29 |
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