JPS63237977A - プリンタ - Google Patents
プリンタInfo
- Publication number
- JPS63237977A JPS63237977A JP7164987A JP7164987A JPS63237977A JP S63237977 A JPS63237977 A JP S63237977A JP 7164987 A JP7164987 A JP 7164987A JP 7164987 A JP7164987 A JP 7164987A JP S63237977 A JPS63237977 A JP S63237977A
- Authority
- JP
- Japan
- Prior art keywords
- time
- power
- circuit
- power source
- turned
- Prior art date
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- Pending
Links
- 238000005259 measurement Methods 0.000 claims description 18
- 230000006866 deterioration Effects 0.000 abstract description 2
- 230000001186 cumulative effect Effects 0.000 description 3
- 238000001514 detection method Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 238000005516 engineering process Methods 0.000 description 2
- 230000007423 decrease Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 239000004973 liquid crystal related substance Substances 0.000 description 1
- 238000004519 manufacturing process Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
Landscapes
- Accessory Devices And Overall Control Thereof (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、時間計測回路を有するプリンタに関する。
従来よりプリンタには時間計測回路が内蔵されておシ、
この時間計測回路は、外部ＡＣ入力電源よシミ力を供給
しているもので、電源投入後から電源断となるまでのプ
リンタの稼動時間を計測したシ、印字ヘッドと連動させ
て印字ヘッドの稼動時間および印字回数を計測している
。
この時間計測回路は、外部ＡＣ入力電源よシミ力を供給
しているもので、電源投入後から電源断となるまでのプ
リンタの稼動時間を計測したシ、印字ヘッドと連動させ
て印字ヘッドの稼動時間および印字回数を計測している
。
上記した従来技術によると、装置の稼動中の計測は行な
うことができるが、装置の電源断となっている間の計測
は行なうことができず、電源断となっている時間が長時
間におよぶ場合に装置の経年数を正確に把握することが
できず、そのために部品の適切な交換時期がわからず、
劣化した部品を使い続けて装置の故障を招くという問題
がある。
うことができるが、装置の電源断となっている間の計測
は行なうことができず、電源断となっている時間が長時
間におよぶ場合に装置の経年数を正確に把握することが
できず、そのために部品の適切な交換時期がわからず、
劣化した部品を使い続けて装置の故障を招くという問題
がある。
本発明は、電源投入後から電源断となるまでの稼動時間
を計測し、さらに印字ヘッドと連動させて印字ヘッドの
稼動時間および印字回数を計測するプリンタにおいて、 電源断時の時間計測を行なうバッテリを内蔵する時間計
測部と、電源の投入、切断を検出する電力供給部とを有
することを特徴どする。
を計測し、さらに印字ヘッドと連動させて印字ヘッドの
稼動時間および印字回数を計測するプリンタにおいて、 電源断時の時間計測を行なうバッテリを内蔵する時間計
測部と、電源の投入、切断を検出する電力供給部とを有
することを特徴どする。
以上の構成によると、電源断になった時点から電源が再
投入されるまでの時間を時間計測部で積算、記憶してお
き、非稼動時間の積算時間をメモリから随時読出すこと
ができるもので、稼動時の積算時間とあわせて経年によ
る部品の劣化および交換時期を知ることができることに
なる。
投入されるまでの時間を時間計測部で積算、記憶してお
き、非稼動時間の積算時間をメモリから随時読出すこと
ができるもので、稼動時の積算時間とあわせて経年によ
る部品の劣化および交換時期を知ることができることに
なる。
以下に本発明の実施例を図面を用いて説明する。
第１図は実施例のブロック図、第２図は時間計測部の各
信号のタイムチャートであり、図において１は電力供給
部、２は時間計測部である。
信号のタイムチャートであり、図において１は電力供給
部、２は時間計測部である。
まず、電力供給部１において、装置の電源電圧３が基準
電圧以下になったことを電圧レベル検出回路４で検出し
、それで電源断と判断し、スイッチング回路５によりバ
ッテリ６から電力を供給するように切替える。
電圧以下になったことを電圧レベル検出回路４で検出し
、それで電源断と判断し、スイッチング回路５によりバ
ッテリ６から電力を供給するように切替える。
バッテリ６からの電力供給に同期して時間計測部２のリ
セット回路７によυカウンタ回路８をリセットして時間
計測を開始する。ここで、タロツク信号発生器９は時間
計測のタイムベースとなる。
セット回路７によυカウンタ回路８をリセットして時間
計測を開始する。ここで、タロツク信号発生器９は時間
計測のタイムベースとなる。
時間計側部２の動作を第２図のタイムチャートを用いて
説明する。
説明する。
クロック信号発生器９からのクロック信号出力Ａをカウ
ンタ回路８で計数し、一定時間、例えば１時間毎にカウ
ンタ出力信号Ｂがパルス発生回路１０に出力される。
ンタ回路８で計数し、一定時間、例えば１時間毎にカウ
ンタ出力信号Ｂがパルス発生回路１０に出力される。
カウンタ出力を受けたパルス発生回路１０よシメモリリ
クエスト信号（以下ＭＲＥＱ信号という。）Ｃが出力さ
れる。このＭＲＥＱ 信号Ｃが出力される間メモリ制
御回路１１より一定のアドレス値を指定するアドレス信
号りが出力され、またクロック信号に同期してメモリ１
２をアクティブにするＯＥ（アウトプットイネーブル）
信号およびメモリ１２からの読出し、メモリへの書込み
を指定するＲ Ｄ／ＷＲ信号を出力する。
クエスト信号（以下ＭＲＥＱ信号という。）Ｃが出力さ
れる。このＭＲＥＱ 信号Ｃが出力される間メモリ制
御回路１１より一定のアドレス値を指定するアドレス信
号りが出力され、またクロック信号に同期してメモリ１
２をアクティブにするＯＥ（アウトプットイネーブル）
信号およびメモリ１２からの読出し、メモリへの書込み
を指定するＲ Ｄ／ＷＲ信号を出力する。
ＯＥ（’Ｈ号がローレベルで、ＲＤ／ＷＲ侶号がハイレ
ベルのときメモリ１２よシ計測時間のデータＥがデータ
バスに読出される。このデータに一定量例えば１時間で
＋１加算してや９、再びメモ１月２の同一アドレスへ記
憶させる。
ベルのときメモリ１２よシ計測時間のデータＥがデータ
バスに読出される。このデータに一定量例えば１時間で
＋１加算してや９、再びメモ１月２の同一アドレスへ記
憶させる。
これは２つのラッチ回路１３．１４および加算回路１５
によって行なわれる。２つのラッチ回路１３．１４へは
ＯＥ （アウトプットイネーブル）信号、ＬＥ（ラッチ
イネーブル）信号Ｉ、Ｆが制御信号として入力され、Ｏ
Ｅ倍信号ローレベルのときにラッチ回路よりデータが出
力され、ＬＥ倍信号ローレベルのときラッチ回路でデー
タがラッチされて出力が保持される。
によって行なわれる。２つのラッチ回路１３．１４へは
ＯＥ （アウトプットイネーブル）信号、ＬＥ（ラッチ
イネーブル）信号Ｉ、Ｆが制御信号として入力され、Ｏ
Ｅ倍信号ローレベルのときにラッチ回路よりデータが出
力され、ＬＥ倍信号ローレベルのときラッチ回路でデー
タがラッチされて出力が保持される。
メモリ１２よシデータバスに出力されたデータをまずラ
ッチ回路１４を通して加算回路１５に出力する。このと
きデータバス上でデータの衝突が起らないようにラッチ
回路１３のＯＥ倍信号ノ・イレペルにしておく。次にラ
ッチ回路１４の出力をラッチすると共に加算回路１５に
加算出力Ｇを加えその和出力Ｈをラッチ回路１３でラッ
チする。
ッチ回路１４を通して加算回路１５に出力する。このと
きデータバス上でデータの衝突が起らないようにラッチ
回路１３のＯＥ倍信号ノ・イレペルにしておく。次にラ
ッチ回路１４の出力をラッチすると共に加算回路１５に
加算出力Ｇを加えその和出力Ｈをラッチ回路１３でラッ
チする。
ラッチ回路１４のＬＥ倍信号をローレベルにした後、ラ
ッチ回路１４の出力をディスイネーブル（６Ｅ信号をハ
イレベル）にし、ラッチ回路１３の出力をイネーブル（
面信号をローレベル）にすることでデータバスに計測時
間の積算結果である加算回路１５からの和出力Ｈが出さ
れる。このデータをメモリ制御回路１１からのＲＤ／Ｗ
Ｒ信号の立上り時にメモリ１２に書込みを行なう。
ッチ回路１４の出力をディスイネーブル（６Ｅ信号をハ
イレベル）にし、ラッチ回路１３の出力をイネーブル（
面信号をローレベル）にすることでデータバスに計測時
間の積算結果である加算回路１５からの和出力Ｈが出さ
れる。このデータをメモリ制御回路１１からのＲＤ／Ｗ
Ｒ信号の立上り時にメモリ１２に書込みを行なう。
以上の一連の動作を周期的に出力されるカウンタ出力に
同期して行なうことでカウンタ出力の周期を単位として
時間計測が行なえる。
同期して行なうことでカウンタ出力の周期を単位として
時間計測が行なえる。
時間計測動作の停止は電源スィッチの投入により電源電
圧の立上シによシバツテリ６からの時間計測部２への電
力供給が停止することによって行なわれるが、電源スィ
ッチの投入時メモリ１２へのアクセスが行なわれている
場合を考慮してバッテリ６から電力を供給する回路をも
う１系統持たせてメモリ１２がアクセスされている期間
電力供給をバイパスさせる。このバイパス回路としてメ
モリ制御回路１１よ多出力されるＭＲＥＱ信号Ｃがハイ
レベルの間ＯＮ しているスイッチング回路１６を設け
る。このスイッチング回路１６を設ケルコとによりメモ
リ１２へのアクセスが終了後、計測動作が停止する。
圧の立上シによシバツテリ６からの時間計測部２への電
力供給が停止することによって行なわれるが、電源スィ
ッチの投入時メモリ１２へのアクセスが行なわれている
場合を考慮してバッテリ６から電力を供給する回路をも
う１系統持たせてメモリ１２がアクセスされている期間
電力供給をバイパスさせる。このバイパス回路としてメ
モリ制御回路１１よ多出力されるＭＲＥＱ信号Ｃがハイ
レベルの間ＯＮ しているスイッチング回路１６を設け
る。このスイッチング回路１６を設ケルコとによりメモ
リ１２へのアクセスが終了後、計測動作が停止する。
第３図に電源電圧レベル検出およびバッテリのスイッチ
ング回路を示す。電源電圧（約５．ＯＶ）が低下すると
コンパレータ１９の出力がハイレベルとなり、次段のト
ランジスタ２０をＯＮさせる。
ング回路を示す。電源電圧（約５．ＯＶ）が低下すると
コンパレータ１９の出力がハイレベルとなり、次段のト
ランジスタ２０をＯＮさせる。
電源電圧が５．ＯＶに復帰した場合にはトランジスタ２
０はＯＦＦとなる。このトランジスタ２０のＯＮ、ＯＦ
Ｆによシ時間計測部２へのバッテリ６からの電力供給の
ＯＮ、ＯＦＦを行なう。
０はＯＦＦとなる。このトランジスタ２０のＯＮ、ＯＦ
Ｆによシ時間計測部２へのバッテリ６からの電力供給の
ＯＮ、ＯＦＦを行なう。
メモリ１２に記憶された計測データについては操作スイ
ッチの押下などによυメモリ制御回路１１よりアドレス
、ＯＥ、ＲＤ／ＷＲ信号りが出力されて読出されたデー
タを液晶などを用いた表示回路１７で表示させる。また
、この表示回路１７を持たないプリンタでは、プリンタ
をテストモードにしたときあるいは操作スイッチの押下
により電源断時間の印字が指示されたとき、メモリ１２
からデータを読出し、読出したデータを所定のフォーマ
ットで印字すれば良い。
ッチの押下などによυメモリ制御回路１１よりアドレス
、ＯＥ、ＲＤ／ＷＲ信号りが出力されて読出されたデー
タを液晶などを用いた表示回路１７で表示させる。また
、この表示回路１７を持たないプリンタでは、プリンタ
をテストモードにしたときあるいは操作スイッチの押下
により電源断時間の印字が指示されたとき、メモリ１２
からデータを読出し、読出したデータを所定のフォーマ
ットで印字すれば良い。
時間計測データはメモリ１２の一定アドレスに記憶させ
ておくが、装置組立て時にメモリをリセットしておきそ
の時点より装置が電源断となっている時間をパルス発生
回路１８からの信号によって計測していく。
ておくが、装置組立て時にメモリをリセットしておきそ
の時点より装置が電源断となっている時間をパルス発生
回路１８からの信号によって計測していく。
以上詳細に説明した本発明によると、プリンタに、電源
断時の時間計測を行なうバッテリを有する時間計測部と
装置の電源の投入、切断を検出する電力供給部を設け、
装置が電源断になった時点から電源が再投入されるまで
の時間を積算、記憶するようにしたことにより、装置の
非稼動時間を装置使用者および製造者がメモリに記憶し
ている積算時間を読出すことで知ることができることに
なる。
断時の時間計測を行なうバッテリを有する時間計測部と
装置の電源の投入、切断を検出する電力供給部を設け、
装置が電源断になった時点から電源が再投入されるまで
の時間を積算、記憶するようにしたことにより、装置の
非稼動時間を装置使用者および製造者がメモリに記憶し
ている積算時間を読出すことで知ることができることに
なる。
これによって、使用者および製造者が積算時間を経年に
よる劣化部品の交換時期を知る目安とすることができ、
装置の保守性の向上が期待できることになる。
よる劣化部品の交換時期を知る目安とすることができ、
装置の保守性の向上が期待できることになる。
第１図は本発明の一実施例を示すブロック図、第２図は
時間計測部の各信号のタイムチャート、第３図は電圧レ
ベル検出回路とスイッチング回路の回路図、第４図は電
源電圧と出方電圧の関係を示すグラフ。
時間計測部の各信号のタイムチャート、第３図は電圧レ
ベル検出回路とスイッチング回路の回路図、第４図は電
源電圧と出方電圧の関係を示すグラフ。
Claims (1)
- 【特許請求の範囲】 １、電源投入後から電源断となるまでの稼動時間を計測
し、さらに印字ヘッドと連動させて印字ヘッドの稼動時
間および印字回数を計測するプリンタにおいて、 電源断時の時間計測を行なうバッテリを内蔵する時間計
測部と、 電源の投入、切断を検出する電力供給部を有し、 電源断になつた時点から電源が再投入されるまでの時間
を積算、記憶して非稼動時間を読出すことができるよう
にしたことを特徴とするプリンタ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7164987A JPS63237977A (ja) | 1987-03-27 | 1987-03-27 | プリンタ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7164987A JPS63237977A (ja) | 1987-03-27 | 1987-03-27 | プリンタ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS63237977A true JPS63237977A (ja) | 1988-10-04 |
Family
ID=13466679
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7164987A Pending JPS63237977A (ja) | 1987-03-27 | 1987-03-27 | プリンタ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS63237977A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US20130332791A1 (en) * | 2012-06-11 | 2013-12-12 | Phison Electronics Corp. | Data protection method, and memory controller and memory storage device using the same |
-
1987
- 1987-03-27 JP JP7164987A patent/JPS63237977A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US20130332791A1 (en) * | 2012-06-11 | 2013-12-12 | Phison Electronics Corp. | Data protection method, and memory controller and memory storage device using the same |
| US8775874B2 (en) * | 2012-06-11 | 2014-07-08 | Phison Electronics Corp. | Data protection method, and memory controller and memory storage device using the same |
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