JPS63221628A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPS63221628A JPS63221628A JP5570887A JP5570887A JPS63221628A JP S63221628 A JPS63221628 A JP S63221628A JP 5570887 A JP5570887 A JP 5570887A JP 5570887 A JP5570887 A JP 5570887A JP S63221628 A JPS63221628 A JP S63221628A
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- resist
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- Pending
Links
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Landscapes
- Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)
- Weting (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、半導体装置の製造方法に関し、特に金属類*
f:用いてパターン全形成する半導体装置の製造方法に
関する。
f:用いてパターン全形成する半導体装置の製造方法に
関する。
レジストをマスクとしてウェハーに溝を形成し、同時に
す7トオフを用いてパターンを形成するプロセスにおい
て、従来は次のように行なわれてい*o tず、ウェハ
ー上にマスクとなるレジストパターンを形成し、次いで
エツチング金貸ないウェハーに韓を堀る。その後金属蒸
着を行ない、マスクとしたレジスト層を除去しパターン
を形成させていた。
す7トオフを用いてパターンを形成するプロセスにおい
て、従来は次のように行なわれてい*o tず、ウェハ
ー上にマスクとなるレジストパターンを形成し、次いで
エツチング金貸ないウェハーに韓を堀る。その後金属蒸
着を行ない、マスクとしたレジスト層を除去しパターン
を形成させていた。
近年微細化が進み、集積度が上がってくると、高N/1
度なパターン形成が要求されてきた。
度なパターン形成が要求されてきた。
しかしながら、上述の従来法では、金属を蒸着させる際
に、蒸着の方向が垂直方向だけでなく斜め方向の成分も
めるので蒸着金属の形成位置がずれたシまた金属パター
ンがすそをひいた9するという欠点がある。
に、蒸着の方向が垂直方向だけでなく斜め方向の成分も
めるので蒸着金属の形成位置がずれたシまた金属パター
ンがすそをひいた9するという欠点がある。
以下、第2図に従来例を示して説明する。まず第2図(
alに示すようにウェハー1全レジスト2をマスクとし
てワエットエッチングを行ない溝3 t−形成する。次
に同図(b)に示すようにレジスト2をマスクとして金
属膜4を蒸着した後、同図(C)に示すようにレジスト
2fr、除去し溝3の中に金属パターン4を形成する。
alに示すようにウェハー1全レジスト2をマスクとし
てワエットエッチングを行ない溝3 t−形成する。次
に同図(b)に示すようにレジスト2をマスクとして金
属膜4を蒸着した後、同図(C)に示すようにレジスト
2fr、除去し溝3の中に金属パターン4を形成する。
しかしながら、金属を蒸着の際に蒸着方向が必ずしも垂
直でないため、金属パターン4は#3内の中心に位置せ
ず同図(C)に示すようにd1←d2となる。また金属
パターン4はレジストマスク巾よシも広がってしまうと
いう欠点がある。
直でないため、金属パターン4は#3内の中心に位置せ
ず同図(C)に示すようにd1←d2となる。また金属
パターン4はレジストマスク巾よシも広がってしまうと
いう欠点がある。
本発明は上記欠点を解消し高精度な金属パターン形成の
ための半導体製造方法を提供するものである。
ための半導体製造方法を提供するものである。
本発明の目的は、金属の蒸着方向によらない高8度な金
属パターン形成ができるリフトオフ方法を提供するもの
である。
属パターン形成ができるリフトオフ方法を提供するもの
である。
本発明によれば、エツチングにより形成した溝に、金属
パターンを蒸着により形成する際、金属パターン形成部
分以外金ポジレジストで埋め込む工程を有している〇 〔実施例〕 不発明の一実施例について図面を参照して説明する。
パターンを蒸着により形成する際、金属パターン形成部
分以外金ポジレジストで埋め込む工程を有している〇 〔実施例〕 不発明の一実施例について図面を参照して説明する。
第1図(a)に示すように、ウェハー11上に、下層レ
ジス)12(厚さ約1〜2μm)t−形成しその上に中
間層15(例えばTi厚さ100−100OA)を形成
しさらにその上に上層レジスト16(厚さ0.5〜1μ
m)を形成する1次に上層レジスト16にパターン形成
し比後、中間層15ftドライエツチングする。その後
solプラズマで下層レジスト12tエツチングする。
ジス)12(厚さ約1〜2μm)t−形成しその上に中
間層15(例えばTi厚さ100−100OA)を形成
しさらにその上に上層レジスト16(厚さ0.5〜1μ
m)を形成する1次に上層レジスト16にパターン形成
し比後、中間層15ftドライエツチングする。その後
solプラズマで下層レジスト12tエツチングする。
この時、上J−レジスト16もエツチングされる。
次に、同図(b)に示すように、GaAsクエハー11
上に、下層レジスト12?マスクとしてエツチングを行
ない溝13を形成する。
上に、下層レジスト12?マスクとしてエツチングを行
ない溝13を形成する。
次に、同図(c3に示すようにポジレジス)17t−塗
布し溝13をポジレジストで埋め込む。次に、光あるい
は荷電ビーム(電子又はイオン)でウェハーll′t−
照射すると中間層15がマスクとな夛、現像後、同図(
d)に示すようにパターン形成部のみが溶解除去される
。
布し溝13をポジレジストで埋め込む。次に、光あるい
は荷電ビーム(電子又はイオン)でウェハーll′t−
照射すると中間層15がマスクとな夛、現像後、同図(
d)に示すようにパターン形成部のみが溶解除去される
。
久に、同図(e)に示すように金属膜14(例えば、A
l g T4 、w、 )tMytiする。次−で、周
知の方法で、下層レジス)121!解除去することにょ
プ中間層15.金属膜14も除去される。同時に。
l g T4 、w、 )tMytiする。次−で、周
知の方法で、下層レジス)121!解除去することにょ
プ中間層15.金属膜14も除去される。同時に。
クエハー11の$13の中に埋込まれたレジスト17も
溶解除去され、同図(f)に示すような金属パターンが
形成される〇 〔発明の効果〕 以上説明したように、本発明は、金属蒸着部分の溝の、
金属パターン形成部分以外をポジレジストで埋め込むこ
とにより、金属蒸着の方向によらず高精度な金属パター
ンが形成できるという効果がある。
溶解除去され、同図(f)に示すような金属パターンが
形成される〇 〔発明の効果〕 以上説明したように、本発明は、金属蒸着部分の溝の、
金属パターン形成部分以外をポジレジストで埋め込むこ
とにより、金属蒸着の方向によらず高精度な金属パター
ンが形成できるという効果がある。
特に、ゲート金属形成のように蒸着金属の寸法。
形状の再現性が!JL要なプロセスでは、大@な効果が
ある。
ある。
第1図(a)〜(f)は本発明の実施例を工程順に示す
断面図である。第2図(a)〜(C)は、従来例を工程
順に示す断面図である。 1 、 l l ・−・−・・GaAl、 2 、 l
2 、 l 6 、 l 7・・・・・・レジスト、
3.13・・・・・・溝、4.x4,1s・・・・・・
金属膜。 H知\− 躬1図 /4−金属歇 第1図
断面図である。第2図(a)〜(C)は、従来例を工程
順に示す断面図である。 1 、 l l ・−・−・・GaAl、 2 、 l
2 、 l 6 、 l 7・・・・・・レジスト、
3.13・・・・・・溝、4.x4,1s・・・・・・
金属膜。 H知\− 躬1図 /4−金属歇 第1図
Claims (1)
- ウェハー上に形成したレジストパターンをマスクとして
、絶縁膜又は基板をエッチングして溝を形成した後、リ
フトオフにより金属パタンを形成する工程において、前
記溝内をレジストで埋め込む工程と、金属パターン形成
領域のみのレジストを除去する工程とを有することを特
徴とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5570887A JPS63221628A (ja) | 1987-03-10 | 1987-03-10 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP5570887A JPS63221628A (ja) | 1987-03-10 | 1987-03-10 | 半導体装置の製造方法 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63221628A true JPS63221628A (ja) | 1988-09-14 |
Family
ID=13006381
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP5570887A Pending JPS63221628A (ja) | 1987-03-10 | 1987-03-10 | 半導体装置の製造方法 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63221628A (ja) |
-
1987
- 1987-03-10 JP JP5570887A patent/JPS63221628A/ja active Pending
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