JPS63216122A - データの多重コピー記録方法 - Google Patents

データの多重コピー記録方法

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JPS63216122A
JPS63216122A JP62292268A JP29226887A JPS63216122A JP S63216122 A JPS63216122 A JP S63216122A JP 62292268 A JP62292268 A JP 62292268A JP 29226887 A JP29226887 A JP 29226887A JP S63216122 A JPS63216122 A JP S63216122A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 Ａ、産業上の利用分野 本発明はホスト中央処理装置（ＣＰＬＩ）と直接アクセ
ス記憶装置（ＤＡＳＤ）サブシステムとの間のデータ転
送を制御する方法及び装置、より具体的に言えば、デー
タ処理システムの連続運転を維持するために、ＣＰＵか
らＤＡＳＤへ同じデータの多重コピーを同時に記録する
方法及び装置に関する。
Ｂ、従来の技術 ホストＣＰＬＩへ接続されたＤＡＳＤサブシステムのよ
うな人出力（Ｉｌｏ）サブシステムは、データ処理シス
テムの全体の性能及び稼働率に大きく影響する関係を持
っている。所望のデータ処理操作を遂行するために、Ｄ
ＡＳＤサブシステムが各ＤＡＳＤに迅速にアクセスする
ことは高性能を発揮するために必須の要件である。更に
、データ処理システムの連続運転を維持するために、Ｄ
ＡＳＤサブシステムは、データの完全性（データの喪失
がない）とデータの可用性（誤動作の場合の回復）とを
持たなければならない。
これらの問題を解決するための通常のアプローチは、例
えば、同じデータの多重コピーを作り、ＤＡＳＤの多重
ボリュームにそれらのデータを記録することを含む。デ
ータの可用性を高くするために、これらのＤＡＳＤは、
電源、機械的運動及びデータ転送路に関して、相互に独
立して配列されることが好ましい。ＤＡＳＤが誤動作を
した場合、データは、誤動作をしたＤＡＳＤに記録され
たデータと同じデータのコピーを含んでいる他のＤＡＳ
Ｄ中にあり、従ってデータ処理システムはそのような有
効データを使用して動作を続行する。
然しながら、従来のアプローチにおいて、二重データは
直列に記録されるので、誤動作による失点はデータ処理
装置のせいにされる。
このアプローチの一例は、ｃｐｕ、パス、制御装置及び
ＤＡＳＤのような冗長コンポーネントを含み、余裕度が
不完全なコンピュータ・システムを指向した米国特許第
４４５３２１５号に記載されている。この特許のシステ
ムは、１対のＤＡＳＤに二重のデータを記録しているが
、この特許の発明者はＤＡＳＤが相互に同期して動作し
ないことを特に意識しているので、これらのＤＡＳＤ中
にデータを同時に記録する能力は持っていない。
換言すれば、二重データがＤＡＳＤ中に記録されたとき
、この特許に開示されたシステムは以下に概説する性能
上の弱点を持っている。
例えば、１８Ｍシステム３７０のような広く使われてい
るデータ処理システムで使われているＤＡＳＤサブシス
テムの他のタイプは、ＣＰＵとＤＡＳＤとの闇に幾つか
のデータ転送路が設けられている。既に広く知られてい
るように、データ転送路は、チャネルを介してＣＰＵか
らコントロール・ユニットへの相互接続と、決められた
インターフェースを介してコントロール・ユニットから
ＤＡＳＤへの相互接続とによって形成されている。
同じコントロール・ユニット、または他の異なったコン
トロール・ユニットに対して、１個以上のデータ転送路
を利用することが出来る。通常、チャネル及びコントロ
ール・ユニットによって形成されている単一のデータ転
送路を介して各ＤＡＳＤを別個にアクセスすることによ
って同じデータの多重コピーが記録されるような方法で
、上述のアプローチが実現されている。
このことは、ただ１つのデータ転送路を使う方法におい
て、二重の記録は実際には直列に行われることを意味し
ている。何故ならば、この場合、チャネル・コマンド・
ワード（ＣＣＷ）の独立したチェインは、そのような記
録を行うために、ＣＰＵからデータ転送路を経て直列的
に転送されるからである。換言すれば、ＤＡＳＤは互に
直列的な動作状態に置かれる。従って、最悪の場合、各
ＤＡＳＤ’がアクセスされている間、探索時間、回転待
ち時間そしてデータ転送時間が直列的に経過する。
多重データ転送路を使った他の装置において、ＣＰＵが
重複したデータを複数のＤＡＳＤに同時に記録しようと
しても、ＣＰＬＩのこの動作は常に達成されるとは限ら
ない。その理由は、（１）　上述したＣＣＷの独立した
チェインはＣＰＵから複数個の制御ユニットへ非同期で
転送されるということ。
（２）　　ＤＡＳＤへのデータ転送路は必ずしも同時に
使用可能ではないということ。例えば、ただ１個のデー
タがＤＡＳＤのうちの１つのＤＡＳＤに記録される準備
が整ったとき、他のＤＡＳＤへのデータ転送路は他の動
作によって使われているかも知れない。この場合、他の
ＤＡＳＤへのデータ転送路が何時、不使用状態になるの
かを正確に予測するのは通常不可能である。
（３）　１つのＤＡＳＤの回転待ち時間は、任意のある
時間において、他のＤＡＳＤの回転待ち時間とは異なっ
ているということ。これは同じデータが異なった時間で
複数のＤＡＳＤに記録されることになる。
これらの理由のため、上述のアプローチでは複数のデー
タを複数のＤＡＳＤに同時に記録することが出来ない。
重複したデータの記録は、成る場合、重なり合った態様
で可能になるけれども、重複の程度を予測したり、また
はそのような記録の正確なタイミングを予測する実用的
な方法はない。
従って、従来のアプローチを使ったデータ処理システム
の全体的な性能は著しく弱められている。
従来の装置の欠点は、最初のコピーの記録の終りにおい
て、そのコピーに関連した状態の情報がホストＣＰＵへ
報告されたとき、同じデータの他のコピーがその時点で
記録されたこと、即ち利用可能であることの保証がない
ことである。従って、若しそのような保証が必要ならば
、ＣＰＵは、結果として課せられる性能劣化を犠牲にし
て、他のコピーが記録されるまで待機しなければならな
い。
Ｃ１発明が解決しようとする問題点 従って、本発明の目的は、ＣＰＵと制御ユニット間のた
だ１個のデータ転送路を使って、ホストＣＰＵから複数
個のＤＡＳＤへ複数のコピーを同時に記録することによ
って、データ処理システムの全体的な性能を改善する方
法及び装置を提供することにある。
Ｄ０問題点を解決するための手段 本発明に従って、ＣＰＵからの同じデータを記録するた
めに予定されている少なくとも２つのＤＡＳＤが、電源
投入時を除いて、通常、回転的に相互に同期されている
。ＤＡＳＤの同期はＣＰＵからのコマンドとは盛立して
同期制御手段によって維持されている０例えば探索コマ
ンド（ＳＥＥＫ）、セクタ設定コマンド（ＳＥＴ　５Ｅ
ＣＴＯＲ）、或いは位置付はコマンド（ＬＯＣＡＴＥ）
などの１個以上のＣＣＷが、ＣＰＵとコントロール・ユ
ニットとの間の単一のデータ転送路を経てＣＰＵからコ
ントロール・ユニットへ転送されたとき、同期されてい
るＤＡＳＤ中に所望の同一のデータが同時に記録され、
その動作をしている間、ＤＡＳＤはデータ転送路から切
り離されている。所望の同一のデータの位置が探索され
たとき、ＤＡＳＤはデータ転送路に再接続される。次に
、所望の記録位置において、同期されたＤＡＳＤ中に同
じデータを同時に記録するために「書き込みＪＣＣＷが
ＣＰＵから、コントロール・ユニットへ転送される。従
って、この記録動作の終了状態をホストＣＰＵへ知らせ
るとき、同じデータの複数のコピーが同期されたＤＡＳ
Ｄの中に記録されている。
Ｅ、実施例 本発明の実施例を第１図乃至第８図を参照して以下に説
明する。
第１図を参照すると、本発明に従ったデータ処理システ
ムのブロック図が示されている。このシステムは、チャ
ネル１２及び１４を介してコントロール・ユニット１６
及び１８に接続されているホスト中央処理袋ｆｉｔ（Ｃ
ＰＵ）／Ｏを含んでいる。
コントロール・ユニット１６は１対のデバイス・インタ
ーフェース２２及び２４が設けられており、他方、コン
トロール・ユニット１８は他の１対のデバイス・インタ
ーフェース２２及び２４が設けられている。（コントロ
ール・ユニット１６及び１８は、それらの通常の使用に
加えて、相互に支援し合っている。）これらのデバイス
・インターフェース２２乃至２４は、チャネルまたはコ
ントロール・ユニットが誤動作をした場合、交互の転送
路の使用を容易にするために、それらの関連した通路３
２乃至３８を介して、直接アクセス記録装置（ＤＡＳＤ
　）コントローラ４２及び４４へ適宜に交差接続されて
いる。各ＤＡＳＤコントローラ４２及び４４は、接続ロ
ジック及び順序制御（図示せず）に加えて、下記のよう
に、同じストリング上の関連ＤＡＳＤをコントロール・
ユニット間で切り換えるための切り換え手段を含んでい
る。
ＤＡＳＤコントローラ４２及び４４の切り換え手段が第
１図に示されたように左側の位置にセットされたとき、
例えば、コントロール・ユニット１６と所定の１対のＤ
ＡＳＤ４６及び４８との問の１対の独立した通路が、コ
ントロール・ユニット１６の制御のもとて同時に完成さ
れる。この詳細については後述する。同様に、これらの
切り換え手段がロジカルな右側位置に切り換えられた時
（例えばチャネル１２、またはコントロール・ユニット
１６の誤動作の場合）、コントロール・ユニット１８と
ＤＡＳ０４６．４８の間の他の１対の独立通路が同じよ
うに完成される。
デバイス・インターフェースを含むコントロール・ユニ
ットの１例はＩＢＭ３８８０ストレージ・コントロール
・ユニットである。ＤＡＳＤコントローラ４２及び４４
を含むＤＡＳＤ４６及び４８は、例えば１８Ｍ３３８０
ＤＡＳＤであってよい。
ＩＢＭ３３８０ストレージ・コントロール・ユニット及
びＩ　８Ｍ３３８０ＤＡＳＤの動作は公知である。
参照数字４６及び４８で表わされているＤＡＳＤの２つ
のストリンクの間に、同期制御ユニット５０が設けられ
ている。その構成は第３図を参照して後で細部を説明す
る。この段階では、同期制御ユニット５０は、各ＤＡＳ
Ｄ４６及び４８の速度及び回転位置を監視し、回転速度
を調節するフィードバック機構を含んでおり、これによ
りＤＡＳＤ４６及び４８が常に、所定の許容公差範囲内
で相互に同期関係を保たさせているということを指摘す
るだけで充分である（但し、電源投入時は除く）。更に
、ＤＡＳＤの同期時において許容される機械的な公差を
補償するために、１対の同期バッファがコントロール・
ユニット１６及び１８に夫々設けられているが、これら
については後述する。
第２図を参照すると、ＤＡＳＤ４６及び４８に重複した
データを同時に記録するための、コントロール・ユニッ
ト１６の主要部のブロック図が示されている。コントロ
ール・ユニット１８はコントロール・ユニット１６と同
じであり、これについては説明しない。
図示されているように、コントロール・ユニット１６は
、制御記憶装置５３を有するマイクロプロセッサ５２と
、チャネル１２へ接続されたチャネル・インターフェー
ス５４と、ＤＡＳＤコントローラ４２．４４へ夫々接続
されたデバイス・インターフェース２２及び２４と、自
動データ転送機構５６と、同期バッファ６２及び６４と
を含んでいる。マイクロプロセッサ５２からの制御を受
けて、チャネル１２へ接続されているチャネル・インタ
ーフェース５４は、既に知られているように、チャネル
１２からコントロール・ユニット１６へのＣＣＷの転゛
送と、コントロール・ユニットからチャネル１２へのス
テータス（状態）の転送と、両方向へのデータ転送とを
選択し、受は取るために、チャネル１２との通信を助け
る。更に、コントロール・ユニット１６は、夫々のＤＡ
ＳＤアクチュエータ機構を同時に動かす（探索する）た
め、デバイス・インターフェース２２及び２４ヘコマン
ドを発生し、現在のＤＡＳＤアクチュエータの下にある
実際のセクタと所望のセクタとを比較するため、各ＤＡ
ＳＤ４６及び４８を初期化しくセクタをセットする）、
カウント・フィールド、キー・フィールド又はデータ・
フィールドのすべてのフィールド（そのようなアーキテ
クチャである場合）、または他の固定長フィールド（ブ
ロック・アーキテクチャである場合）を読み取り、また
は書き込む。また、コントロール・ユニット１６は、チ
ャネル１２から受は取ったデータに対して、ＤＡＳＤ４
６或いは４８から読み取とったフィールドの内容を比較
して、「低」、「等」または「高」ステータスを回答す
る能力を備えている。
データ転送は、先ず、所望のトラックへ各ＤＡＳＤのア
クチュエータが同時に移動し、次に、ＤＡＳＤ４６及び
４８が同期したとき、ＤＡＳＤ４６及び４８の両方に同
時に存在するヘッドの下に到着する所定のセクタを待つ
ことによって達成される。これらの動作が遂行されてい
る闇、データ転送路は通常遮断されており、しばらくの
間、他の動作用に解放される。これに続いて、両方のＤ
ＡＳＤは同じデータを含んでいるものと仮定して、カウ
ント・フィールドが一方のＤＡＳＤから読み取られる。
このカウント・フィールドからのデータはチャネル１２
から入手出来るデータと比較され、そして所定のように
比較されたとき、次に続くフィールドが読み取られ、ま
たは書き込まれる。
若し動作が「読み取り」、（チャネル１２からの「読み
取りＪＣＣＷによって指令される）であれば、ＤＡＳＤ
４６か４８の何れかから読み取られたデータは結局、チ
ャネル・インターフェース５４に与えられる。この場合
、ＤＡＳＤ４８．４８の両方から同じデータを読み取る
必要はない。若し動作が「書き込み」であれば、書き込
まれるべきデータはチャネル１２から受は取られ、同期
バッファ６２及び６４に記憶され、そしてデバイス・イ
ンターフェース２２及び２４に与えられる。
要求されたとき、コントロール・ユニット１６はまた、
読み取られたデータについてエラー訂正を行うが、これ
は通常、カウント・フィールドだけについて行われる。
加えて、コントロール・ユニット１６は、コントロール
・ユニット１６とそれに接続されたＤＡＳＤの両方の効
果的なサービスと保守を容易にするために、店員な診断
動作と補助的な機能とを遂行する。
図示されたように、同期バッファ６２及び６４は、チャ
ネル１２を介してＣＰＵ／Ｏからコントロール・ユニッ
ト１６へ転送されるデータを同時に蓄積し、そのデータ
は同期バッファ６２及び６４の両方に同時に記憶される
。ＤＡＳＤ４６及び４８の間の同期の小さな差異に従っ
て、デバイス・インターフェース２２及び２４は、関連
した同期バッファ６２及び６４からの要求に応じて、そ
れ自身に接続されているＤＡＳＤ４６及び４８へ記録さ
れるべきデータを与え、結果として、ＤＡＳＤの同期に
ついて許容されている公差に起因する、ＤＡＳＤ４６及
び４８の回転位置の僅かな差を補償するのを可能にする
。
より詳細に説明すると、「書き込み」コマンドは、所望
のレコードに先行するギャップのところで、チャネル１
２からコントロール・ユニット１６へ転送される。次に
、チャネル１２を経て、ＣＰＵｌ０からコントロール・
ユニット１６へデータが転送される。コントロール・ユ
ニット１６及びそのデバイス・インターフェース２２及
び２４は、各ＤＡＳＤ中の所望のレコードに対して既に
同期されている（ビット及びバイト・レベルで）。
チャネル１２から受は取ったデータは先ず同期バッファ
６２及び６４の両方に同時に記憶される。
次に、データは、同期バッファ６２及び６４から取り出
されて、各インターフェースと開運した内部同期機構に
よって要求されたとき、デバイス・インターフェース２
２及び２４を経てＤＡＳＤ４６及び４８へ同時に転送さ
れる。デバイス・インターフェースを介してＤＡＳＤへ
データをそのように転送することは公知である。デバイ
ス・インターフェース２２及び２４と開運して２つの独
立した同期バッファ６２．６４を設けることにより、Ｄ
ＡＳＤ４６の回転とＤＡＳＤ４８の回転同期（ｒｏｔａ
ｔｉｏｎａｌ　５ｙｎｃｈｒｏｎｉｚａｔｉｏｎ）の小
さな差異を許容することと、夫々のＤＡＳＤに対応する
デバイス・インターフェース２２及び２４を介して、２
つのＤＡＳＤ間で独特なビット及びバイトの同期を行わ
せることとを可能にする。各同期バッファ中の記憶スペ
ースの大きさは、回転同期の公差にｌ達した対応するバ
イトの数よりも大きい、換言すれば、各同期バッファの
大きさは、リニヤ記録密度（回転角度当りのバイトに変
換しつる２５゜４ミリメートル当りのバイト数）と、回
転角度で表わされた回転同期の公差との関数である。
次に第３図を参照すると、第１図の同期制御ユニット５
０の内部構成を示すブロック図が示されている。図示さ
れているように、ＤＡＳＤ４６に関連した上部の構成は
ＤＡＳＤ４８に開運した下部の構成と同じであり、下部
の構成は特に言及しない限り細部の説明はしない。
例えば、システム内の６６及び６８のようなすべてのＤ
ＡＳＤモータの同期は、中央基準クロック７０及び各Ｄ
ＡＳＤの特別のサーボ面に予め記録されているサーボパ
ルスとを使って遂行される。
基準クロック７０は、すべてのＤＡＳＤが同じ速度（許
容された公差の範囲内で）で回転し且つ同じ相対的な回
転位置で回転するように、各ＤＡＳＤに対して回転速度
と回転位置を設定する基準として動作する。基準クロッ
ク７０からのクロックパルスは、例えばサブシステムの
ＤＡＳＤ４６及び４８のように、相互に回転同期及び位
置同期（ｐｏｓｉｔｉｏｎａｌ　ｓｙｎｃｈｒｏｎｉｓ
ｍ）にあることを必要とするすべてのＤＡＳＤに分配さ
れる。
第４図乃至第６図に示されているように、各ＤＡＳＤは
サーボパルスを記録するためのサーボ面が与えられてい
る。ＤＡＳＤの各トラックに対応するサーボパルスがあ
る。これらのサーボパルスは、公知のように、アクチュ
エータの位置付けと、トラック追跡と、セクタ及びイン
デックスの如き角度的な位置付けとに使われている。特
別の読み取り／書き込みヘッドがサーボパルスを読み取
ったり、書き込んだりするのに設けられている。代表的
に言えば、記録されたサーボパルスはＤＡＳＤのインデ
ックスの位置を表示する周波数の２倍のパルス（二重パ
ルス）によってエンコード（符号化）される独特のパタ
ーンを含んでいる。第６図において、例えば、そのよう
な二重パルスはＤＡＳＤの１回転毎に一度だけインデッ
クスをエンコードするのに用いられている。図示された
例においては、コードは１−１−０−１−０であって。
この場合、１は二重パルスの１つを除くことによりエン
コードされ、０は二重パルスの両方を与えることによっ
てエンコードされる。
然しながら、サーボパルスの細部は本発明にとって重要
ではないことに注意すべきである。重要な点は、サーボ
パルスは、現用のＤＡＳＤで入手可能であり、回転速度
と回転位置を検出するのに使うことが出来、そして、本
発明に従って多重ＤＡＳＤを同期するのに使うことが出
来るということである。
基準クロック７０の出力は、ＤＡＳＤが所定の速度で回
転しているとき、各ＤＡＳＤのサーボ面上に記録されて
いるサーボパルスの速度に等しくなるような速度の基準
クロックパルスの列を与える適当に安定した水晶発振器
とカウンタによって発生される。（他の案として、サー
ボパルスの速度と基準クロックパルスとの比率を上述と
は異なったものにしてもよい。）更に、ＤＡＳＤインデ
ックスの位置に対応して、「基準インデックス」パルス
が基準クロックパルス列に挿入される。
「基準インデックス」パルスは、例えば第７図に示した
ような２倍のパルス幅を持ったパルスであって、基準ク
ロックパルスとは異なったパターンを持っている。（独
立した信号表示を含めて、このような基準インデックス
の他の符号化も可能である。）換言すれば、「基準イン
デックス」パルスは他の基準クロックパルスとは異なっ
た少なくとも１個のパルスである。この「基準インデッ
クス」パルスは、ＤＡＳＤが許容しつる公差内で基準ク
ロックパルスと同期したときに、最も早期で最も新しく
発生されるＤＡＳＤインデックスを表わす。ＤＡＳＤイ
ンデックスの間の基準クロックパルスを計数することｋ
よって、ＤＡＳＤの１回転に対応する時間を設定するこ
とが可能となる。
従って、基準インデックス・パルスを検出することによ
って、ＤＡＳＤインデックスの発生の時間を設定するこ
とが可能である。
サーボパルス検出器７２は、アクチュエータが現在位置
しているトラックにおいて、ＤＡＳＤ４６のサーボ面に
関連している読み取り／書き込みヘッドの出力信号を受
は取る。第５図及び第６図に示されているように、これ
らのパルスは実質的にはアナログ的な性質を有する。サ
ーボパルス検出器７２はサーボ信号増幅器と位相ロック
発振器（ｐｈａｓｅ　１ｏｃｋｅｄ　ｏｓｃｉｌｌａｔ
ｏｒ　−Ｐ　Ｌ　Ｏ）を含んでいる。ＰＬＯはサーボパ
ルスの周波数にロックされ、そして、その出力は読み取
られたアナログサーボパルスに対応するデジタルパルス
である。この装置は通常、各ＤＡＳＤに装着されており
、公知である。更に、ＤＡＳＤインデックスに対応した
サーボパルスの発生は、公知の適当なインデックス検出
手段によって検出され、そしてデジタルパルスがＤＡＳ
Ｄインデックスを表示するために与えられる。
位置検出器７４はサーボパルス検出器７２によって与え
られたデジタルパルスを計数するカウンタを含んでいる
。従って、この計数値はＤＡＳＤ４６の回転位置に対応
し、また、若し経過時間が与えられれば、その回転速度
に対応する。カウン夕は必要に応じて、例えばＤＡＳＤ
インデックスの発生毎にリセットされる。
比較器７６は、基準クロック７０からの入力パルスを計
数するカウンタを含んでいる。この計数値は、例えば基
準インデックスからの経過時間のような、前の基準点か
らの経過時間に対応する。
このカウンタは、例えば基準インデックスの発生時の１
回転に一度などのように、必要に応じて周期的にリセッ
トされる。基準クロックパルスの計数値は、位置検出器
７４中のサーボパルスの計数値と同期的に比較される。
若し基準クロックパルスの計数値がサーボパルスの計数
値よりも大きければ、ＤＡＳＤ４６は回転が遅いことを
意味し、若し基準クロックパルスの計数値がサーボパル
スの計数値よりも小さければ、ＤＡＳＤは回転が速いこ
とを意味する。この差の数値はＤＡＳＤ４６と基準クロ
ック７０との間の位相誤差の大きさである。
エラー表示はモータ・サーボ制御７８へ送られ、モータ
・サーボ制御において、その結果は、ＤＡＳＤモータ６
６を加速すべきかまたは減速すべきかについてフィード
バック・サーボ機構の規則に従って更に処理される。こ
の処理は、上述した計数値の差によって設定された回転
速度の前の値と、現在の値とを比較することと、モータ
を加速すべきか、または減速すべきかについて、ＤＡＳ
Ｄモータへの差信号を計算することと、サーボシステム
の行き過ぎ又は遅れ過ぎ及び発振を回避することとを含
む。サンプル及び訂正の率はモータの物理的特性の関数
である。このようなサーボモータのデザインは公知であ
る。
ＤＡＳＤ４６及び４８におけるＤＡＳＤインデックスは
同時に発生し、その結果、許容誤差の範囲内で他のすべ
ての回転位置も同時に生ずるように、基準クロック７０
から基準インデックスの検出と、サーボパルスからのＤ
ＡＳＤインデックスの検出とが、回転位置に関してＤＡ
ＳＤ４６及び４８を同期させるのを可能にする。これを
達成すすために、各ＤＡＳＤは、サーボパルスにより表
示されるＤＡＳＤインデックスと、基準クロック７０に
より表示される基準インデックスとが同時に発生するま
で、先づ加速される。次に、各ＤＡＳＤは位相誤差表示
を使って回転速度に関して同期され、許容公差範囲内で
エラー表示があるまで、回転速度を加速したり減速した
りする。
比較器７６は、ＤＡＳＤ４６が基準クロック７０と同期
されたか否かを表示する信号をコントロール・ユニット
１６に与え、更にまた、例えば、電源投入後とか、コン
トロール・ユニット１６からの特別の指示があったよう
な場合、同期を開始したときの表示がシステムに与えら
れる。これらの信号は、デバイス・インターフェース２
２及び２４を介して第２図のマイクロプロセッサ５２へ
転送し、またはマイクロプロセッサ５２から転送される
。煩雑さを避けるため、第１図及び第２図には、これに
関する詳細な接続国は省略しである。
第３図に示した同期制御ユニット５０の下部の構成の詳
細は記載しないが、この部分の機能は上部の構成と同じ
機能を有し、且つＤＡＳＤ４８は基準クロック７０で同
期されることは理解できるｆあろう、更に、この構成に
おいて、ＤＡＳＤモータ６６及び６８はＤＣ無刷子モー
タであってもよいし、回転速度を電気的に制御すること
の出来る他の形式のモータでもよいことは注意を要する
。
上述の説明から、ＤＡＳＤの同期は、ＣＰＵｌ０から独
立して、第３図に示した装置によって制御され維持され
る。更に、コントロール・ユニット１６中の同期バッフ
ァ６２及び６４は、第２図を参照して説明したように、
ＤＡＳＤの同期において機械的な公差を補償するのに使
うことが出来る。
第１図に示したように、本発明のデータ処理システムの
動作は、第８図を参照することにより、ただ１つのデー
タ転送路を通り、１８Ｍシステム３７０のアーキテクチ
ャ中のチャネル・コマンド・ワード（ＣＣＷ）として公
知の直列のコマンドを使って、どのようにして本発明の
目的を実現するかが理解出来る。ここで、ＤＡＳＤシス
テムはデータを記録するのにカウント−キー−データ（
Ｃｏｕｎｔ−Ｋｅｙ−Ｄａｔａ、　ＣＫ　Ｄ　）アーキ
テクチャを使うものと仮定する。
既に知られているように、第１図に示したＤＡＳＤの入
出力動作は、ＣＰＵｌ０が主メモリ（図示せず）から入
出力開始指令、即ち５ＴＡＲＴ　１７０インストラクシ
ヨンを呼び出すことで始まる。簡単に言うと、この入出
力のインストラクションは、例えば少なくとも１対のＤ
ＡＳＤ４６及び４８に事実上関係しているコントロール
・ユニットに送られ、例えばチャネル１２、コントロー
ル・ユニット１６及び選択された１対のＤＡＳＤ４６及
び４８を含むデータ転送路を設定する。、＊にＣＣＷの
チェインは、ＤＡＳＤ４６及び４８をアクセスするため
に、ＣＰＵ／Ｏの主メモリから、チャネル１２を経てコ
ントロール・ユニット１６へ転送され、そしてデータ転
送路を通ってすべてのデータを転送させる。従って、２
つの独立したＤＡＳＤへデータを同時に転送することは
、ＣＰＵｌ０及びその制御プログラムに対して透明、即
ち無関係になる。
第８図を参照すると、転送されるＣＣＷは、図示されて
いない探索コマンド、即ち５ＥＥＫコマンド、セクタの
設定コマンド、即ちＳＥＴ　５ＥＣＴＯＲコマンドまた
は位置付はコマンド、即ちＬＯＣＡＴＥコマンドである
。これらのコマンドは、所望の同じデータをＤＡＳＤ４
６及び４８に記録するために、チャネル１２を経てコン
トロール・ユニット１６へ転送される。この場合、ＤＡ
ＳＤ４６及び４８は、相互に回転的に同期されており、
且つ同じデータを記憶しているから、これらのＤＡＳＤ
は、デバイス・インターフェース２２及び２４を介して
、コントロール・ユニット１６により５ＥＥＫ動作及び
５ＥＴＳＥＣＴＯＲ動作を同時に開始することが出来、
その間、ＤＡＳＤはチャネル１２から切り離されている
。
ＤＡＳＤ４６及び４８の探索遅延及び回転遅延は同時に
生じ、従って、ＤＡＳＤが同期されていない従来のデー
タ処理装置に課せられていた余分な角樽を無くすことが
出来る。
５ＥＥＫ動作は、所望の同一のデータを記憶している所
定ののトラックに到達するために、夫々のＤＡＳＤアク
チュエータの機械的運動によって達成される。チャネル
１２及びコシトロール・ユニット１６は、アクチュエー
タがそれらの新しい位置へ移動している間、ＤＡＳＤ４
６及び４８から切り離される。アクチュエータが所定の
トラックに到着したとき、コントロール・ユニットは５
ＥＴＳＥＣＴＯＲ動作を遂行する。公知の回転位置感知
装置を装着したＤＡＳＤを使用した場合、この動作は、
所望のデータを含むセクタに近接する所定のセクタ上に
記録ヘッドが達したときをＤＡＳＤに表示することを含
んでいる。これらの所定のセクタが記録ヘッドの下を通
過するとき、ＤＡＳＤはこのことをコントロール・ユニ
ット１６へ表示し、コントロール・ユニット１６はチャ
ネル１２を介してＣＰＵｌ０へ再接続することを要求す
る。再接続が行われたとき、次に「書き込み」コマンド
が発生され、実行される。
「書き込み」コマンドを受は取ると、ＤＡＳＤ４６及び
４８に接続された２つの独立したデバイス・インターフ
ェース２２及び２４はＤＡＳＤ４６及び４８に記憶する
ために、ＣＰＵｌ０から受は取ったデータを同時に転送
する。この処理動作は記録されるべきバイトの数の計数
が完了するまで続き、この計数が完了したとき、「書き
込み」コマンド動作は終了し、そして、「デバイス終了
」状態情報がコントロール・ユニット１６からチャネル
１２へ送られて、ＤＡＳＤ４６及び４８（ＣＰＵＩＯに
は１個のＤＡＳＤとして見える）は次の使用に利用出来
ることを表示する。このようにして、「デバイス終了」
状態情報がＣＰＵｌ０へ送られたとき、即ち記録が完了
したときにおいて、同°じデータのコピーが事実上、Ｄ
ＡＳＤ４６及び４８に記録される。従って、上述の「デ
バイス終了」情報が１つのＤＡＳＤによってＣＰＬＩへ
送られた後は、従来の装置において存在した２番目のコ
ピーの可用性に関しての不確定性は本発明によって除去
することが出来る。
本発明を特定の実施例について説明して来たが、当業者
であれば、本発明の技術的思想の範囲を外れることなく
幾多の修正、変更を施すことが出来る。例えば、ディス
クのモータは、エンコード・シャフト回転装置などの幾
つかの手段によって、モータから位置的及び回転的の情
報を直接に得ることにより同期することが出来る。
Ｆ１発明の効果 上述したように、本発明は、ＣＰＵとコントロール・ユ
ニットとの間のただ１つのデータ転送路を使って、ホス
トＣＰＵからの同じデータの複数のコピーを複数のＤＡ
ＳＤ中に、同時に記録することによって、データ処理シ
ステムの全体的な性能を向上させる。
【図面の簡単な説明】 第１図は本発明に従ったデータ処理システムのブロック
図、第２図は１対の直後アクセス記憶装置（ＤＡＳＤ）
中に重複したデータを同時に記録するための第１図の各
コントロール・ユニットの必須部分のブロック図、第３
図は第１図の同期制御の内部構成のブロック図、第４図
はＤＡＳＤのディスク組立体と、インデックス部分を示
すサーボ面を説明するための模式図、第５図は第４図の
サーボ面に記録された通常のサーボパルス列を示すタイ
ミング図、第６図はインデックス符号化サーボパルスを
有する独特なサーボパルスを示すタイミング図、第７図
は第３図の基準クロック装置により発生された「インデ
ックス」を表わす２倍幅パルス及び基準パルス列を示す
タイミング図、第８図は中央処理装置（ＣＰＵ）又はチ
ャネルからＤＡＳＤのコントロール・ユニットへ、ある
いはコントロール・ユニットからＣＰＵ又はチャネルへ
の一組のコマンドであって、本発明を実施するために、
第１図のデータ処理システム中で実行されるコマンドの
概略を説明するための図である。 ／Ｏ・・・・ホストＣＰＵ、１２．１４・・・・チャネ
ル、１６，１８・・・・コントロール・ユニット、２２
．２４．２６．２８・・・・デバイス・インターフェー
ス、４２．４４・・・・ＤＡＳＤコントローラ、４６．
４８・・・・直接アクセス記憶装置（ＤＡＳＤ）、５０
・・・・同期制御ユニット、５４・・・・チャネル・イ
ンターフェース、６２，６４・・・・同期バッファ。 千ヤ木ｔし１２へ

Claims (2)

    【特許請求の範囲】
  1. （１）中央処理装置から同一のデータを、該中央処理装
    置と、複数の装置インターフエースをもち該各装置イン
    ターフエースが異なる直接アクセス記憶装置と通信する
    ような制御装置との間の単一のデータ転送路を介して該
    複数の直接アクセス記憶装置上に同時に記録するための
    方法であつて、（ａ）上記複数の直接アクセス記憶装置
    の同期化を開始してそれを維持する段階と、 （ｂ）上記装置インターフエースを介して上記同期化さ
    れた直接アクセス記憶装置上で所望の同一のレコードを
    同時に探索するために、上記中央処理装置から上記デー
    タ転送路を経て上記制御装置に所与の組のコマンドを転
    送する段階と、 （ｃ）上記転送路及び上記装置インターフエースを介し
    て上記同期化された直接アクセス記憶装置上の上記所望
    のレコードの位置上に上記同一のデータを同時に記録す
    るために、上記所望のレコードを見出したときに上記デ
    ータ転送路上で上記中央処理装置から上記制御装置に書
    込コマンドを転送する段階を有する、 データの多重コピー記録方法。
  2. （２）上記直接アクセス記憶装置が上記中央処理装置に
    よつて選択されるべき論理Ｉ／Ｏ装置として与えられて
    いる特許請求の範囲第（１）項に記載の方法。
JP62292268A 1987-02-26 1987-11-20 データの多重コピー記録方法 Granted JPS63216122A (ja)

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