JPS63180115A - 定電流回路 - Google Patents
定電流回路Info
- Publication number
- JPS63180115A JPS63180115A JP62011318A JP1131887A JPS63180115A JP S63180115 A JPS63180115 A JP S63180115A JP 62011318 A JP62011318 A JP 62011318A JP 1131887 A JP1131887 A JP 1131887A JP S63180115 A JPS63180115 A JP S63180115A
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- JP
- Japan
- Prior art keywords
- current
- output
- transistor
- trq3
- circuit
- Prior art date
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- Pending
Links
- 230000003503 early effect Effects 0.000 claims abstract description 8
- 230000000694 effects Effects 0.000 claims abstract description 5
- 238000010586 diagram Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 1
Landscapes
- Control Of Electrical Variables (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ラテラルトランジスタのアーリー効果による
出力電流変化を補償した定電流回路に関する。
出力電流変化を補償した定電流回路に関する。
カレントミラー回路と基準電流源とを組み合わせた定電
流回路として、第2図に示す回路がある。
流回路として、第2図に示す回路がある。
この回路は、FETQl、ツェナダイオードD1、抵抗
R1、及びトランジスタQ2により基準電流I II!
Fを流す基準電流源回路を構成し、このトランジスタQ
2に直列接続されたラテラルトランジスタQ3と別のラ
テラルトランジスタQ4によりカレントミラー回路を構
成して、後者のトランジスタQ4から定電流出力Ioを
取り出すようにしたものである。
R1、及びトランジスタQ2により基準電流I II!
Fを流す基準電流源回路を構成し、このトランジスタQ
2に直列接続されたラテラルトランジスタQ3と別のラ
テラルトランジスタQ4によりカレントミラー回路を構
成して、後者のトランジスタQ4から定電流出力Ioを
取り出すようにしたものである。
ところがこの回路は、基準電流111EFは電源電圧V
゛の変動に対して安定しているが、トランジスタQ4の
出力電流■0は不安定となる。これはラテラルトランジ
スタのアーリー効果、つまりトランジスタQ4が、電源
電圧■゛が増大するとベース幅変調効果によりhrtが
増大して出力電流I。
゛の変動に対して安定しているが、トランジスタQ4の
出力電流■0は不安定となる。これはラテラルトランジ
スタのアーリー効果、つまりトランジスタQ4が、電源
電圧■゛が増大するとベース幅変調効果によりhrtが
増大して出力電流I。
が増大するからである。
そこでこれを改善するために、第3図に示すように、電
源電圧■“の変動を抵抗R2を介してトランジスタQ2
のエミッタに帰還させ、基準電流I□Vを電源電圧変動
に応じて変化させるようにした回路が提案されている。
源電圧■“の変動を抵抗R2を介してトランジスタQ2
のエミッタに帰還させ、基準電流I□Vを電源電圧変動
に応じて変化させるようにした回路が提案されている。
しかしこの回路も、アーリー効果によるトランジスタQ
4のベース抵抗r0と抵抗R2とをバランスさせること
は困難であり、所期の効果を達成することは出来なかっ
た。
4のベース抵抗r0と抵抗R2とをバランスさせること
は困難であり、所期の効果を達成することは出来なかっ
た。
本発明の目的は、アーリー効果を補償して、安定した定
電流出力を得ることができるようにした定電流回路を提
供することである。
電流出力を得ることができるようにした定電流回路を提
供することである。
このために本発明は、カレントミラー回路と基準電流源
とから成る定電流回路において、上記カレントミラー回
路の一部の出力を上記基準電流源に負帰還させるように
構成した。
とから成る定電流回路において、上記カレントミラー回
路の一部の出力を上記基準電流源に負帰還させるように
構成した。
以下、本発明の実施例について説明する。第1図はその
一実施例の定電流回路を示す図である。
一実施例の定電流回路を示す図である。
本実施例では、トランジスタQ3に対してトランジスタ
Q4とは別のトランジスタQ5を接続し、トランジスタ
Q3とトランジスタQ4の組板外にトランジスタQ3と
トランジスタQ5の組でもカレントミラー回路を構成し
、そのトランジスタQ5の出力電流1o’をトランジス
タQ2のエミッタに帰還するようにした。なお、トラン
ジスタQ3、Q4、Q5はモノリシックIC内において
ラテラル構造で形成して、プロセスのバラツキにも拘わ
らず相似な特性を有するようにした。
Q4とは別のトランジスタQ5を接続し、トランジスタ
Q3とトランジスタQ4の組板外にトランジスタQ3と
トランジスタQ5の組でもカレントミラー回路を構成し
、そのトランジスタQ5の出力電流1o’をトランジス
タQ2のエミッタに帰還するようにした。なお、トラン
ジスタQ3、Q4、Q5はモノリシックIC内において
ラテラル構造で形成して、プロセスのバラツキにも拘わ
らず相似な特性を有するようにした。
よって、電源電圧■”が変動すると、トランジスタQ4
、Q5の出力電流To、Io’が変動するが、その比I
o / I o ’は変化せず一定であるので、アー
リー効果の大小に比例した量を基準電流源(トランジス
タQ2)に対して負帰還させることができ、出力電流1
oの電源電圧依存性を取り除くことができる。
、Q5の出力電流To、Io’が変動するが、その比I
o / I o ’は変化せず一定であるので、アー
リー効果の大小に比例した量を基準電流源(トランジス
タQ2)に対して負帰還させることができ、出力電流1
oの電源電圧依存性を取り除くことができる。
以上から本発明によれば、電源電圧が変動しても常に決
まった定電流出力を得ることができるようになる。
まった定電流出力を得ることができるようになる。
第1図は本発明の一実施例の定電流回路の回路図、第2
図と第3図は従来の同回路の回路図である。
図と第3図は従来の同回路の回路図である。
Claims (1)
- (1)、カレントミラー回路と基準電流源とから成る定
電流回路において、 上記カレントミラー回路の一部の出力を上記基準電流源
に負帰還させて、上記カレントミラー回路を構成するト
ランジスタのアーリー効果による出力電流変化を補償し
たことを特徴とする定電流回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62011318A JPS63180115A (ja) | 1987-01-22 | 1987-01-22 | 定電流回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP62011318A JPS63180115A (ja) | 1987-01-22 | 1987-01-22 | 定電流回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS63180115A true JPS63180115A (ja) | 1988-07-25 |
Family
ID=11774671
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP62011318A Pending JPS63180115A (ja) | 1987-01-22 | 1987-01-22 | 定電流回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS63180115A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04117006A (ja) * | 1990-08-31 | 1992-04-17 | Nec Ic Microcomput Syst Ltd | 電流供給回路 |
-
1987
- 1987-01-22 JP JP62011318A patent/JPS63180115A/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH04117006A (ja) * | 1990-08-31 | 1992-04-17 | Nec Ic Microcomput Syst Ltd | 電流供給回路 |
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