JPS63168040A - チツプキヤリアic装置 - Google Patents
チツプキヤリアic装置Info
- Publication number
- JPS63168040A JPS63168040A JP31102086A JP31102086A JPS63168040A JP S63168040 A JPS63168040 A JP S63168040A JP 31102086 A JP31102086 A JP 31102086A JP 31102086 A JP31102086 A JP 31102086A JP S63168040 A JPS63168040 A JP S63168040A
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- Japan
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- chip
- external connection
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- circuit board
- board
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
- 239000000758 substrate Substances 0.000 abstract description 27
- 238000003475 lamination Methods 0.000 abstract 2
- 238000000034 method Methods 0.000 abstract 1
- 239000000919 ceramic Substances 0.000 description 8
- 230000000694 effects Effects 0.000 description 3
- 238000004806 packaging method and process Methods 0.000 description 3
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 1
- 239000010931 gold Substances 0.000 description 1
- 229910052737 gold Inorganic materials 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K1/00—Printed circuits
- H05K1/02—Details
- H05K1/0296—Conductive pattern lay-out details not covered by sub groups H05K1/02 - H05K1/0295
- H05K1/0298—Multilayer circuits
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/30—Assembling printed circuits with electric components, e.g. with resistor
- H05K3/32—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits
- H05K3/34—Assembling printed circuits with electric components, e.g. with resistor electrically connecting electric components or wires to printed circuits by soldering
- H05K3/341—Surface mounted components
- H05K3/3431—Leadless components
-
- H—ELECTRICITY
- H05—ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
- H05K—PRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
- H05K3/00—Apparatus or processes for manufacturing printed circuits
- H05K3/36—Assembling printed circuits with other printed circuits
- H05K3/366—Assembling printed circuits with other printed circuits substantially perpendicularly to each other
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、セラミックキャリアにICチップを装着する
とともに、このセラミックキャリアに設けられた外部接
続電極にて回路基板に接続するように構成されたチップ
キャリアIC装置に関するものである。
とともに、このセラミックキャリアに設けられた外部接
続電極にて回路基板に接続するように構成されたチップ
キャリアIC装置に関するものである。
従来の技術
従来のチップキャリアIC装置11は、ff14図に示
すように方形平板状のセラミックキャリア12の中火部
にICチップ13が装着され、このICチップ13とセ
ラミックキャl) 712に形成されたパッドとが金ワ
イヤ14にてワイヤボンディングされで成り、前記セラ
ミックキャリア12にはその四周縁に前記パッドと配線
(図示せず)にて接続された外部接続電極15が配設さ
れている。
すように方形平板状のセラミックキャリア12の中火部
にICチップ13が装着され、このICチップ13とセ
ラミックキャl) 712に形成されたパッドとが金ワ
イヤ14にてワイヤボンディングされで成り、前記セラ
ミックキャリア12にはその四周縁に前記パッドと配線
(図示せず)にて接続された外部接続電極15が配設さ
れている。
そして、このチップキャリアIC装置11を回路基板1
6上に装着するとともに前記外部接続電極15を回路基
板16の配#117に接続するように構成されている。
6上に装着するとともに前記外部接続電極15を回路基
板16の配#117に接続するように構成されている。
発明が解決しようとする問題点
ところが、方形平板状のセラミックキャリア12の四周
縁に外部接続電極が配設されているので、外部接続電極
の数が多いと、セラミックキャリア12の一辺の長さが
艮くなってその平面積が大きくなり、回路基板16に対
する実装密度が低くなり、又セラミックキャリア12と
回路基[16の熱膨張差の影響を受は易く、外部接続電
極15と回路基板16の配線17どの接続部に接続不良
を生ずる虞れがあるという問題があった。
縁に外部接続電極が配設されているので、外部接続電極
の数が多いと、セラミックキャリア12の一辺の長さが
艮くなってその平面積が大きくなり、回路基板16に対
する実装密度が低くなり、又セラミックキャリア12と
回路基[16の熱膨張差の影響を受は易く、外部接続電
極15と回路基板16の配線17どの接続部に接続不良
を生ずる虞れがあるという問題があった。
本発明は上記従来の問題点に鑑み、回路基板に対する実
装密度が向上するとともに熱膨張差の彰でも受は難いチ
・/プキャリアIC9fiを提供することを目的とする
。
装密度が向上するとともに熱膨張差の彰でも受は難いチ
・/プキャリアIC9fiを提供することを目的とする
。
問題点を解決するための手段
本発明は上記目的を達成するため、多層基板を構成する
1つの基板にICチップを装着し、この多層基板の積層
方向の1つの側面に各基板毎に外部接続電極を配設し、
前記ICチップの接続端子をグループ分けしてそれぞれ
各基板の外部接続電極に接続したことを特徴とする。
1つの基板にICチップを装着し、この多層基板の積層
方向の1つの側面に各基板毎に外部接続電極を配設し、
前記ICチップの接続端子をグループ分けしてそれぞれ
各基板の外部接続電極に接続したことを特徴とする。
作用
本発明は上記構成を有しているので、多層基板の積層方
向に沿う1つの側面にICチップの接続端子に接続され
た外部接続電極が配設されており、この多層基板の前記
1つの側面を回路基板に接合して各外部接続電極を回路
基板の配線に接続することによって、チップキャリアI
C装置を装着することができる。そして、多層基板の1
つの側面にすべての外部接続電極が形成されているので
、チップキャリアICの回路基板に対する接合面積は小
さくて済み、チップキャ+77 I C装置の実装密度
が高くなる。又、多層基板を構成する基板は、ICチッ
プを装着できかつ1グループの接続端子を各基板の一側
端面の外部接続電極に接続できるだけの高さを有するだ
けでよいので、高さ方向のスペースが極端に大きくなる
ということもなく、全体としてコンパクトに構成できる
。又、回路基板との接合面積が小さくなるので熱膨張差
によるMp Mも受は難くなるのである。
向に沿う1つの側面にICチップの接続端子に接続され
た外部接続電極が配設されており、この多層基板の前記
1つの側面を回路基板に接合して各外部接続電極を回路
基板の配線に接続することによって、チップキャリアI
C装置を装着することができる。そして、多層基板の1
つの側面にすべての外部接続電極が形成されているので
、チップキャリアICの回路基板に対する接合面積は小
さくて済み、チップキャ+77 I C装置の実装密度
が高くなる。又、多層基板を構成する基板は、ICチッ
プを装着できかつ1グループの接続端子を各基板の一側
端面の外部接続電極に接続できるだけの高さを有するだ
けでよいので、高さ方向のスペースが極端に大きくなる
ということもなく、全体としてコンパクトに構成できる
。又、回路基板との接合面積が小さくなるので熱膨張差
によるMp Mも受は難くなるのである。
実施例
以下、本発明の一実施例を第1図〜第3図を参照しなが
ら説明する。
ら説明する。
第1図において、1は、チップキャリアIC装置であっ
て、4枚の基#i2a〜2dが積J〆された多層基板3
において1層目の基板2aの中央部にICチップ4が装
着されている。このICチップ4の4周に形成された多
数の接続端子はそれぞれ金ワイヤ5を用いたワイヤボン
ディングにて前記基板2aに形成されたパッド(図示せ
ず)に接続されている。これらパッドはICチップ4の
四辺に対応してその周囲に配設されており、その内のI
Cチップ4の一辺に対応するパッドはこの基板2aに形
成された配線6を介してこの基板2aの一側端面に形成
された外部接続電極7aに接続されている。又、他の各
辺に対応するパッドはそれぞれ2層目〜4層目の基板2
b〜2dに同様に形成された配線(図示せず)に、各基
板2a〜2Cを貫通して形成されたスルーホールを介し
て[1され、かつ2層目〜4層目の基@2b〜2dの配
線はそれぞれの基板の一側端面に形成された外部接続電
極713〜7dI:接続されている。前記各基板28〜
2dの一48nA面は多層基板3の積層方向の一側面3
aを構成するものであり、かつ前記外部接続電極78〜
7dは、tjS2図に示すように、この−側面3a上で
互いに短絡しないように千鳥状に配置されている。
て、4枚の基#i2a〜2dが積J〆された多層基板3
において1層目の基板2aの中央部にICチップ4が装
着されている。このICチップ4の4周に形成された多
数の接続端子はそれぞれ金ワイヤ5を用いたワイヤボン
ディングにて前記基板2aに形成されたパッド(図示せ
ず)に接続されている。これらパッドはICチップ4の
四辺に対応してその周囲に配設されており、その内のI
Cチップ4の一辺に対応するパッドはこの基板2aに形
成された配線6を介してこの基板2aの一側端面に形成
された外部接続電極7aに接続されている。又、他の各
辺に対応するパッドはそれぞれ2層目〜4層目の基板2
b〜2dに同様に形成された配線(図示せず)に、各基
板2a〜2Cを貫通して形成されたスルーホールを介し
て[1され、かつ2層目〜4層目の基@2b〜2dの配
線はそれぞれの基板の一側端面に形成された外部接続電
極713〜7dI:接続されている。前記各基板28〜
2dの一48nA面は多層基板3の積層方向の一側面3
aを構成するものであり、かつ前記外部接続電極78〜
7dは、tjS2図に示すように、この−側面3a上で
互いに短絡しないように千鳥状に配置されている。
このように多層基板3にICチップ4が装着されかつこ
の多層基板3の積層方向に沿う一側面3aに外部接続電
極7a〜7dが形成されたチップキャリアIC装置1は
、第3図に示すように、前記多層基板3の一側面3aを
接合面として回路基板8上に装着固定され、この−側面
3aに形成された各外部接続電極7a〜7dが回路基板
8の配#X(図示せず)と接続される。その際、多層基
板3の積層方向に沿う一画面3aにすべての外部接続電
極7a〜7dが形成されているので、チップキャリアI
C装置1の回路基板8に対する接合面積は小さく、チッ
プキャリアIC装置1の実装密度を高くすることができ
るのである。又、各基板2a〜2dは、ICチップ4を
装着できがっその接続端子を各基板2a〜2dの一側端
面の外部接続電極7a〜7dに接続する配線を形成でき
るだけの高さがあればよいので、高さ方向のスペースも
極端に大きくなるということもなく、全体としてコンパ
クトに構成できる。又、回路基板8との接合面積が小さ
くなるので熱膨張差による影響も受は難いのである。
の多層基板3の積層方向に沿う一側面3aに外部接続電
極7a〜7dが形成されたチップキャリアIC装置1は
、第3図に示すように、前記多層基板3の一側面3aを
接合面として回路基板8上に装着固定され、この−側面
3aに形成された各外部接続電極7a〜7dが回路基板
8の配#X(図示せず)と接続される。その際、多層基
板3の積層方向に沿う一画面3aにすべての外部接続電
極7a〜7dが形成されているので、チップキャリアI
C装置1の回路基板8に対する接合面積は小さく、チッ
プキャリアIC装置1の実装密度を高くすることができ
るのである。又、各基板2a〜2dは、ICチップ4を
装着できがっその接続端子を各基板2a〜2dの一側端
面の外部接続電極7a〜7dに接続する配線を形成でき
るだけの高さがあればよいので、高さ方向のスペースも
極端に大きくなるということもなく、全体としてコンパ
クトに構成できる。又、回路基板8との接合面積が小さ
くなるので熱膨張差による影響も受は難いのである。
発明の効果
本発明のチップキャリアIC装置によれば、以上のよう
に多層基板の積層方向に沿う1つの側面にすべての外部
接続電極が形成されでいるので、チップキャリアIC装
置の回路基板に対する接合面積が小さくて済み、チップ
キャリアIC装置の実装密度が高くなる。また、多層基
板を構成する基板はICを装着できかつその接続端子と
前記外部接続電極を接続できるだけの高さがあればよい
ので、高さ方向のスペースも比較的小さく、全体として
コンパクトに構成できる。又、回路基板との接合面積が
小さくなるので熱膨張差による影響も受は難くなる等、
大なる効果が得られる。
に多層基板の積層方向に沿う1つの側面にすべての外部
接続電極が形成されでいるので、チップキャリアIC装
置の回路基板に対する接合面積が小さくて済み、チップ
キャリアIC装置の実装密度が高くなる。また、多層基
板を構成する基板はICを装着できかつその接続端子と
前記外部接続電極を接続できるだけの高さがあればよい
ので、高さ方向のスペースも比較的小さく、全体として
コンパクトに構成できる。又、回路基板との接合面積が
小さくなるので熱膨張差による影響も受は難くなる等、
大なる効果が得られる。
第1図〜第3図は本発明の一実施例を示し、第1図はチ
ップキャ+77 I C装置の斜視図、第2図は第1図
の底面図、第3図はチップキャリアIC装置を回路基板
に装着した状態の概略斜視図、第4図は従来例の斜視図
である。 1・・・・・・・・・・・・・・・・・・・・・チップ
キャ177 I C装置2a〜2d・・・・・・・・・
基板 3・・・・・・・・・・・・・・・・・・・・・多層基
板4・・・・・・・・・・・・・・・・・・・・・IC
チップ7a〜7d・・・・・・・・・外部接続電極8・
・・・・・・・・・・・・・・・・・・・・回路基板。
ップキャ+77 I C装置の斜視図、第2図は第1図
の底面図、第3図はチップキャリアIC装置を回路基板
に装着した状態の概略斜視図、第4図は従来例の斜視図
である。 1・・・・・・・・・・・・・・・・・・・・・チップ
キャ177 I C装置2a〜2d・・・・・・・・・
基板 3・・・・・・・・・・・・・・・・・・・・・多層基
板4・・・・・・・・・・・・・・・・・・・・・IC
チップ7a〜7d・・・・・・・・・外部接続電極8・
・・・・・・・・・・・・・・・・・・・・回路基板。
Claims (1)
- 多層基板を構成する1つの基板にICチップを装着し、
この多層基板の積層方向の1つの側面に各基板毎に外部
接続電極を配設し、前記ICチップの接続端子をグルー
プ分けしてそれぞれ各基板の外部接続電極に接続したこ
とを特徴とするチップキャリアIC装置。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61311020A JPH0799767B2 (ja) | 1986-12-29 | 1986-12-29 | チツプキヤリアic装置 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP61311020A JPH0799767B2 (ja) | 1986-12-29 | 1986-12-29 | チツプキヤリアic装置 |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS63168040A true JPS63168040A (ja) | 1988-07-12 |
JPH0799767B2 JPH0799767B2 (ja) | 1995-10-25 |
Family
ID=18012150
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP61311020A Expired - Fee Related JPH0799767B2 (ja) | 1986-12-29 | 1986-12-29 | チツプキヤリアic装置 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPH0799767B2 (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0485825U (ja) * | 1990-11-28 | 1992-07-27 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS601848A (ja) * | 1983-05-25 | 1985-01-08 | カボット・テクニカル・セラミックス・インコ−ポレ−テッド | Ic装置パツケ−ジ用基板と製造法 |
JPS63141352A (ja) * | 1986-12-03 | 1988-06-13 | Nec Corp | 面実装集積回路モジユ−ル |
-
1986
- 1986-12-29 JP JP61311020A patent/JPH0799767B2/ja not_active Expired - Fee Related
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS601848A (ja) * | 1983-05-25 | 1985-01-08 | カボット・テクニカル・セラミックス・インコ−ポレ−テッド | Ic装置パツケ−ジ用基板と製造法 |
JPS63141352A (ja) * | 1986-12-03 | 1988-06-13 | Nec Corp | 面実装集積回路モジユ−ル |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0485825U (ja) * | 1990-11-28 | 1992-07-27 |
Also Published As
Publication number | Publication date |
---|---|
JPH0799767B2 (ja) | 1995-10-25 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
LAPS | Cancellation because of no payment of annual fees |