JPS6253734U - - Google Patents
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- Publication number
- JPS6253734U JPS6253734U JP12799386U JP12799386U JPS6253734U JP S6253734 U JPS6253734 U JP S6253734U JP 12799386 U JP12799386 U JP 12799386U JP 12799386 U JP12799386 U JP 12799386U JP S6253734 U JPS6253734 U JP S6253734U
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- JP
- Japan
- Prior art keywords
- circuit
- circuits
- flip
- flop
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- Pending
Links
- 230000004913 activation Effects 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 1
Description
図は本考案の優先選択回路の一実施例を示す回
路図である。 ＦＦ０〜ＦＦｎ……フリツプフロツプ回路、Ａ
ＮＤ０〜ＡＮＤｎ，ＩＣ１〜ＩＣｎ−１，ＡＮＤ
……論理積回路、ＮＡＤ０〜ＮＡＤｎ……否定論
理積回路、ＳＴ０〜ＳＴｎ……起動信号入力端子
、０〜ｎ……選択信号出力端子、ＣＬＲ０〜
ＣＬＲｎ……クリア端子。
路図である。 ＦＦ０〜ＦＦｎ……フリツプフロツプ回路、Ａ
ＮＤ０〜ＡＮＤｎ，ＩＣ１〜ＩＣｎ−１，ＡＮＤ
……論理積回路、ＮＡＤ０〜ＮＡＤｎ……否定論
理積回路、ＳＴ０〜ＳＴｎ……起動信号入力端子
、０〜ｎ……選択信号出力端子、ＣＬＲ０〜
ＣＬＲｎ……クリア端子。
Claims (1)
- 【実用新案登録請求の範囲】 優先選択すべき複数の回路の対応する回路から
の起動信号を受信する論理積回路をそれぞれの入
力端子に接続しかつ前記起動信号に応動したとき
送出する選択信号を論理反転する否定論理積回路
をそれぞれの出力端子に接続した複数のフリツプ
フロツプ回路と； 前記複数のフリツプフロツプ回路の出力端子に
それぞれ接続された複数の前記否定論理積回路の
出力端子に接続されこれらの否定論理積回路の少
なくとも１つから論理反転された前記選択信号が
入力されたとき前記複数のフリツプフロツプ回路
のそれぞれの入力端子に接続された複数の前記論
理積回路のゲートを閉じる論理積回路と； 前記複数のフリツプフロツプ回路の劣性側のフ
リツプフロツプ回路に対する選択動作を優性側の
フリツプフロツプ回路から保留するよう前記複数
のフリツプフロツプ回路を縦続接続する回路と； を備えたことを特徴とする優先選択回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12799386U JPS6253734U (ja) | 1986-08-22 | 1986-08-22 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12799386U JPS6253734U (ja) | 1986-08-22 | 1986-08-22 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6253734U true JPS6253734U (ja) | 1987-04-03 |
Family
ID=31023258
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12799386U Pending JPS6253734U (ja) | 1986-08-22 | 1986-08-22 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6253734U (ja) |
-
1986
- 1986-08-22 JP JP12799386U patent/JPS6253734U/ja active Pending
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