JPS6225323A - 音声蓄積システム - Google Patents
音声蓄積システムInfo
- Publication number
- JPS6225323A JPS6225323A JP16451985A JP16451985A JPS6225323A JP S6225323 A JPS6225323 A JP S6225323A JP 16451985 A JP16451985 A JP 16451985A JP 16451985 A JP16451985 A JP 16451985A JP S6225323 A JPS6225323 A JP S6225323A
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- JP
- Japan
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- audio storage
- storage devices
- audio
- data
- control circuit
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明は音声蓄積システムに関し、特に複数の音声蓄積
装置間に設りられた時分）ｙ多重スイッチを介してデー
タの転送をなすようにした音声蓄積システムに関する。
装置間に設りられた時分）ｙ多重スイッチを介してデー
タの転送をなすようにした音声蓄積システムに関する。
従来技術
従来、この種の音声蓄積システムは第２図に示す構成と
なっている。ずなわら、′１１数の音声蓄積装置１〜ｎ
があり、これ等音声蓄積装置１＝ｎ間には時分υ）多重
スイッチ８０が設けられてこのスイッチを介して各音声
蓄積装置が選択的に接続されるにうになっている。そし
で、これ′８音声蓄積装置１〜ｎを統括的に制御する共
通制御装置１０が設けられている。
なっている。ずなわら、′１１数の音声蓄積装置１〜ｎ
があり、これ等音声蓄積装置１＝ｎ間には時分υ）多重
スイッチ８０が設けられてこのスイッチを介して各音声
蓄積装置が選択的に接続されるにうになっている。そし
で、これ′８音声蓄積装置１〜ｎを統括的に制御する共
通制御装置１０が設けられている。
全ての音声蓄積装置１〜ｎの構成は同一であり、音声蓄
積装置１のみについて述べる。図示せぬホストシステム
と音声入出力線路１１を介してインタフェースする音声
インクフェース回路２１と、この音声インタフェース回
路２１に接続されてディジタル音声信号を一時記憶する
音声メモリ３１と、この音声メモリ３１とスイッチ８０
を介して接続されるディスク装置４１ど、音声メモリ３
１へのディジタル音声信号の書込み読み出しや、音声メ
モリとディスク装置との間にディジタル昌声信号の伝送
をなすスイッチ８０に対する選択接続指示や、更にはま
たディスク装置４１へのディジタル音声信号の書込み読
み出しを行うための１＋制御回路５１と、この制御回路
５１に接続されて装置間バスを介して各制御回路間をイ
ンタフェースする制御回路間インタフェース回路６１と
からなっている。
積装置１のみについて述べる。図示せぬホストシステム
と音声入出力線路１１を介してインタフェースする音声
インクフェース回路２１と、この音声インタフェース回
路２１に接続されてディジタル音声信号を一時記憶する
音声メモリ３１と、この音声メモリ３１とスイッチ８０
を介して接続されるディスク装置４１ど、音声メモリ３
１へのディジタル音声信号の書込み読み出しや、音声メ
モリとディスク装置との間にディジタル昌声信号の伝送
をなすスイッチ８０に対する選択接続指示や、更にはま
たディスク装置４１へのディジタル音声信号の書込み読
み出しを行うための１＋制御回路５１と、この制御回路
５１に接続されて装置間バスを介して各制御回路間をイ
ンタフェースする制御回路間インタフェース回路６１と
からなっている。
共通ルリ御装置１０は、装置間バスに接続された制御回
路間インタフェース回路６ｎ＋１と、この回路６ｎ＋１
を介して音声蓄積装置１〜０を制御する共通制御回路７
０とからなっている。
路間インタフェース回路６ｎ＋１と、この回路６ｎ＋１
を介して音声蓄積装置１〜０を制御する共通制御回路７
０とからなっている。
共通制御回路７０から各音声蓄積装置１〜ｎの各ディス
ク装置４１〜４ｎに対して各音声′？５ｖ１装置個別あ
るいは共通の音声信号のブイレフ１〜りの設定や待避を
行うために、データ転送を行う必要がある。この場合、
制御回路間インタフェース回路６１〜６ｎ＋１を介して
共通制御回路７０と各制御回路５１〜５ｎとの間の信号
経路を形成してデータ転送を実現するようになっている
。
ク装置４１〜４ｎに対して各音声′？５ｖ１装置個別あ
るいは共通の音声信号のブイレフ１〜りの設定や待避を
行うために、データ転送を行う必要がある。この場合、
制御回路間インタフェース回路６１〜６ｎ＋１を介して
共通制御回路７０と各制御回路５１〜５ｎとの間の信号
経路を形成してデータ転送を実現するようになっている
。
従って、一度に転送可能なデータ憬に限界があり、史（
こ、音声蓄積装置の夫々の制御回路５１〜５ｎを介して
迂回する形式となるために、転送処理効率及び信頼性の
低下を１Ｂ来するという欠点がある。
こ、音声蓄積装置の夫々の制御回路５１〜５ｎを介して
迂回する形式となるために、転送処理効率及び信頼性の
低下を１Ｂ来するという欠点がある。
発明の目的
本発明の目的は、共通制御装置と各音声蓄積装置との間
のデータ転送を簡１Ｖに効率良く行うことを可能とした
音声蓄積システムを提供することである。
のデータ転送を簡１Ｖに効率良く行うことを可能とした
音声蓄積システムを提供することである。
発明の構成
本発明による音声蓄積システムは、複数の音声蓄積装置
と、これ等音声蓄積装置間に設けられてこれ等音声蓄積
装置を相互選択接続する時分割多重スイッチと、前記音
声蓄積装置を統括制御する共通制御装置とを含む音声蓄
積システムであって、前記共通制御ｉｔ装置内に前記時
分割多重スイッチに接続されるデータメモリを設け、前
記音声蓄積装置の各々と前記データメモリとの間のデー
タの授受を前記時分割多重スイッチを介して行うように
したことを特徴としている。
と、これ等音声蓄積装置間に設けられてこれ等音声蓄積
装置を相互選択接続する時分割多重スイッチと、前記音
声蓄積装置を統括制御する共通制御装置とを含む音声蓄
積システムであって、前記共通制御ｉｔ装置内に前記時
分割多重スイッチに接続されるデータメモリを設け、前
記音声蓄積装置の各々と前記データメモリとの間のデー
タの授受を前記時分割多重スイッチを介して行うように
したことを特徴としている。
実施例
以下、図面を用いて本発明の詳細な説明する。
第１図は本発明の実施例のブロック図であり、第２図と
同等部分は同一符号により示されておりその説明は省略
する。
同等部分は同一符号により示されておりその説明は省略
する。
本発明では、各音声蓄積装置１〜ｎを統括制御する共通
制御装置１０内に、各音声蓄積装置１〜ｎに設けられた
個々の時分割スイッチの集合である時分υ１多重スイッ
チ８０にインタフェースし、かつこのスイッチ１０８を
介して各音声集積装置１〜ｎから相互選択可能なデータ
メモリ９０を設（〕だものである。
制御装置１０内に、各音声蓄積装置１〜ｎに設けられた
個々の時分割スイッチの集合である時分υ１多重スイッ
チ８０にインタフェースし、かつこのスイッチ１０８を
介して各音声集積装置１〜ｎから相互選択可能なデータ
メモリ９０を設（〕だものである。
ここで、各音声蓄積装置個別あるいは共通の音声信号の
ディレクトリの設定や待避を行うために、共通制御装置
１０内の共通制御回路７０から各音声蓄積装置１〜ｎの
ディスク装置４１〜４ｎに対してデータ転送をな″ｇ場
合、特にディスク装置４１〜４ｎへの書込みをなす場合
には、次のように制御される。予め共通制御回路７０に
よりデータメモリ９０に当該転送ずべぎデータを書込ｌ
υでおき、制御回路間インタフェース回路を介して占込
むべき目的のディスク装置を制御する制御回路に対して
、時分割条虫スイッチ８０を介してデータメモリ９０か
らのデータの引取りとディスク装置への占込みを指示す
る。
ディレクトリの設定や待避を行うために、共通制御装置
１０内の共通制御回路７０から各音声蓄積装置１〜ｎの
ディスク装置４１〜４ｎに対してデータ転送をな″ｇ場
合、特にディスク装置４１〜４ｎへの書込みをなす場合
には、次のように制御される。予め共通制御回路７０に
よりデータメモリ９０に当該転送ずべぎデータを書込ｌ
υでおき、制御回路間インタフェース回路を介して占込
むべき目的のディスク装置を制御する制御回路に対して
、時分割条虫スイッチ８０を介してデータメモリ９０か
らのデータの引取りとディスク装置への占込みを指示す
る。
ディスク装置からの読み出しのためにデータ転送をなす
場合には、共通制御回路７０から制闘回路間インクフェ
ース回路を介して読み出すべき目的のディスク装置を制
６１１する制御回路に対しで、ディスク装置からの読み
出しと時分割多重スイッチ８０を介してデークメ［す９
０へのデータ送出を指示するのである。
場合には、共通制御回路７０から制闘回路間インクフェ
ース回路を介して読み出すべき目的のディスク装置を制
６１１する制御回路に対しで、ディスク装置からの読み
出しと時分割多重スイッチ８０を介してデークメ［す９
０へのデータ送出を指示するのである。
発明の効果
叙上の如く、本発明によれば、各音声蓄積装置間に配設
される時分割多重スイッチに共通制御装置内に設けられ
たデータメモリを接続し、このスイッチを介して音声蓄
積装置のそれぞれからこのデータメモリを相互選択可能
とすることによって、共通制御装置と各音声蓄積装置と
の間のデータ転送を簡単にかつ効率良くなすことが可能
となる。
される時分割多重スイッチに共通制御装置内に設けられ
たデータメモリを接続し、このスイッチを介して音声蓄
積装置のそれぞれからこのデータメモリを相互選択可能
とすることによって、共通制御装置と各音声蓄積装置と
の間のデータ転送を簡単にかつ効率良くなすことが可能
となる。
第１図は本発明の実施例のブロック図、第２図は従来の
音声蓄積システムのブロック図である。 主要部分の符号の説明 １〜ｎ・・・音声蓄積装置 １０・・・・・・共通制御装置 ８０・・・・・・時分割多重スイッチ ９０・・・・・・データメモリ
音声蓄積システムのブロック図である。 主要部分の符号の説明 １〜ｎ・・・音声蓄積装置 １０・・・・・・共通制御装置 ８０・・・・・・時分割多重スイッチ ９０・・・・・・データメモリ
Claims (1)
- 複数の音声蓄積装置と、これ等音声蓄積装置間に設けら
れてこれ等音声蓄積装置を相互選択接続する時分割多重
スイッチと、前記音声蓄積装置を統括制御する共通制御
装置とを含む音声蓄積システムであつて、前記共通制御
装置内に前記時分割多重スイッチに接続されるデータメ
モリを設け、前記音声蓄積装置の各々と前記データメモ
リとの間のデータの授受を前記時分割多重スイッチを介
して行うようにしたことを特徴とする音声蓄積システム
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16451985A JPS6225323A (ja) | 1985-07-25 | 1985-07-25 | 音声蓄積システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16451985A JPS6225323A (ja) | 1985-07-25 | 1985-07-25 | 音声蓄積システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6225323A true JPS6225323A (ja) | 1987-02-03 |
Family
ID=15794703
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16451985A Pending JPS6225323A (ja) | 1985-07-25 | 1985-07-25 | 音声蓄積システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6225323A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0341854A (ja) * | 1989-06-20 | 1991-02-22 | Alcatel Nv | 自動交換機の音声メッセージ伝達装置 |
-
1985
- 1985-07-25 JP JP16451985A patent/JPS6225323A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0341854A (ja) * | 1989-06-20 | 1991-02-22 | Alcatel Nv | 自動交換機の音声メッセージ伝達装置 |
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