JPS62183682A - 映像回路 - Google Patents
映像回路Info
- Publication number
- JPS62183682A JPS62183682A JP61026163A JP2616386A JPS62183682A JP S62183682 A JPS62183682 A JP S62183682A JP 61026163 A JP61026163 A JP 61026163A JP 2616386 A JP2616386 A JP 2616386A JP S62183682 A JPS62183682 A JP S62183682A
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- Japan
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- circuit
- voltage
- signal
- cathode
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- Pending
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- 230000001105 regulatory effect Effects 0.000 claims description 3
- 239000003990 capacitor Substances 0.000 description 9
- 230000007423 decrease Effects 0.000 description 9
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
- 238000010894 electron beam technology Methods 0.000 description 1
Landscapes
- Picture Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野］
この発明は、テレビジョン受像機や各種ディスプレイモ
ニタなどにおける映像回路に関するものである。
ニタなどにおける映像回路に関するものである。
［従来の技術］
第２図は従来の映像回路を示す回路図である。
図において、Ｔｒｌは映像信号が入力されるトランジス
タ、Ｔｒ２は帰線消去用のトランジスタで、トランジス
タＴｒｉのエミッタは、抵抗Ｒ１およびコンデンサＣ１
の並列回路を介して、トランジスタＴｒ２のコレクタに
接続されている。トランジスタＴｒｉのコレクタは、抵
抗Ｒ２を介して、電源Ｂｌに接続されている。トランジ
スタＴｒ２のエミッタは接地されている。
タ、Ｔｒ２は帰線消去用のトランジスタで、トランジス
タＴｒｉのエミッタは、抵抗Ｒ１およびコンデンサＣ１
の並列回路を介して、トランジスタＴｒ２のコレクタに
接続されている。トランジスタＴｒｉのコレクタは、抵
抗Ｒ２を介して、電源Ｂｌに接続されている。トランジ
スタＴｒ２のエミッタは接地されている。
トランジスタＴｒｌのコレクタは、抵抗Ｒ３を介して、
トランジスタＴｒ４のベースに接続されている。トラン
ジスタＴｒ４のエミッタには、トランジスタＴｒ３のエ
ミッタが接続されている。トランジスタＴｒ３のベース
は、ダイオードＤＩおよびコンデンサＣ２の並列回路を
介して、トランジスタＴｒ４のベースに接続されている
とともに、抵抗Ｒ４を介して、電源Ｂｌに接続されてい
る。トランジスタＴｒ４のコレクタは、抵抗Ｒ５を介し
て接地されている。トランジスタＴｒ３のコレクタは、
抵抗Ｒ６、抵抗Ｒ７、および可変抵抗ＶＲＩを介して、
電源Ｂ２に接続されている。抵抗Ｒ６と抵抗Ｒ７との接
続点は電源Ｂｌに接続されている。トランジスタＴｒ４
とトランジスタＴｒ３とは、映像出力を増幅する増幅回
路であるＳ Ｅ Ｐ Ｐ （Ｓｉｎｇｌｅ Ｅｎｄｅｄ
Ｐｕ５ｈ Ｐｕ１ｌ）回路を構成している。
トランジスタＴｒ４のベースに接続されている。トラン
ジスタＴｒ４のエミッタには、トランジスタＴｒ３のエ
ミッタが接続されている。トランジスタＴｒ３のベース
は、ダイオードＤＩおよびコンデンサＣ２の並列回路を
介して、トランジスタＴｒ４のベースに接続されている
とともに、抵抗Ｒ４を介して、電源Ｂｌに接続されてい
る。トランジスタＴｒ４のコレクタは、抵抗Ｒ５を介し
て接地されている。トランジスタＴｒ３のコレクタは、
抵抗Ｒ６、抵抗Ｒ７、および可変抵抗ＶＲＩを介して、
電源Ｂ２に接続されている。抵抗Ｒ６と抵抗Ｒ７との接
続点は電源Ｂｌに接続されている。トランジスタＴｒ４
とトランジスタＴｒ３とは、映像出力を増幅する増幅回
路であるＳ Ｅ Ｐ Ｐ （Ｓｉｎｇｌｅ Ｅｎｄｅｄ
Ｐｕ５ｈ Ｐｕ１ｌ）回路を構成している。
可変抵抗ＶＲＩの可変出力端子には、コンデンサＣ３、
抵抗Ｒ８、およびダイオードＤ２が接続されており、こ
れらによってダイオードクランプ回路が構成されている
。トランジスタＴｒ３．Ｔｒ４の各エミッタの接続点は
、抵抗Ｒ３およびコンデンサＣ４，Ｃ５を介して、ダイ
オードＤ２の７ノードに接続されている。Ｃ８，Ｃ７は
、それぞれ電源Ｂｌ、Ｂ２とアースとの間に挿入された
コンデンサである。５ＥＰＰ回路を構成するトランジス
タＴｒ４．Ｔｒ３の出力は、抵抗ＲＩＯを介して受像管
ＣＲＴのカソードＫに接続されている。
抵抗Ｒ８、およびダイオードＤ２が接続されており、こ
れらによってダイオードクランプ回路が構成されている
。トランジスタＴｒ３．Ｔｒ４の各エミッタの接続点は
、抵抗Ｒ３およびコンデンサＣ４，Ｃ５を介して、ダイ
オードＤ２の７ノードに接続されている。Ｃ８，Ｃ７は
、それぞれ電源Ｂｌ、Ｂ２とアースとの間に挿入された
コンデンサである。５ＥＰＰ回路を構成するトランジス
タＴｒ４．Ｔｒ３の出力は、抵抗ＲＩＯを介して受像管
ＣＲＴのカソードＫに接続されている。
ＦＢＴはフライバックトランスで、その１次側には、水
平出力−トランジスタＴｒ５が接続されている。このト
ランジスタＴｒ５のコレクタ・エミッタ間には、ダンパ
ーダイオードＤ３およびコンデンサＣ８の並列回路が接
続されている。ＤＹはトランジスタＴｒ５のコレクタに
接続されている偏向コイルである。
平出力−トランジスタＴｒ５が接続されている。このト
ランジスタＴｒ５のコレクタ・エミッタ間には、ダンパ
ーダイオードＤ３およびコンデンサＣ８の並列回路が接
続されている。ＤＹはトランジスタＴｒ５のコレクタに
接続されている偏向コイルである。
フライバックトランスＦＢＴの２次側は、受像管ＣＲＴ
のアノードＡに接続されている。また、フライバックト
ランスＦＢＴの２次側には、可変抵抗ＶＲ２が接続され
ており、そのフォーカス調整出力ＦＯＣＵＳおよびスク
リーン調整出力５ＣＲＥＥＮは、受像管ＣＲＴのグリッ
ド電極に接続されている。なお、Ｒ１１は抵抗、Ｃ９は
コンデンサ、Ｈは受像管ＣＲＴのヒータである。
のアノードＡに接続されている。また、フライバックト
ランスＦＢＴの２次側には、可変抵抗ＶＲ２が接続され
ており、そのフォーカス調整出力ＦＯＣＵＳおよびスク
リーン調整出力５ＣＲＥＥＮは、受像管ＣＲＴのグリッ
ド電極に接続されている。なお、Ｒ１１は抵抗、Ｃ９は
コンデンサ、Ｈは受像管ＣＲＴのヒータである。
上記構成において、映像信号はトランジスタＴｒ１のベ
ースに与えられる。ここで、トランジスタＴｒ２のベー
スにパルス信号ＢＬＫが印加されていない期間は帰線消
去期間であり、この間はトランジスタＴｒ２がカットオ
フとなるため、トランジスタＴｒｉは作動せず、トラン
ジスタＴｒｉのコレクタに映像出力は現れない、他方、
トランジスタＴｒ２のベースにパルス信号ＢＬＫが印加
されている期間は、トランジスタＴｒ２が導通状態とな
ってトランジスタＴｒｉが作動し、トランジスタＴｒｌ
のコレクタに映像出力が現われる。
ースに与えられる。ここで、トランジスタＴｒ２のベー
スにパルス信号ＢＬＫが印加されていない期間は帰線消
去期間であり、この間はトランジスタＴｒ２がカットオ
フとなるため、トランジスタＴｒｉは作動せず、トラン
ジスタＴｒｉのコレクタに映像出力は現れない、他方、
トランジスタＴｒ２のベースにパルス信号ＢＬＫが印加
されている期間は、トランジスタＴｒ２が導通状態とな
ってトランジスタＴｒｉが作動し、トランジスタＴｒｌ
のコレクタに映像出力が現われる。
このようにして帰線消去がかけられた映像信号は、トラ
ンジスタＴｒ３．Ｔｒ４からなる５ＥＰＰ回路で増幅さ
れ、その出力は、コンデンサＣ３、抵抗Ｒ８、およびダ
イオードＤ２によって構成されるダイオードクランプ回
路によって、可変抵抗ＶＲ１で決まるＣ点の電位にブラ
ンキングレベルが固定されて、受像管ＣＲＴのカソード
Ｋに供給される。
ンジスタＴｒ３．Ｔｒ４からなる５ＥＰＰ回路で増幅さ
れ、その出力は、コンデンサＣ３、抵抗Ｒ８、およびダ
イオードＤ２によって構成されるダイオードクランプ回
路によって、可変抵抗ＶＲ１で決まるＣ点の電位にブラ
ンキングレベルが固定されて、受像管ＣＲＴのカソード
Ｋに供給される。
高圧回路においては、水平出力の帰線期間に、トランジ
スタＴｒ５のコレクタ電流がしゃ断されることによって
発生する高圧パルスを、フライバックトランスＦＢＴで
昇圧し、これを受像管ＣＲＴの７ノードＡに供給する。
スタＴｒ５のコレクタ電流がしゃ断されることによって
発生する高圧パルスを、フライバックトランスＦＢＴで
昇圧し、これを受像管ＣＲＴの７ノードＡに供給する。
フォーカス調整出力ＦＯＣＵＳは、カソードＫから発射
される電子ビームを受像管ＣＲＴの蛍光スクリーン上に
集束させるために必要なグリッド電圧を調整するための
ものであり、また、スクリーン調整出力５ＣＲＥＥＮは
蛍光スクリーンの輝度を調整するためのものである。
される電子ビームを受像管ＣＲＴの蛍光スクリーン上に
集束させるために必要なグリッド電圧を調整するための
ものであり、また、スクリーン調整出力５ＣＲＥＥＮは
蛍光スクリーンの輝度を調整するためのものである。
［発明が解決しようとする問題点］
上記のような従来の映像回路においては、受像管ＣＲＴ
のカソードＫに印加される信号のブランキングレベルは
、ダイオードクランプ回路によって、１１ｆ変抵抗ＶＲ
Ｉで決まるＣ点の電位に固定されるため、安定している
。
のカソードＫに印加される信号のブランキングレベルは
、ダイオードクランプ回路によって、１１ｆ変抵抗ＶＲ
Ｉで決まるＣ点の電位に固定されるため、安定している
。
しかしながら、高圧回路においては、信号の振幅の大小
や信号の種類などによって７ノード電流が変動し、この
ため、７ノードＡから可変抵抗ＶＲ２によって分圧して
得ているスクリーン電圧も変動する。その結果、受像管
ＣＲＴのスクリーングリッドとカソード間の電圧が変化
し、あたかもＣ点の電位が信号の変化によって変動して
いるかのようになって、輝度が不安定になるという欠点
があった。
や信号の種類などによって７ノード電流が変動し、この
ため、７ノードＡから可変抵抗ＶＲ２によって分圧して
得ているスクリーン電圧も変動する。その結果、受像管
ＣＲＴのスクリーングリッドとカソード間の電圧が変化
し、あたかもＣ点の電位が信号の変化によって変動して
いるかのようになって、輝度が不安定になるという欠点
があった。
この発明は上記従来の欠点を除去するためになされたも
ので、スクリーングリッドとカソード間の電圧を一定に
して、安定した輝度特性の得られる映像回路を提供する
ことを目的としている。
ので、スクリーングリッドとカソード間の電圧を一定に
して、安定した輝度特性の得られる映像回路を提供する
ことを目的としている。
［問題点を解決するための手段］
この発明にかかる映像回路は、映像４８号が入力される
第１のトランジスタと、この第１のトランジスタの映像
出力を増幅する増幅回路と、この増幅回路の出力レベル
を規制するクランプ回路とを備え、上記クランプ回路で
レベルを規制された信号を受像管のカソードへ供給する
ようにした映像回路において、上記第１のトランジスタ
に流れる電流の変化を検知する第２のトランジスタを設
け、この第２のトランジスタの出力にもとづいて上記ク
ランプ回路のクランプレベルを制御するようにしたこと
を特徴とする。
第１のトランジスタと、この第１のトランジスタの映像
出力を増幅する増幅回路と、この増幅回路の出力レベル
を規制するクランプ回路とを備え、上記クランプ回路で
レベルを規制された信号を受像管のカソードへ供給する
ようにした映像回路において、上記第１のトランジスタ
に流れる電流の変化を検知する第２のトランジスタを設
け、この第２のトランジスタの出力にもとづいて上記ク
ランプ回路のクランプレベルを制御するようにしたこと
を特徴とする。
［作用］
この発明においては、たとえば信号の振幅が増大した場
合には、第１のトランジスタに流れる電流が増大し、こ
の電流の増加を第２のトランジスタが検知する。一方、
信号の振幅が増大すると、受像管ＣＲＴの７ノード′尼
圧が低下し、これにともなって、スクリーン電圧も低下
して輝度が下がろうとするが、−上記第２のトランジス
タが、クランプ回路のクランプレベルを制御して、カソ
ードにの゛電位を下げる。これによって、スクリーング
リッドとカソードに間の、に圧は一定に保たれることに
なり、信号の変化による輝度の変化が補償される。
合には、第１のトランジスタに流れる電流が増大し、こ
の電流の増加を第２のトランジスタが検知する。一方、
信号の振幅が増大すると、受像管ＣＲＴの７ノード′尼
圧が低下し、これにともなって、スクリーン電圧も低下
して輝度が下がろうとするが、−上記第２のトランジス
タが、クランプ回路のクランプレベルを制御して、カソ
ードにの゛電位を下げる。これによって、スクリーング
リッドとカソードに間の、に圧は一定に保たれることに
なり、信号の変化による輝度の変化が補償される。
［実施例］
以下、この発明の実施例を図面にしたがって説明する。
第１図はこの発明による映像回路の実施例を示す回路図
である０図において、第２図と同一部分には同一符号を
付して詳しい説明は省略する。
である０図において、第２図と同一部分には同一符号を
付して詳しい説明は省略する。
第１図の回路は、以下に述べる構成が第２図のものと異
なっている。すなわち、電源Ｂｌと抵抗Ｒ２との間には
抵抗Ｒ１２が接続されており、また、電ｉＢｌにはトラ
ンジスタＴｒ６のベースが接続されている。このトラン
ジスタＴｒ８のエミッタは、抵抗Ｒ１３を介して、抵抗
Ｒ１２と抵抗Ｒ２との接続点に接続されている。さらに
、トランジスタＴｒ８のコレクタは、抵抗ＲＩ４、抵抗
Ｒ１５を介して、電源Ｂ２に接続されている。抵抗Ｒ１
４と抵抗ＲＩ５との接続点は、可変抵抗ＶＲＩに接続さ
れている。
なっている。すなわち、電源Ｂｌと抵抗Ｒ２との間には
抵抗Ｒ１２が接続されており、また、電ｉＢｌにはトラ
ンジスタＴｒ６のベースが接続されている。このトラン
ジスタＴｒ８のエミッタは、抵抗Ｒ１３を介して、抵抗
Ｒ１２と抵抗Ｒ２との接続点に接続されている。さらに
、トランジスタＴｒ８のコレクタは、抵抗ＲＩ４、抵抗
Ｒ１５を介して、電源Ｂ２に接続されている。抵抗Ｒ１
４と抵抗ＲＩ５との接続点は、可変抵抗ＶＲＩに接続さ
れている。
次に動作について説明する。いま、トランジスタＴｒｉ
のベースに印加される信号の振幅が大きくなったとする
と、トランジスタＴｒｉのコレクタに流れる電流も増大
する。このため、抵抗Ｒ１２の両端の電圧降下が大きく
なり、トランジスタＴｒｏｔのベース電流が増加する。
のベースに印加される信号の振幅が大きくなったとする
と、トランジスタＴｒｉのコレクタに流れる電流も増大
する。このため、抵抗Ｒ１２の両端の電圧降下が大きく
なり、トランジスタＴｒｏｔのベース電流が増加する。
したがって、トランジスタＴｒｆｌのコレクタ電流も増
加するから、抵抗Ｒ１５の電圧降下が大きくなる。その
結果、Ｃ点の電位は下がり、クランプ回路のクランプレ
ベルが低下する。
加するから、抵抗Ｒ１５の電圧降下が大きくなる。その
結果、Ｃ点の電位は下がり、クランプ回路のクランプレ
ベルが低下する。
一方、信号の振幅が増大すると、受像管ＣＲＴの７メー
ド電圧が低下するので、スクリーン調整出力５ＣＲＥＥ
Ｎの電圧も低下して輝度が下がろうとする。しかしなが
ら、上記のように、Ｃ点の゛電位がトランジスタＴｒ６
によって制御されて、クランプ回路のクランプレベルが
低下するために。
ド電圧が低下するので、スクリーン調整出力５ＣＲＥＥ
Ｎの電圧も低下して輝度が下がろうとする。しかしなが
ら、上記のように、Ｃ点の゛電位がトランジスタＴｒ６
によって制御されて、クランプ回路のクランプレベルが
低下するために。
受像管ＣＲＴのカソードにの電位も下がり、スクリーン
グリッドとカソードに間の電圧が一定に保たれる。この
結果、信号の振幅の増大による輝度の低下が補償され、
安定した黒レベルを得ることができる。
グリッドとカソードに間の電圧が一定に保たれる。この
結果、信号の振幅の増大による輝度の低下が補償され、
安定した黒レベルを得ることができる。
［発明の効果］
以上のように、この発明によれば、映像回路の電流変化
を検知して受像管のカソード電圧を制御するようにした
ので、信号の変化による輝度の変動を補償することがで
き、いかなる信号に対しても安定した黒レベルが得られ
る効果がある。
を検知して受像管のカソード電圧を制御するようにした
ので、信号の変化による輝度の変動を補償することがで
き、いかなる信号に対しても安定した黒レベルが得られ
る効果がある。
第１図はこの発明による映像回路の実施例を示す回路図
、第２図は従来の映像回路の回路図である。 Ｔｒｉ、 Ｔｒ３． Ｔｒ４． Ｔｒ８− ）ランジス
タ、Ｃ３・・・コンデンサ、Ｒ８・・・抵抗、Ｄ２・・
・ダイオード。 ＣＲＴ・・・受像管、Ｋ・・・カソード。 なお、図中、同一符号は同一または相当部分を示す。
、第２図は従来の映像回路の回路図である。 Ｔｒｉ、 Ｔｒ３． Ｔｒ４． Ｔｒ８− ）ランジス
タ、Ｃ３・・・コンデンサ、Ｒ８・・・抵抗、Ｄ２・・
・ダイオード。 ＣＲＴ・・・受像管、Ｋ・・・カソード。 なお、図中、同一符号は同一または相当部分を示す。
Claims (1)
- （１）映像信号が入力される第１のトランジスタと、こ
の第１のトランジスタの映像出力を増幅する増幅回路と
、この増幅回路の出力レベルを規制するクランプ回路と
を備え、上記クランプ回路でレベルを規制された信号を
受像管のカソードへ供給するようにした映像回路におい
て、上記第１のトランジスタに流れる電流の変化を検知
する第２のトランジスタを設け、この第２のトランジス
タの出力にもとづいて上記クランプ回路のクランプレベ
ルを制御するようにしたことを特徴とする映像回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61026163A JPS62183682A (ja) | 1986-02-08 | 1986-02-08 | 映像回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61026163A JPS62183682A (ja) | 1986-02-08 | 1986-02-08 | 映像回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62183682A true JPS62183682A (ja) | 1987-08-12 |
Family
ID=12185881
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61026163A Pending JPS62183682A (ja) | 1986-02-08 | 1986-02-08 | 映像回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62183682A (ja) |
-
1986
- 1986-02-08 JP JP61026163A patent/JPS62183682A/ja active Pending
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