JPS62176314A - 差動増幅回路 - Google Patents

差動増幅回路

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Publication number
JPS62176314A
JPS62176314A JP61019401A JP1940186A JPS62176314A JP S62176314 A JPS62176314 A JP S62176314A JP 61019401 A JP61019401 A JP 61019401A JP 1940186 A JP1940186 A JP 1940186A JP S62176314 A JPS62176314 A JP S62176314A
Authority
JP
Japan
Prior art keywords
circuit
differential amplifier
emitter
transistor
darlington
Prior art date
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Pending
Application number
JP61019401A
Other languages
English (en)
Inventor
Katsuharu Kimura
克治 木村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は差動増幅器に関し、特にレベルシフト出力を持
つダーリントン接続された差動増幅器に関する。
〔従来の技術〕
従来、この種の差動増幅器のレベルシフト回路は、第４
図に示すようなエミッタフォロワ回路を介して行ってい
た。
〔発明が解決しようとする問題点〕
上述した従来の差動増幅器のレベルシフト回路は第４図
に示すようにエミッタフォロワ回路となりているので、
回路電流が大きくなｆｉＩ。＋２Ｉ０となる。
また、一般に定電流源工。、Ｉ、はそれぞれトランジス
タ１個以上で構成するか、あるいは等測的に大きな抵抗
で代用されるが、２つの定電流源工、の分だけ、ＩＣ化
した場合にはレイアウトのスベースが余分にいる。
〔問題点を解決するための手段〕
本発明の差動増幅回路は、ダーリントン接続された２対
のトランジスタペアを有している。
〔実施例〕
第１図は本発明の一実施例である。
トランジスタＱｌ、Ｑ２およびトランジスタＱ３゜Ｑ４
はダーリントン接続されている。トランジスタＱｌのベ
ースとトランジスタＱ３のベースは差動増幅器の入力対
を構成している。一方トランジスタＱ１のエミッタとト
ランジスタＱ３のエミッタは対としてみたときに、入力
に対してＶＢＥＩ。
ＶＢＢ３だけレベルシフトされた電圧が生じるエミッタ
フォロワ回路とみなせる。
第２図は第１図のトランジスタＱ１〜Ｑ４のレイアウト
図を示している。
第３図は本発明の回路を多段縦接続した電界検出機能付
ＩＰ増幅器の例である。各差動増幅器に接続される２重
平衡型差動増幅器のと間には第４図に示すレベルシフト
用のエミッタフォロワ回路が不要となシ、従ってエミッ
タフォロワ回路を構成する２重個の定電流源を減らせら
れ、その分、電流値とレイアウト上のスベースを減らせ
られる。
特にダーリントン接続するととＫよシ第２図に示すよう
にコレクタが共通の２個のトランジスタはよく知られて
いる手法であるが、同一のコレクタ領域内に実現出来る
ためＫよシ一層レイアウト上のスベースが削減できる。
〔発明の効果〕
以上説明したように、本発明はダーリントン接！された
２対のトランジスタペアに上り差動増幅器を構成し、入
力対を構成するトランジスタのおのおののエミッタよシ
他の回路へ信号供給することにより、レベルシフト用の
エミッタフォロワ回路を省略できる効果があシ、レイア
ウト上のスベースを縮小でき、また回路電流を減らせら
れる効果がある。
【図面の簡単な説明】
第１図は本発明を実現する回路である。 Ｑｌ〜Ｑ４・・・・・・トランジスタ Ｒ１，Ｒ２・・・・・・抵抗 工◎・・・・・・定電流源 第２図は本発明の回路でトランジスタＱ１〜Ｑ４をレイ
アウトした配置図である。 第３図は本発明の応用回路例であシ、電界検出機能付Ｉ
Ｐ増幅回路である。 Ｑｏｏｓ〜す石・・・・・・トランジスタＲＯＯＩ〜Ｒ
ｎ、・・・・・・抵抗 Ｃ００Ｉ〜ｃｏｏｓ・・・・・・コンデンサ１１゜ｅ　
”＊・・・・・・定電流源 ＶＢ、ＶＲ・・・・・・電界検出電圧 第４図は従来のエミッタフォロア型のレベルシフト回路
である。 ′Ｘ５１　図 ７１！５Ｚ図

Claims (1)

    【特許請求の範囲】
  1. ダーリントン接続された第１および第２のトランジスタ
    とダーリントン接続された第３および第４のトランジス
    タとを差動型式に接続し、上記第１のトランジスタのベ
    ースと上記第３のトランジスタのベースを入力対とし、
    上記第１のトランジスタのエミッタと上記第３のトラン
    ジスタのエミッタをレベルシフト出力対とすることを特
    徴とする差動増幅回路。
JP61019401A 1986-01-30 1986-01-30 差動増幅回路 Pending JPS62176314A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0440104A (ja) * 1990-06-06 1992-02-10 Agency Of Ind Science & Technol 超高周波ダイオード発振器の位相同期回路

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS52132659A (en) * 1976-04-29 1977-11-07 Sony Corp Differential amplifier
JPS60246108A (ja) * 1984-05-22 1985-12-05 Nec Corp 中間周波増幅器

Patent Citations (2)

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