JPS62145758A - パラジウムを用いる銅製ボンデイングパツドの酸化防止法 - Google Patents
パラジウムを用いる銅製ボンデイングパツドの酸化防止法Info
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- H01L2924/1901—Structure
- H01L2924/1904—Component type
- H01L2924/19043—Component type being a resistor
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は一般に半導体デバイス上の銅製ボンディングパ
ッドとリードフレームまだは他の外部回路部品とのテー
プ式自動化ボンデインダに関する。
ッドとリードフレームまだは他の外部回路部品とのテー
プ式自動化ボンデインダに関する。
よシ詳細には、本発明は銅製ボンディングパッド上にお
ける酸化防止に関する。
ける酸化防止に関する。
テープ式自動化ボンディング法は、半導体デバイス上の
複数のポンプインクパッドを一般にデバイスが取シ付け
られるリードフレーム上のリード線に接続することによ
シ外部回路部品に同時に接続するための方法である。ボ
ンディングパッドは通常銅製であシ、半導体デバイスの
大刀端子および出力端子を形成する。
複数のポンプインクパッドを一般にデバイスが取シ付け
られるリードフレーム上のリード線に接続することによ
シ外部回路部品に同時に接続するための方法である。ボ
ンディングパッドは通常銅製であシ、半導体デバイスの
大刀端子および出力端子を形成する。
テープ式自動化ボンディングは、短いコネクタービーム
が形成された金属テープ、一般に薄い銅テープまたは銅
めっきテープを用いて行われる。テープを半導体デバイ
スに整列させることにょシ、これらのコネクタービーム
の内端を1回の操作(一般に熱圧着またはりフロー)で
半導体デバイス上のボンディングパッドにポンプインク
して内側リードボンドを形成することができる。内側リ
ードボンド9が形成されたのち、コネクタービームの外
端とり一ト9フレームのリード線との間に外側リードボ
ンドを形成し、余分なテープを切シ取る。
が形成された金属テープ、一般に薄い銅テープまたは銅
めっきテープを用いて行われる。テープを半導体デバイ
スに整列させることにょシ、これらのコネクタービーム
の内端を1回の操作(一般に熱圧着またはりフロー)で
半導体デバイス上のボンディングパッドにポンプインク
して内側リードボンドを形成することができる。内側リ
ードボンド9が形成されたのち、コネクタービームの外
端とり一ト9フレームのリード線との間に外側リードボ
ンドを形成し、余分なテープを切シ取る。
内側リードボンドを形成する際には、コネクタービーム
またはボンディングパットのいずれか一方に突起または
バンプを形成する必要がある。この種のバンプはボンド
を形成するために必要な金属を提供し、かつコネクター
ビームと半導体ダイの間に必要な距離またはずれを与え
るのに役立つ。
またはボンディングパットのいずれか一方に突起または
バンプを形成する必要がある。この種のバンプはボンド
を形成するために必要な金属を提供し、かつコネクター
ビームと半導体ダイの間に必要な距離またはずれを与え
るのに役立つ。
いずれの場合も、銅製ボンディングバット″またはバン
プ付き銅製ボンディングパッドを処理して銅の酸化を防
止することが必要である。酸化はボンド80品質、およ
び得られるコネクタービームとの電気的接触を妨げるで
あろう。
プ付き銅製ボンディングパッドを処理して銅の酸化を防
止することが必要である。酸化はボンド80品質、およ
び得られるコネクタービームとの電気的接触を妨げるで
あろう。
これまで銅製ボンディングパッドまたはバンプ付き銅製
ボンディングパッドの酸化防止は、半導体デバイスの最
上層上に金の薄層を、一般にスパッター法により、また
は無電解めっき浴を用いて付着させることにより行われ
てきた。金層は通常は薄く、約soo、Aの厚さをもち
、内側リード線は常法によりバンプ付き銅テープまたは
銅製フラットテープを用いて形成された。
ボンディングパッドの酸化防止は、半導体デバイスの最
上層上に金の薄層を、一般にスパッター法により、また
は無電解めっき浴を用いて付着させることにより行われ
てきた。金層は通常は薄く、約soo、Aの厚さをもち
、内側リード線は常法によりバンプ付き銅テープまたは
銅製フラットテープを用いて形成された。
銅の酸化を防止するだめに金を用いることは受容できる
が、これには一定の欠点があった。特に、比較的高い温
度下に置かれると、金は下層の鋼中へ拡散し、銅が露出
して酸化を受ける。このような拡散のため、下層の銅を
適切に保護するためにはより厚い金層を用いる必要があ
り、場合によっては銅の酸化に対して金層が保護する能
力が低下する。
が、これには一定の欠点があった。特に、比較的高い温
度下に置かれると、金は下層の鋼中へ拡散し、銅が露出
して酸化を受ける。このような拡散のため、下層の銅を
適切に保護するためにはより厚い金層を用いる必要があ
り、場合によっては銅の酸化に対して金層が保護する能
力が低下する。
これらの理由から、銅製ボンディングパッドおよびバン
プ付き銅製ボンディングパッドを酸化に対して保護する
ための代替法を提供することが強く望まれている。保護
被膜材として、特に、導電性であり、半導体が遭遇する
と思われる環境内で非反応性であり、鋼中への拡散性が
低く、その中への銅の拡散性が低く、かつ半導体デバイ
スの表面に好都合に施すことができる他の保護被膜材料
を確認することが望ましいであろう。
プ付き銅製ボンディングパッドを酸化に対して保護する
ための代替法を提供することが強く望まれている。保護
被膜材として、特に、導電性であり、半導体が遭遇する
と思われる環境内で非反応性であり、鋼中への拡散性が
低く、その中への銅の拡散性が低く、かつ半導体デバイ
スの表面に好都合に施すことができる他の保護被膜材料
を確認することが望ましいであろう。
バンプ付きボンディング構造をもつ半導体デバイス上の
テープ式自動化ボンディングについては米国特許第4.
OOO,842号明細書に一般的に記載されている。
テープ式自動化ボンディングについては米国特許第4.
OOO,842号明細書に一般的に記載されている。
バンプ付きボンディングチーブを用いるテープ式自動化
ボンディングについては米国特許第4.209.355
号明細書に一般的に記載されている。各種の酸化防止用
被膜(金、クロム酸塩、およびリン酸銀を含む)を銅製
ボンディング構造物上に用いることについては米国特許
第4、188.438号明細書に記載されている。
ボンディングについては米国特許第4.209.355
号明細書に一般的に記載されている。各種の酸化防止用
被膜(金、クロム酸塩、およびリン酸銀を含む)を銅製
ボンディング構造物上に用いることについては米国特許
第4、188.438号明細書に記載されている。
問題点を解決するための手段及び作用
本発明は、半導体デバイス上の銅製ボンディング構造物
の酸化を防止するための改良法を提供する。銅製ボンデ
ィング構造物は半導体をリードフレームその他の外部回
路部品にテープ式自動化ボンディングするために用いら
れる型のものである。
の酸化を防止するための改良法を提供する。銅製ボンデ
ィング構造物は半導体をリードフレームその他の外部回
路部品にテープ式自動化ボンディングするために用いら
れる型のものである。
詳細には銅製ボンディング構造物はボンディングパッド
のコネクタービームと内側リート9ボンド8を形成する
。本発明方法はフラットボンディングチーブと適合させ
るためのバンプ付きボンディング構造物、およびバンプ
付きボンディングチーブと適合させるためのバンプなし
ボンディング構造物の双方に関して有用である。
のコネクタービームと内側リート9ボンド8を形成する
。本発明方法はフラットボンディングチーブと適合させ
るためのバンプ付きボンディング構造物、およびバンプ
付きボンディングチーブと適合させるためのバンプなし
ボンディング構造物の双方に関して有用である。
本発明はパラジウム層を酸化防止層として銅製ボンディ
ング構造物上に施すことよシなる。好ましくは、パラジ
ウム層は80〜300 A1よシ好ましくは100〜2
00Aの厚さに施される。この付与は普通はスパッター
法により行われる。パラジウムは先行技術の酸化防止層
である金と対比して、高温においてすら下部の銅層への
移動の程度のがきわめて低い。さらに、銅も同じく高温
においてすらパラジウム中への移動抵抗性を示す。
ング構造物上に施すことよシなる。好ましくは、パラジ
ウム層は80〜300 A1よシ好ましくは100〜2
00Aの厚さに施される。この付与は普通はスパッター
法により行われる。パラジウムは先行技術の酸化防止層
である金と対比して、高温においてすら下部の銅層への
移動の程度のがきわめて低い。さらに、銅も同じく高温
においてすらパラジウム中への移動抵抗性を示す。
さらにパラジウムはボンディングパッドとボンディング
構造物との間に抵抗の低い電気的接続が形成されるのを
妨害せず、まだ半導体が普通置かれる条件下で実質的に
非反応性であることが見出された。fi、にパラジウム
は高温において高酸素環境下での酸化に対し著しく抵抗
性である。
構造物との間に抵抗の低い電気的接続が形成されるのを
妨害せず、まだ半導体が普通置かれる条件下で実質的に
非反応性であることが見出された。fi、にパラジウム
は高温において高酸素環境下での酸化に対し著しく抵抗
性である。
実施例
本発明は半導体デバイスのテープ式自動化ボンディング
に用いられる改良された銅製ポンプインクパッド構造物
を提供する。この銅製ボンディングパッド構造物は銅製
ボンディングパッド構造物の酸化を防止し、一方間時に
この銅製ボンディングパッド構造物を一般の銅製ボンデ
ィングパッドに熱圧着しうるパラジウムの最終層を特色
とする。
に用いられる改良された銅製ポンプインクパッド構造物
を提供する。この銅製ボンディングパッド構造物は銅製
ボンディングパッド構造物の酸化を防止し、一方間時に
この銅製ボンディングパッド構造物を一般の銅製ボンデ
ィングパッドに熱圧着しうるパラジウムの最終層を特色
とする。
パラジウム層は普通は純パラジウムまだは主としてパラ
ジウムからなる合金であシ、ウェーハ加工の最終段階で
スパッター法または電気めっき法により施される。
ジウムからなる合金であシ、ウェーハ加工の最終段階で
スパッター法または電気めっき法により施される。
好ましい実施態様においては、銅製ボンディング構造物
は露出しだアルミニウム金属化パッド上に順次付着した
3種の金属層から構成され、この構造によシ銅がボンデ
ィングパッドから下層のアルミニウムへ移動するのが防
止される。これが好ましい実施態様であるが、現在知ら
れている他のボンディングパッド構造物および将来開発
されると思われるものにも同様に本発明が有用であろう
ということは認められるであろう。本発明は銅製ボンデ
ィングパットゝ構造物上の露出しだ銅の酸化防止に関す
るものであシ、銅を下部の回路素子に接続する特定の様
式により限定されるものではない。
は露出しだアルミニウム金属化パッド上に順次付着した
3種の金属層から構成され、この構造によシ銅がボンデ
ィングパッドから下層のアルミニウムへ移動するのが防
止される。これが好ましい実施態様であるが、現在知ら
れている他のボンディングパッド構造物および将来開発
されると思われるものにも同様に本発明が有用であろう
ということは認められるであろう。本発明は銅製ボンデ
ィングパットゝ構造物上の露出しだ銅の酸化防止に関す
るものであシ、銅を下部の回路素子に接続する特定の様
式により限定されるものではない。
第1〜8図には、本発明の銅製ボンディングパッド構造
物の製法が詳述されている。第1図はアルミニウム金属
化パッド12が表面に形成された半導体基板10を示す
。パシベーション層14および16が常法により金属化
パツ)”12上に形成されている。本発明の銅製ボンデ
ィングパッド構造物を形成するためには、まず絶縁層1
4および16を貫通するアクセス開口を設ける必要があ
る。
物の製法が詳述されている。第1図はアルミニウム金属
化パッド12が表面に形成された半導体基板10を示す
。パシベーション層14および16が常法により金属化
パツ)”12上に形成されている。本発明の銅製ボンデ
ィングパッド構造物を形成するためには、まず絶縁層1
4および16を貫通するアクセス開口を設ける必要があ
る。
これは一般の写真平版法により行われ、第2図に示す開
口18を与える。
口18を与える。
開口18を形成したのち、アルミニウム層20(第3図
)をアルミニウム金属化パット″′12上に直接に形成
し、絶縁層16を覆うことができる。
)をアルミニウム金属化パット″′12上に直接に形成
し、絶縁層16を覆うことができる。
アルミニウム層は一般に少なくとも2,0OOA、よシ
一般的には4000〜6. OOOA 、通常は約4.
00 OAの厚さをもつであろう。アルミニウム層はア
ルミニウム金属化パッド12上に直接に施されるので、
アルミニウム層はスパッター法、蒸発法その他の常法に
よって施すことがでべろ。
一般的には4000〜6. OOOA 、通常は約4.
00 OAの厚さをもつであろう。アルミニウム層はア
ルミニウム金属化パッド12上に直接に施されるので、
アルミニウム層はスパッター法、蒸発法その他の常法に
よって施すことがでべろ。
アルミニウム層20を付着させたのち、ニッケル層22
をアルミニウム層上に直接に付着させる。
をアルミニウム層上に直接に付着させる。
ニッケル層22は常法により、一般にスパッター法によ
り付着され、層20と22の界面にニッケルーアルミニ
ウム合金を形成するであろう。ニッケル層の厚さは銅が
アルミニウム中へ移動するのを防ぐのに十分なものであ
り、一般に少々くとも約2.000A1より一般的には
2,000〜5. OOOA、通常は約3. OOOA
であろう。
り付着され、層20と22の界面にニッケルーアルミニ
ウム合金を形成するであろう。ニッケル層の厚さは銅が
アルミニウム中へ移動するのを防ぐのに十分なものであ
り、一般に少々くとも約2.000A1より一般的には
2,000〜5. OOOA、通常は約3. OOOA
であろう。
次いで銅層24をスパッター法によって少なくとも4,
0OOA、一般に約4,000〜15,000せる。銅
層は常法によりバンプ付き銅テープに直接にボンディン
グするのに役立つ。
0OOA、一般に約4,000〜15,000せる。銅
層は常法によりバンプ付き銅テープに直接にボンディン
グするのに役立つ。
これら3種の金属層20,22および24を金属化パッ
ト9構造物上に施したのち、半導体デバイス上にホトレ
ジスト層26(第4図)を施す。ホトレジストは金属化
パッド構造物の範囲を定めるために用いられる。まずホ
トレジストを露光および現像し、これによシホトレジス
トを半導体デバイスの大部分の領域から除去し、ただし
アルミニウム金属化パッド12上は残しておく(第5図
に示す)。銅およびニッケル層それぞれ22および24
を次いで液状エツチング剤(たとえば硝酸および過酸化
水素)中でエツチングしたのち1.リン酸/酢酸混合物
中でアルミニウムのエツチングを行う。これらのエツチ
ングは、ホトレジストキャップ26a(第5図)で保護
された金属化パッド12の上方の領域を除くすべての領
域の半導体デバイスから金属層が実質的に除去されるま
で続けられる。次いでホトレジストキャップ26aを除
去し、銅を緩和な酸中で洗浄する。得られた構造物を第
6図に示す。
ト9構造物上に施したのち、半導体デバイス上にホトレ
ジスト層26(第4図)を施す。ホトレジストは金属化
パッド構造物の範囲を定めるために用いられる。まずホ
トレジストを露光および現像し、これによシホトレジス
トを半導体デバイスの大部分の領域から除去し、ただし
アルミニウム金属化パッド12上は残しておく(第5図
に示す)。銅およびニッケル層それぞれ22および24
を次いで液状エツチング剤(たとえば硝酸および過酸化
水素)中でエツチングしたのち1.リン酸/酢酸混合物
中でアルミニウムのエツチングを行う。これらのエツチ
ングは、ホトレジストキャップ26a(第5図)で保護
された金属化パッド12の上方の領域を除くすべての領
域の半導体デバイスから金属層が実質的に除去されるま
で続けられる。次いでホトレジストキャップ26aを除
去し、銅を緩和な酸中で洗浄する。得られた構造物を第
6図に示す。
第6図に示す構造物は銅製ボンディングパッドへの熱圧
着に一般に適している。しかしこの露出したm層24は
、半導体デバイスが酸素含有雰囲気内に置かれたとき酸
化を受ける。この酸化は銅製ボンディングパッドと抵抗
の低いボンドを形成するのを妨害するので望ましくない
。
着に一般に適している。しかしこの露出したm層24は
、半導体デバイスが酸素含有雰囲気内に置かれたとき酸
化を受ける。この酸化は銅製ボンディングパッドと抵抗
の低いボンドを形成するのを妨害するので望ましくない
。
第7図を参照すると、本発明の第1の実施態様において
は銅製ボンディングパッド構造物24の酸化が銅金属化
層24の上部に薄いパラジウム層30を施すことによっ
て防止される。パラジウム層30はスパッター法または
無電解めっき法により半導体デバイスの最上面全体に施
される。次いで一般の写真平版マスキング法により銅製
ポンディ/グパッド24以外の全領域のウェーハから、
パラジウム層30が除去される。あるいはバラジラム層
を第3図の構造物にスパッター法または蒸着法により施
すこともできる。余分なパラジウムは次いで第1〜4図
に関連して述べた後続のエツチング操作中に除去される
であろう。
は銅製ボンディングパッド構造物24の酸化が銅金属化
層24の上部に薄いパラジウム層30を施すことによっ
て防止される。パラジウム層30はスパッター法または
無電解めっき法により半導体デバイスの最上面全体に施
される。次いで一般の写真平版マスキング法により銅製
ポンディ/グパッド24以外の全領域のウェーハから、
パラジウム層30が除去される。あるいはバラジラム層
を第3図の構造物にスパッター法または蒸着法により施
すこともできる。余分なパラジウムは次いで第1〜4図
に関連して述べた後続のエツチング操作中に除去される
であろう。
いずれの場合も、oラジウムは80〜300 A。
より一般的には約100〜200Aの最終厚さに施され
るであろう。パラジウム層は約80A未満ではしばしば
銅の被覆に不連続部を示し、従って酸化防止に際して有
効性が低くなる。これに対し約30OAを越える厚さを
もつパラジウム層はきわめて脆く、銅製ボンディングパ
ッドの熱圧着中に亀裂を生じやすい。パラジウム層30
は普通はスパッター法により施されるが、無電解めっき
法も用いられる。
るであろう。パラジウム層は約80A未満ではしばしば
銅の被覆に不連続部を示し、従って酸化防止に際して有
効性が低くなる。これに対し約30OAを越える厚さを
もつパラジウム層はきわめて脆く、銅製ボンディングパ
ッドの熱圧着中に亀裂を生じやすい。パラジウム層30
は普通はスパッター法により施されるが、無電解めっき
法も用いられる。
第8図には、本発明の第2の実施態様が示されている。
銅バンプ32が銅層24の上部に直接に形成されている
。銅バンプ32は常法により形成され、一般に半導体デ
バイスの約00(11インチ(0,0254mm)上方
へ突出している。次いで銅バンプ上に、第7図に関連し
て述べた方法のいずれかによりパラジウム層34を施す
。第8図に示しだように、パラジウムの垂直な面が除去
されているので、パラジウム層は第3図の構造物に施さ
れ、次いで層20.22および24と共にエツチングさ
れだのであろう。
。銅バンプ32は常法により形成され、一般に半導体デ
バイスの約00(11インチ(0,0254mm)上方
へ突出している。次いで銅バンプ上に、第7図に関連し
て述べた方法のいずれかによりパラジウム層34を施す
。第8図に示しだように、パラジウムの垂直な面が除去
されているので、パラジウム層は第3図の構造物に施さ
れ、次いで層20.22および24と共にエツチングさ
れだのであろう。
パラジウム層30または34を付着させたのち、半導体
デバイスは一般に常法により銅製ボンディングテーゾと
内側リードボンドゝを形成しうる状態となる。
デバイスは一般に常法により銅製ボンディングテーゾと
内側リードボンドゝを形成しうる状態となる。
以上、本発明を明確に理解するだめに図面および例によ
シ詳述したが、特許請求の範囲内において一定の変更お
よび修正を行いうろことは明らかであろう。
シ詳述したが、特許請求の範囲内において一定の変更お
よび修正を行いうろことは明らかであろう。
第1図は本発明の銅製ボンディングパッド構造物が形成
される前の、一対の絶縁層により被覆されたアルミニウ
ム金属化パッドを示す。 第2図は金属化パッドへ達する開口が絶縁層にエツチン
グされたのちの第1図の金属化パッドを示す。 第3図は第2図の露出しだ金属化、oットゝにアルミニ
ウム、ニッケルおよび銅の各層が厘次施されたのちの状
態を示す。 第4図はさらにホトレジスト層が上部に施された、第3
図の金属化パッド構造物を示す。 第5図はホトレジスト層が露光および現像され、金属化
パッドを覆う領域以外のすべての領域が除去された、第
4図の構造物を示す。 第6図は銅、ニッケルおよびアルミニウムの各層ヲエッ
チングし、ホトレジスト層を剥離することによシ形成さ
れた、本発明の銅製ボンディングパッド構造物を示す。 第7図は、銅の酸化を防止するためにパラジウム層が上
部に施された、第6図の銅製ポンプインクパッドを示す
。 第8図は本発明の他の実施態様を示し、この場合第6図
の銅製ボンデインダパッド構造物が上部に形成された銅
バンプ構造物を含み、さらに銅バンプの酸化を防止する
ためのパラジウム層を含む。 これらの図面において各記号は下記のものを表わす。 10:基板 12ニアルミニウム金属化パツド 14.16:パシベーション層 18:開口20 ニア
ルミニウム層 22:ニッケル層24:@層
26:ホトレジスト層26a:ホトレ
ジストキャップ 30.34:パラジウム層 32:@バンプ(外5名
)
される前の、一対の絶縁層により被覆されたアルミニウ
ム金属化パッドを示す。 第2図は金属化パッドへ達する開口が絶縁層にエツチン
グされたのちの第1図の金属化パッドを示す。 第3図は第2図の露出しだ金属化、oットゝにアルミニ
ウム、ニッケルおよび銅の各層が厘次施されたのちの状
態を示す。 第4図はさらにホトレジスト層が上部に施された、第3
図の金属化パッド構造物を示す。 第5図はホトレジスト層が露光および現像され、金属化
パッドを覆う領域以外のすべての領域が除去された、第
4図の構造物を示す。 第6図は銅、ニッケルおよびアルミニウムの各層ヲエッ
チングし、ホトレジスト層を剥離することによシ形成さ
れた、本発明の銅製ボンディングパッド構造物を示す。 第7図は、銅の酸化を防止するためにパラジウム層が上
部に施された、第6図の銅製ポンプインクパッドを示す
。 第8図は本発明の他の実施態様を示し、この場合第6図
の銅製ボンデインダパッド構造物が上部に形成された銅
バンプ構造物を含み、さらに銅バンプの酸化を防止する
ためのパラジウム層を含む。 これらの図面において各記号は下記のものを表わす。 10:基板 12ニアルミニウム金属化パツド 14.16:パシベーション層 18:開口20 ニア
ルミニウム層 22:ニッケル層24:@層
26:ホトレジスト層26a:ホトレ
ジストキャップ 30.34:パラジウム層 32:@バンプ(外5名
)
Claims (25)
- (1)銅製ボンディングパッド構造物少なくとも1個を
含み、該銅製ボンディングパッドがパラジウム層により
被覆され、下層の銅の酸化が防止されていることを特徴
とする半導体デバイス。 - (2)パラジウム層が約80〜300Åの厚さをもつ、
特許請求の範囲第1項に記載の半導体デバイス。 - (3)パラジウム層がスパッター法または無電解めつき
法により施される、特許請求の範囲第1項に記載の半導
体デバイス。 - (4)銅製ボンディングパッド構造物がバンプ付きであ
る、特許請求の範囲第1項に記載の半導体デバイス。 - (5)銅製ボンディングパッド構造物がバンプ付きでな
い、特許請求の範囲第1項に記載の半導体デバイス。 - (6)アルミニウム金属化パッド、該アルミニウム金属
化パッド上に直接付着したアルミニウム層、スパッター
法により該アルミニウム層上に直接付着して界面に安定
なアルミニウム−ニッケル合金を形成したニッケル層、
該ニッケル層上に付着して銅製ボンディングパッドへの
ボンディングを可能にする銅層、および該銅層上に付着
して下層の銅の酸化を防止するパラジウム層からなる金
属化パッド構造物少なくとも1個を含むことを特徴とす
る半導体デバイス。 - (7)該アルミニウム層が約2,000〜6,000Å
の厚さをもつ、特許請求の範囲第6項に記載の半導体デ
バイス。 - (8)該ニッケル層が約2,000〜5,000Åの厚
さをもつ、特許請求の範囲第6項に記載の半導体デバイ
ス。 - (9)該銅層が約4,000〜15,000Åの厚さを
もつ、特許請求の範囲第6項に記載の半導体デバイス。 - (10)該パラジウム層が約80〜300Åの厚さをも
つ、特許請求の範囲第6項に記載の半導体デバイス。 - (11)該銅層がバンプ付きである、特許請求の範囲第
6項に記載の半導体デバイス。 - (12)該銅層がバンプ付きでない、特許請求の範囲第
6項に記載の半導体デバイス。 - (13)該パラジウム層がスパッター法または無電解め
っき法により施される、特許請求の範囲第6項に記載の
半導体デバイス。 - (14)アルミニウム金属化パッド上に直接にアルミニ
ウム層を施し; 該アルミニウム層上に直接にニッケル層を施し;該ニッ
ケル層上に直接に銅層を施し;そして該銅層上に銅の酸
化を防止するためのパラジウム層を施す ことよりなる、アルミニウム金属化パッド上に、銅テー
プに結合しうる銅製ボンディング構造物を形成する方法
。 - (15)該アルミニウム層が約2,000〜6,000
Åの厚さに施される、特許請求の範囲第14項に記載の
方法。 - (16)該ニッケル層が約2,000〜5,000Åの
厚さに施される、特許請求の範囲第14項に記載の方法
。 - (17)該銅層が約4,000〜15,000Åの厚さ
に施される、特許請求の範囲第14項に記載の方法。 - (18)さらに、銅層上にパラジウムを付着させる前に
銅バンプを施すことよりなる、特許請求の範囲第14項
に記載の方法。 - (19)該パラジウム層が約80〜300Åの厚さに施
される、特許請求の範囲第14項に記載の方法。 - (20)該パラジウムがスパッター法または無電解めつ
き法により施される、特許請求の範囲第19項に記載の
方法。 - (21)銅製ボンディング構造物上に銅の酸化を防止す
るためにパラジウム層を施すことを特徴とする、半導体
デバイス上に銅テープへの熱圧着のための銅製ボンディ
ング構造物を形成する方法。 - (22)該パラジウム層が80〜300Åの厚さで施さ
れる、特許請求の範囲第21項に記載の方法。 - (23)該パラジウム層がスパッター法または無電解め
つき法により施される、特許請求の範囲第21項に記載
の方法。 - (24)該銅製ボンディング構造物がバンプ付きである
、特許請求の範囲第21項に記載の方法。 - (25)該銅製ボンディング構造物がバンプ付きでない
、特許請求の範囲第21項に記載の方法。
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Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0448627U (ja) * | 1990-06-01 | 1992-04-24 | ||
JP2000252528A (ja) * | 1999-02-26 | 2000-09-14 | Nhk Spring Co Ltd | 熱電発電用熱電変換モジュールブロック |
US6759597B1 (en) | 1998-02-02 | 2004-07-06 | International Business Machines Corporation | Wire bonding to dual metal covered pad surfaces |
US7468320B2 (en) | 1999-07-27 | 2008-12-23 | International Business Machines Corporation | Reduced electromigration and stressed induced migration of copper wires by surface coating |
JP2012069691A (ja) * | 2010-09-22 | 2012-04-05 | Toshiba Corp | 半導体装置とその製造方法 |
Families Citing this family (17)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR910006949B1 (ko) * | 1987-09-24 | 1991-09-14 | 가부시키가이샤 도시바 | 범프 및 그 형성방법 |
DE3823347A1 (de) * | 1988-07-09 | 1990-01-11 | Semikron Elektronik Gmbh | Leistungs-halbleiterelement |
NL8902695A (nl) * | 1989-11-01 | 1991-06-03 | Philips Nv | Interconnectiestructuur. |
DE4225138A1 (de) * | 1992-07-30 | 1994-02-03 | Daimler Benz Ag | Multichipmodul und Verfahren zu dessen Herstellung |
US5825078A (en) * | 1992-09-23 | 1998-10-20 | Dow Corning Corporation | Hermetic protection for integrated circuits |
DE19724595A1 (de) * | 1997-06-11 | 1998-12-17 | Micronas Semiconductor Holding | Verfahren zum Herstellen einer Halbleiteranordnung mit strukturierter Metallisierung |
US6423642B1 (en) | 1998-03-13 | 2002-07-23 | Semitool, Inc. | Reactor for processing a semiconductor wafer |
US6218732B1 (en) * | 1998-09-15 | 2001-04-17 | Texas Instruments Incorporated | Copper bond pad process |
US7217325B2 (en) | 1999-01-22 | 2007-05-15 | Semitool, Inc. | System for processing a workpiece |
EP1190446A1 (de) * | 1999-06-28 | 2002-03-27 | Unaxis Balzers Aktiengesellschaft | Bauteil und verfahren zu dessen herstellung |
US6511901B1 (en) | 1999-11-05 | 2003-01-28 | Atmel Corporation | Metal redistribution layer having solderable pads and wire bondable pads |
US6191023B1 (en) * | 1999-11-18 | 2001-02-20 | Taiwan Semiconductor Manufacturing Company | Method of improving copper pad adhesion |
US6613671B1 (en) * | 2000-03-03 | 2003-09-02 | Micron Technology, Inc. | Conductive connection forming methods, oxidation reducing methods, and integrated circuits formed thereby |
US6171712B1 (en) * | 2000-03-15 | 2001-01-09 | Ford Global Technologies, Inc. | Palladium and palladium/copper thin flat membranes |
EP1139413B1 (en) * | 2000-03-24 | 2005-03-16 | Texas Instruments Incorporated | Wire bonding process |
US8354692B2 (en) * | 2006-03-15 | 2013-01-15 | Infineon Technologies Ag | Vertical semiconductor power switch, electronic component and methods of producing the same |
WO2008078268A1 (en) * | 2006-12-27 | 2008-07-03 | Nxp B.V. | Semiconductor component with inertly encapsulated metal surface layers |
Family Cites Families (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4188438A (en) * | 1975-06-02 | 1980-02-12 | National Semiconductor Corporation | Antioxidant coating of copper parts for thermal compression gang bonding of semiconductive devices |
IT1075077B (it) * | 1977-03-08 | 1985-04-22 | Ates Componenti Elettron | Metodo pr realizzare contatti su semiconduttori |
US4282043A (en) * | 1980-02-25 | 1981-08-04 | International Business Machines Corporation | Process for reducing the interdiffusion of conductors and/or semiconductors in contact with each other |
US4652336A (en) * | 1984-09-20 | 1987-03-24 | Siemens Aktiengesellschaft | Method of producing copper platforms for integrated circuits |
-
1986
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- 1986-08-12 FR FR8611632A patent/FR2591802A1/fr active Pending
- 1986-11-25 DE DE19863640248 patent/DE3640248A1/de not_active Withdrawn
Cited By (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0448627U (ja) * | 1990-06-01 | 1992-04-24 | ||
US6759597B1 (en) | 1998-02-02 | 2004-07-06 | International Business Machines Corporation | Wire bonding to dual metal covered pad surfaces |
JP2000252528A (ja) * | 1999-02-26 | 2000-09-14 | Nhk Spring Co Ltd | 熱電発電用熱電変換モジュールブロック |
US7468320B2 (en) | 1999-07-27 | 2008-12-23 | International Business Machines Corporation | Reduced electromigration and stressed induced migration of copper wires by surface coating |
JP2012069691A (ja) * | 2010-09-22 | 2012-04-05 | Toshiba Corp | 半導体装置とその製造方法 |
Also Published As
Publication number | Publication date |
---|---|
GB2184288A (en) | 1987-06-17 |
GB8614593D0 (en) | 1986-07-23 |
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DE3640248A1 (de) | 1987-06-19 |
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