JPS62132412A - 増幅器 - Google Patents
増幅器Info
- Publication number
- JPS62132412A JPS62132412A JP27382685A JP27382685A JPS62132412A JP S62132412 A JPS62132412 A JP S62132412A JP 27382685 A JP27382685 A JP 27382685A JP 27382685 A JP27382685 A JP 27382685A JP S62132412 A JPS62132412 A JP S62132412A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- bias circuit
- resistor
- gain
- base
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は増幅器に関１１、特に段階的に利得を切換る増
幅器に関する。
幅器に関する。
一般に可変利得増幅器は、オーディオ分野の信号系や測
定装置などのコントロールに使わね、外部の直流電圧又
は直流電流等により利得を変えることが要求される。
定装置などのコントロールに使わね、外部の直流電圧又
は直流電流等により利得を変えることが要求される。
従来の可’＆第１１得増幅器の一例を第３図に示す。
この可変利得増幅器はトランジスタ２４．２５゜２６．
２７．２９及び定電流源２８．３１．バイアス３２より
なる差動増幅器でありトランジスタ２２を介１２て信号
源２０が接続されている。トランジスタ２２のコレクタ
ーエミッタ間のインピーダンスはトランジスタ２２０ベ
ースに接続さｈている。定電流源２３により可変される
。ここで抵抗３０のインピーダンスをＲ１、トランジス
タ２２のコレクターエミッタ間のインピーダンスをＲｃ
ｅとすると、第３図における増幅器の利得は、下式１式
％ （１）式よりトランジスタ２２のコレクターエミッタ間
のインピーダンスを定電流源２３の電流を可変すること
により増幅器の利得を可変することができる。前述のこ
とより、オーディオ分野の信号系や測定装置などのコン
トロールに使用［また場合定１流源２３を外部に設置す
れば、外部より利得を可変することができる。
２７．２９及び定電流源２８．３１．バイアス３２より
なる差動増幅器でありトランジスタ２２を介１２て信号
源２０が接続されている。トランジスタ２２のコレクタ
ーエミッタ間のインピーダンスはトランジスタ２２０ベ
ースに接続さｈている。定電流源２３により可変される
。ここで抵抗３０のインピーダンスをＲ１、トランジス
タ２２のコレクターエミッタ間のインピーダンスをＲｃ
ｅとすると、第３図における増幅器の利得は、下式１式
％ （１）式よりトランジスタ２２のコレクターエミッタ間
のインピーダンスを定電流源２３の電流を可変すること
により増幅器の利得を可変することができる。前述のこ
とより、オーディオ分野の信号系や測定装置などのコン
トロールに使用［また場合定１流源２３を外部に設置す
れば、外部より利得を可変することができる。
第３図の従来の回路においでは、設定狙１得の自由度は
あるが、トランジスタ２２のコレクターエミッタ間のイ
ンピーダンスを定電流源２３によって可変するため、定
電流源及びトランジスタの能力に左右される。この従来
回路をＦＭやＡＭの受信器のＬｏ／Ｄｘ （入力感度変
更回路）回路などの段階的な利得の可変を必要とした。
あるが、トランジスタ２２のコレクターエミッタ間のイ
ンピーダンスを定電流源２３によって可変するため、定
電流源及びトランジスタの能力に左右される。この従来
回路をＦＭやＡＭの受信器のＬｏ／Ｄｘ （入力感度変
更回路）回路などの段階的な利得の可変を必要とした。
豐１合、利１ドを調整する定電流源のわずかな変化で利
得が変化する為設定が容易でない６また集積回路化した
ず６合トランジスタのコレクターエミッタ間のインピー
ダンスのバラツキも太ういため）１１得のバラツキも大
きくなる。
得が変化する為設定が容易でない６また集積回路化した
ず６合トランジスタのコレクターエミッタ間のインピー
ダンスのバラツキも太ういため）１１得のバラツキも大
きくなる。
本発明の可変第１１得増幅器は、極性の等［７い第１゜
第２．第３０Ｔ、のエミッタが共通に接続され、該共通
エミッタに第１．第２．第３のＴｒと同じ極性の第４の
Ｔ、のコレクタが接続され、第４のＴ、のベースを入力
端とし、第４のトランジスタのベースは第１の抵抗を介
して第１のバイアス回路に接続し１、第４のＴ、のエミ
ッタは第２のバイアス回路に接続され、前記第１．第２
のＴｒのベースは、第３のバイアス回路に接続し第１の
ｒ１のコレクタは、第４のバイアス回路に接続され、第
２．第３のＴｒのコレクタは第２の抵抗を介Ｌ７て第４
のバイアス回路に接続され、第３のＴ、のベースは、第
５のバイアス回路に接続され、第２゜第３のＴ、のコレ
クタを出力端子としたことにより構成される。このよう
にすることにより段階的な利得可変を容易に行う。
第２．第３０Ｔ、のエミッタが共通に接続され、該共通
エミッタに第１．第２．第３のＴｒと同じ極性の第４の
Ｔ、のコレクタが接続され、第４のＴ、のベースを入力
端とし、第４のトランジスタのベースは第１の抵抗を介
して第１のバイアス回路に接続し１、第４のＴ、のエミ
ッタは第２のバイアス回路に接続され、前記第１．第２
のＴｒのベースは、第３のバイアス回路に接続し第１の
ｒ１のコレクタは、第４のバイアス回路に接続され、第
２．第３のＴｒのコレクタは第２の抵抗を介Ｌ７て第４
のバイアス回路に接続され、第３のＴ、のベースは、第
５のバイアス回路に接続され、第２゜第３のＴ、のコレ
クタを出力端子としたことにより構成される。このよう
にすることにより段階的な利得可変を容易に行う。
以下本発明について図面を参照して説明する。
第１図は本発明の一実施例の回路図である。第１のトラ
ンジスタであるトランジスタ２．第２のトランジスタで
あるトランジスタ３．第３のトランジスタであるトラン
ジスタ４（以下トランジスタをＴ、と示す。）＃′ｉ差
動構成をなし、第４のトランジスえである。Ｔ、１０及
び第１の抵抗である抵抗６定電圧源７によりバイアスさ
れている。
ンジスタであるトランジスタ２．第２のトランジスタで
あるトランジスタ３．第３のトランジスタであるトラン
ジスタ４（以下トランジスタをＴ、と示す。）＃′ｉ差
動構成をなし、第４のトランジスえである。Ｔ、１０及
び第１の抵抗である抵抗６定電圧源７によりバイアスさ
れている。
Ｔ、２のベースは、定電圧源８によりバイアスされ、Ｔ
、４のベースは電圧源９によりバイアスさねている。第
２の抵抗である抵抗５け差動の負荷となっている。ここ
で定電圧源８より電圧源９の電位の方が高い場合信号源
２０より、入力端１に信号が印加されるとＴｒｌｏによ
り電流増幅されＴｒ４を介し、て負荷である抵抗５に電
流が流れ、出力端１１には、抵抗５に流れる電流に比例
［また重圧が発生する。
、４のベースは電圧源９によりバイアスさねている。第
２の抵抗である抵抗５け差動の負荷となっている。ここ
で定電圧源８より電圧源９の電位の方が高い場合信号源
２０より、入力端１に信号が印加されるとＴｒｌｏによ
り電流増幅されＴｒ４を介し、て負荷である抵抗５に電
流が流れ、出力端１１には、抵抗５に流れる電流に比例
［また重圧が発生する。
逆に、定電圧源８より重圧源９の７位の方が低い場合信
号源２０より入力端１に信号が印加さねるとＴ、１０に
より電流増幅されＴｒ３を介し、て負荷である抵抗５に
電流が加わると同時にＴ、２にも電流が流ねる。ここで
Ｔ、１０のコレクタに流れる電流を工。とじ、Ｔｒ２の
エミッタ面積をＡＴｒ３のエミッタ面積をＢとすると、
抵抗５に流れる電流は（２）式になる 出力端１１には抵抗５に流れる電流に比例したπ圧が発
生する之めＴｒ ２− １’ｒ ３の面積比と抵抗５に
より増幅利得が設定できる。以上のことより定電圧源８
より電圧源９の電位の方が高い場合より定電圧源８より
電圧源９の電位が低い方がＴ１３、Ｔ、２のエミッタ面
積化分だけ出力電位すなわち増幅利得が低下する。上記
のことより負荷抵抗５の値及びＴｒ ３＝ Ｔｒ ２の
エミツタ面積比を設定すわば、自由に２段階の牙１．１
得をもった増幅器にできる、従来例の第３図で問題であ
った、段階的な利得可変を容易に設定できる。すなわち
抵抗値、エミツタ面積比の設定は容易である。また第１
図において重圧源９により容易に第１１得の切換が可能
であり集結回路化ｔ、ｆＣ，場合でも利得のバラツキは
小さい。
号源２０より入力端１に信号が印加さねるとＴ、１０に
より電流増幅されＴｒ３を介し、て負荷である抵抗５に
電流が加わると同時にＴ、２にも電流が流ねる。ここで
Ｔ、１０のコレクタに流れる電流を工。とじ、Ｔｒ２の
エミッタ面積をＡＴｒ３のエミッタ面積をＢとすると、
抵抗５に流れる電流は（２）式になる 出力端１１には抵抗５に流れる電流に比例したπ圧が発
生する之めＴｒ ２− １’ｒ ３の面積比と抵抗５に
より増幅利得が設定できる。以上のことより定電圧源８
より電圧源９の電位の方が高い場合より定電圧源８より
電圧源９の電位が低い方がＴ１３、Ｔ、２のエミッタ面
積化分だけ出力電位すなわち増幅利得が低下する。上記
のことより負荷抵抗５の値及びＴｒ ３＝ Ｔｒ ２の
エミツタ面積比を設定すわば、自由に２段階の牙１．１
得をもった増幅器にできる、従来例の第３図で問題であ
った、段階的な利得可変を容易に設定できる。すなわち
抵抗値、エミツタ面積比の設定は容易である。また第１
図において重圧源９により容易に第１１得の切換が可能
であり集結回路化ｔ、ｆＣ，場合でも利得のバラツキは
小さい。
第２図に本発明で正の単電源を用いた場合の具体例を示
す。第２図において第１図と対応する部分については、
同一番号で示［−７説明をはぶ〈。抵抗４０．４２、Ｔ
、４３は、Ｔ、２とＴｒｉｏに所定のバイアスを与える
為の回路である。抵抗４４゜４５．４６はＴ、４に所定
のバイアスを与える回路でＴ、４７によりＴｒ４のベー
スの電位をＴ、２゜３のベース電位に比べて高くしたり
低くしたりすることにより、利得を可変するものである
。
す。第２図において第１図と対応する部分については、
同一番号で示［−７説明をはぶ〈。抵抗４０．４２、Ｔ
、４３は、Ｔ、２とＴｒｉｏに所定のバイアスを与える
為の回路である。抵抗４４゜４５．４６はＴ、４に所定
のバイアスを与える回路でＴ、４７によりＴｒ４のベー
スの電位をＴ、２゜３のベース電位に比べて高くしたり
低くしたりすることにより、利得を可変するものである
。
以上説明【、たよりに本発明は、段階的な利得可変を容
易に設定できる。
易に設定できる。
第１図は本発明の一実施例の回路図、第２図は本発明の
一実施例の回路図、第３図は従来例の回路図である。 １・・・・・・入力端、２〜４・・・・・・トランジス
タ、５゜６・・・・・・抵抗、７．８・・団・定冨圧源
、９・・川・電圧源、１０・・・・・・トランジスタ、
１１・・川・出力端、２０・・・・・・信号源、２１・
・・・・・入力端、２２・・・・・・トランジスタ、２
３・・・・・・電流源、２４〜２７・・・・・・トラン
ジスタ、２８・・・・・・定電流源、２９・・・・・・
トランジスタ、３０・・・・・・抵抗、３１・・・・・
・定電流源、３２・・・・・・出力端、４１．４２・・
・・・・抵抗、４３・・・・・・トランジスタ、４４〜
４６・・・・・・抵抗、４７．４８・・・・・・トラン
ジスタ、４９・・・・・・抵抗、５０・・・・・・切換
スイッチ、５１・・・・・・定電圧。 代理人 弁理士 内 原 晋 ′１予Ｚ図
一実施例の回路図、第３図は従来例の回路図である。 １・・・・・・入力端、２〜４・・・・・・トランジス
タ、５゜６・・・・・・抵抗、７．８・・団・定冨圧源
、９・・川・電圧源、１０・・・・・・トランジスタ、
１１・・川・出力端、２０・・・・・・信号源、２１・
・・・・・入力端、２２・・・・・・トランジスタ、２
３・・・・・・電流源、２４〜２７・・・・・・トラン
ジスタ、２８・・・・・・定電流源、２９・・・・・・
トランジスタ、３０・・・・・・抵抗、３１・・・・・
・定電流源、３２・・・・・・出力端、４１．４２・・
・・・・抵抗、４３・・・・・・トランジスタ、４４〜
４６・・・・・・抵抗、４７．４８・・・・・・トラン
ジスタ、４９・・・・・・抵抗、５０・・・・・・切換
スイッチ、５１・・・・・・定電圧。 代理人 弁理士 内 原 晋 ′１予Ｚ図
Claims (1)
- 第１、第２、第３のトランジスタのエミッタが共通に接
続され、該共通エミッタに第４のトランジスタのコレク
タが接続され、前記第４のトランジスタのベースは第１
の抵抗を介して第１のバイアス回路に接続されると共に
入力信号が供給され、前記第１および第２のトランジス
タのベースは第２のバイアス回路に、前記第３のトラン
ジスタのベースは第３のバイアス回路に夫々接続され、
前記第２および第３のトランジスタのコレクタは出力端
子に接続されていることを特徴とする増幅器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27382685A JPS62132412A (ja) | 1985-12-04 | 1985-12-04 | 増幅器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27382685A JPS62132412A (ja) | 1985-12-04 | 1985-12-04 | 増幅器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62132412A true JPS62132412A (ja) | 1987-06-15 |
| JPH0586083B2 JPH0586083B2 (ja) | 1993-12-09 |
Family
ID=17533089
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27382685A Granted JPS62132412A (ja) | 1985-12-04 | 1985-12-04 | 増幅器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62132412A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004027987A1 (ja) * | 2002-09-19 | 2004-04-01 | Mitsubishi Denki Kabushiki Kaisha | 可変利得増幅器 |
-
1985
- 1985-12-04 JP JP27382685A patent/JPS62132412A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004027987A1 (ja) * | 2002-09-19 | 2004-04-01 | Mitsubishi Denki Kabushiki Kaisha | 可変利得増幅器 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0586083B2 (ja) | 1993-12-09 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| EXPY | Cancellation because of completion of term |