JPS62113255A - オフライン情報転送方式 - Google Patents
オフライン情報転送方式Info
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- JPS62113255A JPS62113255A JP60252606A JP25260685A JPS62113255A JP S62113255 A JPS62113255 A JP S62113255A JP 60252606 A JP60252606 A JP 60252606A JP 25260685 A JP25260685 A JP 25260685A JP S62113255 A JPS62113255 A JP S62113255A
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- Japan
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- cpu
- priority device
- memory
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、ハイレベルデータリンク（＋−Ｉ Ｄ Ｌ
Ｃ）等の高度な手順で装置間の情報の送受を行なうシス
テムにおけるオフライン情報の転送方式に１１１′ＩＩ
るものである。
Ｃ）等の高度な手順で装置間の情報の送受を行なうシス
テムにおけるオフライン情報の転送方式に１１１′ＩＩ
るものである。
（従来の技術）
従来、このような分野の技術としては、古Ｉｌｌ他著ｒ
ｌｓＤＮ交換機における信号制御方式」（電子通信学会
技術研究報告、５Ｅ８５−３５）、あるいは画材 他著
［ネットワークアーキテクチャ」（情報処理、Ｖｏｌ、
２４．Ｎｏ、１０）ｋ−記Ｍされたものがある。以下、
これらに沿って説明する。
ｌｓＤＮ交換機における信号制御方式」（電子通信学会
技術研究報告、５Ｅ８５−３５）、あるいは画材 他著
［ネットワークアーキテクチャ」（情報処理、Ｖｏｌ、
２４．Ｎｏ、１０）ｋ−記Ｍされたものがある。以下、
これらに沿って説明する。
第２図は従来の情報送受信装置の一構成例を示すもので
、図中、１０は情報送受信装置、２０は上位装置、３０
は共通メモリである。また、情報送受信装ｇ１１０は、
シリアルデータインタフェース（ＳＤＩ）１１と、プロ
セッサ（ＣＰＵ）１２と、リードオンリメモリ（ＲＯＭ
）１３と、ランダムアクセスメモリ（ＲＡＭ）１４と、
ダイレクトメモリアクセスコントローラ（ＤＭＡＣ）１
５とからなっている。
、図中、１０は情報送受信装置、２０は上位装置、３０
は共通メモリである。また、情報送受信装ｇ１１０は、
シリアルデータインタフェース（ＳＤＩ）１１と、プロ
セッサ（ＣＰＵ）１２と、リードオンリメモリ（ＲＯＭ
）１３と、ランダムアクセスメモリ（ＲＡＭ）１４と、
ダイレクトメモリアクセスコントローラ（ＤＭＡＣ）１
５とからなっている。
前記構成の基本的アーキアクチ１７は、国際標準化機構
（１８０）にて標準化されているところの７層化された
開放型システム間相互接続（Ｏ８Ｉ ）基本参照モデル
をベースにした構成となつＣおり、前記情報送受信装置
１０は１１θ記Ｏ８１基本参照モデルの７層のうちの第
２層（Ｌ２） 、即らデータリンク層に相当する機能を
担務しており、その使用プロトコルはＣＣＩＴＴ勧告１
４４０ 、 Ｉ ４４１にて標準化され′ＣいるＬＡ
ＰＤである。また、上位装置２０は７層のうちの第３層
（Ｌ３）、即ちネットワーク層に相当する機能を担務し
ている。
（１８０）にて標準化されているところの７層化された
開放型システム間相互接続（Ｏ８Ｉ ）基本参照モデル
をベースにした構成となつＣおり、前記情報送受信装置
１０は１１θ記Ｏ８１基本参照モデルの７層のうちの第
２層（Ｌ２） 、即らデータリンク層に相当する機能を
担務しており、その使用プロトコルはＣＣＩＴＴ勧告１
４４０ 、 Ｉ ４４１にて標準化され′ＣいるＬＡ
ＰＤである。また、上位装置２０は７層のうちの第３層
（Ｌ３）、即ちネットワーク層に相当する機能を担務し
ている。
第３図はＯ３１基本参照モデルの７層化の論理的概念を
示したものであり、第２図に例示される情報送受信装置
１“０は各エンドシスデム１．２および中間システム３
のＬ２に相当する。そして、このＬ２は物理的にはレイ
ヤ１（Ｌｌ）を介して対向しているが、論理的には直接
対向システムのＬ２に接続されている。ＬＡＰＤはＨＤ
ＬＣをベースに規準化されたものであり、Ｌ２内でクロ
ーズした形で順序制御、再送制御等の高度手順を行なっ
ている。
示したものであり、第２図に例示される情報送受信装置
１“０は各エンドシスデム１．２および中間システム３
のＬ２に相当する。そして、このＬ２は物理的にはレイ
ヤ１（Ｌｌ）を介して対向しているが、論理的には直接
対向システムのＬ２に接続されている。ＬＡＰＤはＨＤ
ＬＣをベースに規準化されたものであり、Ｌ２内でクロ
ーズした形で順序制御、再送制御等の高度手順を行なっ
ている。
従って、第２図のようにＬ２でクローズした形で情報送
受信装置１０を構成するためには、送受する情報の一時
蓄積機能、情報送受のトリガおよび報告のための上位装
置２０とのコマンド／ステータス送受機能が必要になる
。第１図の構成ではこれらの機能を１２／Ｌ３の両方か
らアクセス可能な共通メモリ３０によって実現している
。
受信装置１０を構成するためには、送受する情報の一時
蓄積機能、情報送受のトリガおよび報告のための上位装
置２０とのコマンド／ステータス送受機能が必要になる
。第１図の構成ではこれらの機能を１２／Ｌ３の両方か
らアクセス可能な共通メモリ３０によって実現している
。
共通メモリ３０は送受情報の一時蓄積用のバッファとし
て使うとともに、１２／Ｌ３間のコマンド／ステータス
送受として送信側が該共通メモリ３０内の固定エリアに
情報を書込み、受信側が続出ず形で使われている。また
、この共通メモリ３０の管理は情報送受信装＠１０にて
行なっている。
て使うとともに、１２／Ｌ３間のコマンド／ステータス
送受として送信側が該共通メモリ３０内の固定エリアに
情報を書込み、受信側が続出ず形で使われている。また
、この共通メモリ３０の管理は情報送受信装＠１０にて
行なっている。
また、これらのような高度化された複雑な手順で情報の
送受を行なうシステムでは、保守上、信頼性上、またサ
ービス上、情報の伝送誤りの回数。
送受を行なうシステムでは、保守上、信頼性上、またサ
ービス上、情報の伝送誤りの回数。
内容等の保守運用情報が必要になる。従来は、これらの
情報を統計的に情報送受信装置１０内部でデータ採取し
、必要に応じて、前述の１２／Ｌ３間の」マント／ステ
ータスを用いて上位１ｉＪｆ２０に報告するようになし
ていた。
情報を統計的に情報送受信装置１０内部でデータ採取し
、必要に応じて、前述の１２／Ｌ３間の」マント／ステ
ータスを用いて上位１ｉＪｆ２０に報告するようになし
ていた。
（発明が解決しようと１６問題点）
しかしながら、このように保守運用情報等のオフライン
情報を共通メモリ３０を介してＬ２／Ｌ３間のコマンド
／ステータスの形で送受する方式では、そのシステムの
保守運用を司どる装置が、例えばモニタの目的で情報の
送受の状態、即ち保守運用情報等のオフライン情報を逐
次必要とする場合、又は統計的でない多量の逐次データ
を必要とする場合、これらの情報の送受用として大きな
エリアが必要となり、メモリサイズの増大をＩＢいてし
まうという問題点があった。
情報を共通メモリ３０を介してＬ２／Ｌ３間のコマンド
／ステータスの形で送受する方式では、そのシステムの
保守運用を司どる装置が、例えばモニタの目的で情報の
送受の状態、即ち保守運用情報等のオフライン情報を逐
次必要とする場合、又は統計的でない多量の逐次データ
を必要とする場合、これらの情報の送受用として大きな
エリアが必要となり、メモリサイズの増大をＩＢいてし
まうという問題点があった。
本発明はメモリサイズを増大することなく、しかも新た
に物理的インタフェース点を設けることなく、保守運用
情報等のオフライン情報を送受する方式を提供すること
を目的とする。
に物理的インタフェース点を設けることなく、保守運用
情報等のオフライン情報を送受する方式を提供すること
を目的とする。
（問題点を解決するための手段）
本発明では前記問題点を解決するため、ハイレベルデー
タリンク等の高度な手順を使用する情報送受信装置とそ
の上位装置との間のオノライン情報転送方式において、
情報送受信装置に、上位装置に対して送受信する情報を
一時蓄積するメモリと、該情報の送受信に関するコマン
ド／ステータスを送受する回路とを設け、保守運用情報
等のオフライン情報の受渡しを、前記メモリによる１０
ツク転送により行なうようになした。
タリンク等の高度な手順を使用する情報送受信装置とそ
の上位装置との間のオノライン情報転送方式において、
情報送受信装置に、上位装置に対して送受信する情報を
一時蓄積するメモリと、該情報の送受信に関するコマン
ド／ステータスを送受する回路とを設け、保守運用情報
等のオフライン情報の受渡しを、前記メモリによる１０
ツク転送により行なうようになした。
（作用）
本発明によれば、オフライン情報は、上位装置と情報送
受信装置との間で送受する他の上位装置への送受情報と
同様に、メモリによるゾロツク転送により行なうため、
データ樋の多い情報を自由に送受できる。
受信装置との間で送受する他の上位装置への送受情報と
同様に、メモリによるゾロツク転送により行なうため、
データ樋の多い情報を自由に送受できる。
（実施例）
第１図は本発明の一実施例を示ずブロック図で図中、第
２図と同一構成部分は同一符号をもって表わず。即ら、
１０ａは情報送受信装置、１１はシリアルデータインタ
フェース（ＳＤＩ）、１２はブロセッ１ノ（ＣＰＵ）
、ＰＭＯ、・・・・・・ＰＭｎ−１゜ＰＭｎはページメ
モリ、Ｑｌ、Ｏ２はイベント回路、２０は上位装置であ
る。
２図と同一構成部分は同一符号をもって表わず。即ら、
１０ａは情報送受信装置、１１はシリアルデータインタ
フェース（ＳＤＩ）、１２はブロセッ１ノ（ＣＰＵ）
、ＰＭＯ、・・・・・・ＰＭｎ−１゜ＰＭｎはページメ
モリ、Ｑｌ、Ｏ２はイベント回路、２０は上位装置であ
る。
前記ページメモリＰＭＯ〜ＰＭｎは、送受する情報の一
塊を一時蓄積するメモリであり、各々、独立に制御され
、ｎ塊分蓄積することができる。
塊を一時蓄積するメモリであり、各々、独立に制御され
、ｎ塊分蓄積することができる。
イベント回路Ｑ１．Ｑ２は、各々Ｌ３／１２間のコマン
ド／ステータスの送受用の回路である。該ページメモリ
ＰＭＯ〜ＰＭｎおＪ：びイベント回路Ｑｌ、Ｑ２は、第
２図の回路における共通メモリの役割を果すものである
。
ド／ステータスの送受用の回路である。該ページメモリ
ＰＭＯ〜ＰＭｎおＪ：びイベント回路Ｑｌ、Ｑ２は、第
２図の回路における共通メモリの役割を果すものである
。
前記情報送受信装置１０ａと上位装置２０を含む自シス
テムと、これに対向する他システム（図示せず）との間
にお【ノる情報の送受信動作の概略を以下、説明する。
テムと、これに対向する他システム（図示せず）との間
にお【ノる情報の送受信動作の概略を以下、説明する。
自システム内の上位装置２０から他システム内の上位＠
置（Ｌ３）に情報を送信する場合、上位装置２０はまず
、これをイベント回路Ｑ１を用いて情報送受信装置１０
ａ内のＣＰＬＪ１２に知らせる。ＣＰＬＪ１２はこのコ
マンドを受信すると、ページメモリＰＭＯ−ＰＭｎの中
から未使用のものをハントし、該ハントしたページメモ
リ番号、例えばＰＭＯを、イベント回路Ｑ２を使用して
上位装置２０に知らせる。上位装置２０は前記与えられ
たページメモリＰＭＯに送出すべき情報を内込み、送出
要求をイベント回路Ｑ１を使用してＣＰＬＪ１２に送出
する。ＣＰｔＪ１２はこの送出要求を知ると、５Ｄ１１
１を起動し、他システム内の上位装置に前記情報を送出
する。
置（Ｌ３）に情報を送信する場合、上位装置２０はまず
、これをイベント回路Ｑ１を用いて情報送受信装置１０
ａ内のＣＰＬＪ１２に知らせる。ＣＰＬＪ１２はこのコ
マンドを受信すると、ページメモリＰＭＯ−ＰＭｎの中
から未使用のものをハントし、該ハントしたページメモ
リ番号、例えばＰＭＯを、イベント回路Ｑ２を使用して
上位装置２０に知らせる。上位装置２０は前記与えられ
たページメモリＰＭＯに送出すべき情報を内込み、送出
要求をイベント回路Ｑ１を使用してＣＰＬＪ１２に送出
する。ＣＰｔＪ１２はこの送出要求を知ると、５Ｄ１１
１を起動し、他システム内の上位装置に前記情報を送出
する。
情報受信の場合は、これらの逆の動作を行なう。
次に、保守運用情報の転送方法について説明する。上位
装置２０が何らかの理由で他システムの上位装置との送
受信動作のモニタをある一定時間行ないたいとする。ま
ず、上位装置２０は通常の情報送受信動作の場合と同様
に、この要求をイベント回路Ｑ１を介してＣＰＵ１２に
知らせる。この時、ＣＰＵ１２は空きのページメモリを
ハントしにいくが、場合によってはシステムとして前も
ってページメモリの番号を定める方式もありうる。
装置２０が何らかの理由で他システムの上位装置との送
受信動作のモニタをある一定時間行ないたいとする。ま
ず、上位装置２０は通常の情報送受信動作の場合と同様
に、この要求をイベント回路Ｑ１を介してＣＰＵ１２に
知らせる。この時、ＣＰＵ１２は空きのページメモリを
ハントしにいくが、場合によってはシステムとして前も
ってページメモリの番号を定める方式もありうる。
いずれの場合もこの要求をトリガにして、ＣＰＵ１２は
送受信動作のモニタ動作を開始し、その結果を逐次、指
定ページメモリ内にストアづる。指定Ｖｆ間が来ると、
モニタ動作が終了したことをイベント回路Ｑ２を介して
上位装置２０に通知する。
送受信動作のモニタ動作を開始し、その結果を逐次、指
定ページメモリ内にストアづる。指定Ｖｆ間が来ると、
モニタ動作が終了したことをイベント回路Ｑ２を介して
上位装置２０に通知する。
この時、ページメモリをケースバイケースにハントする
方式ならその番号を付加情報として付加する必要がある
。
方式ならその番号を付加情報として付加する必要がある
。
次に、テストデータとして多くの情報を付加して上位装
ｂ！１２０に何らかの試験を行なう場合について説明す
る。この場合は送信動作とほぼ同様な動作をする。即ち
、まず上位装置２０はイベント回路Ｑ１を介して試験要
求をＣＰＬＪ１２に出す。
ｂ！１２０に何らかの試験を行なう場合について説明す
る。この場合は送信動作とほぼ同様な動作をする。即ち
、まず上位装置２０はイベント回路Ｑ１を介して試験要
求をＣＰＬＪ１２に出す。
ＣＰＬ１１２は空きのページメ七りをハントしく前もっ
て与えられでいる方式もある）、これをイベント回路Ｑ
２より上位装置２０に知らＵる。上位装置２０はこのペ
ージメモリにテストデータを書込み、ＣＰＵ１２にイベ
ント回路０１を介して試験動作開始指令を出ず。ＣＰＵ
１２は試験が終了すると、イベント回路Ｑ２を介して、
これを上位装置２０に知らせる。この時、テスト結果デ
ータを付加する必要があれば、先にハントしたページメ
モリに、あるいは新たにハントしたページメモリに占込
んで、その由、付加情報とじてイベント回路Ｑ２を介し
で上位装置２０に知らせる。
て与えられでいる方式もある）、これをイベント回路Ｑ
２より上位装置２０に知らＵる。上位装置２０はこのペ
ージメモリにテストデータを書込み、ＣＰＵ１２にイベ
ント回路０１を介して試験動作開始指令を出ず。ＣＰＵ
１２は試験が終了すると、イベント回路Ｑ２を介して、
これを上位装置２０に知らせる。この時、テスト結果デ
ータを付加する必要があれば、先にハントしたページメ
モリに、あるいは新たにハントしたページメモリに占込
んで、その由、付加情報とじてイベント回路Ｑ２を介し
で上位装置２０に知らせる。
（発明の効果）
以上説明したように本発明によれば、保守運用情報等の
オフライン情報の送受を対向装置との情報の送受と同じ
手段で行なうことができるので、オフライン情報送受専
用のハードを設けたりすることなく、しかも通常の情報
の送受手順と同様の手順で実行できる等の利点がある。
オフライン情報の送受を対向装置との情報の送受と同じ
手段で行なうことができるので、オフライン情報送受専
用のハードを設けたりすることなく、しかも通常の情報
の送受手順と同様の手順で実行できる等の利点がある。
第１図は本発明のオフライン情報転送方式の一実施例を
示１構成図、第２図は従来の情報送受信装置の一例を示
す構成図、第３図はＯＳ＋Ｕ本参照モデルの概念図であ
る。 １０ａ：信号送受信装置、１１ニジリアルデータインタ
フエース（ＳＤＩ＞、１２：プロセッサ（ＣＰＵ）、２
０：上位装置、ＰＭＯ、・・・・・・ｐＭｎ−１、ＰＭ
ｎ ：ベージメしり、Ｑｌ、Ｑ２：イベント回路。 特許出願人 沖電気工業株式会社 代理人弁理士 古 １） 精 孝 Ｉ）Ｍｏ、−１）Ｍｎ−１，ρＭｎ：ベージメモリＱ１
．Ｑ２：イベント回路 エンドシステム 中間システム エン
ドシステムＯ３Ｉ基本参照モデルの概念図 第３図
示１構成図、第２図は従来の情報送受信装置の一例を示
す構成図、第３図はＯＳ＋Ｕ本参照モデルの概念図であ
る。 １０ａ：信号送受信装置、１１ニジリアルデータインタ
フエース（ＳＤＩ＞、１２：プロセッサ（ＣＰＵ）、２
０：上位装置、ＰＭＯ、・・・・・・ｐＭｎ−１、ＰＭ
ｎ ：ベージメしり、Ｑｌ、Ｑ２：イベント回路。 特許出願人 沖電気工業株式会社 代理人弁理士 古 １） 精 孝 Ｉ）Ｍｏ、−１）Ｍｎ−１，ρＭｎ：ベージメモリＱ１
．Ｑ２：イベント回路 エンドシステム 中間システム エン
ドシステムＯ３Ｉ基本参照モデルの概念図 第３図
Claims (1)
- 【特許請求の範囲】 ハイレベルデータリンク等の高度な手順を使用する情報
送受信装置とその上位装置との間のオフライン情報転送
方式において、 情報送受信装置に、上位装置に対して送受信する情報を
一時蓄積するメモリと、該情報の送受信に関するコマン
ド／ステータスを送受する回路とを設け、 保守運用情報等のオフライン情報の受渡しを、前記メモ
リによるブロック転送により行なうことを特徴とする オフライン情報転送方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60252606A JPS62113255A (ja) | 1985-11-13 | 1985-11-13 | オフライン情報転送方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60252606A JPS62113255A (ja) | 1985-11-13 | 1985-11-13 | オフライン情報転送方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS62113255A true JPS62113255A (ja) | 1987-05-25 |
Family
ID=17239705
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60252606A Pending JPS62113255A (ja) | 1985-11-13 | 1985-11-13 | オフライン情報転送方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS62113255A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03201634A (ja) * | 1989-12-28 | 1991-09-03 | Oki Electric Ind Co Ltd | 保守情報転送方式 |
-
1985
- 1985-11-13 JP JP60252606A patent/JPS62113255A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03201634A (ja) * | 1989-12-28 | 1991-09-03 | Oki Electric Ind Co Ltd | 保守情報転送方式 |
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