JPS6211081Y2 - - Google Patents
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- Publication number
- JPS6211081Y2 JPS6211081Y2 JP8868278U JP8868278U JPS6211081Y2 JP S6211081 Y2 JPS6211081 Y2 JP S6211081Y2 JP 8868278 U JP8868278 U JP 8868278U JP 8868278 U JP8868278 U JP 8868278U JP S6211081 Y2 JPS6211081 Y2 JP S6211081Y2
- Authority
- JP
- Japan
- Prior art keywords
- frequency
- output
- pass filter
- frequency synthesizer
- low
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
Links
- 239000003990 capacitor Substances 0.000 claims description 4
- 230000003321 amplification Effects 0.000 claims 2
- 238000003199 nucleic acid amplification method Methods 0.000 claims 2
- 238000010586 diagram Methods 0.000 description 7
- 239000013078 crystal Substances 0.000 description 6
- 230000000295 complement effect Effects 0.000 description 5
- 230000007423 decrease Effects 0.000 description 2
- 230000003247 decreasing effect Effects 0.000 description 2
Landscapes
- Channel Selection Circuits, Automatic Tuning Circuits (AREA)
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【考案の詳細な説明】
本考案は出力周波数の変化に対する出力特性の
非対称性を改善した周波数シンセサイザに関す
る。
非対称性を改善した周波数シンセサイザに関す
る。
従来の周波数シンセサイザは第１図に示す如
く、電圧制御発振器（以下、VCOと記す。）１と
フエーズ・ロツクド・ループ（以下、PLLと記
す。）８とからなつている。PLL８はVCO１の出
力周波数を分周する分周器２と、分周器２の出力
を分周するプログラマブル・デイバイダ３と、水
晶発振器４と、水晶発振器４の出力を分周する分
周器５と、プログラマブル・デイバイダ３のおよ
び分周器５の出力周波数を位相比較する位相比較
器６と、位相比較器６の出力を入力とするアクテ
イブフイルタからなるローパスフイルタ７とから
なつている。またVCO１はローパスフイルタ７
の出力を共振回路に接続したバラクタダイオード
９に印加されてその出力周波数を変化させる。
く、電圧制御発振器（以下、VCOと記す。）１と
フエーズ・ロツクド・ループ（以下、PLLと記
す。）８とからなつている。PLL８はVCO１の出
力周波数を分周する分周器２と、分周器２の出力
を分周するプログラマブル・デイバイダ３と、水
晶発振器４と、水晶発振器４の出力を分周する分
周器５と、プログラマブル・デイバイダ３のおよ
び分周器５の出力周波数を位相比較する位相比較
器６と、位相比較器６の出力を入力とするアクテ
イブフイルタからなるローパスフイルタ７とから
なつている。またVCO１はローパスフイルタ７
の出力を共振回路に接続したバラクタダイオード
９に印加されてその出力周波数を変化させる。
また、ローパスフイルタ７はダーリントン接続
したトランジスタ１０と１１とからなる直流増幅
器と、抵抗１２とコンデンサ１３とを直列接続し
た負帰還回路とからなるアクテイブフイルタで構
成されている。
したトランジスタ１０と１１とからなる直流増幅
器と、抵抗１２とコンデンサ１３とを直列接続し
た負帰還回路とからなるアクテイブフイルタで構
成されている。
この周波数シンセサイザは、プログラマブルデ
イバイダ３の分周比を設定してVCO１から所望
の周波数の出力を得ることができる。
イバイダ３の分周比を設定してVCO１から所望
の周波数の出力を得ることができる。
しかし、上記の周波数シンセサイザにおいて、
異なる２つの周波数の出力を交互にVCO１より
得るようにプログラマブルカウンタ３を設定した
場合、VCO１のバラクタダイオード９の両端に
印加される電圧は第２図に示す如く周波数を増加
させる方向の場合と、周波数を下降させる方向の
場合とで異なる。これは周波数シンセサイザの出
力特性に非対称性があることを示している。
異なる２つの周波数の出力を交互にVCO１より
得るようにプログラマブルカウンタ３を設定した
場合、VCO１のバラクタダイオード９の両端に
印加される電圧は第２図に示す如く周波数を増加
させる方向の場合と、周波数を下降させる方向の
場合とで異なる。これは周波数シンセサイザの出
力特性に非対称性があることを示している。
この理由は、ローパスフイルタ７の直流増幅器
がその出力電圧の上昇時の応答と、その出力電圧
の下降時の応答とが異なるためである。
がその出力電圧の上昇時の応答と、その出力電圧
の下降時の応答とが異なるためである。
本考案は上記にかんがみなされたもので、上記
の欠点を解消した周波数シンセサイザを提供する
ことを目的とする。
の欠点を解消した周波数シンセサイザを提供する
ことを目的とする。
この目的は本考案によればローパスフイルタを
駆動する直流増幅器を有するPLLを用いた周波数
シンセサイザにおいて、前記直流増幅器の出力段
を構成するトランジスタをコンプリメンタリ接続
とすることにより達成される。
駆動する直流増幅器を有するPLLを用いた周波数
シンセサイザにおいて、前記直流増幅器の出力段
を構成するトランジスタをコンプリメンタリ接続
とすることにより達成される。
以下、本考案を実施例により説明する。
第３図は本考案の一実施例のブロツク図であ
る。
る。
第３図において第１図と同一構成要素には同一
の符号を付してある。
の符号を付してある。
１はVCOであり、VCO１の出力を分周する分
周器２、分周器２の出力を分周するプログラマブ
ルデイバイダ３。水晶発振器４、水晶発振器４の
出力周波数を分周する分周器５、プログラマブル
デイバイダ３および分周器５の出力周波数を位相
比較する位相比較器６、およびローパスフイルタ
７′とでPLL８を構成し、ローパスフイルタ７′の
出力をVCO１の共振回路に接続したバラクタダ
イオード９に印加して周波数シンセサイザを構成
する。
周器２、分周器２の出力を分周するプログラマブ
ルデイバイダ３。水晶発振器４、水晶発振器４の
出力周波数を分周する分周器５、プログラマブル
デイバイダ３および分周器５の出力周波数を位相
比較する位相比較器６、およびローパスフイルタ
７′とでPLL８を構成し、ローパスフイルタ７′の
出力をVCO１の共振回路に接続したバラクタダ
イオード９に印加して周波数シンセサイザを構成
する。
一方、ローパスフイルタ７′はダーリントン接
続したトランジスタ１０と１１および出力段とし
てコンプリメンタリ接続したトランジスタ１４と
１５とからなる直流増幅器と、抵抗１２およびコ
ンデンサ１３を直列接続した負帰還回路とからな
るローパスのアクテイブフイルタで構成する。
続したトランジスタ１０と１１および出力段とし
てコンプリメンタリ接続したトランジスタ１４と
１５とからなる直流増幅器と、抵抗１２およびコ
ンデンサ１３を直列接続した負帰還回路とからな
るローパスのアクテイブフイルタで構成する。
本実施例の周波数シンセサイザは第１図に示し
た従来の周波数シンセサイザと同様にプログラマ
ブル・デイバイダ３の分周比を設定してVCO１
の出力から所望の周波数の出力を得ることができ
る。
た従来の周波数シンセサイザと同様にプログラマ
ブル・デイバイダ３の分周比を設定してVCO１
の出力から所望の周波数の出力を得ることができ
る。
しかし本実施例の場合において、VCO１から
異なる２つの周波数の出力を得るようにプログラ
マブル・デイバイダ３を設定した場合、ローパス
フイルタ７′を構成する直流増幅器の出力段はト
ランジスタ１４と１５とをコンプリメンタリ接続
して構成してあるため、第４図に示す如くバラク
タダイオード９の両端に印加される電圧は周波数
を増加させる方向の場合と、周波数を下降させる
方向の場合とが対称となり、周波数シンセサイザ
の出力周波数を上昇させる場合と、下降させる場
合の出力特性を対称とすることができる。
異なる２つの周波数の出力を得るようにプログラ
マブル・デイバイダ３を設定した場合、ローパス
フイルタ７′を構成する直流増幅器の出力段はト
ランジスタ１４と１５とをコンプリメンタリ接続
して構成してあるため、第４図に示す如くバラク
タダイオード９の両端に印加される電圧は周波数
を増加させる方向の場合と、周波数を下降させる
方向の場合とが対称となり、周波数シンセサイザ
の出力周波数を上昇させる場合と、下降させる場
合の出力特性を対称とすることができる。
つぎに本考案の他の実施例につき説明する。
第５図は本考案の他の実施例のブロツク図であ
る。
る。
第５図において、第１図および第３図と同一の
構成要素には同一の符号を付してある。
構成要素には同一の符号を付してある。
１はVCOであり、分周器２および５、プログ
ラマブル・デイバイダ３、水晶発振器４、位相比
較器６、ローパスフイルタ７″はPLL８を構成
し、PLL８とVCO１とで周波数シンセサイザを
構成している。
ラマブル・デイバイダ３、水晶発振器４、位相比
較器６、ローパスフイルタ７″はPLL８を構成
し、PLL８とVCO１とで周波数シンセサイザを
構成している。
ローパスフイルタ７″は出力段にトランジスタ
１７と１８とをコンプリメンタリ接続して構成し
た演算増幅器１６と、抵抗１２とコンデンサ１３
とを直列接続した負帰還回路とからなるローパス
のアクテイブフイルタで構成する。
１７と１８とをコンプリメンタリ接続して構成し
た演算増幅器１６と、抵抗１２とコンデンサ１３
とを直列接続した負帰還回路とからなるローパス
のアクテイブフイルタで構成する。
本実施例の周波数シンセサイザも、第１図およ
び第２図に示した周波数シンセサイザと同様にプ
ログラマブル・デイバイダ３の分周比を設定する
ことによりVCO１の出力から所望の周波数の出
力を得ることができる。
び第２図に示した周波数シンセサイザと同様にプ
ログラマブル・デイバイダ３の分周比を設定する
ことによりVCO１の出力から所望の周波数の出
力を得ることができる。
しかし、本実施例の場合において、ローパスフ
イルタ７″を構成する演算増幅器１６の出力段を
トランジスタ１７と１８とをコンプリメンタリ接
続で構成してあるため、前記一実施例の場合と同
様に、プログラマブル・デイバイダ３により異な
る２つの周波数を交互に設定した場合、バラクタ
ダイオード９に印加される電圧は第４図に示す如
く周波数の上昇する場合と、周波数の下降する場
合と対称となり、周波数シンセサイザの出力周波
数を上昇させる場合と下降させる場合の出力特性
を対称とすることができる。
イルタ７″を構成する演算増幅器１６の出力段を
トランジスタ１７と１８とをコンプリメンタリ接
続で構成してあるため、前記一実施例の場合と同
様に、プログラマブル・デイバイダ３により異な
る２つの周波数を交互に設定した場合、バラクタ
ダイオード９に印加される電圧は第４図に示す如
く周波数の上昇する場合と、周波数の下降する場
合と対称となり、周波数シンセサイザの出力周波
数を上昇させる場合と下降させる場合の出力特性
を対称とすることができる。
尚、以上の説明においてPLLを構成するローパ
スフイルタはアクテイブフイルタで構成した例で
説明したが、特にアクテイブフイルタに限る必要
はなく、一般のCR型のフイルタと出力段を構成
するトランジスタをコンプリメンタリ接続とした
直流増幅器とで構成しても勿論差支えない。
スフイルタはアクテイブフイルタで構成した例で
説明したが、特にアクテイブフイルタに限る必要
はなく、一般のCR型のフイルタと出力段を構成
するトランジスタをコンプリメンタリ接続とした
直流増幅器とで構成しても勿論差支えない。
以上説明した如く本考案によれば、ローパスフ
イルタを駆動する直流増幅器を備えたPLLを用い
た周波数シンセサイザにおいて、前記直流増幅器
の出力段を構成するトランジスタをコンプリメン
タリ接続としたことにより、周波数シンセサイザ
の周波数変化時の出力特性を対称とするこことが
できる。
イルタを駆動する直流増幅器を備えたPLLを用い
た周波数シンセサイザにおいて、前記直流増幅器
の出力段を構成するトランジスタをコンプリメン
タリ接続としたことにより、周波数シンセサイザ
の周波数変化時の出力特性を対称とするこことが
できる。
第１図は従来の周波数シンセサイザの構成を示
すブロツク図。第２図は第１図の周波数シンセサ
イザの周波数変化時の出力特性を説明に供する
図。第３図は本考案の一実施例のブロツク図。第
４図は本考案の周波数シンセサイザの周波数変化
時の出力特性の説明に供する図。第５図は本考案
の他の実施例のブロツク図。 １；VCO、２および５；分周器、３；プログ
ラマブル・デイバイダ、４；水晶発振器、６；位
相比較器、７，７′および７″；ローパスフイル
タ、８；PLL、９；バラクタダイオード、１０，
１１，１４，１５，１７および１８；トランジス
タ、１６；演算増幅器。
すブロツク図。第２図は第１図の周波数シンセサ
イザの周波数変化時の出力特性を説明に供する
図。第３図は本考案の一実施例のブロツク図。第
４図は本考案の周波数シンセサイザの周波数変化
時の出力特性の説明に供する図。第５図は本考案
の他の実施例のブロツク図。 １；VCO、２および５；分周器、３；プログ
ラマブル・デイバイダ、４；水晶発振器、６；位
相比較器、７，７′および７″；ローパスフイル
タ、８；PLL、９；バラクタダイオード、１０，
１１，１４，１５，１７および１８；トランジス
タ、１６；演算増幅器。
Claims (1)
- アクテイブローパスフイルタを有するフエー
ズ・ロツクド・ループを用いた周波数シンセサイ
ザにおいて、前記フエーズ・ロツクド・ループ中
に前段の増幅部と、コンプリメンタリ接続された
トランジスタより構成された出力段の増幅部を備
え、前段の増幅部の入力線路より出力段の増幅部
の出力線路との間に抵抗とコンデンサの直列回路
を接続したアクテイブローパスフイルタを用いた
ことを特徴とする周波数シンセサイザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8868278U JPS6211081Y2 (ja) | 1978-06-28 | 1978-06-28 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8868278U JPS6211081Y2 (ja) | 1978-06-28 | 1978-06-28 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS555651U JPS555651U (ja) | 1980-01-14 |
| JPS6211081Y2 true JPS6211081Y2 (ja) | 1987-03-16 |
Family
ID=29015391
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8868278U Expired JPS6211081Y2 (ja) | 1978-06-28 | 1978-06-28 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6211081Y2 (ja) |
-
1978
- 1978-06-28 JP JP8868278U patent/JPS6211081Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS555651U (ja) | 1980-01-14 |
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