JPS6173189A - Ｃｒｔ表示制御回路 - Google Patents
Ｃｒｔ表示制御回路Info
- Publication number
- JPS6173189A JPS6173189A JP59196013A JP19601384A JPS6173189A JP S6173189 A JPS6173189 A JP S6173189A JP 59196013 A JP59196013 A JP 59196013A JP 19601384 A JP19601384 A JP 19601384A JP S6173189 A JPS6173189 A JP S6173189A
- Authority
- JP
- Japan
- Prior art keywords
- character
- control circuit
- symbol
- display control
- crt display
- Prior art date
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- Granted
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は電子機器に用いられるＣＲＴ表示制御回路に関
するものである。
するものである。
従来例の構成とその問題点
近年、ＣＲＴ表示制御回路は、ワード・プロセッサにお
いて重要な役割を果たしている。特にドイツ語、スペイ
ン語等を扱う装置においては通常のアルファベットに加
えてｕａ等の記号を表示すすることか要請されている。
いて重要な役割を果たしている。特にドイツ語、スペイ
ン語等を扱う装置においては通常のアルファベットに加
えてｕａ等の記号を表示すすることか要請されている。
以下従来のＣＲＴ表示制御回路について説明する。
第１図は従来のＣＲＴ表示制御回路を示す。
図において、文字コードメモリ１はリフレッシュアドレ
スに対応した文字コードを出力する。文字パターン発生
メモリー（以下ＣＧと略す）２は文字コードにより指定
される番地より表示ノくターンを読み出しシフトレジス
タ３へ書き込む。
スに対応した文字コードを出力する。文字パターン発生
メモリー（以下ＣＧと略す）２は文字コードにより指定
される番地より表示ノくターンを読み出しシフトレジス
タ３へ書き込む。
以上の方法で、第２図に示すような文字と記号を表示し
ようとすれば、可能な全ての文字と記号の組み合わせを
ＣＧに格納しておかねばならない。
ようとすれば、可能な全ての文字と記号の組み合わせを
ＣＧに格納しておかねばならない。
しかしながら、限られたＣＧの容量ではこの方法は実現
不可能である。一方解決策として、第３図のように、文
字コードメモリ１１の出力を文字ＣＧ１３に接続して、
文字パターンを得て、記号コードメモリ１２の出力を記
号ＣＧ１４へ接続して記号パターンを得る方法が考えら
れるが、この場合はＣＧが余分に最低２個必要となり、
またＣＧは高価なものであるためコストアップにつなが
るという問題があった。
不可能である。一方解決策として、第３図のように、文
字コードメモリ１１の出力を文字ＣＧ１３に接続して、
文字パターンを得て、記号コードメモリ１２の出力を記
号ＣＧ１４へ接続して記号パターンを得る方法が考えら
れるが、この場合はＣＧが余分に最低２個必要となり、
またＣＧは高価なものであるためコストアップにつなが
るという問題があった。
発明の目的
本発明は上記の従来の欠点を解消するもので、１個のパ
ターン発生メモリで文字と記号を独立して指定可能なＣ
ＲＴ表示制御回路を提供することを目的とする。
ターン発生メモリで文字と記号を独立して指定可能なＣ
ＲＴ表示制御回路を提供することを目的とする。
発明の構成
本発明は、文字コードメモリと記号コードメモリとそれ
らの出力を切り替えるセレクタと文字パターンと記号パ
ターンを格納する領域をそれぞれ有する。文字記号ＣＧ
を設けることにより、１個のパターン発生メモリで文字
と記号を独立して指定可能としたものである。
らの出力を切り替えるセレクタと文字パターンと記号パ
ターンを格納する領域をそれぞれ有する。文字記号ＣＧ
を設けることにより、１個のパターン発生メモリで文字
と記号を独立して指定可能としたものである。
実施例の説明
第４図は本発明の一実施例におけるＣＲＴ表示の
制御回路１ブロック図を示すものであり、第６図は第４
図において使用されるＣＧ２４の構成を示すものである
。
図において使用されるＣＧ２４の構成を示すものである
。
文字コードメモリ２１と記号コードメモリ２２からのデ
ータは、セレクタ２３で選択されたのち、第５図の構成
をもつ文字記号ＣＧ２４に入力される。文字記号ＣＧ２
４の出力はシフトレジスタ２５により並列−直列変換さ
れてビデオ信号となる。
ータは、セレクタ２３で選択されたのち、第５図の構成
をもつ文字記号ＣＧ２４に入力される。文字記号ＣＧ２
４の出力はシフトレジスタ２５により並列−直列変換さ
れてビデオ信号となる。
以上のように構成された本実施例のＣＲＴ制御回路の動
作について以下説明をする。
作について以下説明をする。
１文字表示頭域の上部すなわち記り表示部ではロウアド
レスのＲＡ２＝ＲＡ３＝Ｏであり、この期間は記号コー
ドがＣＧ２４に入力されそのコードに応じた記号パター
ンを出力することができる。
レスのＲＡ２＝ＲＡ３＝Ｏであり、この期間は記号コー
ドがＣＧ２４に入力されそのコードに応じた記号パター
ンを出力することができる。
さらに文字表示＠域ではＲＡ２＝ＲＡ３＝ｏが満足され
ない為文字コードがＣＧ２４に入力され、そのコードに
応じた文字コードを出力することができる。
ない為文字コードがＣＧ２４に入力され、そのコードに
応じた文字コードを出力することができる。
以上のように本実施例によれば、ＣＧが１個にもかかわ
らず、表示領域に応じたコードを入力することによりＣ
Ｇ２個分の機能を持たせることができる。
らず、表示領域に応じたコードを入力することによりＣ
Ｇ２個分の機能を持たせることができる。
実施例においては文字と記号の２つのパターンを指定す
るようになっているが、３つ以上のパターンに対しても
本発明を適用して所期の効果を得ることができる。
るようになっているが、３つ以上のパターンに対しても
本発明を適用して所期の効果を得ることができる。
発明の効果
本発明は文字コードメモリと記号コードメモリとそれら
の出力を選択するセレクタと記号パターンを格納する＠
域と文字パターンを格納する領域をもつ文字記号ＣＧと
シフトレジスタとを設けることにより、１個のＣＧを使
用して文字と記号を独立して表示することができるもの
である。
の出力を選択するセレクタと記号パターンを格納する＠
域と文字パターンを格納する領域をもつ文字記号ＣＧと
シフトレジスタとを設けることにより、１個のＣＧを使
用して文字と記号を独立して表示することができるもの
である。
第１図は従来のＣＲＴ表示制御回路のブロック図、第２
図は第１図で使用されるＣＧの内容を示す図、第３図は
ＣＧを２個使用したＣＲＴ表示制御回路のブロック図、
第４図は本発明の一実施例におけるＣＲＴ表示制御回路
のブロック図、第５図は同回路で使用されたＣＧの構成
を示す図である。 ２１・・・・・・文字コードメモリ、２２・・・・・・
記号コードメモリ、２４・・・・・・文字記号ＣＧ１２
５・山・・シフトレジスタ。 第１図 第２図 第３図
図は第１図で使用されるＣＧの内容を示す図、第３図は
ＣＧを２個使用したＣＲＴ表示制御回路のブロック図、
第４図は本発明の一実施例におけるＣＲＴ表示制御回路
のブロック図、第５図は同回路で使用されたＣＧの構成
を示す図である。 ２１・・・・・・文字コードメモリ、２２・・・・・・
記号コードメモリ、２４・・・・・・文字記号ＣＧ１２
５・山・・シフトレジスタ。 第１図 第２図 第３図
Claims (1)
- 文字コードを出力する文字コードメモリと、記号コード
を出力する記号コードメモリと、文字パターンおよび記
号パターンをそれぞれ格納する領域を備えたパターン発
生メモリーと、前記コードメモリの出力を切りかえて上
記パターン発生メモリに供給するセレクタを有するＣＲ
Ｔ表示制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59196013A JPS6173189A (ja) | 1984-09-19 | 1984-09-19 | Ｃｒｔ表示制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59196013A JPS6173189A (ja) | 1984-09-19 | 1984-09-19 | Ｃｒｔ表示制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6173189A true JPS6173189A (ja) | 1986-04-15 |
| JPH0462590B2 JPH0462590B2 (ja) | 1992-10-06 |
Family
ID=16350775
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59196013A Granted JPS6173189A (ja) | 1984-09-19 | 1984-09-19 | Ｃｒｔ表示制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6173189A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01113288U (ja) * | 1988-01-27 | 1989-07-31 | ||
| JPH02262697A (ja) * | 1989-04-03 | 1990-10-25 | Mitsubishi Electric Corp | 半導体記憶装置 |
-
1984
- 1984-09-19 JP JP59196013A patent/JPS6173189A/ja active Granted
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01113288U (ja) * | 1988-01-27 | 1989-07-31 | ||
| JPH02262697A (ja) * | 1989-04-03 | 1990-10-25 | Mitsubishi Electric Corp | 半導体記憶装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0462590B2 (ja) | 1992-10-06 |
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