JPS6160575B2 - - Google Patents
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- JPS6160575B2 JPS6160575B2 JP56071657A JP7165781A JPS6160575B2 JP S6160575 B2 JPS6160575 B2 JP S6160575B2 JP 56071657 A JP56071657 A JP 56071657A JP 7165781 A JP7165781 A JP 7165781A JP S6160575 B2 JPS6160575 B2 JP S6160575B2
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Classifications
-
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- H01L—SEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
- H01L23/00—Details of semiconductor or other solid state devices
- H01L23/48—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor
- H01L23/488—Arrangements for conducting electric current to or from the solid state body in operation, e.g. leads, terminal arrangements ; Selection of materials therefor consisting of soldered or bonded constructions
- H01L23/495—Lead-frames or other flat leads
- H01L23/49541—Geometry of the lead-frame
- H01L23/49558—Insulating layers on lead frames, e.g. bridging members
-
- H—ELECTRICITY
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- H01L2224/01—Means for bonding being attached to, or being formed on, the surface to be connected, e.g. chip-to-package, die-attach, "first-level" interconnects; Manufacturing methods related thereto
- H01L2224/50—Tape automated bonding [TAB] connectors, i.e. film carriers; Manufacturing methods related thereto
-
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Description
【発明の詳細な説明】
本発明は半導体装置の製造方法にかかり、とく
にいわゆるTAB(Tape Automated Bonding)
法によつて製造される半導体装置の製造方法に関
するものである。
にいわゆるTAB(Tape Automated Bonding)
法によつて製造される半導体装置の製造方法に関
するものである。
TAB法は、例えば第1図aに示すように、絶
縁性フイルム1に設けられた開孔部2に支持体3
に支えられたリード4を突出させ、このリードの
先端に半導体チツプ5を接続するものである。半
導体チツプとリードとの接続は、通常、チツプの
電極を金で突起状に形成し、これに銅でできたリ
ードに金や錫をめつきし、Au/Auの熱圧着また
はAu/Snの共晶合金により行なわれる。以上の
ようにして接続されたチツプを支持体3を一体の
まま第1図bのように切断し、これを例えば第1
図cのように、プリント基板6に開けられた貫通
孔7に挿入してリード4の末端を配線8に接続す
る。この例では、半導体チツプ5はリード4に支
えられて宙吊りになるが、例えば第2図に断面図
に示したように、セラミツク基板9に半導体チツ
プ5を固着し、リード4の末端を導電層10に接
続してもよい。導電層10はピン11に接続さ
れ、プリント基板やソケツトに挿入して使用され
る。
縁性フイルム1に設けられた開孔部2に支持体3
に支えられたリード4を突出させ、このリードの
先端に半導体チツプ5を接続するものである。半
導体チツプとリードとの接続は、通常、チツプの
電極を金で突起状に形成し、これに銅でできたリ
ードに金や錫をめつきし、Au/Auの熱圧着また
はAu/Snの共晶合金により行なわれる。以上の
ようにして接続されたチツプを支持体3を一体の
まま第1図bのように切断し、これを例えば第1
図cのように、プリント基板6に開けられた貫通
孔7に挿入してリード4の末端を配線8に接続す
る。この例では、半導体チツプ5はリード4に支
えられて宙吊りになるが、例えば第2図に断面図
に示したように、セラミツク基板9に半導体チツ
プ5を固着し、リード4の末端を導電層10に接
続してもよい。導電層10はピン11に接続さ
れ、プリント基板やソケツトに挿入して使用され
る。
以上の説明から明らかなように、支持体3は半
導体チツプの接続やリードの切断の際にリードの
不整列防止のために効果的な働きをする。しか
し、従来は、第1図cや第2図のようにリードの
末端を配線8や導電層10に接続した後もこの支
持体をリードに付着したままであつたので、これ
が半導体装置の信頼性を低下させる原因となつて
いた。即ち、支持体はポリイミド樹脂等の有機物
であることが多く、これは吸湿性があるので、リ
ード間でリークが生じるなどの問題があつた。
導体チツプの接続やリードの切断の際にリードの
不整列防止のために効果的な働きをする。しか
し、従来は、第1図cや第2図のようにリードの
末端を配線8や導電層10に接続した後もこの支
持体をリードに付着したままであつたので、これ
が半導体装置の信頼性を低下させる原因となつて
いた。即ち、支持体はポリイミド樹脂等の有機物
であることが多く、これは吸湿性があるので、リ
ード間でリークが生じるなどの問題があつた。
この問題の対策として、第3図aのようにリー
ド4の先端に接続した半導体チツプ5を、図中に
示した破線で切断して第3図bのようにリードの
末端に支持体3を形成し、しかる後に支持体3を
切断除去し、例えば第3図cのようにリードを成
形して、外部端子に接続する方法がある。この方
法ならば、支持体が残らないので上記のような問
題がなくなるが、しかし、リードの末端を外部端
子に接続する前に支持体を切断除去してしまうの
で、リードの曲がりなどが生ずることがあつた。
ド4の先端に接続した半導体チツプ5を、図中に
示した破線で切断して第3図bのようにリードの
末端に支持体3を形成し、しかる後に支持体3を
切断除去し、例えば第3図cのようにリードを成
形して、外部端子に接続する方法がある。この方
法ならば、支持体が残らないので上記のような問
題がなくなるが、しかし、リードの末端を外部端
子に接続する前に支持体を切断除去してしまうの
で、リードの曲がりなどが生ずることがあつた。
本発明はかかる問題を解消するためになされた
もので、その特徴は、半導体チツプに接続された
リードの末端を外部端子即ち、第1図に於ける配
線8や第2図に於ける導電層10などに接続した
後、支持体を除去してしまうことにあり、これに
よりリードの不整列の問題とリード間リークによ
る信頼性上の問題を一拳に解決しようとするもの
である。
もので、その特徴は、半導体チツプに接続された
リードの末端を外部端子即ち、第1図に於ける配
線8や第2図に於ける導電層10などに接続した
後、支持体を除去してしまうことにあり、これに
よりリードの不整列の問題とリード間リークによ
る信頼性上の問題を一拳に解決しようとするもの
である。
以下に本発明の実施例を詳細に説明する。
通常、リードは絶縁性フイルムにエポキシ系樹
脂やポリエステル系樹脂で接着して形成される。
従つて、支持枠を除去するにはこれらの樹脂を溶
解すればよい。この溶剤として最も有効なのは、
オルト・ジ・クロル・ベンゼルとテトラ・クロ
ル・エチレンをそれぞれ2:1に混合したもので
ある。これを約150℃に温めこれに第2図に示し
たようなセラミツク・ケースに組み込んだ半導体
装置を15〜20分浸漬しておけば、上記の樹脂は完
全に溶解し、支持体がリード・パタンから分離で
きる。第2図の場合、支持体3は、リード・パタ
ンの下側に付いているので、上記のようにしてリ
ードから分離しても、半導体装置から除去できな
い。従つて、このような場合は第4図に示したよ
うに支持体3が表側になるように半導体チツプを
接続すればよい。即ち、第1図aに示したものと
は反対に半導体チツプを接続しておく。
脂やポリエステル系樹脂で接着して形成される。
従つて、支持枠を除去するにはこれらの樹脂を溶
解すればよい。この溶剤として最も有効なのは、
オルト・ジ・クロル・ベンゼルとテトラ・クロ
ル・エチレンをそれぞれ2:1に混合したもので
ある。これを約150℃に温めこれに第2図に示し
たようなセラミツク・ケースに組み込んだ半導体
装置を15〜20分浸漬しておけば、上記の樹脂は完
全に溶解し、支持体がリード・パタンから分離で
きる。第2図の場合、支持体3は、リード・パタ
ンの下側に付いているので、上記のようにしてリ
ードから分離しても、半導体装置から除去できな
い。従つて、このような場合は第4図に示したよ
うに支持体3が表側になるように半導体チツプを
接続すればよい。即ち、第1図aに示したものと
は反対に半導体チツプを接続しておく。
第1図cに示したようなプリント基板に実装さ
れた半導体装置の場合は、上記のような溶剤に浸
漬すると、プリント基板上の配線8まで剥離して
しまう恐れがある。このような場合は、絶縁性フ
イルムとリードとの接着にポリエステル系の樹脂
を使えば、これは熱可塑性であるので熱を加える
ことにより接着力が低下し、容易に剥がすことが
できる。
れた半導体装置の場合は、上記のような溶剤に浸
漬すると、プリント基板上の配線8まで剥離して
しまう恐れがある。このような場合は、絶縁性フ
イルムとリードとの接着にポリエステル系の樹脂
を使えば、これは熱可塑性であるので熱を加える
ことにより接着力が低下し、容易に剥がすことが
できる。
また、絶縁性フイルムにポリイミドを使い、リ
ードとポリイミドとを、上記のような樹脂を介さ
ずに直接に接着してリード・パタンを形成するも
のもある。このような場合は、このポリイミドで
形成した支持体を、例えばヒドラジンなどで溶解
すればよい。支持体の厚さが40〜50μmの場合、
50〜60℃に温めたヒドラジンに20〜30分程度浸漬
しておけば容易に支持体を除去できる。
ードとポリイミドとを、上記のような樹脂を介さ
ずに直接に接着してリード・パタンを形成するも
のもある。このような場合は、このポリイミドで
形成した支持体を、例えばヒドラジンなどで溶解
すればよい。支持体の厚さが40〜50μmの場合、
50〜60℃に温めたヒドラジンに20〜30分程度浸漬
しておけば容易に支持体を除去できる。
以上のようにして、支持体を除去することが可
能であるが、支持体を除去した後、リードが曲が
つたりして相互に接触することが懸念される。し
かし、通常、ワイヤ・ボンデイング法で用いてい
る金やアルミニウムの細線が直径25〜30μmであ
るのに対し、TAB法のリードは35μm厚×100μ
m幅の銅で形成されているので、振動や衝撃等で
曲がることは殆んどなく、信頼性上の問題はな
い。
能であるが、支持体を除去した後、リードが曲が
つたりして相互に接触することが懸念される。し
かし、通常、ワイヤ・ボンデイング法で用いてい
る金やアルミニウムの細線が直径25〜30μmであ
るのに対し、TAB法のリードは35μm厚×100μ
m幅の銅で形成されているので、振動や衝撃等で
曲がることは殆んどなく、信頼性上の問題はな
い。
以上、詳細に説明したように、従来のTAB法
によつて組み立てられた半導体装置は、不要な支
持体を残していたために高い信頼度を維持するこ
とが困難であつたが、本発明によつて、より高信
頼の半導体装置を製造することが可能となつた。
によつて組み立てられた半導体装置は、不要な支
持体を残していたために高い信頼度を維持するこ
とが困難であつたが、本発明によつて、より高信
頼の半導体装置を製造することが可能となつた。
第1図乃至第3図は本発明に関わるTAB法の
半導体装置の例を示した図であり、第4図は本発
明の実施を容易に行なうための半導体装置の組み
立て例を示した断面図である。 尚、図において、1……絶縁性フイルム、2…
…開孔部、3……支持体、4……リード、5……
半導体チツプ、6……プリント基板、7……貫通
孔、8……配線、9……セラミツク基板、10…
…導電層、11……ピンである。
半導体装置の例を示した図であり、第4図は本発
明の実施を容易に行なうための半導体装置の組み
立て例を示した断面図である。 尚、図において、1……絶縁性フイルム、2…
…開孔部、3……支持体、4……リード、5……
半導体チツプ、6……プリント基板、7……貫通
孔、8……配線、9……セラミツク基板、10…
…導電層、11……ピンである。
Claims (1)
- 1 絶縁性フイルムに開けられた開孔部に突出し
たリードに半導体チツプの電極を接続する工程
と、前記絶縁性フイルムの一部を一体のままリー
ドを切断する工程と、前記リードの末端部を外部
端子に接続する工程と、しかる後に前記絶縁性フ
イルムの一部を除去する工程とを含むことを特徴
とする半導体装置の製造方法。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56071657A JPS57186346A (en) | 1981-05-12 | 1981-05-12 | Manufacture of semiconductor device |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP56071657A JPS57186346A (en) | 1981-05-12 | 1981-05-12 | Manufacture of semiconductor device |
Publications (2)
Publication Number | Publication Date |
---|---|
JPS57186346A JPS57186346A (en) | 1982-11-16 |
JPS6160575B2 true JPS6160575B2 (ja) | 1986-12-22 |
Family
ID=13466892
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP56071657A Granted JPS57186346A (en) | 1981-05-12 | 1981-05-12 | Manufacture of semiconductor device |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS57186346A (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5057461A (en) * | 1987-03-19 | 1991-10-15 | Texas Instruments Incorporated | Method of mounting integrated circuit interconnect leads releasably on film |
-
1981
- 1981-05-12 JP JP56071657A patent/JPS57186346A/ja active Granted
Also Published As
Publication number | Publication date |
---|---|
JPS57186346A (en) | 1982-11-16 |
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