JPS6145430B2 - - Google Patents

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Publication number
JPS6145430B2
JPS6145430B2 JP998281A JP998281A JPS6145430B2 JP S6145430 B2 JPS6145430 B2 JP S6145430B2 JP 998281 A JP998281 A JP 998281A JP 998281 A JP998281 A JP 998281A JP S6145430 B2 JPS6145430 B2 JP S6145430B2
Authority
JP
Japan
Prior art keywords
clamp
circuit
synchronization
clamp circuit
time constant
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP998281A
Other languages
English (en)
Other versions
JPS57124971A (en
Inventor
Ichiji Munesawa
Toshihiko Tsuru
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
Nippon Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Nippon Electric Co Ltd filed Critical Nippon Electric Co Ltd
Priority to JP998281A priority Critical patent/JPS57124971A/ja
Publication of JPS57124971A publication Critical patent/JPS57124971A/ja
Publication of JPS6145430B2 publication Critical patent/JPS6145430B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04NPICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00Details of television systems
    • H04N5/04Synchronising
    • H04N5/08Separation of synchronising signals from picture signals

Landscapes

  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Synchronizing For Television (AREA)

Description

【発明の詳細な説明】 本発明はテレビジヨン信号から同期信号を分離
する同期分離回路に関する。
従来、同期分離回路は第1図に示すように、同
期を分離するコンパレータ2とクランプパルスを
発生するスライス回路3へは同じクランプ回路1
からの信号を供給していた。ここで第2図はクラ
ンプ回路1を等価的に表わしたもので、スイツチ
Sはクランプパルスにより、複合映像信号の同期
先端又は同期の後のペデスタル部分でオンし、同
期先端又はペデスタルの電圧をコンデンサCに充
電する。この充電された電圧により、入力信号は
同期先端又はペデスタルが一定電圧にクランプさ
れることになる。しかしながら、クランプ回路1
においてはコンデンサCの電圧はスイツチSがオ
フのときの等価抵抗Rにより放電され、コンデン
サCの電圧は次のクランプパルスが出るまでしだ
いに低下する。このときの様子を第3図を参照し
ながら説明する。同図で、aは入力、bはクラン
プ回路1の出力、cは同期信号部分の拡大図、d
はコンパレータ2の出力を示しており、又同図で
実線は映像レベルが高い場合、破線は映像レベル
が低い場合を示している。
前述のとおり、クランプ回路の時定数により入
力映像信号のレベルは時定数で決まる割合で低下
してゆくが、映像レベルの高い場合と低い場合と
で低下する絶対量が異なり、振幅の大きい場合ほ
ど低下するレベル値が大きく、第3図bのように
なる。すなわちペデスタルレベル(クランプ電
圧)に対するレベルの低下は映像レベルが高い場
合の方が大きく、又、実際の波形においては立ち
上がり及び立ち下がりがある程度傾斜しているた
め、同期信号部分の拡大図は第3図cに示すよう
になる。この結果、コンパレータ2において、第
3図cで示す基準レベルで同期信号を分離する
と、第3図dに示すように映像レベルの大きい場
合(実線)と小さい場合(破線)とでは同期信号
の前縁がずれることになる。
すなわち、コンパレータ2から分離した同期信
号は第3図dのように映像レベルの変動に伴い同
期前縁が変動する、いわゆるジツターを生じる。
このジツターの量はクランプ回路1におけるレベ
ル低下の量に対応しており、従つてCRの時定数
を大きくして、レベル低下を小さくすれば改善す
ることができる。
第4図a,b,cは映像レベルが大きく異なる
信号が切替わつたときのそれぞれ入力a、クラン
プ回路1の出力b、及びコンパレータ出力cを示
す図であり、平均映像レベルが異なる信号に切替
つた場合、同期先端又はペデスタルの電圧が急激
に変化し、クランプするためにはコンデンサCの
電圧もその変化分だけ変化しなければならない
が、同期先端又はペデスタルの電圧がスライス回
路3のスライス点よりずれるため、クランプパル
スが発生せず、コンデンサCの電圧を新たな電圧
に充電することができない。クランプパルスが出
ないためコンデンサCの電圧はCRの時定数にし
たがつてしだいに低下し、同期がスライス点にか
かるとクランプパルスが発生し、新たな電圧がC
に充電され、切替つた信号は同期先端又はペデス
タルでクランプされる。第4図bはクランプ回路
1の出力のこの様子を示すもので、コンパレータ
ー2の出力は第4図cのように新たにクランプが
かかるまで分離同期が抜けることになり、この抜
ける期間はCRの時定が大きいほど長くなる。以
上説明したように映像レベルの変動によるジツタ
ーを減らすためにはCR時定数を大きくし、他方
信号切替時の応答を速くするにはCR時定数を小
さくしなければならないが、第1図の構成では前
述したように同時に両特性を満足することができ
ないという欠点がある。
本発明の目的は、時定数の比較的小さいクラン
プ回路を追加することにより従来の欠点を解決
し、応答の速い映像レベルの分離同期への影響の
少ない同期分離回路を提供することである。
本発明によれば、時定数の大きな第一のクラン
プ回路と、時定数の小さな第二のクランプ回路と
を用意し、クランプパルスは第二のクランプ回路
の出力をスライスして作り、同期分離は第一のク
ランプを受けるコンパレータで行う同期分離回路
が得られる。
次に本発明の一実施例を示した図面を参照して
本発明を詳細に説明する。第5図は本発明の一実
施例を示す図であり、入力複合映像信号は第1の
クランプ回路4と、第2のクランプ回路6とに入
る。第1のクランプ回路4は時定数CRは比較的
大きく、映像レベルによる同期前縁のジツターは
少ない。このため、第1のクランプ回路4でクラ
ンプされた信号から、コンパレーター5で分離さ
れた同期信号の前縁のジツターは小さい。また第
2のクランプ回路6の時定数は比較的小さいた
め、第3図に示すような入力でも第2のクランプ
回路6より信号をうけるスライス回路7には短か
い時間でクランプパルスが発生し、平均映像レベ
ルの異なる信号に切替つた場合でも第1及び第2
のクランプ回路4,6は短い時間で切替後の信号
をクランプすることができる。したがつて、それ
自身では応答の遅い第1のクランプ回路4も、こ
のクランプパルスにより速くクランプを行うこと
ができる。
本発明は以上説明したように、時定数の大きい
クランプ回路を通つた信号より同期分離を行い、
時定数の小さいクランプ回路を通つた信号よりク
ランプパルスを発生させることにより、映像レベ
ルによる前縁変化が少なく応答の速い同期分離回
路を実現できる。
【図面の簡単な説明】
第1図は従来例を示すブロツク図、第2図はク
ランプ回路の等価回路、第3図は映像レベルによ
り同期前縁変化する様子を示す図、第4図は映像
平均レベルがステツプ状に変化した場合の同期分
離の動作を示す図、第5図は本発明の一実施例を
示すブロツク図である。 図において、1…クランプ回路、2…コンパレ
ーター、3…スライス回路、4…第1のクランプ
回路、5…コンパレーター、6…第2のクランプ
回路、7…スライス回路。

Claims (1)

    【特許請求の範囲】
  1. 1 入力映像信号を受けクランプパルスのタイミ
    ングによつて動作する第一のクランプ回路と、前
    記第一のクランプ回路の出力を受け同期信号を分
    離するコンパレータと、前記第一のクランプ回路
    の時定数より小さな時定数をもち、入力映像信号
    を受けクランプパルスのタイミングによつて動作
    する第二のクランプ回路と、前記第二のクランプ
    パルス回路の出力を受け前記クランプパルスを作
    るスライス回路とを具備することを特徴とする同
    期分離回路。
JP998281A 1981-01-26 1981-01-26 Synchronizing separation circuit Granted JPS57124971A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP998281A JPS57124971A (en) 1981-01-26 1981-01-26 Synchronizing separation circuit

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JP998281A JPS57124971A (en) 1981-01-26 1981-01-26 Synchronizing separation circuit

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Publication Number Publication Date
JPS57124971A JPS57124971A (en) 1982-08-04
JPS6145430B2 true JPS6145430B2 (ja) 1986-10-08

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ID=11735099

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JP998281A Granted JPS57124971A (en) 1981-01-26 1981-01-26 Synchronizing separation circuit

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Families Citing this family (2)

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Publication number Priority date Publication date Assignee Title
JPS6183376U (ja) * 1984-11-02 1986-06-02
JP4758107B2 (ja) 2005-01-25 2011-08-24 パナソニック株式会社 同期分離装置

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JPS57124971A (en) 1982-08-04

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