JPS6131548B2 - - Google Patents
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- Publication number
- JPS6131548B2 JPS6131548B2 JP4799078A JP4799078A JPS6131548B2 JP S6131548 B2 JPS6131548 B2 JP S6131548B2 JP 4799078 A JP4799078 A JP 4799078A JP 4799078 A JP4799078 A JP 4799078A JP S6131548 B2 JPS6131548 B2 JP S6131548B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- data
- memory circuit
- memory
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- Prior art date
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- Expired
Links
- 238000001514 detection method Methods 0.000 claims description 11
- 230000001934 delay Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 5
- 238000000034 method Methods 0.000 description 5
- 230000007423 decrease Effects 0.000 description 3
- 230000003111 delayed effect Effects 0.000 description 2
- 230000003213 activating effect Effects 0.000 description 1
- 125000004122 cyclic group Chemical group 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
- 230000001360 synchronised effect Effects 0.000 description 1
Landscapes
- Management Or Editing Of Information On Record Carriers (AREA)
- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
Description
【発明の詳細な説明】
本発明は、データ誤り検出回路とメモリ回路を
用いることにより、PCM録音テープ等の再生時
データに不連続点があつてもノイズが発生しない
ようにしたデイジタル信号の再生装置に関し、例
えばPCM録音テープの編集が切断によつても支
障がないようにしたものである。
用いることにより、PCM録音テープ等の再生時
データに不連続点があつてもノイズが発生しない
ようにしたデイジタル信号の再生装置に関し、例
えばPCM録音テープの編集が切断によつても支
障がないようにしたものである。
現在アナログ式録音再生機置においては、テー
プ編集を行う場合、音の継ぎ目をなくするために
第１図のようにテープＴを斜めに切断して継ぐ方
法が採られている。これに対してPCM録音再生
機等においては、音をデイジタル信号に変換して
テープ上に記録しているために従来のように単に
テープを切断して継ぐという方法を採ると、テー
プの継ぎ目でデータの不連続点が生じ、再生時に
はノイズとなつて現われるという問題がある。そ
こでテープを切断することなく編集を行うという
電子編集方式が考えられるが、この方式は装置が
大型かつ複雑になるとともに非常に高価となり、
また時間がかかるという問題がある。
プ編集を行う場合、音の継ぎ目をなくするために
第１図のようにテープＴを斜めに切断して継ぐ方
法が採られている。これに対してPCM録音再生
機等においては、音をデイジタル信号に変換して
テープ上に記録しているために従来のように単に
テープを切断して継ぐという方法を採ると、テー
プの継ぎ目でデータの不連続点が生じ、再生時に
はノイズとなつて現われるという問題がある。そ
こでテープを切断することなく編集を行うという
電子編集方式が考えられるが、この方式は装置が
大型かつ複雑になるとともに非常に高価となり、
また時間がかかるという問題がある。
本発明は例えばPCM録音されたテープをアナ
ログ式録音再生機と同じように切断して継ぐ方法
で編集したテープでもノイズが発生しないように
したデイジタル信号の再生装置を提供するもの
で、以下その一実施例について第２図〜第４図を
用いて説明しよう。
ログ式録音再生機と同じように切断して継ぐ方法
で編集したテープでもノイズが発生しないように
したデイジタル信号の再生装置を提供するもの
で、以下その一実施例について第２図〜第４図を
用いて説明しよう。
まず、第２図は本発明装置のブロツク回路図で
あり、例えばPCM録音されたテープからの再生
デイジタル信号Ｓはメモリ回路１に入力され、こ
こで一定時間遅延されてその出力から取り出され
る。このメモリ回路１は例えばランダムアクセス
メモリ（RAM）で構成され、指定されたアドレ
スにデータをメモリするものである。
あり、例えばPCM録音されたテープからの再生
デイジタル信号Ｓはメモリ回路１に入力され、こ
こで一定時間遅延されてその出力から取り出され
る。このメモリ回路１は例えばランダムアクセス
メモリ（RAM）で構成され、指定されたアドレ
スにデータをメモリするものである。
２は書き込みアドレス指定回路で、前記再生デ
イジタル信号と同期した信号、例えばテープ上に
デイジタル信号とともに記録されたクロツク信号
またそのデイジタル信号に基づいて作られた第１
のクロツク信号３により駆動され、前記メモリ回
路１に対してデータをメモリするアドレスを指示
する。
イジタル信号と同期した信号、例えばテープ上に
デイジタル信号とともに記録されたクロツク信号
またそのデイジタル信号に基づいて作られた第１
のクロツク信号３により駆動され、前記メモリ回
路１に対してデータをメモリするアドレスを指示
する。
４は読出しアドレス指定回路で、通常時はゲー
ト回路５を通つた前記第１のクロツク信号３によ
りメモリ回路１へのデータのメモリ周期と同期し
て駆動され、そのメモリ回路１にメモリされてい
るデータをそのメモリされた順番に読出し出力さ
せるものである。
ト回路５を通つた前記第１のクロツク信号３によ
りメモリ回路１へのデータのメモリ周期と同期し
て駆動され、そのメモリ回路１にメモリされてい
るデータをそのメモリされた順番に読出し出力さ
せるものである。
６は前記再生デイジタル信号を入力し、そのデ
ータ誤りを検出するデータ誤り検出回路で、その
データに誤りがあれば該データが入力されている
間中出力を発生する構成からなり、この誤り検出
の方法はCRC（Cyclic Redundancy Check）方
式が一般によく用いられる。
ータ誤りを検出するデータ誤り検出回路で、その
データに誤りがあれば該データが入力されている
間中出力を発生する構成からなり、この誤り検出
の方法はCRC（Cyclic Redundancy Check）方
式が一般によく用いられる。
７は前記データ誤り検出回路６の出力を入力
し、その出力からデータ誤り期間をメモリするメ
モリ回路であり、８は前記メモリ回路８にメモリ
されたデータ誤り期間に基づいて前記読出しアド
レス指定回路４を制御し、上記メモリ回路１の読
出しアドレスを指示する制御回路である。
し、その出力からデータ誤り期間をメモリするメ
モリ回路であり、８は前記メモリ回路８にメモリ
されたデータ誤り期間に基づいて前記読出しアド
レス指定回路４を制御し、上記メモリ回路１の読
出しアドレスを指示する制御回路である。
９は上記第１のクロツク信号３よりも僅かに低
い周波数の第２のクロツク信号で、前記メモリ回
路７から上記制御回路８により読出しアドレス指
定回路４をもつて行なわれるメモリ回路１の読出
しアドレスの指示と同期してメモリ回路７により
ゲート回路５が作動されることによつて該第２の
クロツク信号９が前記第１のクロツク信号３に代
わつて読出しアドレス指定回路４を作動させるよ
うになつている。
い周波数の第２のクロツク信号で、前記メモリ回
路７から上記制御回路８により読出しアドレス指
定回路４をもつて行なわれるメモリ回路１の読出
しアドレスの指示と同期してメモリ回路７により
ゲート回路５が作動されることによつて該第２の
クロツク信号９が前記第１のクロツク信号３に代
わつて読出しアドレス指定回路４を作動させるよ
うになつている。
１０は上記書込みアドレス指定回路２と読出し
アドレス指定回路４の各指定アドレスを比較する
比較回路で、そのメモリ回路１に指定する各指定
アドレスからメモリ回路１の全アドレスにデータ
がメモリされた時出力を発生し、その出力により
前記ゲート回路５を作動し、読出しアドレス指定
回路４に供給されるクロツク信号を第２のクロツ
ク信号９から第１のクロツク信号３に切換えるも
のである。
アドレス指定回路４の各指定アドレスを比較する
比較回路で、そのメモリ回路１に指定する各指定
アドレスからメモリ回路１の全アドレスにデータ
がメモリされた時出力を発生し、その出力により
前記ゲート回路５を作動し、読出しアドレス指定
回路４に供給されるクロツク信号を第２のクロツ
ク信号９から第１のクロツク信号３に切換えるも
のである。
以上のような構成において、正常は再生デイジ
タル信号がメモリ回路１並びにデータ誤り検出回
路６に入力されている状態ではそのデータ誤り検
出回路６には出力は発生されず、このため、再生
デイジタル信号は書込みアドレス指定回路２によ
り第１のクロツク信号３の周期に基づきメモリ回
路１のアドレスに順次メモリされて行き、また読
出しアドレス指定回路４により前記書込みアドレ
ス指定回路２のデータ書込み周期と同期して前記
メモリ回路１にメモリされたデイジタル信号がそ
のメモリされた順番に読出されて行く。すなわち
再生デイジタル信号はメモリ回路１のメモリ容量
分だけ遅延されて出力される。
タル信号がメモリ回路１並びにデータ誤り検出回
路６に入力されている状態ではそのデータ誤り検
出回路６には出力は発生されず、このため、再生
デイジタル信号は書込みアドレス指定回路２によ
り第１のクロツク信号３の周期に基づきメモリ回
路１のアドレスに順次メモリされて行き、また読
出しアドレス指定回路４により前記書込みアドレ
ス指定回路２のデータ書込み周期と同期して前記
メモリ回路１にメモリされたデイジタル信号がそ
のメモリされた順番に読出されて行く。すなわち
再生デイジタル信号はメモリ回路１のメモリ容量
分だけ遅延されて出力される。
そして、いま誤りデータが再生されて来るとこ
の誤りデータは上記の動作と同様にメモリ回路１
の各アドレスにメモリされて行くと同時に該誤り
データは誤りデータ検出回路６により検出され、
その誤りデータ期間はメモリ回路７でメモリされ
る。このメモリ回路７はこれにデータがメモリさ
れた時から出力を発生するまでの時間は上記メモ
リ回路１のメモリ容量により決定される遅延時
間、すなわちメモリ回路１にデータがメモリさ
れ、そのデータが読出されるまでの時間と同期さ
れており、またメモリ回路７にメモリされた誤り
データ期間に基づき制御回路８により読出しアド
レス指定回路４が読出すアドレスをメモリ回路１
の誤りデータがメモリされているアドレス分だけ
飛ばして読出すようになつているため、前記誤り
データがメモリ回路１にメモリされ、一定時間後
にそれが読出されようとした時、読出しアドレス
指定回路４はそのメモリ回路１の誤りデータがメ
モリされているアドレスを飛ばして次に正常なデ
ータがメモリされているアドレスを読出す。
の誤りデータは上記の動作と同様にメモリ回路１
の各アドレスにメモリされて行くと同時に該誤り
データは誤りデータ検出回路６により検出され、
その誤りデータ期間はメモリ回路７でメモリされ
る。このメモリ回路７はこれにデータがメモリさ
れた時から出力を発生するまでの時間は上記メモ
リ回路１のメモリ容量により決定される遅延時
間、すなわちメモリ回路１にデータがメモリさ
れ、そのデータが読出されるまでの時間と同期さ
れており、またメモリ回路７にメモリされた誤り
データ期間に基づき制御回路８により読出しアド
レス指定回路４が読出すアドレスをメモリ回路１
の誤りデータがメモリされているアドレス分だけ
飛ばして読出すようになつているため、前記誤り
データがメモリ回路１にメモリされ、一定時間後
にそれが読出されようとした時、読出しアドレス
指定回路４はそのメモリ回路１の誤りデータがメ
モリされているアドレスを飛ばして次に正常なデ
ータがメモリされているアドレスを読出す。
したがつて、誤りデータは出力されず、正常な
デイジタル信号が連続して出力されるものであ
る。この動作を第３図，第４図により図式化して
述べると、まず第３図はテープＴ上のａ点で切断
し、かつ継いだ状態を示したもので、これを再生
した時その継ぎ目ａの前後の範囲ｂに亘つてデー
タが誤る可能性がある。
デイジタル信号が連続して出力されるものであ
る。この動作を第３図，第４図により図式化して
述べると、まず第３図はテープＴ上のａ点で切断
し、かつ継いだ状態を示したもので、これを再生
した時その継ぎ目ａの前後の範囲ｂに亘つてデー
タが誤る可能性がある。
したがつて、いまメモリ回路１に時間ｅでこの
誤りデータがメモリされ、それが時系列的に時間
ｃで正に出力されようとした時、その誤りデータ
の時間がｂである場合、その時間を飛ばしてｄ点
に読出すところを移す動作を行なう。
誤りデータがメモリされ、それが時系列的に時間
ｃで正に出力されようとした時、その誤りデータ
の時間がｂである場合、その時間を飛ばしてｄ点
に読出すところを移す動作を行なう。
これにより、メモリ回路１からは正常なデータ
のみが読出されるのである。
のみが読出されるのである。
ここで、上記のような動作が１回行なわれると
メモリ回路１のメモリ可能容量はｅ，ｄ間だけと
なり、次に誤りデータが入力されるとさらにメモ
リ可能なアドレスが減少して行くため、何個所も
編集したテープを再生するにはメモリ回路１の容
量を非常に大きくする必要がある。
メモリ回路１のメモリ可能容量はｅ，ｄ間だけと
なり、次に誤りデータが入力されるとさらにメモ
リ可能なアドレスが減少して行くため、何個所も
編集したテープを再生するにはメモリ回路１の容
量を非常に大きくする必要がある。
このため、上記実施例ではメモリ回路７からゲ
ート回路５を前記読出しアドレス指定回路４が誤
りデータを飛ばして正常なデータがメモリされた
アドレスの読出し指定を行なうと同時にその読出
しアドレス指定回路４を第２のクロツク信号９に
より作動させるようにしたのである。
ート回路５を前記読出しアドレス指定回路４が誤
りデータを飛ばして正常なデータがメモリされた
アドレスの読出し指定を行なうと同時にその読出
しアドレス指定回路４を第２のクロツク信号９に
より作動させるようにしたのである。
これによりメモリ回路１へのデータ書込みクロ
ツクよりも読出しクロツクが遅くなるため、次第
にメモリ回路１のメモリ容量が拡大されて行く。
すなわち第４図において読出しがｄ点から徐々に
ｃ点の方へ移動されて行き、そしてこの読出しア
ドレスが最終アドレスに到達した時、それが比較
回路１０により書込みアドレスと読出しアドレス
の最大アドレス差として検出され、その出力によ
りゲート回路５が作動されて読出しアドレス指定
回路４の読出しクロツクは元の第１のクロツク信
号３に復帰し、したがつてメモリ回路１の遅延時
間は元の正常な状態に戻り、以降正常な動作が行
なわれる。
ツクよりも読出しクロツクが遅くなるため、次第
にメモリ回路１のメモリ容量が拡大されて行く。
すなわち第４図において読出しがｄ点から徐々に
ｃ点の方へ移動されて行き、そしてこの読出しア
ドレスが最終アドレスに到達した時、それが比較
回路１０により書込みアドレスと読出しアドレス
の最大アドレス差として検出され、その出力によ
りゲート回路５が作動されて読出しアドレス指定
回路４の読出しクロツクは元の第１のクロツク信
号３に復帰し、したがつてメモリ回路１の遅延時
間は元の正常な状態に戻り、以降正常な動作が行
なわれる。
ここで、実際のデイジタル信号の再生におい
て、例えばテープの継ぎ目による誤りデータ時間
を0.2秒としてメモリ回路１のサンプル数を
10K、第１のクロツク信号３を50KHz、第２のク
ロツク信号を49.5KHzと設定した場合、メモリ回
路１にメモリされた誤りデータを飛ばすことによ
りメモリ回路１のメモリ容量が減少してから元の
メモリ容量に戻るまでの時間は20秒となる。
て、例えばテープの継ぎ目による誤りデータ時間
を0.2秒としてメモリ回路１のサンプル数を
10K、第１のクロツク信号３を50KHz、第２のク
ロツク信号を49.5KHzと設定した場合、メモリ回
路１にメモリされた誤りデータを飛ばすことによ
りメモリ回路１のメモリ容量が減少してから元の
メモリ容量に戻るまでの時間は20秒となる。
なお、前記メモリ回路１のメモリ容量が減少し
た後元に戻るまでの間、データ読出しクロツクが
書込みクロツクよりも遅いため、音程が僅かに変
化するが、これは聴感上ほとんど判別できない程
度とすることができ、実質何らの支障はない。
た後元に戻るまでの間、データ読出しクロツクが
書込みクロツクよりも遅いため、音程が僅かに変
化するが、これは聴感上ほとんど判別できない程
度とすることができ、実質何らの支障はない。
以上の実施例から明らかなように、本発明によ
ればデイジタル信号の再生において、誤りデータ
によるノイズを発生させることなく再生すること
ができるため、例えばPCM録音されたテープを
切断して継いだ編集テープをその継ぎ目によるノ
イズ発生なく再生することができるものであり、
これはそのPCM録音されたテープの編集をアナ
ログ信号が録音されたテープの編集と同様の編集
を可能とする大きな効果が得られるものである。
ればデイジタル信号の再生において、誤りデータ
によるノイズを発生させることなく再生すること
ができるため、例えばPCM録音されたテープを
切断して継いだ編集テープをその継ぎ目によるノ
イズ発生なく再生することができるものであり、
これはそのPCM録音されたテープの編集をアナ
ログ信号が録音されたテープの編集と同様の編集
を可能とする大きな効果が得られるものである。
第１図はアナログ式録音再生機用テープの編集
を説明するための図、第２図は本発明の一実施例
を示すブロツク回路図、第３図はPCM録音再生
機用テープの編集を説明するための図、第４図は
メモリ回路のメモリ状態を時系列的に図式化した
図である。 Ｓ……再生デイジタル信号、１……メモリ回
路、２……書込みアドレス指定回路、３……第１
のクロツク信号、４……読出しアドレス指定回
路、５……ゲート回路、６……誤りデータ検出回
路、７……メモリ回路、８……制御回路、９……
第２のクロツク信号、１０……比較回路。
を説明するための図、第２図は本発明の一実施例
を示すブロツク回路図、第３図はPCM録音再生
機用テープの編集を説明するための図、第４図は
メモリ回路のメモリ状態を時系列的に図式化した
図である。 Ｓ……再生デイジタル信号、１……メモリ回
路、２……書込みアドレス指定回路、３……第１
のクロツク信号、４……読出しアドレス指定回
路、５……ゲート回路、６……誤りデータ検出回
路、７……メモリ回路、８……制御回路、９……
第２のクロツク信号、１０……比較回路。
Claims (1)
- １ デイジタル信号を入力し、遅延させて出力す
るメモリ回路と、前記デイジタル信号を入力し、
このデータ誤りを検出するデータ誤り検出回路
と、前記データ誤り検出回路によるデータ誤りの
検出動作に基づき前記メモリ回路にメモリされて
いる誤りデータを飛ばして次のデイジタル信号を
出力するように該メモリ回路を制御する手段を備
えたことを特徴とするデイジタル信号の再生装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4799078A JPS54139710A (en) | 1978-04-21 | 1978-04-21 | Reproducer of digial signals |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4799078A JPS54139710A (en) | 1978-04-21 | 1978-04-21 | Reproducer of digial signals |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8339178A Division JPS54139709A (en) | 1978-07-07 | 1978-07-07 | Reproducer of digital signals |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54139710A JPS54139710A (en) | 1979-10-30 |
| JPS6131548B2 true JPS6131548B2 (ja) | 1986-07-21 |
Family
ID=12790749
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4799078A Granted JPS54139710A (en) | 1978-04-21 | 1978-04-21 | Reproducer of digial signals |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS54139710A (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3569998D1 (en) * | 1984-06-01 | 1989-06-08 | Telefunken Fernseh & Rundfunk | Process for reducing the noticeability of errors in a digital audio signal |
| DE3420516C2 (de) * | 1984-06-01 | 1993-11-25 | Telefunken Fernseh & Rundfunk | Verfahren zur Verringerung der Wahrnehmbarkeit von Fehlern in einem digitalen Audiosignal |
| JPH0754616B2 (ja) * | 1985-02-12 | 1995-06-07 | ソニー株式会社 | デジタル信号の処理装置 |
-
1978
- 1978-04-21 JP JP4799078A patent/JPS54139710A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54139710A (en) | 1979-10-30 |
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